JPS61182233A - ウエハおよびその製造方法 - Google Patents

ウエハおよびその製造方法

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JPS61182233A
JPS61182233A JP2166585A JP2166585A JPS61182233A JP S61182233 A JPS61182233 A JP S61182233A JP 2166585 A JP2166585 A JP 2166585A JP 2166585 A JP2166585 A JP 2166585A JP S61182233 A JPS61182233 A JP S61182233A
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JP
Japan
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wafer
face
crystal defects
plane
subjected
Prior art date
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Pending
Application number
JP2166585A
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English (en)
Inventor
Masaru Tsukahara
塚原 優
Hirobumi Shimizu
博文 清水
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
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Publication of JPS61182233A publication Critical patent/JPS61182233A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/322Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
    • H01L21/3221Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明はウェハおよびその製造に適用して効果のある技
術に関する。
〔背景技術〕
たとえばシリコン(Si )のウェハを製造する場合く
単結晶引き上げされてスライスされたウェハに面加工を
施した後、イオン注入や熱処理、拡散処理等を行う。そ
の際、製造過程においてウェハの結晶欠陥が発生すると
、デバイスの歩留りを低下させてしまう。
そこで、ウェハのミラー面(表面)とは反対側の面であ
る裏面にバックダメージ加工を施すことにより、ゲッタ
リング効果を与えることで結晶欠陥の発生を抑制するこ
とが考えられる。
ところが、この場合には、サンドブラスト、研削、ある
いはレーザー加工等によるバックダメージ加工が特別に
必要であるので、ウェハ加工工数が増加する上に、バン
クダメージ加工の方法やそのばらつきによってゲッタリ
ング効果が左右され、コントロールが困難であり、また
ウェハの表裏両面が(100)面であって、結晶欠陥防
止効果も必ずしも十分なものとは言えない問題があるこ
とを本発明者は見い出した。
なお、ウェハの面加工については、株式会社工業調査会
、昭和57年11月10日発行、[電子材料J19’8
3年11月号別冊、P49〜P56に記載されている。
〔発明の目的〕
本発明の目的は、ウェハの結晶欠陥を防止することので
きる技術を提供することにある。
本発明の目的は、少ない加工工数で効率的に結晶欠陥防
止効果を得ることのできる技術を提供することにある。
本発明の他の目的は、デバイスの歩留りを向上させるこ
とのできる技術を提供することにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
〔発明の概要〕
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、次の通りである。
すなわち、ウェハの表面が(100)面、裏面が(11
1)面にアルカリエンチング等で加工されることにより
、ウェハ面の汚染を防止し、結晶欠陥を抑制でき、前記
目的を達成できるものであ〔実施例〕 第1図(al、 (bl、 (C1は本発明の一実施例
であるウェハの製造工程を示す断面図である。
この実施例におけるウェハ1はたとえばシリコン(Si
)で作られている。ウェハlはシリコン単結晶の引き上
げ後、オリエンテーションフラットの切削、ラッピング
あるいは研削加工を受ける(第1図(al参照)。この
状態では、ウェハ1の表面2も裏面3も結晶方位で見て
(100)面となっている。
次に、第1図falのウェハ1を水酸化カリウム(KO
H)または水酸化ナトリウム(NaOH)等のアルカリ
性エツチング液の中でアルカリエツチングすることによ
り、ウェハ1の表面2および裏面3の両方を(111)
面とする(第1図Tbl参照)。この(111)面はウ
ェハ面をたとえば5〜10μmのギザギザ状凹凸面にエ
ツチングすることにより得られる。
その後、ウェハ1のミラー面すなわち集積回路形成面で
ある表面2のみをミラー加工して(100)面とするが
、裏面3は(111)面のままである(第1図1cI参
照)。
このように、ウェハ1の裏面3を(111)面とするこ
とにより、ウェハ1の結晶欠陥の発生を抑制することが
できる。
すなわち、ウェハの結晶欠陥はウェハ面が汚染されてい
ると発生し易いが、汚染は(100)面よりも(111
)面の方が受けにくい。言い換えれば、結晶の(100
)面は大気中では酸化や種々のイオン等による化学反応
を(111)面よりも速く受け、酸化膜等を生じる等の
汚染を受は易い。したがって、本実施例のようにウェハ
lの裏面3を(111)面とすることにより、汚染を防
止し、結晶欠陥の発生を抑制することができ、デバイス
の歩留り向上を図ることができる。
〔効果〕
(1)、ウェハの表面を(100)面、裏面を(111
)面とすることにより、ウェハの汚染を防止できるので
、結晶欠陥の発生を抑制できる。
(2)、前記Tllにより、デバイスの歩留り向上を図
ることができる。
(3)、ラッピングまたは研削加工されたウェハにエツ
チングを施して少なくともその裏面に(111)面を形
成し、次いで表面を(100)面に加工することにより
、少ない加工工数で効率的なウェハ面加工を行うことが
できる。
以上本発明者によってなされた発明を実施例に基づき具
体的に説明したが、本発明は前記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。
たとえば、アルカリエツチングの材料等は前記以外のも
のを用いることができる。
〔利用分野〕
以上の説明では主として本発明者によってなされた発明
をその背景となった利用分野であるシリコンウェハに適
用した場合について説明したが、それに限定されるもの
ではなく、たとえば、化合物半導体装置の如く、シリコ
ン以外の材料を用いたウェハにも適用できる。
【図面の簡単な説明】
第1図[al、 (bl、 (c)は本発明の一実施例
であるウェハの製造工程を順次示す断面図である。 1・・・ウェハ、2・・・表面、3・・・裏面。 第  1  図

Claims (1)

  1. 【特許請求の範囲】 1、表面が(100)面、裏面が(111)面に加工さ
    れていることを特徴とするウェハ。 2、ウェハがシリコンウェハよりなることを特徴とする
    特許請求の範囲第1項記載のウェハ。 3、ラッピングまたは研削加工されたウェハにエッチン
    グを施して少なくともその裏面に(111)面を形成し
    、次いで表面を(100)面に加工することを特徴とす
    るウェハの製造方法。 4、エッチングがアルカリエッチングであることを特徴
    とする特許請求の範囲第3項記載のウェハの製造方法。
JP2166585A 1985-02-08 1985-02-08 ウエハおよびその製造方法 Pending JPS61182233A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0628992A2 (en) * 1993-06-08 1994-12-14 Shin-Etsu Handotai Company Limited Method of making semiconductor wafers
KR101261239B1 (ko) 2011-12-08 2013-05-07 삼성코닝정밀소재 주식회사 반도체 기판의 표면 가공 방법

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0628992A2 (en) * 1993-06-08 1994-12-14 Shin-Etsu Handotai Company Limited Method of making semiconductor wafers
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