JPS61164346A - エコ−キヤンセラ - Google Patents
エコ−キヤンセラInfo
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- JPS61164346A JPS61164346A JP642185A JP642185A JPS61164346A JP S61164346 A JPS61164346 A JP S61164346A JP 642185 A JP642185 A JP 642185A JP 642185 A JP642185 A JP 642185A JP S61164346 A JPS61164346 A JP S61164346A
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- Japan
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- circuit
- memory
- dispersion
- echo
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/02—Details
- H04B3/20—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other
- H04B3/23—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は通信衛星や海底ケーブルを用いた長距離電話回
線において発生するエコーを消去する、エコーキャンセ
ラに関するものである。
線において発生するエコーを消去する、エコーキャンセ
ラに関するものである。
従来の技術
近年、エコー経路の推定インパルス応答と受信信号とか
ら擬似エコー信号を合成し、実際のエコー信号から差し
引くことによりエコー信号を消去するエコーキャンセラ
が利用されるようになってきた。従来の技術としては、
例えば、文献「アンアダプティブエコーキャンセラーユ
ージングデジタルシグナルプロセッサーエルエスアイチ
ッブス」（Ｋ、Ｏｚａｗａ 、Ｔ 、Ａｒａｓｅｋｉ
、Ｙ、Ｌｔｏｈ、 ”ＡｎＡｄａｐｔｉｕｅ Ｅｃｈｏ
Ｃａｎｃｅｌｌｅｒ Ｕｓｉｎｇ ＤｉｇｉｔａｌＳ
ｉｇｎａｌ Ｐｒｏｃｅｓｓｏｒ ＬＳＩ Ｃｈｉｐ
ｓ”、Ｐｒｏｃ。
ら擬似エコー信号を合成し、実際のエコー信号から差し
引くことによりエコー信号を消去するエコーキャンセラ
が利用されるようになってきた。従来の技術としては、
例えば、文献「アンアダプティブエコーキャンセラーユ
ージングデジタルシグナルプロセッサーエルエスアイチ
ッブス」（Ｋ、Ｏｚａｗａ 、Ｔ 、Ａｒａｓｅｋｉ
、Ｙ、Ｌｔｏｈ、 ”ＡｎＡｄａｐｔｉｕｅ Ｅｃｈｏ
Ｃａｎｃｅｌｌｅｒ Ｕｓｉｎｇ ＤｉｇｉｔａｌＳ
ｉｇｎａｌ Ｐｒｏｃｅｓｓｏｒ ＬＳＩ Ｃｈｉｐ
ｓ”、Ｐｒｏｃ。
ＩＣＡＳＳＰ ８３ 、ＰＰ 、４６６−４６９ 、
Ａｐｒｉｌ １９８３）がある。
Ａｐｒｉｌ １９８３）がある。
以下図面を参照しながら、上述のような従来のエコーキ
ャンセラについて説明を行なう。
ャンセラについて説明を行なう。
第４図は従来のエコーキャンセラのブロック図を示すも
のである。第４図において、４１は受信信号入力端子、
４２は受信信号出力端子、４３は送信信号入力端子、４
４は送信信号出力端子、４５は予め定められた個数（こ
れをＮとする）の受信信号の単位時間毎の標本値を記憶
するＸメモリ、４６はエコー経路の推定インパルス応答
の単位時間毎の標本値を記憶するＨメモリ、４７はただ
み込み演算回路、４８は減算回路、４９は適応制御回路
である。
のである。第４図において、４１は受信信号入力端子、
４２は受信信号出力端子、４３は送信信号入力端子、４
４は送信信号出力端子、４５は予め定められた個数（こ
れをＮとする）の受信信号の単位時間毎の標本値を記憶
するＸメモリ、４６はエコー経路の推定インパルス応答
の単位時間毎の標本値を記憶するＨメモリ、４７はただ
み込み演算回路、４８は減算回路、４９は適応制御回路
である。
以上のように構成されたエコーキャンセラについて、以
下その動作について説明する。
下その動作について説明する。
受信信号出力端子４２と送信信号入力端子４３の間に存
在する未知変数であるエコー経路のインパルス応答の行
ベクトルをＨとし第（１）式に示す。
在する未知変数であるエコー経路のインパルス応答の行
ベクトルをＨとし第（１）式に示す。
ここでＮはエコーキャンセラで推定できるエコー経路の
推定インパルス応答の次数である。
推定インパルス応答の次数である。
Ｈ＝（ｈｌ、ｈ２．・・・・・・ｈＮ） ・・・・・
・・・・・・・・・・（１）時刻ｊにおけるＸメモリ４
．６の内容でちるところの受信信号入力端子４１から入
力された受信信号系列をｘｊ とし、第（２）式に示す
。
・・・・・・・・・・（１）時刻ｊにおけるＸメモリ４
．６の内容でちるところの受信信号入力端子４１から入
力された受信信号系列をｘｊ とし、第（２）式に示す
。
）（＋＝（ｘｊ−１，！、−２＋”°１Ｋ 、 −Ｎ
） −−−−−−°−（２）時刻ｊにおける送信信号入
力端子４３から入力されるエコー信号をｙ、とすると、
ｙｊとｘｊとＨは】 第（３）式に示すような関係にある。ただしＨ′はＨの
転置を表わす。
） −−−−−−°−（２）時刻ｊにおける送信信号入
力端子４３から入力されるエコー信号をｙ、とすると、
ｙｊとｘｊとＨは】 第（３）式に示すような関係にある。ただしＨ′はＨの
転置を表わす。
ｙ、＝Ｘ、−Ｈ’＝ΣＸ・ ・・ｈ・ ・・・・・・・
・・惨）ｉ＝１１−１ １ 時刻ｉにおけるＨメモリ４６の内容であるところのエコ
ー経路の推定インパルス応答の行ベクトルをＨ，とし、
第（４）式に示す。
・・惨）ｉ＝１１−１ １ 時刻ｉにおけるＨメモリ４６の内容であるところのエコ
ー経路の推定インパルス応答の行ベクトルをＨ，とし、
第（４）式に示す。
貧、＝（曾１．飽 ・・・・・漕￥） ・・・・・・
・・・・・・・・・（４）］ ］ ］’
］まず、たたみ込み演算回路４７は第（６）式
に示すようにＸメモリ４６の内容とＨメモリ４６の内容
とのたたみ込み演算を行ない、擬似エコー信号ｙ５を出
力する。
・・・・・・・・・（４）］ ］ ］’
］まず、たたみ込み演算回路４７は第（６）式
に示すようにＸメモリ４６の内容とＨメモリ４６の内容
とのたたみ込み演算を行ない、擬似エコー信号ｙ５を出
力する。
次に減算回路４８は第（６）式に示すように、第（３）
式から算出されるエコー信号Ｊから第（５）式に示した
擬似エコー信号’１２を差し引いてエコーを消去し、残
留エコー信号ｅｊ を出力する。
式から算出されるエコー信号Ｊから第（５）式に示した
擬似エコー信号’１２を差し引いてエコーを消去し、残
留エコー信号ｅｊ を出力する。
へ ・・・・・・・・・・・・・・・・・・
・・・（６）”ｊ＝ｙｊ−ｙｉ さらに適応制御回路４９は、既知の受信信号系列Ｘ・
および残留エコー信号ｅ、を用いて、第（７）式に示す
ように学習同定法によりＭ、を逐次修正する修正量であ
るΔＨ，を出力し、未知変数Ｈを推定する。ここでαは
０くα〈２なる定数を表わす。
・・・（６）”ｊ＝ｙｊ−ｙｉ さらに適応制御回路４９は、既知の受信信号系列Ｘ・
および残留エコー信号ｅ、を用いて、第（７）式に示す
ように学習同定法によりＭ、を逐次修正する修正量であ
るΔＨ，を出力し、未知変数Ｈを推定する。ここでαは
０くα〈２なる定数を表わす。
発明が解決しようとする問題点
しかしながら、上記のような構成では単位時間内に、第
（６）式に示すたたみ込み演算にＮ回と、第（η式に示
す推定インパルス応答の修正に約８回とで、合計約２Ｎ
回の乗算を行なわなければならず、単位時間が１２５
（μｓｅｃ：Ｉ、次数Ｎが３２０の場合には１秒間に約
６１２万回もの乗算を行なう必要があり、乗算器の動作
速度は著しく速いものが要求されるという問題点を有し
ていた。
（６）式に示すたたみ込み演算にＮ回と、第（η式に示
す推定インパルス応答の修正に約８回とで、合計約２Ｎ
回の乗算を行なわなければならず、単位時間が１２５
（μｓｅｃ：Ｉ、次数Ｎが３２０の場合には１秒間に約
６１２万回もの乗算を行なう必要があり、乗算器の動作
速度は著しく速いものが要求されるという問題点を有し
ていた。
本発明は上記問題点に鑑み、乗算回数が少なくてすみ、
ハードウェア化が容易なエコーキャンセラを提供するも
のである。
ハードウェア化が容易なエコーキャンセラを提供するも
のである。
問題点を解決するための手段
この目的を達成するだめに本発明のエコーキャンセラは
、予め定めた個数の受信信号の単位時間毎の標本値を記
憶する第１のメモリと、予め定めた個数のエコー経路の
推定インパルス応答の単位時間毎の標本値を記憶する第
２のメモリと、前記第２のメモリの内容の分散の大きい
部分を検出する分散計測回路と、前記分散計測回路によ
り分散が大きいと判断された部分は単位時間毎に前記第
１のメモリの内容と前記第２のメモリの内容とのたたみ
込み演算を行ない、前記分散計測回路忙より分散が小さ
いと判断された部分は複数単位時間毎に前記第１のメモ
リの内容と前記第２のメモリの内容とのたたみ込み演算
を行ない擬似エコー信号を作成するたたみ込み演算回路
と、エコー信号から前記たたみ込み演算回路により得ら
れた擬似エコー信号を差し引くことによりエコーを消去
する減算回路と、前記分散計測回路により分散が太きい
と判断された部分は単位時間毎に前記第２のメモリの内
容の修正を行ない、前記分散計測回路により分散が小さ
いと判断された部分は数単位時間毎に前記第２のメモリ
の内容の修正を行なう適応制御回路から構成されている
。
、予め定めた個数の受信信号の単位時間毎の標本値を記
憶する第１のメモリと、予め定めた個数のエコー経路の
推定インパルス応答の単位時間毎の標本値を記憶する第
２のメモリと、前記第２のメモリの内容の分散の大きい
部分を検出する分散計測回路と、前記分散計測回路によ
り分散が大きいと判断された部分は単位時間毎に前記第
１のメモリの内容と前記第２のメモリの内容とのたたみ
込み演算を行ない、前記分散計測回路忙より分散が小さ
いと判断された部分は複数単位時間毎に前記第１のメモ
リの内容と前記第２のメモリの内容とのたたみ込み演算
を行ない擬似エコー信号を作成するたたみ込み演算回路
と、エコー信号から前記たたみ込み演算回路により得ら
れた擬似エコー信号を差し引くことによりエコーを消去
する減算回路と、前記分散計測回路により分散が太きい
と判断された部分は単位時間毎に前記第２のメモリの内
容の修正を行ない、前記分散計測回路により分散が小さ
いと判断された部分は数単位時間毎に前記第２のメモリ
の内容の修正を行なう適応制御回路から構成されている
。
作 用
この構成によって、分散計測回路により分散が小さく、
エコーの消去には影響が小さいと判断されたエコー経路
の推定インパルス応答の部分は、複数単位時間毎にたた
み込み演算とエコー経路の推定インパルス応答の修正を
行なうので、単位時間毎に全ての部分のたたみ込み演算
と推定インパルス応答の修正を行なう従来の方法に比べ
、乗算回数を減少させることとなる。
エコーの消去には影響が小さいと判断されたエコー経路
の推定インパルス応答の部分は、複数単位時間毎にたた
み込み演算とエコー経路の推定インパルス応答の修正を
行なうので、単位時間毎に全ての部分のたたみ込み演算
と推定インパルス応答の修正を行なう従来の方法に比べ
、乗算回数を減少させることとなる。
実施例
以下本発明の一実施例について、図面を参照しながら説
明する。第１図は本発明の一実施例におけるエコーキャ
ンセラのブロック図を示すものである。第１図において
、１は受信信号入力端子、２は受信信号出力端子、３は
送信信号入力端子、４は送信信号出力端子、５は予め定
められた個数（これをＮとする）の受信信号の単位時間
毎の標本値を記憶するＸメモリ、６は予め定められた個
数のエコー経路の推定インパルス応答の単位時間毎の標
本値を記憶するＨメモリ、７はたたみ込み演算回路、８
は減算回路、９は適応制御回路、１０は分散計測回路で
ある。第２図は本発明の一実施例におけるエコーキャン
セラの分散計測回路１０のブロック図である。
明する。第１図は本発明の一実施例におけるエコーキャ
ンセラのブロック図を示すものである。第１図において
、１は受信信号入力端子、２は受信信号出力端子、３は
送信信号入力端子、４は送信信号出力端子、５は予め定
められた個数（これをＮとする）の受信信号の単位時間
毎の標本値を記憶するＸメモリ、６は予め定められた個
数のエコー経路の推定インパルス応答の単位時間毎の標
本値を記憶するＨメモリ、７はたたみ込み演算回路、８
は減算回路、９は適応制御回路、１０は分散計測回路で
ある。第２図は本発明の一実施例におけるエコーキャン
セラの分散計測回路１０のブロック図である。
第２図において、１６は絶対値回路、１６は加算回路、
１７は比較回路、１８は制御回路、１９は閾値、２０は
分散計測回路入力端子、２１は分散計測回路出力端子、
２２はクロック信号入力端子、２３はリセット信号、２
４はイネーブル信号、２５は比較回路出力信号である。
１７は比較回路、１８は制御回路、１９は閾値、２０は
分散計測回路入力端子、２１は分散計測回路出力端子、
２２はクロック信号入力端子、２３はリセット信号、２
４はイネーブル信号、２５は比較回路出力信号である。
以上のように構成されたエコーキャンセラについて、以
下その動作について説明する。
下その動作について説明する。
まず、分散計測回路１０は第（８）式忙示すように、Ｈ
メモリの内容のＬ標本ずつ毎の絶対値の和Ｄｋを求める
。このＤｋをもって、ｋの部分の分散を表すものとする
。Ｌ標本を単位としてＨメモリを分割すると、内部はＭ
（−Ｎ／Ｌ ）個のブロックに分かれることになる。こ
こでｋはブロック番号を示す。
メモリの内容のＬ標本ずつ毎の絶対値の和Ｄｋを求める
。このＤｋをもって、ｋの部分の分散を表すものとする
。Ｌ標本を単位としてＨメモリを分割すると、内部はＭ
（−Ｎ／Ｌ ）個のブロックに分かれることになる。こ
こでｋはブロック番号を示す。
ただし１≦に５Ｍである。
そしてＤｋを予め定められた閾値と比較し、Ｄｋ〉閾値
となるブロック番号ｋをたたみ込み演算回路７および適
応制御回路９に出力する。
となるブロック番号ｋをたたみ込み演算回路７および適
応制御回路９に出力する。
次に、たたみ込み演算回路７は、分散計測回路１ｏによ
り分散が大きいと判断されたブロックに対応する部分の
みのたたみ込み演算を第（６）式と同様に（ただしこの
場合、ｉは１からＮまでではなくなる）行ない、擬似エ
コー信号ｙ、を出力する。
り分散が大きいと判断されたブロックに対応する部分の
みのたたみ込み演算を第（６）式と同様に（ただしこの
場合、ｉは１からＮまでではなくなる）行ない、擬似エ
コー信号ｙ、を出力する。
】
次に減算回路８は第（６）式に従い送信信号入力端子３
から入力された１５ から、たたみ込み演算回路７か
ら出力された擬似エコー信号７ｉ を差し引き、残留
エコー信号ｅｊ を出力する。
から入力された１５ から、たたみ込み演算回路７か
ら出力された擬似エコー信号７ｉ を差し引き、残留
エコー信号ｅｊ を出力する。
次に適応制御回路９は、分散計測回路１０により分散が
大きいと判断されたブロックに対応する部分のみ、エコ
ー経路の推定インパルス応答の修正を第（方式と同様に
（ただしこの場合、ｉは１からＮまでではなくなる）行
なう。
大きいと判断されたブロックに対応する部分のみ、エコ
ー経路の推定インパルス応答の修正を第（方式と同様に
（ただしこの場合、ｉは１からＮまでではなくなる）行
なう。
次にたたみ込み演算回路７は全ブロックについて、ただ
み込み演算を第（６）式に従って行ない、擬似エコー信
号７ｊ＋１を出力する。
み込み演算を第（６）式に従って行ない、擬似エコー信
号７ｊ＋１を出力する。
次に減算回路８は第（６）式に従い、送信信号入力端子
３から入力された３’ Ｈ＋ １から、たたみ込み演算
回路７から出力された擬似エコー信号ｙｊ＋１を差し引
き、残留エコー信号ｅｊ＋１を出力する。
３から入力された３’ Ｈ＋ １から、たたみ込み演算
回路７から出力された擬似エコー信号ｙｊ＋１を差し引
き、残留エコー信号ｅｊ＋１を出力する。
次に適応制御回路９は全ブロックについて、エコー経路
の推定インパルス応答の修正を第（７）式に従って行な
う。
の推定インパルス応答の修正を第（７）式に従って行な
う。
そして初めのステップに戻るという操作を繰り返す。
ところで分散計測回路は第２図に示すように、まず、分
散計測回路入力端子２ｏから入力されたエコー経路の推
定インパルス応答り、は絶対値回路１５により絶対値１
ｈ、＋に変化される。
散計測回路入力端子２ｏから入力されたエコー経路の推
定インパルス応答り、は絶対値回路１５により絶対値１
ｈ、＋に変化される。
次に加算回路１６はその出力が入力に耶る構成となって
いるので第（８）式に示す演算を行なうことになり、第
にブロックの分散評価値Ｄｋは絶対値回路１６からｌｈ
、ｌがｋＬ標本人力された後に出力される。出力はＬ標
本毎に制御回路１８から送られるリセット信号２３によ
りリセットされる。
いるので第（８）式に示す演算を行なうことになり、第
にブロックの分散評価値Ｄｋは絶対値回路１６からｌｈ
、ｌがｋＬ標本人力された後に出力される。出力はＬ標
本毎に制御回路１８から送られるリセット信号２３によ
りリセットされる。
次に比較回路１７は、Ｌ標本毎に制御回路１８から送ら
れるイネーブル信号２４により加算回路１６の出力信号
Ｄｋを有効な値とみなし、＋側人力に入力された加算回
路１６の出力信号Ｄｋ と。
れるイネーブル信号２４により加算回路１６の出力信号
Ｄｋを有効な値とみなし、＋側人力に入力された加算回
路１６の出力信号Ｄｋ と。
−個入力に入力された閾値１９との比較を行ない、Ｄｋ
が閾値より大きい場合、つまり第にブロックの推定イン
パルス応答の分散が大きいと判断した場合には′°１”
を比較回路、出力信号２６として出力し、Ｄｋが等号を
含み閾値より小さい場合、つまり第にブロックの推定イ
ンノくルス応答の分散が小さいと判断した場合には“ｏ
”を比較回路出力信号２６として出力する。
が閾値より大きい場合、つまり第にブロックの推定イン
パルス応答の分散が大きいと判断した場合には′°１”
を比較回路、出力信号２６として出力し、Ｄｋが等号を
含み閾値より小さい場合、つまり第にブロックの推定イ
ンノくルス応答の分散が小さいと判断した場合には“ｏ
”を比較回路出力信号２６として出力する。
次に制御回路１８は比較回路が１”と出力したブロック
に対応するブロック番号ｋを分散計測回路出力端子２１
からただみ込み演算回路７および適応制御回路９に出力
する。クロック信号入力イミングでクロックパルスが入
力され、制御回路１８ではこのクロックパルスをカウン
トして、Ｌクロックパルス毎にイネーブル信号２４を出
力し、比較回路出力信号２６を入力し、リセット信号２
３を出力し、分散計測回路出力信号を出力する。第３図
に制御回路１８に入出力するこれらの信号のタイミング
チャートを示す。
に対応するブロック番号ｋを分散計測回路出力端子２１
からただみ込み演算回路７および適応制御回路９に出力
する。クロック信号入力イミングでクロックパルスが入
力され、制御回路１８ではこのクロックパルスをカウン
トして、Ｌクロックパルス毎にイネーブル信号２４を出
力し、比較回路出力信号２６を入力し、リセット信号２
３を出力し、分散計測回路出力信号を出力する。第３図
に制御回路１８に入出力するこれらの信号のタイミング
チャートを示す。
以上のように本実施例によれば、分散計測回路１ｏによ
り、Ｈメモリ６に記憶されているエコー経路の推定イン
パルス応答の分散が大きいと判断されたブロックは単位
時間毎にたたみ込み演算回路７によるたたみ込み演算、
および適応制御回路９による推定インパルス応答の修正
を行ない、分散計測回路１０により、Ｈメモリ６に記憶
されているエコー経路の推定インパルス応答の分散が小
さいと判断されたブロックは２単位時間毎にたたみ込み
演算回路７によるたたみ込み演算、および適応制御回路
９による推定インパルス応答の修正を行なうので、従来
約２Ｎ回必要だった乗算回数は、平均で（２Ｎ−ＫＬ）
回となる。ただしＮは推定インパルス応答の次数、Ｌは
ブロック長、２は分散計測回路１０により分散が小さい
と判断されたブロック数を示す。また、エコー経路が変
動した場合は、従来方式に比べて収束速度はやや劣るも
のの変動に追従することができる。
り、Ｈメモリ６に記憶されているエコー経路の推定イン
パルス応答の分散が大きいと判断されたブロックは単位
時間毎にたたみ込み演算回路７によるたたみ込み演算、
および適応制御回路９による推定インパルス応答の修正
を行ない、分散計測回路１０により、Ｈメモリ６に記憶
されているエコー経路の推定インパルス応答の分散が小
さいと判断されたブロックは２単位時間毎にたたみ込み
演算回路７によるたたみ込み演算、および適応制御回路
９による推定インパルス応答の修正を行なうので、従来
約２Ｎ回必要だった乗算回数は、平均で（２Ｎ−ＫＬ）
回となる。ただしＮは推定インパルス応答の次数、Ｌは
ブロック長、２は分散計測回路１０により分散が小さい
と判断されたブロック数を示す。また、エコー経路が変
動した場合は、従来方式に比べて収束速度はやや劣るも
のの変動に追従することができる。
発明の効果
本発明は分散計測回路を設けることにより、エコー経路
の推定インパルス応答の分散が小さい、つまりエコーの
消去に影響の小さい部分は、たたみ込み演算および推定
インパルス応答の修正を複数単位時間毎に行なうことに
より、乗算回数を減らすことができ、さらに分散計測回
路は絶対値回路と加算回路と比較回路と制御回路とで構
成したことにより、簡単に推定インパルス応答の部分毎
の分散を求めることができるのでハードウェア化が容易
であるという効果を得ることができる優れたエコーキャ
ンセラを実現できるものである。
の推定インパルス応答の分散が小さい、つまりエコーの
消去に影響の小さい部分は、たたみ込み演算および推定
インパルス応答の修正を複数単位時間毎に行なうことに
より、乗算回数を減らすことができ、さらに分散計測回
路は絶対値回路と加算回路と比較回路と制御回路とで構
成したことにより、簡単に推定インパルス応答の部分毎
の分散を求めることができるのでハードウェア化が容易
であるという効果を得ることができる優れたエコーキャ
ンセラを実現できるものである。
第１図は本発明の一実施例におけるエコーキャンセラの
ブロック図、第２図は同エコーキャンセラの分散計測回
路のブロック図、第３図は同分散計測回路の制御回路の
タイミングチャート、第４図は従来のエコーキャンセラ
のブロック図である。 ５・・・・−・Ｘメモリ、６・・・・・・Ｈメモリ、７
・・・・・・たたみ込み演算回路、８・・・・・・減算
回路、９・・・・・・適応制御回路、１０・・・・・・
分散計測回路。
ブロック図、第２図は同エコーキャンセラの分散計測回
路のブロック図、第３図は同分散計測回路の制御回路の
タイミングチャート、第４図は従来のエコーキャンセラ
のブロック図である。 ５・・・・−・Ｘメモリ、６・・・・・・Ｈメモリ、７
・・・・・・たたみ込み演算回路、８・・・・・・減算
回路、９・・・・・・適応制御回路、１０・・・・・・
分散計測回路。
Claims (2)
- （１）予め定めた個数の受信信号の単位時間毎の標本値
を記憶する第１のメモリと、予め定めた個数のエコー径
路の推定インパルス応答の単位時間毎の標本値を記憶す
る第２のメモリと、前記第２のメモリの内容の分散の大
きい部分を検出する分散計測回路と、前記分散計測回路
により分散が大きいと判断された部分は単位時間毎に前
記第１のメモリの内容と前記第２のメモリの内容とのた
たみ込み演算を行ない、前記分散計測回路により分散が
小さいと判断された部分は複数単位時間毎に前記第１の
メモリの内容と前記第２のメモリの内容とのたたみ込み
演算を行ない擬似エコー信号を作成するたたみ込み演算
回路と、エコー信号から前記たたみ込み演算回路により
得られた擬似エコー信号を差し引くことによりエコーを
消去する減算回路と、前記分散計測回路により分散が大
きいと判断された部分は単位時間毎に前記第２のメモリ
の内容の修正を行ない、前記分散計測回路により分散が
小さいと判断された部分は複数単位時間毎に前記第２の
メモリの内容の修正を行なう適応制御回路とを備えたこ
とを特徴とするエコーキャンセラ。 - （２）分散計測回路は、第２のメモリの内容を絶対値に
変換する絶対値回路と、前記絶対値回路の出力の複数標
本ずつ毎の和を求める加算回路と、前記加算回路の出力
と予め定めた閾値とを比較する比較回路と、前記比較回
路の出力に基づいて前記第２のメモリの分散の大きい部
分の場所の情報を出力する制御回路とを有することを特
徴とする特許請求の範囲第１項記載のエコーキャンセラ
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP642185A JPS61164346A (ja) | 1985-01-17 | 1985-01-17 | エコ−キヤンセラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP642185A JPS61164346A (ja) | 1985-01-17 | 1985-01-17 | エコ−キヤンセラ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61164346A true JPS61164346A (ja) | 1986-07-25 |
Family
ID=11637904
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP642185A Pending JPS61164346A (ja) | 1985-01-17 | 1985-01-17 | エコ−キヤンセラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61164346A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0786991A (ja) * | 1993-09-10 | 1995-03-31 | Nec Corp | エコー消去方法およびエコーキャンセラ |
| EP1083897A4 (en) * | 1998-06-03 | 2003-01-02 | Merck & Co Inc | HIV INTEGRASE INHIBITORS |
-
1985
- 1985-01-17 JP JP642185A patent/JPS61164346A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0786991A (ja) * | 1993-09-10 | 1995-03-31 | Nec Corp | エコー消去方法およびエコーキャンセラ |
| EP1083897A4 (en) * | 1998-06-03 | 2003-01-02 | Merck & Co Inc | HIV INTEGRASE INHIBITORS |
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