JPS61146020A - 電子楽器の楽音波形処理装置 - Google Patents
電子楽器の楽音波形処理装置Info
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- JPS61146020A JPS61146020A JP59269375A JP26937584A JPS61146020A JP S61146020 A JPS61146020 A JP S61146020A JP 59269375 A JP59269375 A JP 59269375A JP 26937584 A JP26937584 A JP 26937584A JP S61146020 A JPS61146020 A JP S61146020A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔童東上の利用分野〕
この発明は、例えば楽音信号等の周期性を有する信号を
ディジタル的に処理する場合に用いられる信号処理装置
に関する。
ディジタル的に処理する場合に用いられる信号処理装置
に関する。
音声信号、楽音信号等のアナログ信号を逐次サンプリン
グしてディジタルサンプリングデータに変換し、処理す
る技術は、音声合成、電子楽器、データ通信等の分野に
おいて広く用いられている。
グしてディジタルサンプリングデータに変換し、処理す
る技術は、音声合成、電子楽器、データ通信等の分野に
おいて広く用いられている。
ところで、この種の技術において特に重要な点は、扱う
べきディジタルデータのビット数をいかに少くするか（
いかくデータ圧縮をするか）という点であり、このため
種々のデータ圧縮方法が考えられ【いる。
べきディジタルデータのビット数をいかに少くするか（
いかくデータ圧縮をするか）という点であり、このため
種々のデータ圧縮方法が考えられ【いる。
第７図はデータ圧縮回路の一般的構成を示す図である。
この図において、ｌはディジタルサンプリングデータＳ
Ｄが逐次供給される入力端子、２は予測値発生回路であ
る。この予測値発生回路２は、過去のサンプリングデー
タＳＤから現在のサンプリングデータＳＤの値を予測し
、この予測結果を予測値Ｙとして減算ａ３へ出力する。
Ｄが逐次供給される入力端子、２は予測値発生回路であ
る。この予測値発生回路２は、過去のサンプリングデー
タＳＤから現在のサンプリングデータＳＤの値を予測し
、この予測結果を予測値Ｙとして減算ａ３へ出力する。
減算器３は現在のサンプリングデータＳＤから予測値Ｙ
を減算し、この減算結果をデータＤとしてコーグ４へ出
力する。ここで、予測値Ｙは現在のサンプリングデータ
ＳＤｋ近い値であり、したがって、減−器３の出力デー
タＤの値はサンプリングデータＳＤの値よりはるかく小
さい値となり、そのビット数も少くなる。すなわち、予
測値発生回路２および減算器３からなるデータ圧縮回路
５によってデータ圧縮が行われる。そして、この圧縮さ
れたデータＤが＝−ダ５において例えばハフマンコード
、シャノンファノコード等に変換され、これにより更に
データ圧縮が行われ、出力端子６から出力される。出力
端子６から出力されたデータは、例えば他所へ伝送され
、あるいはメモリに記憶される。
を減算し、この減算結果をデータＤとしてコーグ４へ出
力する。ここで、予測値Ｙは現在のサンプリングデータ
ＳＤｋ近い値であり、したがって、減−器３の出力デー
タＤの値はサンプリングデータＳＤの値よりはるかく小
さい値となり、そのビット数も少くなる。すなわち、予
測値発生回路２および減算器３からなるデータ圧縮回路
５によってデータ圧縮が行われる。そして、この圧縮さ
れたデータＤが＝−ダ５において例えばハフマンコード
、シャノンファノコード等に変換され、これにより更に
データ圧縮が行われ、出力端子６から出力される。出力
端子６から出力されたデータは、例えば他所へ伝送され
、あるいはメモリに記憶される。
＠８図は８７図の回路によって圧縮されたデータを復調
する復調回路の構成を示す図であり、入力端子７へ供給
されたデータは、コーグ５と逆の変換を行うデコーダ８
によってデータＤに戻され、次いで加算ｉ！１ｉＦ９お
よび予測値発生回路２から構成される復調回路１０によ
ってサンプリングデータ５Ｄ）Ｃ戻される。
する復調回路の構成を示す図であり、入力端子７へ供給
されたデータは、コーグ５と逆の変換を行うデコーダ８
によってデータＤに戻され、次いで加算ｉ！１ｉＦ９お
よび予測値発生回路２から構成される復調回路１０によ
ってサンプリングデータ５Ｄ）Ｃ戻される。
第９図は第７図のデータ圧縮回路５の最も簡単な構成例
を示す図であり、この回路によるデータ圧縮方法はＤ
Ｐ ＣＭ （Ｄ ｉｆｆ＠ｒＩｎｔｉ社ｐｕｍａｓ Ｃ
（ＸｌｓＭｏａｄａｔｌｏｎ）と呼ばれる。この回路に
おいて、符号１２は入力データを１サンプルタイム遅延
させる遅延要素であり、例えばＤＷフリップフロップが
用いられる。第１０図に第９図の回路によつ焔圧縮され
たデータを復調する復調回路の構成を示す。
を示す図であり、この回路によるデータ圧縮方法はＤ
Ｐ ＣＭ （Ｄ ｉｆｆ＠ｒＩｎｔｉ社ｐｕｍａｓ Ｃ
（ＸｌｓＭｏａｄａｔｌｏｎ）と呼ばれる。この回路に
おいて、符号１２は入力データを１サンプルタイム遅延
させる遅延要素であり、例えばＤＷフリップフロップが
用いられる。第１０図に第９図の回路によつ焔圧縮され
たデータを復調する復調回路の構成を示す。
なお、以下、第９図、＠１０図の回路を各々ｒｌｆｌ圧
縮回路１３．ＤＰＣＭ復調回路１４と称する。
縮回路１３．ＤＰＣＭ復調回路１４と称する。
ところで、もとの信号（楽音信号等）が滑らかな波形の
信号である場合は、第９図に示す回路を、第１１図に示
すよ５に多段接続することによって、より大きなデータ
圧縮効率を得ることができる。
信号である場合は、第９図に示す回路を、第１１図に示
すよ５に多段接続することによって、より大きなデータ
圧縮効率を得ることができる。
なお、第１２図は第１１図の復調回路である。しかし、
第１１図の回路の段数がある程度以上大きい場合は、い
わゆる線形予測法ＩＣｓづいてデータ圧縮回路を構成し
た方がより大ぎい圧縮効率を得ることができる。第１５
図にその構成を示し、また第１４図に復調回路の構成を
示す。なお、これらの図においてＭは乗算器、＆１〜＆
ｎは乗算係数Ｃ乗算される値）である。乗算係数ａ１〜
＆ｎは入力データの自己相関列による正規化方程式を解
くことにより求められる。
第１１図の回路の段数がある程度以上大きい場合は、い
わゆる線形予測法ＩＣｓづいてデータ圧縮回路を構成し
た方がより大ぎい圧縮効率を得ることができる。第１５
図にその構成を示し、また第１４図に復調回路の構成を
示す。なお、これらの図においてＭは乗算器、＆１〜＆
ｎは乗算係数Ｃ乗算される値）である。乗算係数ａ１〜
＆ｎは入力データの自己相関列による正規化方程式を解
くことにより求められる。
上述した各データ圧縮回路によれば、有効にデータ圧縮
を行うことができるが、電子楽器等の分野においては、
扱われるデータ量が極めて膨大であるため、さらに圧縮
効率を上げることが望まれている。
を行うことができるが、電子楽器等の分野においては、
扱われるデータ量が極めて膨大であるため、さらに圧縮
効率を上げることが望まれている。
そこでこの発明は、特に楽音信号のような周期性を有す
る信号の処理において、上述した従来のものよりさらに
データ量を圧縮することができる信号処理装置を提供す
ることを目的としている。
る信号の処理において、上述した従来のものよりさらに
データ量を圧縮することができる信号処理装置を提供す
ることを目的としている。
第１発明：
周期性を有する被処理信号を１〜ｎ周期遅延させた遅延
信号を各々出力する遅延手段と、前記各遅延信号の各々
に係数を乗算する乗算手段と、前記被処理信号から前記
係数が乗算された各遅延信号をそれぞれ減算する演算手
段とを具備し、前記Ｘ算手段の出力を処理済信号として
出力する。
信号を各々出力する遅延手段と、前記各遅延信号の各々
に係数を乗算する乗算手段と、前記被処理信号から前記
係数が乗算された各遅延信号をそれぞれ減算する演算手
段とを具備し、前記Ｘ算手段の出力を処理済信号として
出力する。
第２発明：
上記第１発明によって得られた処理済信号をもとの信号
に戻す信号処Ｍ？ｃ詮であり、加算手段と、この加算手
段の出力を１〜ｎ周期遅延させた信号を出力する遅延手
段と、この遅延手段の各出力に係数を乗算する乗算手段
とを具備し、前記加算手段は前記処理済信号と前記乗算
手段の各出力とを加算し【出力する。
に戻す信号処Ｍ？ｃ詮であり、加算手段と、この加算手
段の出力を１〜ｎ周期遅延させた信号を出力する遅延手
段と、この遅延手段の各出力に係数を乗算する乗算手段
とを具備し、前記加算手段は前記処理済信号と前記乗算
手段の各出力とを加算し【出力する。
第３発明：
入力端へ供給される信号を所定周期遅延させる遅延手段
と、前記入力端へ供給される信号から前記遅延手段の出
力を減算する加算手段とからなる信号圧縮回路を複数個
縦続接続して構成される。
と、前記入力端へ供給される信号から前記遅延手段の出
力を減算する加算手段とからなる信号圧縮回路を複数個
縦続接続して構成される。
第４発明：
上記第３発明によって圧縮された信号をもとの信号に戻
す信号処理装置であり、加算手段と、前記加算手段の出
力を所定周期遅延させて前記加算手段の入力端へ供給す
る遅延手段とからなる復調回路を前記信号圧縮回路と同
数縦続接続して構成される。
す信号処理装置であり、加算手段と、前記加算手段の出
力を所定周期遅延させて前記加算手段の入力端へ供給す
る遅延手段とからなる復調回路を前記信号圧縮回路と同
数縦続接続して構成される。
第１図は第１発明の一実施例による信号処理装置１６を
適用したデータ圧縮回路の構成を示すブロック図である
。この図において４９、Ｔｌは入力４子であり、この入
力端子Ｔｌへは楽音信号を一定時間間隔でサンプリング
したディジタルサンプリングデータＳＤが逐次供給され
る。この場合、楽音信号の１周期間のサンプル点数は鴫
である。そして、入力端子ＴＩへ供給されたサンプリン
グデータＳＤは、Ｄ Ｐ （’ ＭＥＥＮ回路１３１ｆ
Ｃよってデータ圧縮され、データＤＩとして信号処理装
置１６へ供給される。第２図はサンプリングデータＳＤ
およびデータＤＩの一例をアナログ波形によって示した
図である。
適用したデータ圧縮回路の構成を示すブロック図である
。この図において４９、Ｔｌは入力４子であり、この入
力端子Ｔｌへは楽音信号を一定時間間隔でサンプリング
したディジタルサンプリングデータＳＤが逐次供給され
る。この場合、楽音信号の１周期間のサンプル点数は鴫
である。そして、入力端子ＴＩへ供給されたサンプリン
グデータＳＤは、Ｄ Ｐ （’ ＭＥＥＮ回路１３１ｆ
Ｃよってデータ圧縮され、データＤＩとして信号処理装
置１６へ供給される。第２図はサンプリングデータＳＤ
およびデータＤＩの一例をアナログ波形によって示した
図である。
信号処理装置１６はデータＤ１を圧縮する回路であり、
予測値発生回路１７と減算６２２とから構成される。予
測値発生回路１７において、１８−１〜１８−Ｐは各々
入力されるデータをｍサンプルタイム（すなわち、楽音
信号の１ｊＱ期）遅延させて出力する遅延要素であり、
例えばｍステージのシフトレジスタが用いられる。デー
タＤ１はこれらの遅延要素１８−１〜１８−Ｐによって
１〜Ｐ周期遅延されて乗算器１９−１〜１９−Ｐへ供給
される。乗算５１９−１〜１９−Ｐは各々、入力される
データに係数ｂ１〜ｂｐを乗算し、加算器２０−１．２
０−２・・・へ出力する。加算器２０−１゜２０−２−
・・ハ乗算５１９−１〜１９−Ｐノ各出力を加算し、こ
の加算結果を予測値Ｙｌとして減算器２２へ出力する。
予測値発生回路１７と減算６２２とから構成される。予
測値発生回路１７において、１８−１〜１８−Ｐは各々
入力されるデータをｍサンプルタイム（すなわち、楽音
信号の１ｊＱ期）遅延させて出力する遅延要素であり、
例えばｍステージのシフトレジスタが用いられる。デー
タＤ１はこれらの遅延要素１８−１〜１８−Ｐによって
１〜Ｐ周期遅延されて乗算器１９−１〜１９−Ｐへ供給
される。乗算５１９−１〜１９−Ｐは各々、入力される
データに係数ｂ１〜ｂｐを乗算し、加算器２０−１．２
０−２・・・へ出力する。加算器２０−１゜２０−２−
・・ハ乗算５１９−１〜１９−Ｐノ各出力を加算し、こ
の加算結果を予測値Ｙｌとして減算器２２へ出力する。
減算！２２はデータＤ１から予測値Ｙｌを減算し、この
減算結果をデータＤ２とし【コーグ４へ出力する。コー
グ４（第７図参照）はデータＤ２をコード変換し、デー
タＤ３として出力端子Ｔ２へ供給する。この出力端子Ｔ
２に得られるデータＤ３がメモリに記憶され、あるいは
他所へ伝送される。
減算結果をデータＤ２とし【コーグ４へ出力する。コー
グ４（第７図参照）はデータＤ２をコード変換し、デー
タＤ３として出力端子Ｔ２へ供給する。この出力端子Ｔ
２に得られるデータＤ３がメモリに記憶され、あるいは
他所へ伝送される。
以上の構成において、データＤＩは第２図から明らかな
よう）ｃ周期性を有しており、楽音信号の周期と等しい
周期で変化している。したがって、現在のデータＤＩを
、１〜Ｐ周期前の各データＤ１から予測することが可能
である。予測値発生回路１７は上記の鑑点から構成され
た回路であり、乗算器１９−１〜１９−Ｐの係数ｂ１〜
ｂｐを適切に決めるととくより、現在のデータＤ１に極
めて近い予測［Ｙｌを発生することができる。なお、遅
延要素１８の数が多いほど現在のデータＴ）ＩＫより近
い予測値Ｙｌを発生することができる。そして、予測値
Ｙ１が現在のデータＤ１に近いはどデータＤ２として圧
縮効率の高いデータｔ４ることができる。
よう）ｃ周期性を有しており、楽音信号の周期と等しい
周期で変化している。したがって、現在のデータＤＩを
、１〜Ｐ周期前の各データＤ１から予測することが可能
である。予測値発生回路１７は上記の鑑点から構成され
た回路であり、乗算器１９−１〜１９−Ｐの係数ｂ１〜
ｂｐを適切に決めるととくより、現在のデータＤ１に極
めて近い予測［Ｙｌを発生することができる。なお、遅
延要素１８の数が多いほど現在のデータＴ）ＩＫより近
い予測値Ｙｌを発生することができる。そして、予測値
Ｙ１が現在のデータＤ１に近いはどデータＤ２として圧
縮効率の高いデータｔ４ることができる。
次に、係数−１〜ｈｐの決定方法について説明するつこ
の係数ｂ１〜ｂＰは統計学上の手法により決定される。
の係数ｂ１〜ｂＰは統計学上の手法により決定される。
いま、データＤｌの各蝮を、ｙ・＊ ’１ ｍ ’＠
””” ’ｊｌ ｇ ’ｊｌ＋ ｌ ＠ ’３１＋コ”
°。
””” ’ｊｌ ｇ ’ｊｌ＋ ｌ ＠ ’３１＋コ”
°。
とすると、浦号４６１１装置１６は、
ｙ＠、 ｙ臘、１１膳 ””” ９７ｏ、 ７ｙ、
ｙ、杓ｙ！鳳◆１・・・、・・うｙ１１’ｌｌｌ−１＊
’雪ｍ−１＃ ’ａ １ｌ−１””’！ｌ−１１１な
る腫１１ Ｉ） ＃ Ａ列各々ＩＩＣ珠立に作用してい
る。そこで、ｙｏｌ、〜’ｍ−＠ ＠ Ｉ の自己相関
列をそれぞれｓ ｒ＠、Ｉ ”’ Ｘ”ｔｍ−１、ｌ
とし１に−・ として祈たな自己相関列を求め、と九による正規方感式
を解くこと和よＯ１係Ｉ＆ｂ１〜ｂＰを求めることがで
きる。
ｙ、杓ｙ！鳳◆１・・・、・・うｙ１１’ｌｌｌ−１＊
’雪ｍ−１＃ ’ａ １ｌ−１””’！ｌ−１１１な
る腫１１ Ｉ） ＃ Ａ列各々ＩＩＣ珠立に作用してい
る。そこで、ｙｏｌ、〜’ｍ−＠ ＠ Ｉ の自己相関
列をそれぞれｓ ｒ＠、Ｉ ”’ Ｘ”ｔｍ−１、ｌ
とし１に−・ として祈たな自己相関列を求め、と九による正規方感式
を解くこと和よＯ１係Ｉ＆ｂ１〜ｂＰを求めることがで
きる。
丁なわち、まず、自己相関列を次のようにして求めるａ
ｆｉ初に一人力列ｙｘＬを次のように分解するＯ 次に、自己相関列を各々についてｅ′ｌＫシ、そのＳを
真の自己＃ｌ＆＆ｌへとする、 データＤ２を琥小とするｍ歌ｂ１〜ｂＰは次の正規万感
式を解くことにより得ることができる。
ｆｉ初に一人力列ｙｘＬを次のように分解するＯ 次に、自己相関列を各々についてｅ′ｌＫシ、そのＳを
真の自己＃ｌ＆＆ｌへとする、 データＤ２を琥小とするｍ歌ｂ１〜ｂＰは次の正規万感
式を解くことにより得ることができる。
なお、以上の手順は次の手順と等価である。ま’！Ｌ
＝ＴＩ！Ｉｎ （ｎ ｚ’ｓ ２ ”・”ａＰ ）
””Ｃηなる式に基づい【求める。
＝ＴＩ！Ｉｎ （ｎ ｚ’ｓ ２ ”・”ａＰ ）
””Ｃηなる式に基づい【求める。
また、圧定な自己相関列の巌型和は圧定であることが知
られているので、係ａｂｌ〜ｂｐによる復調系（第５図
参照）もまた安定である。
られているので、係ａｂｌ〜ｂｐによる復調系（第５図
参照）もまた安定である。
次に％第２発明の実施例につい【説明する。第３図は、
第１凶の回路によって圧縮されたデータＤ３１に：もと
のナングリングデータＳＤに戻す復調回路の構成を示す
図である。この図において、Ｔ３は入力端子であり、こ
の入力端子Ｔ３へは、データＤ３が、第１図の出力端子
Ｔ２から出力された時と同一の順序で、かつ、同一のタ
イミングで逐次供給される。そして、このデータＤ３が
デコーダ８によりデータＤ２に逆変換され、第２発明の
実施例による信号処理装置３０へ逐次供給される。
第１凶の回路によって圧縮されたデータＤ３１に：もと
のナングリングデータＳＤに戻す復調回路の構成を示す
図である。この図において、Ｔ３は入力端子であり、こ
の入力端子Ｔ３へは、データＤ３が、第１図の出力端子
Ｔ２から出力された時と同一の順序で、かつ、同一のタ
イミングで逐次供給される。そして、このデータＤ３が
デコーダ８によりデータＤ２に逆変換され、第２発明の
実施例による信号処理装置３０へ逐次供給される。
信号処理装置３０は、データＤ２をデータＤｌ：復調す
る回路であり、加算！！１３１と、第１図のものと全く
同一構成による予測値発生回路１７とから構成されてい
る。この信号処理ｔｃｔｉ１３０の基本構成は、第８図
の加算器９および予測値発生回路２かも構成される復調
回路と同じであ考、データＤ２はこの信号処理装置３０
に：よってデータＤ１に復調され、ＤＰＣＭ復調回路１
４へ供給される。
る回路であり、加算！！１３１と、第１図のものと全く
同一構成による予測値発生回路１７とから構成されてい
る。この信号処理ｔｃｔｉ１３０の基本構成は、第８図
の加算器９および予測値発生回路２かも構成される復調
回路と同じであ考、データＤ２はこの信号処理装置３０
に：よってデータＤ１に復調され、ＤＰＣＭ復調回路１
４へ供給される。
ＤＰＣＭ復調回路１４は、データＤＩをサンプリングデ
ータＳＤＫ復調し、出力端子Ｔ４へ供給する。
ータＳＤＫ復調し、出力端子Ｔ４へ供給する。
次に、第３発明の実施例を第４図を参照して説明する。
第４図において、入力端子ＴＩへ供給されたサンプリン
グデータＳＤは、ＤＰＣＭ圧縮回路１３．１３によって
圧縮され、データＤ４として第３発明の実施例による信
号処理装置４０へ供給される。この信号処理装置４０は
データＤ４をさらに圧縮し、データＤ５として出力する
もので、減算器４１と鳳サンプルタイムの遅延要素４２
とからなる圧縮回路４３を複数個縦続接続してなるもの
である。ここで、もとの信号（楽音信号等）が周期性を
有するならば、データＤ４にも周期性が残っており、し
たがって、遅延要素４２が予測値発生回路として動作し
、圧縮回路４３に、よるデータ圧縮が可能となる。そし
て、この圧縮回路４を複数個縦続接続すれば、さらにデ
ータ圧縮を行うことができる。この信号処理装ｆｉ１４
Ｇから出力されたデータＤ５は、コーグ４によってコー
ド変換され、データＤ６として出力端子Ｔ２へ供給され
る。
グデータＳＤは、ＤＰＣＭ圧縮回路１３．１３によって
圧縮され、データＤ４として第３発明の実施例による信
号処理装置４０へ供給される。この信号処理装置４０は
データＤ４をさらに圧縮し、データＤ５として出力する
もので、減算器４１と鳳サンプルタイムの遅延要素４２
とからなる圧縮回路４３を複数個縦続接続してなるもの
である。ここで、もとの信号（楽音信号等）が周期性を
有するならば、データＤ４にも周期性が残っており、し
たがって、遅延要素４２が予測値発生回路として動作し
、圧縮回路４３に、よるデータ圧縮が可能となる。そし
て、この圧縮回路４を複数個縦続接続すれば、さらにデ
ータ圧縮を行うことができる。この信号処理装ｆｉ１４
Ｇから出力されたデータＤ５は、コーグ４によってコー
ド変換され、データＤ６として出力端子Ｔ２へ供給され
る。
次に、第４発明の実施例を第５図を参照して説明する。
第５図は第４図の回路によって圧縮されたデータＤ６を
復調する復調回路の構成を示す図であり、入力端子て３
へ供給されたデータＤ６はデ；−ダ８によってデータＤ
５に戻され、第４発明の実施例による信号処理装置４５
へ供給される。
復調する復調回路の構成を示す図であり、入力端子て３
へ供給されたデータＤ６はデ；−ダ８によってデータＤ
５に戻され、第４発明の実施例による信号処理装置４５
へ供給される。
信号処理装置４５は、加算器４６と、囚サンプルタイム
の遅延−１！素４７とからなる復調回路４８を、第４図
の圧縮回路４３０個数と等しい数だけ縦続接続したもの
で、データＤ５をデータＤ４に復調して出力する。出力
されたデータＤ４は、ＤＰｃＭ復調回路１４．１４によ
りもとのサンプリングデータ５Ｄ）Ｃ戻され、出力端子
Ｔ４へ供給される。
の遅延−１！素４７とからなる復調回路４８を、第４図
の圧縮回路４３０個数と等しい数だけ縦続接続したもの
で、データＤ５をデータＤ４に復調して出力する。出力
されたデータＤ４は、ＤＰｃＭ復調回路１４．１４によ
りもとのサンプリングデータ５Ｄ）Ｃ戻され、出力端子
Ｔ４へ供給される。
なお、上述した第１図、第４図の回路においては、ディ
ジタルサンプリングデータＳＤをデータ圧縮しているが
、ＤＰＣＭＥＥＮ１回路１３％信号回路１筐 のアナログ信号をこれらの回路によってデータ圧縮した
後ディジタルデータに変換するようにしてもよい。
ジタルサンプリングデータＳＤをデータ圧縮しているが
、ＤＰＣＭＥＥＮ１回路１３％信号回路１筐 のアナログ信号をこれらの回路によってデータ圧縮した
後ディジタルデータに変換するようにしてもよい。
次に、上述した実施例の応用例について説明する。第６
図は第３図に示す回路を適用した電子楽器の構成例を示
すブロック図である。この図忙おいて、メモリＭには、
楽音信号の立上りから終了に至るまでの全波形をサンプ
リングしたサンプリングデータな、第１図の回路によっ
て圧縮したデータＣ以下、楽音データと称する１が、各
音色Ｃピアノ音．フルート音等）毎に，かつ各音高毎に
記憶されている。そして、音色選択部５０によっていず
れかの音色が選択さ糺ると、音色選択部５０の出力デー
タＴＣＫよって、その音色に対応する楽音データが記憶
されているメモリＭの記憶エリアが指定される。次に％
鍵盤５１のいずれかの鍵が押下されると、押鍵検出部５
２がこれを検知し、押下された鍵のキーコードＫＣを出
力すると共ｋ。
図は第３図に示す回路を適用した電子楽器の構成例を示
すブロック図である。この図忙おいて、メモリＭには、
楽音信号の立上りから終了に至るまでの全波形をサンプ
リングしたサンプリングデータな、第１図の回路によっ
て圧縮したデータＣ以下、楽音データと称する１が、各
音色Ｃピアノ音．フルート音等）毎に，かつ各音高毎に
記憶されている。そして、音色選択部５０によっていず
れかの音色が選択さ糺ると、音色選択部５０の出力デー
タＴＣＫよって、その音色に対応する楽音データが記憶
されているメモリＭの記憶エリアが指定される。次に％
鍵盤５１のいずれかの鍵が押下されると、押鍵検出部５
２がこれを検知し、押下された鍵のキーコードＫＣを出
力すると共ｋ。
キーオン信号ＫＯＮを出力する．このキーオン信号ＫＯ
Ｎは開離が押下されている間′１１信号を続ける。アド
レス発生器５３は、押鍵検出ｇｌｉ５２から出力された
キー；−ドＫＣを対応するアドレスデータ人ＤＩＫ！換
してメモリＭへ出力し、また、キーオン信号ＫＯＮが″
１″信号に立上った時点以降、０，１．２・・・と逐次
変化するアドレスデータ人ＤＤをメモリλ（へ出力する
。アドレスデータ人Ｄ１がメモリＭへ供給されると、前
述したデータＴＣＶｃよって指定されている記憶エリア
内のアドレスデータ人１）１）Ｃ対応する領域が指定さ
れる。この領域は、音色選択部５０によって選択された
音色を有し、押鍵検出部５２から出力されたキーニード
ＫＣの音高を有する楽音データが記憶されている領域で
ある。そして、アドレスデータ人ＤＤがメモリＭへ供給
されると、該領域の相対アドレス０番地内の楽音データ
から順次読出され、楽音再生Ｗ６５４へ順次供給される
。楽音再生部５４は、第Ｓ図と同一の回路であり、楽音
データが順次供給されると、その出力端からサンプリン
グデ・−夕ＳＤを出力し、サウンドシステム５５へ供給
する。サウンドシステム５５は、供給されたサンプリン
グデータＳＤをアナログ信号に’［換し、スピーカから
楽音として発音する。
Ｎは開離が押下されている間′１１信号を続ける。アド
レス発生器５３は、押鍵検出ｇｌｉ５２から出力された
キー；−ドＫＣを対応するアドレスデータ人ＤＩＫ！換
してメモリＭへ出力し、また、キーオン信号ＫＯＮが″
１″信号に立上った時点以降、０，１．２・・・と逐次
変化するアドレスデータ人ＤＤをメモリλ（へ出力する
。アドレスデータ人Ｄ１がメモリＭへ供給されると、前
述したデータＴＣＶｃよって指定されている記憶エリア
内のアドレスデータ人１）１）Ｃ対応する領域が指定さ
れる。この領域は、音色選択部５０によって選択された
音色を有し、押鍵検出部５２から出力されたキーニード
ＫＣの音高を有する楽音データが記憶されている領域で
ある。そして、アドレスデータ人ＤＤがメモリＭへ供給
されると、該領域の相対アドレス０番地内の楽音データ
から順次読出され、楽音再生Ｗ６５４へ順次供給される
。楽音再生部５４は、第Ｓ図と同一の回路であり、楽音
データが順次供給されると、その出力端からサンプリン
グデ・−夕ＳＤを出力し、サウンドシステム５５へ供給
する。サウンドシステム５５は、供給されたサンプリン
グデータＳＤをアナログ信号に’［換し、スピーカから
楽音として発音する。
なお、ビブラート等のピッチ変化を発生楽音に付ける場
合は、アドレスデータλＤＤの出力タイ建ングを変化さ
せればよい。この場合、楽ｆ再生部５４内のデータ処理
もアドレスデータ入Ｔ）Ｄの変化タイミングに同期させ
る。また、楽音データな各音高毎に記憶させるのではな
く、全音高共通に１組の楽音データを記憶させ、あるい
は複数の音高毎に各１組の楽音・データを記憶させる場
合は、アドレスデータ人ＤＤの変化タイミングを、キー
コードＫＣに対応する速度とすればよい。
合は、アドレスデータλＤＤの出力タイ建ングを変化さ
せればよい。この場合、楽ｆ再生部５４内のデータ処理
もアドレスデータ入Ｔ）Ｄの変化タイミングに同期させ
る。また、楽音データな各音高毎に記憶させるのではな
く、全音高共通に１組の楽音データを記憶させ、あるい
は複数の音高毎に各１組の楽音・データを記憶させる場
合は、アドレスデータ人ＤＤの変化タイミングを、キー
コードＫＣに対応する速度とすればよい。
以上説明したように、第１〜第４発明によれば、周期性
のある信号をディジタル的に処理する場合において、処
理すべきディジタルデータのデータ量（ビット数）を従
来のものより大＠に減らすことができる効果が得られる
。
のある信号をディジタル的に処理する場合において、処
理すべきディジタルデータのデータ量（ビット数）を従
来のものより大＠に減らすことができる効果が得られる
。
第１図は第１発明の一実施例を適用したデータ圧縮回路
の構成を示すブロック図、第２図は第１図におけろデー
タＳＤおよびＤＩの一例をアナログ波形によって示した
図、第３図は＠２発明の一実施例を適用したデータ復調
回路の構成を示すブロック図、第４図は第３発明の一実
施例を適用したデータ圧縮回路の構成を示すブロック図
、第５図は第４発明の一実施例を適用したデータ復調回
路の構成を示すブロック図、第６図は第１図および第３
図の回路の応用例を示すブロック図、第７図はデータ圧
縮回路の一般的構成を示すブロック図、第８９は第７図
に対応するデータ復調回路の構成を示すブロック図、第
９図、＠１０図は各々ＤＰ（”Ｍ圧縮回路、ＤＰＣＭ復
調回路の構成を示す図、＠１１図は他のデータ圧縮回路
の構成例を示すブロック図、第１２図は第１１図に対応
する復調回路の構成を示すブロック図、第１３図は線形
予測法に基づくデータ圧縮回路の構成を示すブロック図
、第１４図は第１３図に対応する復調回路の構成を示す
ブロック図である。 １６．３０，４０．４５・・・・・・信号処理装置、１
７・・・・・・予？１１１１ｉ［発生回路、１８−１〜
１８−Ｐ・・・・・・遅延要素、１９−１〜１９−Ｐ・
・・・・・乗算器、２０−１．２０−２・・・・・・加
算器、２２・・・・・・減算器、３１・・・・・・加算
器、４１・・・・・・減算器、４２・・・・・・遅延要
素、４３・・・・・・データ圧縮回路、４６・・・・・
・加算器、４７・・・・・・遅延要素、４８・・・・・
・データ復調回路。 キ１発明−実す上伸Ｊ 第１図 ヤｔ１引：ｌ’ｌＴ社−ＰＳＤ、ＤＩの岐刑第２図 ヤ２を朗―實絶／？１７ 第３図 う
の構成を示すブロック図、第２図は第１図におけろデー
タＳＤおよびＤＩの一例をアナログ波形によって示した
図、第３図は＠２発明の一実施例を適用したデータ復調
回路の構成を示すブロック図、第４図は第３発明の一実
施例を適用したデータ圧縮回路の構成を示すブロック図
、第５図は第４発明の一実施例を適用したデータ復調回
路の構成を示すブロック図、第６図は第１図および第３
図の回路の応用例を示すブロック図、第７図はデータ圧
縮回路の一般的構成を示すブロック図、第８９は第７図
に対応するデータ復調回路の構成を示すブロック図、第
９図、＠１０図は各々ＤＰ（”Ｍ圧縮回路、ＤＰＣＭ復
調回路の構成を示す図、＠１１図は他のデータ圧縮回路
の構成例を示すブロック図、第１２図は第１１図に対応
する復調回路の構成を示すブロック図、第１３図は線形
予測法に基づくデータ圧縮回路の構成を示すブロック図
、第１４図は第１３図に対応する復調回路の構成を示す
ブロック図である。 １６．３０，４０．４５・・・・・・信号処理装置、１
７・・・・・・予？１１１１ｉ［発生回路、１８−１〜
１８−Ｐ・・・・・・遅延要素、１９−１〜１９−Ｐ・
・・・・・乗算器、２０−１．２０−２・・・・・・加
算器、２２・・・・・・減算器、３１・・・・・・加算
器、４１・・・・・・減算器、４２・・・・・・遅延要
素、４３・・・・・・データ圧縮回路、４６・・・・・
・加算器、４７・・・・・・遅延要素、４８・・・・・
・データ復調回路。 キ１発明−実す上伸Ｊ 第１図 ヤｔ１引：ｌ’ｌＴ社−ＰＳＤ、ＤＩの岐刑第２図 ヤ２を朗―實絶／？１７ 第３図 う
【３写ＣシＩＩ目＃１実施イ号す
第４発明＃１実絶ρ１】
第５図
−ｆ−ＦＩ” ｍ＠Ｉ’ｔｉｐ” −６６’）＃％ｆｃ
’ ｒ ７ｒＭｔ＝ ｔＴｈＴＩ
１１ｆＱ ％に第７図 第８ｆ！ｆ ＤＰＣＭ／ａ鴻町陶３ ｏｐｃｙｇｌ調ｑ
崎４第９図 第１Ｏ図 線形子５ｔａｒＢ去に基イ〈テも力＝綿回路 ヤ１３
図−ｆＬ盲同回路第１３図 第１４図
’ ｒ ７ｒＭｔ＝ ｔＴｈＴＩ
１１ｆＱ ％に第７図 第８ｆ！ｆ ＤＰＣＭ／ａ鴻町陶３ ｏｐｃｙｇｌ調ｑ
崎４第９図 第１Ｏ図 線形子５ｔａｒＢ去に基イ〈テも力＝綿回路 ヤ１３
図−ｆＬ盲同回路第１３図 第１４図
Claims (4)
- （１）周期性を有する被処理信号を処理する信号処理装
置において、 前記被処理信号を１〜ｎ周期遅延させた遅延信号を各々
出力する遅延手段と、 前記各遅延信号の各々に係数を乗算する乗算手段と、 前記被処理信号から前記係数が乗算された各遅延信号を
それぞれ減算する演算手段と を具備し、前記演算手段の出力を処理済信号として出力
することを特徴とする信号処理装置。 - （２）周期性を有する被処理信号を１〜ｎ周期遅延させ
て複数の遅延信号を得、これらの遅延信号の各々に係数
を乗算した後、前記被処理信号から減算して得た処理済
信号をもとの被処理信号に戻す信号処理装置において、 加算手段と、 前記加算手段の出力を１〜ｎ周期遅延させた信号を出力
する遅延手段と、 前記遅延手段の各出力に係数を乗算する乗算手段と を具備し、前記加算手段は前記処理済信号と前記乗算手
段の各出力とを加算するようにしてなる信号処理装置。 - （３）周期性を有する被処理信号を処理する信号処理装
置において、入力端へ供給される信号を所定周期遅延さ
せる遅延手段と、前記入力端へ供給される信号から前記
遅延手段の出力を減算する減算手段とからなる信号圧縮
回路を複数個縦続接続してなる信号処理装置。 - （４）入力端へ供給される信号を所定周期遅延させる遅
延手段と、前記入力端へ供給される信号から前記遅延手
段の出力を減算する減算手段とからなる信号圧縮回路を
複数個縦続接続してなる装置によつて圧縮処理された信
号をもとの信号に戻す信号処理装置において、加算手段
と、前記加算手段の出力を所定周期遅延させて前記加算
手段の入力端へ供給する遅延手段とからなる復調回路を
前記信号圧縮回路と同数縦続接続してなる信号処理装置
。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59269375A JPS61146020A (ja) | 1984-12-20 | 1984-12-20 | 電子楽器の楽音波形処理装置 |
| US06/784,842 US4781096A (en) | 1984-10-09 | 1985-10-04 | Musical tone generating apparatus |
| EP85112743A EP0177934B1 (en) | 1984-10-09 | 1985-10-08 | Musical tone generating apparatus |
| DE8585112743T DE3585125D1 (de) | 1984-10-09 | 1985-10-08 | Musiktonerzeugungsvorrichtung. |
| SG1895A SG1895G (en) | 1984-10-09 | 1995-01-07 | Musical tone generating apparatus |
| HK134595A HK134595A (en) | 1984-10-09 | 1995-08-24 | Musical tone generating apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59269375A JPS61146020A (ja) | 1984-12-20 | 1984-12-20 | 電子楽器の楽音波形処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61146020A true JPS61146020A (ja) | 1986-07-03 |
| JPH039478B2 JPH039478B2 (ja) | 1991-02-08 |
Family
ID=17471522
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59269375A Granted JPS61146020A (ja) | 1984-10-09 | 1984-12-20 | 電子楽器の楽音波形処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61146020A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04252471A (ja) * | 1991-01-28 | 1992-09-08 | Matsushita Electric Ind Co Ltd | ディスク及びディスク再生装置 |
| JPH05119928A (ja) * | 1991-10-30 | 1993-05-18 | Tokyo Electric Co Ltd | 固定磁気デイスク装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53119656A (en) * | 1977-03-29 | 1978-10-19 | Nippon Telegr & Teleph Corp <Ntt> | Forecast coding equipment |
| JPS5448471A (en) * | 1977-09-26 | 1979-04-17 | Nippon Telegr & Teleph Corp <Ntt> | Coding system |
-
1984
- 1984-12-20 JP JP59269375A patent/JPS61146020A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53119656A (en) * | 1977-03-29 | 1978-10-19 | Nippon Telegr & Teleph Corp <Ntt> | Forecast coding equipment |
| JPS5448471A (en) * | 1977-09-26 | 1979-04-17 | Nippon Telegr & Teleph Corp <Ntt> | Coding system |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04252471A (ja) * | 1991-01-28 | 1992-09-08 | Matsushita Electric Ind Co Ltd | ディスク及びディスク再生装置 |
| JPH05119928A (ja) * | 1991-10-30 | 1993-05-18 | Tokyo Electric Co Ltd | 固定磁気デイスク装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH039478B2 (ja) | 1991-02-08 |
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