JPS61133843U - - Google Patents

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JPS61133843U
JPS61133843U JP9151884U JP9151884U JPS61133843U JP S61133843 U JPS61133843 U JP S61133843U JP 9151884 U JP9151884 U JP 9151884U JP 9151884 U JP9151884 U JP 9151884U JP S61133843 U JPS61133843 U JP S61133843U
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JP
Japan
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bank
operation code
memory
switching circuit
analyzing
Prior art date
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Description

【図面の簡単な説明】
第1図はバンク切り替え回路を使用しているシ
ステムブロツク図である。第2図は、従来のメモ
リバンク切り替え回路の回路図である。第3図は
本考案の一実施例によるメモリバンク切り替え回
路の回路図である。第4図および第5図は第3図
のメモリバンク切り替え回路のタイミングチヤー
トで、第4図はLD(3000H)、Aの場合、
第5図はブロツク転送命令LDIRの場合である
。 100〜104……Dフリツプ・フロツプ、1
05……デコーダ、201……ローフリツプ・フ
ロツプ、202……ROM、200,203,2
04,205,207……ローフリツプ・フロツ
プ、206……カウンタ、208……データセレ
クタ、209……デコーダ。

Claims (1)

    【実用新案登録請求の範囲】
  1. CPU外部にオペコード解析回路を置き、オペ
    コードの解析により、メモリの読み出しバンク及
    び書き込みバンクの切り替え信号を出力すること
    を特徴とするメモリバンクの切替え回路。
JP9151884U 1984-06-19 1984-06-19 Pending JPS61133843U (ja)

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JP9151884U JPS61133843U (ja) 1984-06-19 1984-06-19

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JP9151884U JPS61133843U (ja) 1984-06-19 1984-06-19

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JPS61133843U true JPS61133843U (ja) 1986-08-21

Family

ID=30647479

Family Applications (1)

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JP9151884U Pending JPS61133843U (ja) 1984-06-19 1984-06-19

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