JPS6096173A - Drive circuit of gate turn off thyristor - Google Patents

Drive circuit of gate turn off thyristor

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Publication number
JPS6096173A
JPS6096173A JP20307783A JP20307783A JPS6096173A JP S6096173 A JPS6096173 A JP S6096173A JP 20307783 A JP20307783 A JP 20307783A JP 20307783 A JP20307783 A JP 20307783A JP S6096173 A JPS6096173 A JP S6096173A
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JP
Japan
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transistor
gate
turn
drive circuit
gate turn
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Pending
Application number
JP20307783A
Other languages
Japanese (ja)
Inventor
Kenji Kawagishi
川岸 賢至
Masaharu Uko
宇高 正晴
Haruyoshi Mori
治義 森
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
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Publication of JPS6096173A publication Critical patent/JPS6096173A/en
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H02GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02MAPPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M1/00Details of apparatus for conversion
    • H02M1/06Circuits specially adapted for rendering non-conductive gas discharge tubes or equivalent semiconductor devices, e.g. thyratrons, thyristors

Abstract

PURPOSE:To enhance the performance of a gate turn OFF thyristor without increasing the size by inserting a transistor not only between the gate and the cathode of a GTO but also between the anode and the gate, thereby enabling to drive the GTO at a logical level. CONSTITUTION:The first and second transistors 3B, 3A are inserted between the anode and the base and between the gate and the cathode of a GTO1. When the GTO1 is turned ON, a base current is supplied to the transistor 3B to conduct the transistor. When the GTO1 is turned OFF, the transistor 3A is conducted.

Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は、ゲートターンオフサイリスクの駆動回路に
関する。
DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to a drive circuit for a gate turn-off circuit.

〔従来技術〕[Prior art]

第1図はこの種の駆動回路の従来例を示したもので、■
はゲートターンオフサイリスク(以下、GTOと略記す
る)、2はダイオード、3Aはトランジスタである。
Figure 1 shows a conventional example of this type of drive circuit.
is a gate turn-off transistor (hereinafter abbreviated as GTO), 2 is a diode, and 3A is a transistor.

このGTOlをオン状態からオフ状態えターンオフさせ
る場合には、トランジスタ3Aにベース電流を供給して
該トランジスタ3Aを導通させ、G ′r 01のゲー
トから蓄積キャリアを引き出す。
When this GTOl is turned off from an on state to an off state, a base current is supplied to the transistor 3A to make the transistor 3A conductive, and the accumulated carriers are drawn out from the gate of G'r01.

ダイオード2はその順方向電圧降下分だけGTOlに加
わる逆バイアス電圧を高める作用を行うもので、該ダイ
オード2が除去されていてもGTO1をターンオフする
機能は発揮される。
The diode 2 functions to increase the reverse bias voltage applied to the GTOl by the forward voltage drop thereof, and even if the diode 2 is removed, the function of turning off the GTO1 is exhibited.

このような駆動回路は逆バイアス電源を用いることなく
比較的高速でGTOIをターンオフさせることができる
ので、高性能なターンオフ機能を得ることができるが、
他方、ターンオン機能については、これを高めようとす
るとG i” Oのゲートに十分に大なるオンゲート電
流を高速に供給しなくてはならないので該オンゲート電
流を供給する回路が大型化する結果、上記ターンオフ機
能の高性能化による小型化の利点が失われ、駆動回路が
大型化すると云う問題があり、これは、特に、高周波で
大電力を開閉るすインバータやヂョソバ等の電力変換器
を構成するG T Oを駆動する場合に顕著であった。
Such a drive circuit can turn off the GTOI at a relatively high speed without using a reverse bias power supply, so a high-performance turn-off function can be obtained.
On the other hand, in order to improve the turn-on function, it is necessary to supply a sufficiently large on-gate current to the gate of G i"O at high speed, and as a result, the circuit for supplying the on-gate current becomes larger. There is a problem in that the advantage of miniaturization due to the high performance of the turn-off function is lost and the drive circuit becomes larger. This was noticeable when driving GTO.

〔発明の概要〕[Summary of the invention]

この発明は、上記した従来の問題点に鑑みてなされたも
ので、GTOのアノード−ゲート間及びゲート−カソー
ド間にそれぞれ第1及び第2のトランジスタを挿入し、
GTO(7)−ターンオンに際しては上記第1のトラン
ジスタを駆動し、ターンオフに際しては上記第2のトラ
ンジスタを駆動する構成とすることによって、大型化す
ることなく高性能なターンオン・ターンオフ機能を持た
せることができるゲートターンオフサイリスクの駆動回
路を提案するものである。
This invention was made in view of the above-mentioned conventional problems, and includes inserting first and second transistors between the anode and gate and between the gate and cathode of the GTO, respectively.
GTO (7) - To provide high-performance turn-on and turn-off functions without increasing the size by driving the first transistor at turn-on and driving the second transistor at turn-off. This paper proposes a drive circuit for a gate turn-off circuit that can perform the following steps.

〔発明の実施例〕[Embodiments of the invention]

第2図Telはこの発明の一実施例を示す回路図である
。図において、3Bは点弧用のトランジスタであって、
そのコレクタC及びエミッタEがそれぞれG’l”01
のアノードA及びゲー1− Gに接続されており、該ト
ランジスタ3B1 トランジスタ3Aおよびダイオード
DIはGTO1と同一バソケージ(図示しない)に収納
される。
FIG. 2 is a circuit diagram showing an embodiment of the present invention. In the figure, 3B is an ignition transistor,
Its collector C and emitter E are respectively G'l"01
The transistor 3B1, the transistor 3A, and the diode DI are housed in the same bath cage (not shown) as the GTO1.

第2図(b)は上記回路において、GTOIを等価トラ
ンジスタ回路で示したもので、Slは等価PNPIN型
トランジスタは等価NPN)ランリスクである。
FIG. 2(b) shows the GTOI in the above circuit as an equivalent transistor circuit, and Sl is the equivalent PNPIN type transistor (equivalent NPN) run risk.

GTOlをターンオンさせる場合には、トランジスタ3
Bにベース電流を供給してこれを導通させる。トランジ
スタ3Bが導通すると、GTO1の等(il[1NPN
)ランリスクS2のベースに電流が流入する。等価PN
P l−ランリスクS1と等価NPN)ランリスクS2
は正のフィードバック回路を構成しているので電流が急
激に増加して両者が飽和し、スイッチオン状態になる。
When turning on GTOl, transistor 3
A base current is supplied to B to make it conductive. When transistor 3B conducts, GTO1 etc.(il[1NPN
) Current flows into the base of run risk S2. equivalent PN
P l-run risk S1 and equivalent NPN) run risk S2
constitutes a positive feedback circuit, so the current increases rapidly, saturating both, and turning on the switch.

即ち、G T 01がターンオンする。That is, GT01 is turned on.

該ターンオン後のオン電圧降下は、該GTO1のオン電
圧降下で定まり、トランジスタ3Bの飽和電圧はいくら
高くてもG”FOlのオンゲート電流が確保できればよ
いので、第3図に示すように、トランジスタ3Bとして
は、電界効果型1−ランリスクの如きバイポーラトラン
ジスタに比して比較的入出力インピーダンスの高いトラ
ンジスタを用いることも可能で、GTOlをロジ・ノク
レヘルの信号でターンオンさせることが可能となるので
、GTolの制御能力を高めることができる。なお、第
3図においてS及びDは電界効果トランジスタのソース
及びドレンをそれぞれ示している。
The on-voltage drop after the turn-on is determined by the on-voltage drop of the GTO1, and no matter how high the saturation voltage of the transistor 3B is, it is sufficient to ensure the on-gate current of G"FOl. Therefore, as shown in FIG. As such, it is also possible to use a transistor with relatively high input/output impedance compared to a bipolar transistor such as a field effect type 1-run risk transistor, and it is possible to turn on the GTOl with a logic node signal. The control ability of GTol can be improved. In FIG. 3, S and D indicate the source and drain of the field effect transistor, respectively.

GTOlのターンオフはトランジスタ3Aを消弧用の1
−ランリスクとして前記した従来の場合と同じくこれを
駆動して行えば良い。
Turn-off of GTOl turns off transistor 3A
- This can be done by driving the run risk in the same way as in the conventional case described above.

第4図は、この発明の他の実施例の回路図であって、ト
ランジス3A、3B共に電界効果型トランジスタを用い
てあり、GTO1のターンオン、ターンオフ共にロジッ
クレベルの信号で行うことができる特徴を有し、更に、
トランジスタ3Bに直列にダイオード4を挿入して該ト
ランジスタ3Bの寄生ダイオードに流れる電流を抑制し
ている。
FIG. 4 is a circuit diagram of another embodiment of the present invention, in which field-effect transistors are used for both transistors 3A and 3B, and the turn-on and turn-off of GTO1 can be performed using logic level signals. has, and furthermore,
A diode 4 is inserted in series with the transistor 3B to suppress the current flowing through the parasitic diode of the transistor 3B.

なお、上記実施例のトランシフタ3A、3BはN型トラ
ンジスタであるが、P型I・ランリスクであっても良い
ことば明らかである。
Note that although the transferers 3A and 3B in the above embodiment are N-type transistors, it is obvious that they may be P-type I/run-risk transistors.

この発明は以上説明した通り、GTOのゲート−カソー
ド間だけでなくアノードゲート間にもトランジスタを挿
入し、該アノード−ゲート間のトランジスタを導通させ
てGTOにオンデー1〜電流を供給する構成としたこと
により、G”FOをロジックレベルの信号で駆動するこ
とができるので、大型化することなく高性能なターンオ
ン・ターンオフ機能を持たせることができる利点を有し
、この為、高周波で大電力を開閉するインバータ等電力
変換器のG T Oを駆動するのに極めて好適である。
As explained above, this invention has a structure in which a transistor is inserted not only between the gate and cathode of the GTO but also between the anode and gate, and the transistor between the anode and the gate is made conductive to supply on-day current to the GTO. As a result, the G"FO can be driven with a logic level signal, which has the advantage of providing high-performance turn-on and turn-off functions without increasing the size. It is extremely suitable for driving the GTO of a power converter such as an inverter that opens and closes.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のゲートターンオフサイリスクの駆動回路
の回路図、第2図(alばこの発明の一実施例を示す回
路図、第2図(b)はゲートターンオフサイリスクを等
!+Ili I・ランリスク回路で示した上記実施例の
動作を説明する為の回路図、第3図及び第4図はこの発
明の他の実施例の回路図である。 図において、1−ゲートターンオフサイリスク2.4−
ダイオード、3 A 、 3 B−1−ランリスク。 なお、図中、同一符号は同一または相当部分を示す。 代理人大岩増雄 第 1 図 第 2 図 (cl) (b) 〕 /D S 図 /−1 2 図 /−1 2
Figure 1 is a circuit diagram of a conventional gate turn-off circuit drive circuit, Figure 2 (a) is a circuit diagram showing an embodiment of the present invention, and Figure 2 (b) is a circuit diagram of a conventional gate turn-off circuit.・A circuit diagram for explaining the operation of the above embodiment shown as a run risk circuit, and FIG. 3 and FIG. 4 are circuit diagrams of other embodiments of the present invention. 2.4-
Diode, 3 A, 3 B-1-run risk. In addition, in the figures, the same reference numerals indicate the same or corresponding parts. Agent Masuo Oiwa Figure 1 Figure 2 (cl) (b) /D S Figure/-1 2 Figure/-1 2

Claims (4)

【特許請求の範囲】[Claims] (1) ゲートターンオフサイリスクのアノード−ゲー
ト間に挿入された点弧用の第1のトランジスタと上記ゲ
ートターンオフサイリスクのゲート−カソード間に挿入
された消弧用の第2のトランジスタを具えるゲートター
ンオフサイリスタの駆動回路。
(1) A first transistor for ignition inserted between the anode and gate of the gate turn-off switch and a second transistor for extinction inserted between the gate and cathode of the gate turn-off switch. Gate turn-off thyristor drive circuit.
(2)少なくとも第1のトランジスタが電界効果型トラ
ンジスタであることを特徴とする特許請求の範囲第1項
記載のゲートターンオフサイリスクの駆動回路。
(2) The gate turn-off transistor drive circuit according to claim 1, wherein at least the first transistor is a field effect transistor.
(3) ゲートターンオフサイリスクのカソードと第2
のトランジスタとの間にダイオードが挿入されているこ
とを特徴とする特許請求の範囲第1項〜第2項記載のゲ
ートターンオフサイリスクの駆動回路。
(3) Cathode and second gate turn-off
3. A drive circuit for a gate turn-off circuit according to claim 1, wherein a diode is inserted between the transistor and the transistor.
(4) ゲートターンオフサイリスクのゲートと第1の
トランジスタとの間にダイオードが挿入されていること
を特徴とする特許請求の範囲第1項〜第3項記載のゲー
トターンオフサイリスクの駆動回路。
(4) A drive circuit for a gate turn-off transistor according to claims 1 to 3, characterized in that a diode is inserted between the gate of the gate turn-off transistor and the first transistor.
JP20307783A 1983-10-27 1983-10-27 Drive circuit of gate turn off thyristor Pending JPS6096173A (en)

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