JPS6087551A - 多値伝送方式 - Google Patents
多値伝送方式Info
- Publication number
- JPS6087551A JPS6087551A JP19534583A JP19534583A JPS6087551A JP S6087551 A JPS6087551 A JP S6087551A JP 19534583 A JP19534583 A JP 19534583A JP 19534583 A JP19534583 A JP 19534583A JP S6087551 A JPS6087551 A JP S6087551A
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- JP
- Japan
- Prior art keywords
- transmission
- data
- signal
- conversion table
- error
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/14—Digital recording or reproducing using self-clocking codes
- G11B20/1403—Digital recording or reproducing using self-clocking codes characterised by the use of two levels
- G11B20/1423—Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code
- G11B20/1426—Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code conversion to or from block codes or representations thereof
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/38—Synchronous or start-stop systems, e.g. for Baudot code
- H04L25/40—Transmitting circuits; Receiving circuits
- H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
- H04L25/4917—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using multilevel codes
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Physics & Mathematics (AREA)
- Spectroscopy & Molecular Physics (AREA)
- Computer Networks & Wireless Communication (AREA)
- Error Detection And Correction (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野
本発明は、３値４ワイヤで多値情報を伝送する多値伝送
方式に関するものである。
方式に関するものである。
従来技術と問題点
多値情報を伝送する方式として、３値４ワイヤによる方
式が知られてい本！例えば第１図に示すように、送信デ
ータを変換装置１により多値情報に変換し、送信装置２
から４ワイヤからなる伝送路５に送出し、受信側では受
信装置３で゛受信し、送信側の変換装置１に於ける変換
処理と逆の変換を行う変換装置３によりデータを再生す
るものである。３値レベルは□、例Ｘば、２ワイヤの一
方のワイヤを＋、−２０の何れかの値とし、これに対応
して他方のワイヤを−、十、Ｏの極性とすることができ
るものであり、この２ワイヤを２組用い□て４ワイヤに
よりＪ３（ｉ２タプルで多値情報を伝送することができ
□るものである。
式が知られてい本！例えば第１図に示すように、送信デ
ータを変換装置１により多値情報に変換し、送信装置２
から４ワイヤからなる伝送路５に送出し、受信側では受
信装置３で゛受信し、送信側の変換装置１に於ける変換
処理と逆の変換を行う変換装置３によりデータを再生す
るものである。３値レベルは□、例Ｘば、２ワイヤの一
方のワイヤを＋、−２０の何れかの値とし、これに対応
して他方のワイヤを−、十、Ｏの極性とすることができ
るものであり、この２ワイヤを２組用い□て４ワイヤに
よりＪ３（ｉ２タプルで多値情報を伝送することができ
□るものである。
第２図は従来の麹換テーブルの説明図であり、データＤ
Ｉ−ＤＢは、現時点のシンボルｉと１タイミング前のシ
ンボルｉ−１との関係により伝送されるもので、３値を
０．１．２で示し、例えば、ｉ−１シンボルが３４ｆｉ
２タプル表示の“０１”である時に、データＤ３を送
信する場合は、ｉシンボルは１１″となる。次に同じデ
ータＤ３を送信する場合、１タイミング前のシンボルが
“１１”であったから、ｉシンボルは“２１″となるも
のである。
Ｉ−ＤＢは、現時点のシンボルｉと１タイミング前のシ
ンボルｉ−１との関係により伝送されるもので、３値を
０．１．２で示し、例えば、ｉ−１シンボルが３４ｆｉ
２タプル表示の“０１”である時に、データＤ３を送
信する場合は、ｉシンボルは１１″となる。次に同じデ
ータＤ３を送信する場合、１タイミング前のシンボルが
“１１”であったから、ｉシンボルは“２１″となるも
のである。
第３図は送受信データの一例の説明図であり、ＳＤは送
信データ、ＳＳば３値２タプルの送信信号、Ｒ３は受信
信号、Ｒｌ）は受信データを示し、初期値を“００″と
した場合についてのものである。■のタイミングで送信
データをＤ４とすると、第２図の変換テーブルかや送イ
Ｓ信号は“１ビとなる。次の■のタイミンンで送信デー
タをＤ３とすると、送信信号は２１”となる。以下同様
に■〜■のタイミングでデータＤ７．Ｄ２．Ｄ２、Ｄ５
．Ｄ８を送信すると、送信信号は、“１２”、２１″、
“１０″、”０２″となる。第２図に於ける■〜■は、
前述の送信データに対応した送信信号を示すものである
。
信データ、ＳＳば３値２タプルの送信信号、Ｒ３は受信
信号、Ｒｌ）は受信データを示し、初期値を“００″と
した場合についてのものである。■のタイミングで送信
データをＤ４とすると、第２図の変換テーブルかや送イ
Ｓ信号は“１ビとなる。次の■のタイミンンで送信デー
タをＤ３とすると、送信信号は２１”となる。以下同様
に■〜■のタイミングでデータＤ７．Ｄ２．Ｄ２、Ｄ５
．Ｄ８を送信すると、送信信号は、“１２”、２１″、
“１０″、”０２″となる。第２図に於ける■〜■は、
前述の送信データに対応した送信信号を示すものである
。
受信側では、初期値が００”で■のタイミングの受信信
号が“１１′であることにより、変換テーブルから受信
データはＤ４に変換される。次の■のタイミングの受信
信号が“２１”であるから、受信データはＤ３となり、
■のタイミングの受信信号が“１２”であるから、受信
データはＤ７となる。次の■のタイミングの受（８（８
号が伝送路エラーにより” ２２ ”となったとすると
、第２図の変換テーブルから、受信データはＤ３として
復号されることになる。即ち送信データがＤ２であった
ものが受信データはＤ３として復号されることになる。
号が“１１′であることにより、変換テーブルから受信
データはＤ４に変換される。次の■のタイミングの受信
信号が“２１”であるから、受信データはＤ３となり、
■のタイミングの受信信号が“１２”であるから、受信
データはＤ７となる。次の■のタイミングの受（８（８
号が伝送路エラーにより” ２２ ”となったとすると
、第２図の変換テーブルから、受信データはＤ３として
復号されることになる。即ち送信データがＤ２であった
ものが受信データはＤ３として復号されることになる。
この伝送路エラーが次の■のタイミングの受信データに
波及し、正しく受信できても受信データはＤ４となる。
波及し、正しく受信できても受信データはＤ４となる。
しかし、次の■のタイミングの受信信号が正しい場合は
、正しい受信データＤ８に復号されることになる。即ち
伝送路エラーは次のタイミングの受信データに影響を及
ぼすが、更に次のタイミングの受信データには波及しな
いことになる。又必ず２タプルの一方が変化するので、
受信側のクロック再生が容易となるものである。
、正しい受信データＤ８に復号されることになる。即ち
伝送路エラーは次のタイミングの受信データに影響を及
ぼすが、更に次のタイミングの受信データには波及しな
いことになる。又必ず２タプルの一方が変化するので、
受信側のクロック再生が容易となるものである。
゛前述のように、３値４ワイヤによる多値伝送方式は、
伝送路エラーが発生しても、２シンボＪし以上エラーが
波及しないセのであり、且つクロ゛ンクの再生が容易で
ある利点がある。しかし、エラーの発生を検出すること
ができない欠点があった。
伝送路エラーが発生しても、２シンボＪし以上エラーが
波及しないセのであり、且つクロ゛ンクの再生が容易で
ある利点がある。しかし、エラーの発生を検出すること
ができない欠点があった。
発明の、目的
本発明は、３値４ワイヤによる多値伝送方式〇こ於いて
、伝、送路エラーを検出できるようＧこすることを目的
とザるものである。
、伝、送路エラーを検出できるようＧこすることを目的
とザるものである。
発明の構成
本発明は、送信側の変換装置内の変換テーフ゛ルにより
送信データを３値２タプルの送信信号に変換して３値４
ワイヤの伝送路により伝送し、該伝送路を介し°ζ受信
した受信信号を受信側の変換装置内の変換テーブルによ
り、送信データと同じデータに復号する多植伝送方式、
に於いて、前記送信側の変換装置内の変換テーブルに、
前記送信データと１タイミング前に変換された送信信号
とをアドレスとして続出される送１３信号を、直交座標
上モ３値２タプルの１単位離れた位置に割当てて格納し
、前記受信側の変換装置内の変換テーブルに、受信信号
と１タイミング前の受信信号とをアドレスとして読出さ
れるデータを格納すると共に、前記直交座標上で３値２
タプルのＩＡ″Ｌ位離れた位置以外の受信信号をアドレ
スに含む時に読出されるエラー信号を格納したものであ
り、以下実施例について詳細に説明する。 。
送信データを３値２タプルの送信信号に変換して３値４
ワイヤの伝送路により伝送し、該伝送路を介し°ζ受信
した受信信号を受信側の変換装置内の変換テーブルによ
り、送信データと同じデータに復号する多植伝送方式、
に於いて、前記送信側の変換装置内の変換テーブルに、
前記送信データと１タイミング前に変換された送信信号
とをアドレスとして続出される送１３信号を、直交座標
上モ３値２タプルの１単位離れた位置に割当てて格納し
、前記受信側の変換装置内の変換テーブルに、受信信号
と１タイミング前の受信信号とをアドレスとして読出さ
れるデータを格納すると共に、前記直交座標上で３値２
タプルのＩＡ″Ｌ位離れた位置以外の受信信号をアドレ
スに含む時に読出されるエラー信号を格納したものであ
り、以下実施例について詳細に説明する。 。
発明の実施例
第４図は本発明の実施例の要部ブロック図であり、１１
はＲＯＭ （リードオンリメモリ）等からなる変換テー
ブル、１２はラッチ回路、１３及び１４はＤＡ変換回路
、１５及び１６は送信回路、１７は４ワイヤから存る伝
送路、１８及び１９は受信識別回路、２０はラッチ回路
、２１はＲＯＭ（リードオンリメモリ）等からなる変換
テーブル、２２はクロック再生回路である。変換テーブ
ル１１とラッチ回路１２とは送信側の変換装置内に設け
られ、変換テーブル２１とラッチ回路２０とは受信側の
変換装置内に設けられるものであり、送信側に於いて、
送信データＳＤは、データＤｉ〜Ｄ４の何れかを“Ｉ”
とし°Ｃ入力されるものであり、この送信データＳＤと
ラッチ回路１２でラッチされたｉ−１シンボルとをアド
レスとして変換テーブル１１をアクセスし、この変換テ
ーブル１１から３値２タプルの送信信号が読出されるも
のであり、この送信信号は送信クロックＣＬによりラッ
チ回路１２にラッチされる。変換テーブル１１から読出
された送信信号は合計４ビツトの２値化号であるから、
ＤＡ変換回路１３．１４により２ビツトを３値の０．１
．２に変換して、送信回路１５．１６により伝送路１７
に送出するものである。
はＲＯＭ （リードオンリメモリ）等からなる変換テー
ブル、１２はラッチ回路、１３及び１４はＤＡ変換回路
、１５及び１６は送信回路、１７は４ワイヤから存る伝
送路、１８及び１９は受信識別回路、２０はラッチ回路
、２１はＲＯＭ（リードオンリメモリ）等からなる変換
テーブル、２２はクロック再生回路である。変換テーブ
ル１１とラッチ回路１２とは送信側の変換装置内に設け
られ、変換テーブル２１とラッチ回路２０とは受信側の
変換装置内に設けられるものであり、送信側に於いて、
送信データＳＤは、データＤｉ〜Ｄ４の何れかを“Ｉ”
とし°Ｃ入力されるものであり、この送信データＳＤと
ラッチ回路１２でラッチされたｉ−１シンボルとをアド
レスとして変換テーブル１１をアクセスし、この変換テ
ーブル１１から３値２タプルの送信信号が読出されるも
のであり、この送信信号は送信クロックＣＬによりラッ
チ回路１２にラッチされる。変換テーブル１１から読出
された送信信号は合計４ビツトの２値化号であるから、
ＤＡ変換回路１３．１４により２ビツトを３値の０．１
．２に変換して、送信回路１５．１６により伝送路１７
に送出するものである。
受信側では、受信識別回路１ ａ’、’ １９により３
値の０．１．２のレベルを識別して２値化号に変換し、
変換テーブル２１のアドレスＡ４〜Ａ７とする。又ラッ
チｔＤＪ路２０に加えられて、クロック再生回路２２か
らのクロックによりラッチされる。クロック再生回路２
２は、前述のように３値２タプルのシンボルの少なくと
もｌクプルは変化するので、その変化を検出することに
より、容易にクロックを再生することができる。即し通
常の２値化号の伝送方式のように、タンク回路や位相同
期回路（ＰＬＬ）等の回路を用いることなく、簡単な構
成でクロックを再生することができる。又ラッチ回路２
０のラッチ出力が変換テーブル２１のアドレスＡＯ〜Ａ
３となり、変換テーブル２１はアドレスＡＯ〜Ａ７によ
りアクセスされる。即ち受信信号と１タイミング前の受
信信号とをアドレスとして変換テーブル２１がアクセス
されて、受信データＲＤのＤ１〜Ｄ４が読出される。
値の０．１．２のレベルを識別して２値化号に変換し、
変換テーブル２１のアドレスＡ４〜Ａ７とする。又ラッ
チｔＤＪ路２０に加えられて、クロック再生回路２２か
らのクロックによりラッチされる。クロック再生回路２
２は、前述のように３値２タプルのシンボルの少なくと
もｌクプルは変化するので、その変化を検出することに
より、容易にクロックを再生することができる。即し通
常の２値化号の伝送方式のように、タンク回路や位相同
期回路（ＰＬＬ）等の回路を用いることなく、簡単な構
成でクロックを再生することができる。又ラッチ回路２
０のラッチ出力が変換テーブル２１のアドレスＡＯ〜Ａ
３となり、変換テーブル２１はアドレスＡＯ〜Ａ７によ
りアクセスされる。即ち受信信号と１タイミング前の受
信信号とをアドレスとして変換テーブル２１がアクセス
されて、受信データＲＤのＤ１〜Ｄ４が読出される。
第５図は変換テーブルの説明図であり、、ｉシンボルを
、２タプルの合計が偶数となるように選定した場合を示
すものである。従って、第６図に示すように、■〜■の
タイミングで送信データＳＤがＤ２． ＤＩ、 Ｄ４．
Ｄ３．６２． Ｄ４． Ｄ３゜Ｄ２の場合、初期値を
“００”とすると、送信信号ｓｓは、１１”、”２０”
、・・・０２”となる。この送信信号ＳＳは第５図にも
■〜■で示している。
、２タプルの合計が偶数となるように選定した場合を示
すものである。従って、第６図に示すように、■〜■の
タイミングで送信データＳＤがＤ２． ＤＩ、 Ｄ４．
Ｄ３．６２． Ｄ４． Ｄ３゜Ｄ２の場合、初期値を
“００”とすると、送信信号ｓｓは、１１”、”２０”
、・・・０２”となる。この送信信号ＳＳは第５図にも
■〜■で示している。
■のタイミングに於いては、伝送路エラーがないので、
受信側の変換装置内の変換テーブル２１のアドレスＡＯ
〜Ａ７は、“０“００′００１０１″となり、データＤ
２が読出される。次の■のタイミングで伝送路エラーが
発生して、送信信号ＳＳの“２０″′が′″２１″の受
信側４ Ｒ’Ｓとなったとすると、変換テーブル２工に
は２１”のアドレスＡ４〜Ａ７“１００１”に対応する
領域に受信データＲＤがなく、エラー信号Ｅが格納され
ているので、そのエラー信号Ｉ３が読出される。このエ
ラーは次の受信データにまで波及することば、従来と同
様であるので、■のタイミングに於いても変換テーブル
２１からエラー化％ ｆ３．が読出される。又■、■の
タイミングのように、連続して伝送路エラーが発生ずる
と、変換テーブル２１からは■のタイミングまでエラー
信叶Ｅが読出される。
受信側の変換装置内の変換テーブル２１のアドレスＡＯ
〜Ａ７は、“０“００′００１０１″となり、データＤ
２が読出される。次の■のタイミングで伝送路エラーが
発生して、送信信号ＳＳの“２０″′が′″２１″の受
信側４ Ｒ’Ｓとなったとすると、変換テーブル２工に
は２１”のアドレスＡ４〜Ａ７“１００１”に対応する
領域に受信データＲＤがなく、エラー信号Ｅが格納され
ているので、そのエラー信号Ｉ３が読出される。このエ
ラーは次の受信データにまで波及することば、従来と同
様であるので、■のタイミングに於いても変換テーブル
２１からエラー化％ ｆ３．が読出される。又■、■の
タイミングのように、連続して伝送路エラーが発生ずる
と、変換テーブル２１からは■のタイミングまでエラー
信叶Ｅが読出される。
従って、伝送路エラーを検出することができることにな
る。 ′ 第５図の変換テーブルを、直交座標上で３値を０．１．
２で示すと、第７図の（ｂ）に示すものとなる。即ち１
単位離れた位置にシンボルが割当てられていないので、
１単位の誤りは確実に検出することができる。なお第７
図の（ａ）ば、門２図に示す変換テーブルの場合に相当
す諷もめであり、直交座標上では総ての位置に割当てら
れていることになる。又第７図の（Ｃ）は、＋１３１と
同様に１単位離れた５個の位置を占めることかで１き詠
のに如して、４個の位置を占めるこ左になり、送信デー
タの種類が工□個少なくなる。しかし、１単位の誤りを
確実謡検出することができ゛ることは、（ｂ）の場合と
同様である。この（ｂｌが２タプルの合計が偶数の場合
を示し、（ｅ）が□奇数の場合を示すことになる。
る。 ′ 第５図の変換テーブルを、直交座標上で３値を０．１．
２で示すと、第７図の（ｂ）に示すものとなる。即ち１
単位離れた位置にシンボルが割当てられていないので、
１単位の誤りは確実に検出することができる。なお第７
図の（ａ）ば、門２図に示す変換テーブルの場合に相当
す諷もめであり、直交座標上では総ての位置に割当てら
れていることになる。又第７図の（Ｃ）は、＋１３１と
同様に１単位離れた５個の位置を占めることかで１き詠
のに如して、４個の位置を占めるこ左になり、送信デー
タの種類が工□個少なくなる。しかし、１単位の誤りを
確実謡検出することができ゛ることは、（ｂ）の場合と
同様である。この（ｂｌが２タプルの合計が偶数の場合
を示し、（ｅ）が□奇数の場合を示すことになる。
第８図は受信−の変換テーブルのアドレスと読出ンータ
との説ｉ図であり、ラッチ回路２０のラッチ出力がｉ−
１シンボルで、受信識別回路１８．１９０出力がｉシン
ボルとなる。３値４ワイヤにより３値２タプルの送信信
号ＳＳが、例えば、“２２″で、ｉ−１シンボルが０２
″であるとすると、アドレスＡ４〜Ａ７は“１０１０”
、アドレスＡＯ〜Ａ３は“００１０”となるから、続出
データは“００１０”、即ら１〕３の受信データとなる
。又エラー信号Ｅは“０”で誤りなしを示すものとなる
。
との説ｉ図であり、ラッチ回路２０のラッチ出力がｉ−
１シンボルで、受信識別回路１８．１９０出力がｉシン
ボルとなる。３値４ワイヤにより３値２タプルの送信信
号ＳＳが、例えば、“２２″で、ｉ−１シンボルが０２
″であるとすると、アドレスＡ４〜Ａ７は“１０１０”
、アドレスＡＯ〜Ａ３は“００１０”となるから、続出
データは“００１０”、即ら１〕３の受信データとなる
。又エラー信号Ｅは“０”で誤りなしを示すものとなる
。
又伝送路エラーにより１単位の誤りが発生し、２タプル
の合計が奇数となると、アドレスＡ４〜Ａ７は受信信号
誤りの領域を示すものとなり、エラー信号Ｅば“ｌ”で
誤りありを示すものとなる。文武の受信信月についても
、ラッチ出力によるアドレスＡＯ〜Ａ３によって読出さ
れたエラー信号Ｅは“１”となり、誤りありを示すもの
となり、第５図に示す変換テーブル以外の受信信号の場
合に総てエラー信号Ｅが“１”として読出され、誤りあ
りを示すので、伝送路エラーを検出することができる。
の合計が奇数となると、アドレスＡ４〜Ａ７は受信信号
誤りの領域を示すものとなり、エラー信号Ｅば“ｌ”で
誤りありを示すものとなる。文武の受信信月についても
、ラッチ出力によるアドレスＡＯ〜Ａ３によって読出さ
れたエラー信号Ｅは“１”となり、誤りありを示すもの
となり、第５図に示す変換テーブル以外の受信信号の場
合に総てエラー信号Ｅが“１”として読出され、誤りあ
りを示すので、伝送路エラーを検出することができる。
送信側の変換テーブル１１は、第８図に示す変換テーブ
ルに於いて、ｉ−１シンボルと送信データＤｉ−Ｄ４を
アドレスとし、ｉシンボルを続出データとした構成とす
ることにより、送信データＤ１〜Ｄ４を３値２タプルに
変換して送信することができる。その場合は、エラー信
号Ｅに対応する領域を省略することができる。
ルに於いて、ｉ−１シンボルと送信データＤｉ−Ｄ４を
アドレスとし、ｉシンボルを続出データとした構成とす
ることにより、送信データＤ１〜Ｄ４を３値２タプルに
変換して送信することができる。その場合は、エラー信
号Ｅに対応する領域を省略することができる。
前述の実施例は、３値２タプルにより多値伝送する場合
についてのものであるが、Ｐ値ｎタプルの場合にも適用
することができるものである。この場合の伝送可能な送
信データ数Ｍは、Ｍ＝ （ＰＨ１１） ／２ となる。前述の実施例では、Ｐ＝３．ｎ＝２であるから
、（３ｎｏ １）／２＝４となり、送信データはＤ１〜
Ｄ４となる。又Ｐ＝３．ｎ＝３とすれば、（３（ＩＱ
１）／２＝１３となる。
についてのものであるが、Ｐ値ｎタプルの場合にも適用
することができるものである。この場合の伝送可能な送
信データ数Ｍは、Ｍ＝ （ＰＨ１１） ／２ となる。前述の実施例では、Ｐ＝３．ｎ＝２であるから
、（３ｎｏ １）／２＝４となり、送信データはＤ１〜
Ｄ４となる。又Ｐ＝３．ｎ＝３とすれば、（３（ＩＱ
１）／２＝１３となる。
発明の詳細
な説明したように、本発明は、送信側の変換装置内の変
換テーブル１１に、送信データと１タイミング前に変換
された送信信号とをアドレスとして読出される送信信号
を、直交座標上で３値２タプルの１単位離れた位置に割
当てて格納し、受信側の変換装置内の変換テーブル２１
に、受信信号と１タイミング前の受信信号とをアドレス
として読出されるデータを格納する共に、前記直交座標
上で３値２タプルの１単位＾１］れた位置以外の受信信
号をアドレスに含む時に読出されるエラー信号Ｅを格納
したものであるから、伝送路エラーにより３値２タプル
の１単位のエラーが発生した場合に、確実に検出するこ
とができるものである。
換テーブル１１に、送信データと１タイミング前に変換
された送信信号とをアドレスとして読出される送信信号
を、直交座標上で３値２タプルの１単位離れた位置に割
当てて格納し、受信側の変換装置内の変換テーブル２１
に、受信信号と１タイミング前の受信信号とをアドレス
として読出されるデータを格納する共に、前記直交座標
上で３値２タプルの１単位＾１］れた位置以外の受信信
号をアドレスに含む時に読出されるエラー信号Ｅを格納
したものであるから、伝送路エラーにより３値２タプル
の１単位のエラーが発生した場合に、確実に検出するこ
とができるものである。
従って多値伝送の信頼性を向上することができる利点が
ある。
ある。
第１図は多値伝送方式の概略ブロック図、第２図は従来
の変換テーブルの説明図、第３図は従来の多値伝送方式
による伝送路エラーが発生した場合の動作説明図、第４
図は本発明の実施例の要部ブロック図、第５図は本発明
の実施例の変換テーブルの説明図、第６図は本発明の実
施例の伝送路エラーが発生した場合の動作説明図、第７
図（ａ）〜（Ｃ１は直交座標上の３値２タプルのシンボ
ルの位置の説明図、第８図は本発明の実施例の受信側の
変換装置内の変換テーブルの説明図である。 １１は変換テーブル、１２はラッチ回路、１３．１４は
ＤＡ変換回路、１５．１６は送信回路、１７は伝送路、
１８．１９は受信識別回路、２０はラッチ回路、２１は
変換テーブル、２２はクロック再生回路である。 特許出願人 富士通株式会社 代理人弁理士 相 谷 昭 司 代理人弁理士 渡 邊 弘 − 第５図 第６図 ）（Ｌ） ＤＩＥ ＥＬ）３ Ｅ Ｅ ＥＤ２第７図 （ａ） （ｂ） （ｃ） ０１２ ０１２ ０１２
の変換テーブルの説明図、第３図は従来の多値伝送方式
による伝送路エラーが発生した場合の動作説明図、第４
図は本発明の実施例の要部ブロック図、第５図は本発明
の実施例の変換テーブルの説明図、第６図は本発明の実
施例の伝送路エラーが発生した場合の動作説明図、第７
図（ａ）〜（Ｃ１は直交座標上の３値２タプルのシンボ
ルの位置の説明図、第８図は本発明の実施例の受信側の
変換装置内の変換テーブルの説明図である。 １１は変換テーブル、１２はラッチ回路、１３．１４は
ＤＡ変換回路、１５．１６は送信回路、１７は伝送路、
１８．１９は受信識別回路、２０はラッチ回路、２１は
変換テーブル、２２はクロック再生回路である。 特許出願人 富士通株式会社 代理人弁理士 相 谷 昭 司 代理人弁理士 渡 邊 弘 − 第５図 第６図 ）（Ｌ） ＤＩＥ ＥＬ）３ Ｅ Ｅ ＥＤ２第７図 （ａ） （ｂ） （ｃ） ０１２ ０１２ ０１２
Claims (1)
- 送信側の変換装置内の変換テーブルにより送信データを
３値２タプルの送信信号に変換して３値４ワイヤの伝送
路により伝送し、該伝送路を介して受信した受信信号を
受信側の変換装置内の変換テーブルにより、送信データ
と同じデータに復号する多値伝送方式に於いて、前記送
信側の変換装置内の変換テーブルに、前記送信データと
１タイミング前に変換された送信（８号とをアドレスと
して読出される送信信号を、直交座標上で３値２タプル
の１単位離れた位置に割当てて格納し、前記受信側の変
換装置内の変換テーブルに、受信信号と１タイミング前
の受信信号とをアドレスとして読出されるデータを格納
すると共に、前記直交座標上で３値２タプルの１単位離
れた位置以外の受信信号をアドレスに含む時に読出され
るエラー信号を格納したことを特徴とする多値伝送方式
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19534583A JPS6087551A (ja) | 1983-10-20 | 1983-10-20 | 多値伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19534583A JPS6087551A (ja) | 1983-10-20 | 1983-10-20 | 多値伝送方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6087551A true JPS6087551A (ja) | 1985-05-17 |
Family
ID=16339621
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19534583A Pending JPS6087551A (ja) | 1983-10-20 | 1983-10-20 | 多値伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6087551A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7292629B2 (en) | 2002-07-12 | 2007-11-06 | Rambus Inc. | Selectable-tap equalizer |
| US9544169B2 (en) | 1999-10-19 | 2017-01-10 | Rambus Inc. | Multiphase receiver with equalization circuitry |
-
1983
- 1983-10-20 JP JP19534583A patent/JPS6087551A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9544169B2 (en) | 1999-10-19 | 2017-01-10 | Rambus Inc. | Multiphase receiver with equalization circuitry |
| US9998305B2 (en) | 1999-10-19 | 2018-06-12 | Rambus Inc. | Multi-PAM output driver with distortion compensation |
| US7292629B2 (en) | 2002-07-12 | 2007-11-06 | Rambus Inc. | Selectable-tap equalizer |
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