JPS6066837A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPS6066837A JPS6066837A JP17741383A JP17741383A JPS6066837A JP S6066837 A JPS6066837 A JP S6066837A JP 17741383 A JP17741383 A JP 17741383A JP 17741383 A JP17741383 A JP 17741383A JP S6066837 A JPS6066837 A JP S6066837A
- Authority
- JP
- Japan
- Prior art keywords
- slopes
- recess
- cover member
- substrate
- sealed
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/02—Containers; Seals
- H01L23/10—Containers; Seals characterised by the material or arrangement of seals between parts, e.g. between cap and base of the container or between leads and walls of the container
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/12—Mountings, e.g. non-detachable insulating substrates
- H01L23/13—Mountings, e.g. non-detachable insulating substrates characterised by the shape
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Die Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
+、元明は、半導体装置用パッケージの構造に関するも
のである。
のである。
従来、こり柚の十纒体装置用パッケージの構造は、第1
図にボづ−ように半導体菓子を搭載するセラミックの杷
縁納体4と蓋部材1とを金糸共晶合金等のロウ拐2でロ
ウ付けし、気密封止するものである。又、この場合の封
止作業において、金糸共晶合金等のロウ材2及び蓋部材
1の位置決め用にガイド治具3が心安であった。しかし
、ガイド冶具3は各々のパッケージ、特に絶縁基体4に
合わせて作成しなければならず、又熱伝導の差があり、
封止時の周囲温度が一足でりってもロウI2に加わる温
度に差が生じ、封止時には絶縁基体4゜蓋部材1.ロウ
材2の大きざやガイド治具3の大きさ等をJAI味して
封止温度ケ決めなけ7’Lばならなかった。又ガイド治
具3葡−使用するため、治具3の公差によって蓋部材1
と絶#:基体4とのずれという問題があり、位置合わせ
に多くの1・];米工数が必要であった。
図にボづ−ように半導体菓子を搭載するセラミックの杷
縁納体4と蓋部材1とを金糸共晶合金等のロウ拐2でロ
ウ付けし、気密封止するものである。又、この場合の封
止作業において、金糸共晶合金等のロウ材2及び蓋部材
1の位置決め用にガイド治具3が心安であった。しかし
、ガイド冶具3は各々のパッケージ、特に絶縁基体4に
合わせて作成しなければならず、又熱伝導の差があり、
封止時の周囲温度が一足でりってもロウI2に加わる温
度に差が生じ、封止時には絶縁基体4゜蓋部材1.ロウ
材2の大きざやガイド治具3の大きさ等をJAI味して
封止温度ケ決めなけ7’Lばならなかった。又ガイド治
具3葡−使用するため、治具3の公差によって蓋部材1
と絶#:基体4とのずれという問題があり、位置合わせ
に多くの1・];米工数が必要であった。
不究明の目的は、従来のこのような欠点ケ除去し、確実
に蓋部材と絶縁基体の位置合わぜかできるパッケージ全
提供することにある。
に蓋部材と絶縁基体の位置合わぜかできるパッケージ全
提供することにある。
不究明VCよれば、絶縁基体の壁部材の封止面及び蓋部
材の封止面をかみ合せの斜1f1とし、%に杷縁基体側
の斜面全内部に傾φFするようにして、その斜面で絶縁
基体の壁部材とローイオ及び養部祠との位置合せを行な
うものである。
材の封止面をかみ合せの斜1f1とし、%に杷縁基体側
の斜面全内部に傾φFするようにして、その斜面で絶縁
基体の壁部材とローイオ及び養部祠との位置合せを行な
うものである。
本発明の一実施例7i−第2図全用いてよフ詳細に説明
する。絶縁基体14には封止面とする壁部材を有し、こ
の壁部材の上表面を内部に傾斜する斜面とし、この1頃
厨面にこれとかみ合せができる傾斜底面をもった金糸共
晶合金等のロー材12を載置する。ロウ月12の上表向
はやはり内部に傾斜1−る上表面金持っておジ、この上
表面にこれとかみ合せができる傾斜底面を巾フーる蓋部
旧11ケ載益し、全体ケ〃11熱して制止するものであ
る。
する。絶縁基体14には封止面とする壁部材を有し、こ
の壁部材の上表面を内部に傾斜する斜面とし、この1頃
厨面にこれとかみ合せができる傾斜底面をもった金糸共
晶合金等のロー材12を載置する。ロウ月12の上表向
はやはり内部に傾斜1−る上表面金持っておジ、この上
表面にこれとかみ合せができる傾斜底面を巾フーる蓋部
旧11ケ載益し、全体ケ〃11熱して制止するものであ
る。
本発明によれは、ガイド治具を必要とせず、又制止温贋
も金糸共晶合金等のロー材の融点を考慮した渦展でよく
、いりいろな形状のパッケージを刺止することができる
。
も金糸共晶合金等のロー材の融点を考慮した渦展でよく
、いりいろな形状のパッケージを刺止することができる
。
第1図は従来Qガイド冶具を使用したパッケージ刺止を
説明J−る断面図、第2図は+:発明の一実施例による
パッケージで封止面を斜面とする断面図である。 1.11・・・・蓋部材、2.12・・・−ロー材、3
・・・・・ガイド治具44,14・・−・・絶縁基体。 ・ 入 代理人 弁理士 内 原 蹟、)
説明J−る断面図、第2図は+:発明の一実施例による
パッケージで封止面を斜面とする断面図である。 1.11・・・・蓋部材、2.12・・・−ロー材、3
・・・・・ガイド治具44,14・・−・・絶縁基体。 ・ 入 代理人 弁理士 内 原 蹟、)
Claims (1)
- 半導体素子全搭載する絶縁基体に蓋部材を被せてロウ材
で封止する構造の半導体装置用パッケージにおいて%υ
υ記絶縁基体の壁部材の上表面及び台部材底表面ケ互い
にかみ合せロエ能な傾斜面とし、該傾斜面でそれぞれ全
嵌合させ位置合わせすることを特徴と−j、6谷器構造
をもった半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17741383A JPS6066837A (ja) | 1983-09-24 | 1983-09-24 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17741383A JPS6066837A (ja) | 1983-09-24 | 1983-09-24 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6066837A true JPS6066837A (ja) | 1985-04-17 |
Family
ID=16030487
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17741383A Pending JPS6066837A (ja) | 1983-09-24 | 1983-09-24 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6066837A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002334944A (ja) * | 2001-05-08 | 2002-11-22 | Nec Corp | 中空構造パッケージ |
-
1983
- 1983-09-24 JP JP17741383A patent/JPS6066837A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002334944A (ja) * | 2001-05-08 | 2002-11-22 | Nec Corp | 中空構造パッケージ |
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