JPS6065848U - 計算機システム - Google Patents
計算機システムInfo
- Publication number
- JPS6065848U JPS6065848U JP15766883U JP15766883U JPS6065848U JP S6065848 U JPS6065848 U JP S6065848U JP 15766883 U JP15766883 U JP 15766883U JP 15766883 U JP15766883 U JP 15766883U JP S6065848 U JPS6065848 U JP S6065848U
- Authority
- JP
- Japan
- Prior art keywords
- computer system
- execution code
- executed
- command information
- execution
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Bus Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案にかかる計算機システムの一実施例の構
成ブロック図、第２図は第１図のコマンド情報の構成を
示した図である。 ３０・・・主記憶装置、４０・・・Ｉ１０装置、Ａ２・
・・実行コードエリア。
成ブロック図、第２図は第１図のコマンド情報の構成を
示した図である。 ３０・・・主記憶装置、４０・・・Ｉ１０装置、Ａ２・
・・実行コードエリア。
Claims (1)
- 【実用新案登録請求の範囲】 主記憶装置に対してコマンドチェイニングによりＤＭＡ
動作を行なうＩ１０装置を有する計算機システムにおい
て、 前記主記憶装置にセットされていて前記Ｉ１０装置によ
り実行される各コマンド情報に実行コードエリアが設け
られていて、Ｉ１０装置が前記各コマンド情報の中の１
つを実行開始する度に、実行するコマンド情報の実行コ
ードエすア゛１こ実行コードを書き込むことを特徴とす
る計算機システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15766883U JPS6065848U (ja) | 1983-10-12 | 1983-10-12 | 計算機システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15766883U JPS6065848U (ja) | 1983-10-12 | 1983-10-12 | 計算機システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6065848U true JPS6065848U (ja) | 1985-05-10 |
Family
ID=30347546
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15766883U Pending JPS6065848U (ja) | 1983-10-12 | 1983-10-12 | 計算機システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6065848U (ja) |
-
1983
- 1983-10-12 JP JP15766883U patent/JPS6065848U/ja active Pending
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