JPS5881654U - 演算処理装置 - Google Patents

演算処理装置

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Publication number
JPS5881654U
JPS5881654U JP17327681U JP17327681U JPS5881654U JP S5881654 U JPS5881654 U JP S5881654U JP 17327681 U JP17327681 U JP 17327681U JP 17327681 U JP17327681 U JP 17327681U JP S5881654 U JPS5881654 U JP S5881654U
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JP
Japan
Prior art keywords
operand
arithmetic processing
data
work register
register
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Pending
Application number
JP17327681U
Other languages
English (en)
Inventor
修 小野寺
Original Assignee
株式会社日立製作所
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Publication date
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Priority to JP17327681U priority Critical patent/JPS5881654U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の演算処理装置のブロック図、第２図は本
考案の一実施例あ同じくブロック図、第３、第４図は同
じくデータ変換回路の動作説明図、第５図は同じくデー
タ変換回路のブロック図である。 １・・・・・・第２オペランド用ワークレジスタ、２・
・・・・・第１オペランド用ワークレジスタ、３・・・
・・・データ変換回路、４・・・・・・第１オペランド
ポインタ、５・・・・・・演算器、６・・・・・・第２
オペランドポインタ、７・・・・・・演算器二

Claims (1)

    【実用新案登録請求の範囲】
  1. データ変換機能を具備する演算器を有する演算処理装置
    において、第１オペランドの先頭からのデータを格納し
    ておくワークレジスタ及び第２オペランドの最後からの
    データを格納しておくワークレジスタと、第２オペラン
    ド格納用レジスタと第１オペランド格納用レジスタの間
    に第２オペランド格納用ワークレジスタにアドレス下降
    方向に格納されているデータを第１オペランド格納用ワ
    ークレジスタにアドレス上昇方向に配列し直して格納で
    きる変換回路を有し、単又は複数バイトのデータ変換を
    同時に実行できる機能を有する事を特徴とする演算処理
    装置。
JP17327681U 1981-11-24 1981-11-24 演算処理装置 Pending JPS5881654U (ja)

Priority Applications (1)

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JP17327681U JPS5881654U (ja) 1981-11-24 1981-11-24 演算処理装置

Applications Claiming Priority (1)

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JP17327681U JPS5881654U (ja) 1981-11-24 1981-11-24 演算処理装置

Publications (1)

Publication Number Publication Date
JPS5881654U true JPS5881654U (ja) 1983-06-02

Family

ID=29965144

Family Applications (1)

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JP17327681U Pending JPS5881654U (ja) 1981-11-24 1981-11-24 演算処理装置

Country Status (1)

Country Link
JP (1) JPS5881654U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6488826A (en) * 1987-09-30 1989-04-03 Takeshi Sakamura Data processor

Cited By (1)

* Cited by examiner, † Cited by third party
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