JPS58155050U - 電子レジスタ - Google Patents
電子レジスタInfo
- Publication number
- JPS58155050U JPS58155050U JP5045782U JP5045782U JPS58155050U JP S58155050 U JPS58155050 U JP S58155050U JP 5045782 U JP5045782 U JP 5045782U JP 5045782 U JP5045782 U JP 5045782U JP S58155050 U JPS58155050 U JP S58155050U
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- data
- register
- electronic register
- display device
- Prior art date
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- Pending
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- Electrophonic Musical Instruments (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図は本考案による電子レジスタの一実施例を示すブロッ
ク図である。 １・・・・・・キーボード、２・・・・・・ｃｐｕ、
３・・・・・・アキュムレータ、４・・・・・・ＲＯＭ
、５・・・・・・第１のレジスタ、６・・・・・・第１
の表示バッファ回路、７・・・・・・第１の表示装置、
８・・・・・・第２のレジスタ、９・・曲第２の表示バ
ッファ回路、１０・・・・・・第２の表示装置。
ク図である。 １・・・・・・キーボード、２・・・・・・ｃｐｕ、
３・・・・・・アキュムレータ、４・・・・・・ＲＯＭ
、５・・・・・・第１のレジスタ、６・・・・・・第１
の表示バッファ回路、７・・・・・・第１の表示装置、
８・・・・・・第２のレジスタ、９・・曲第２の表示バ
ッファ回路、１０・・・・・・第２の表示装置。
Claims (1)
- キーボードと、このキーボードからの入力データを制御
し、かつ内部にアキュムレータを有スるＣＰＵと、この
ＣＰＵに結合され入力毎に新たなデータを記憶する第１
のレジスタと、この第１のレジスタの記憶データを表示
する第１の表示装置と、前記ＣＰＵに結合され入力デー
タの前記アキュムレータによる累積値を記憶する第２の
レジスタと、この第２のレジスタの記憶データを表示す
る第２の表示装置とを具備してなる電子レジスタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5045782U JPS58155050U (ja) | 1982-04-07 | 1982-04-07 | 電子レジスタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5045782U JPS58155050U (ja) | 1982-04-07 | 1982-04-07 | 電子レジスタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58155050U true JPS58155050U (ja) | 1983-10-17 |
Family
ID=30061253
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5045782U Pending JPS58155050U (ja) | 1982-04-07 | 1982-04-07 | 電子レジスタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58155050U (ja) |
-
1982
- 1982-04-07 JP JP5045782U patent/JPS58155050U/ja active Pending
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