JPS60254848A - スクランブルデ−タの初期送出方式 - Google Patents

スクランブルデ−タの初期送出方式

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Publication number
JPS60254848A
JPS60254848A JP59109555A JP10955584A JPS60254848A JP S60254848 A JPS60254848 A JP S60254848A JP 59109555 A JP59109555 A JP 59109555A JP 10955584 A JP10955584 A JP 10955584A JP S60254848 A JPS60254848 A JP S60254848A
Authority
JP
Japan
Prior art keywords
signal
data
circuit
scramble
pattern
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59109555A
Other languages
English (en)
Inventor
Kazuhisa Yamamoto
和央 山本
Tomoo Ishikawa
石川 倫男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP59109555A priority Critical patent/JPS60254848A/ja
Publication of JPS60254848A publication Critical patent/JPS60254848A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/04Speed or phase control by synchronisation signals
    • H04L7/10Arrangements for initial synchronisation

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、フレーム同期パターンを付加したデータパル
ス列をスクランブル化して送出するスクランブルデータ
の初期送出方式に関し、特にデータが無くフレーム同期
パターンのみ伝送するデータ伝送の初期時のスクランブ
ル方式に関する。
〔発明の技術的背景〕
周知のように、デジタルデータ信号を伝送する際にはデ
ータ信号のスクランブル化を行ない、例えば連続的に信
号″0”が続いたときのタイミング消失を防いだりして
いる。第1図はデータ信号をスクランブル化するための
自己同期形スクランブル回路を示しており、排他オア回
路5は入力端子1に印加されたデータ信号とスクランブ
ル信号発生器6で形成したスクランブル信号との排他的
論理和をとり、スクランブル信号発生器6に加えるとと
もに出力端子2に出力する。出力端子2か発生66は例
えば第2図に示すような回路構成であり、排他オア回路
5から端子3を介して入力されたスクランブルデータ信
号は3ステージのシフトレジスタ10に加えられる。す
なわち、端子3を介して入力された信号は1ビツトずつ
シフトレジスタ11に順次入力され、これに対応してシ
フトレジスタ10のステージ10aの信号はシフトレジ
スタ10のステージ10bに移行し、同時にシフトレジ
スタ10のステージ10bに記録されていた信号はシフ
トレジスタ10のステージ10cに移行し、同時にシフ
トレジスタ10のステージIOCに記録されていた信号
は消滅する。シフトレジスタ10のステージ10a。
10Cの信号は排他オア回路8に入力され、排他オア回
路8はこれらの信号の排他的論理和をとり、上述したス
クランブル信号を形成する。このスクランブル信号は第
1図に示した排他オア回路5に入力される。
かかる自己同期形スクランブル回路に入力される信号は
例えば第3図に示すように、フレーム同期パターン(例
えば8ビツトで01111110”の信号)に挾まれた
部分にデータ(例えば32ビツトの信号)を挿入して構
成される。ところで、このデータ信号を送出する初期時
において、データは全て0”であり、この信号を受信す
る受信側の同期がとれるのをみはからって′送信側はデ
ータ信号の送出を開始する。
〔背景技術の問題点〕
ところで、たまたまスクランブル信号発生器6のシフト
レジスタ10の各ステージ]、Oa 、 10b 、 
10cの信号が全て10”のとき、端子10に印加され
る信号が信号“0”の連続であると、自己同期形スクラ
ンブル回路の出力信号は信号″0”の連続となり、出力
信号は一向にスクランブル化されないという問題点があ
った。
なお、一般に、スクランブル信号発生器6を単体でPN
(疑似雑音)パターン発生器として使う場合、あるいは
PNパターン発生器で形成した信号とデータ信号との排
他的論理和をもってスクランブルデータとする場合には
、PNパターン発生器のシフトレジスタ全ステージが”
0”になるとシフトレジスタの所定のステージの信号を
強制的に信号゛1”にする回路を付加することで上述し
た問題点を解消することができるが、第1図に示した自
己同期形スクランブル回路では、受信側でPNパターン
の同期を必要としないが、スクランブル信号発生回路6
のシフトレジスタの特定ステージの信号を強制的に61
”にするとスクランブル化データそのものが誤りとなり
、このような方法は使えなかった。
〔発明の目的〕
本発明は上述した点に鑑みてなされたもので、データが
全てOである信号送出の初期にスクランブル信号発生器
のシフトレジスタの信号がどのような場合においても、
データ信号を確実にスクランブル化することのできるス
クランブルデータの初期送出方式を提供することを目的
とする。
〔発明の概要〕
本発明では、フレーム同期パターンを付加したデータパ
ルス列をスクランブル化して伝送するスクランブルデー
タ送出方式において、データが無くフレーム同期パター
ンのみ送出する伝送の初期時には、前記フレーム同期パ
ターンの頭から前記スクランブル化を開始するようにし
ている。
〔発明の実施例〕
以下、本発明の実施例を添付図面を参照して詳細に説明
する。
第4図は本発明のスクランブルデータの初期送出方式を
適用したスクランブル回路の一実施例を説明するための
ブロック図である。この実施例においてデータ信号送出
の初期にはスイッチあは接点a、側に切換えられてオー
ル60″パターン発生器乙の出力を選択している。スイ
ッチγはスイッチ切換制御回路5の制御に応じた所定の
周期タイミングで接点す、 、 b2の切換えを行い、
フレーム同期パターン発生器冴から発生されたフレーム
同期パターンと、オール″0”パターン発生器nから発
生されたオール″0”パターンとを交互に選択すること
により所定のデータ信号を形成する。
このデータ信号はスクランブル起動スイッチあを介して
自己同期形スクランブル回路間の排他オア回路5に加え
られることになる。スクランブル起動スイッチ路はスク
ランブル起動回路四の出力により駆動される。スクラン
ブル駆動回路四はスイッチ切換制御回路5の出力を監視
し、スイッチ切換制御回路5から出力される信号がスイ
ッチnの接点す、を選択する信号に切換ったとき、すな
わち、スイッチ27からフレーム同期パターンの出力が
開始されたときに同期してスクランブル起動スイッチ間
に同スイッチ路をオンにする信号を加える。したがって
、自己同期形スクランブル回路加に最初に加えられる信
号は1”を含むフレーム同期パターンとなる。このため
に、自己同期形スクランブル回路頷のスクランブル信号
発生器6のシフトレジスタの各ステージにはフレーム同
期パターンに対応したオール″9″でない信号が最初に
入力され、これに続く入力データが0”の連続であった
としても確実にスクランブルがかけられることになる。
自己同期形スクランブル回路Iによりスクランブルのか
けられたスクランブル化データ信号は出力端子2から図
示しない受信装置に送出され、ここでデスクランブルさ
れて受信される。このスクランブル化データ信号の受信
により受信側でデータ受信の同期が得られるとスイッチ
26を接点a2側に切換え、入力端子21に印加された
データの送出を開始する。
〔発明の効果〕
以上説明したように本発明によれば、データ信号の送出
の初期においても確実にスクランブルをかけることがで
き、受信側では初期の受信同期を容易に得ることができ
る。
【図面の簡単な説明】
第1図は自己同期形スクランブル回路の構成を示すブロ
ック図、第2図は第1図に示した自己同期形スクランブ
ル回路の要部を示すブロック図、第3図はデータ信号の
構成を説明するための図、第4図は本発明のスクランブ
ルデータの初期送出方式を適用したスクランブル回路の
一実施例を示すブロック図である。 1 、2.、3 、4・・・端子、5・・・排他オア回
路、6・・・スクランブル信号発生器、8・・・排他オ
ア回路、10・・シストレジスタ、21・・・端子、n
・・・オール″0”パターン発生器、U・・・フレーム
同期パターン発生器、δ・・スイッチ切換制御回路、ア
、27・・・切換スイッチ、あ・・・スクランブル起動
スイッチ、四・・・スクランブル起動回路、加・・・自
己同期形スクランブル回路。

Claims (1)

    【特許請求の範囲】
  1. 7L/−ム同期パターンを付加したデータパルス列をス
    クランブル化して伝送するスクランブルデータ送出方式
    において、データが無くフレーム同期パターンのみ送出
    する伝送の初期時には、前記フレーム同期パターンの頭
    から前記スクランブル化を開始するよう?こしたことを
    特徴とするスクランブルデータの初期送出方式。
JP59109555A 1984-05-31 1984-05-31 スクランブルデ−タの初期送出方式 Pending JPS60254848A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59109555A JPS60254848A (ja) 1984-05-31 1984-05-31 スクランブルデ−タの初期送出方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59109555A JPS60254848A (ja) 1984-05-31 1984-05-31 スクランブルデ−タの初期送出方式

Publications (1)

Publication Number Publication Date
JPS60254848A true JPS60254848A (ja) 1985-12-16

Family

ID=14513200

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59109555A Pending JPS60254848A (ja) 1984-05-31 1984-05-31 スクランブルデ−タの初期送出方式

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