JPS60252932A - ユニツト誤插入検出装置 - Google Patents
ユニツト誤插入検出装置Info
- Publication number
- JPS60252932A JPS60252932A JP59108530A JP10853084A JPS60252932A JP S60252932 A JPS60252932 A JP S60252932A JP 59108530 A JP59108530 A JP 59108530A JP 10853084 A JP10853084 A JP 10853084A JP S60252932 A JPS60252932 A JP S60252932A
- Authority
- JP
- Japan
- Prior art keywords
- unit
- units
- power supply
- backboard
- wiring
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Power Sources (AREA)
- Direct Current Feeding And Distribution (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ユニット誤挿入検出装置に関し、例えば端局
中継装置などにおいて、シェルフ状に形成されたパック
メート上に電源盤と複数個の所定ユニットを挿着するに
あたり、該複数個のユニ。
中継装置などにおいて、シェルフ状に形成されたパック
メート上に電源盤と複数個の所定ユニットを挿着するに
あたり、該複数個のユニ。
トのうちに、その挿着個所を誤まっているものが存在す
る場合には、該複数個のユニｙ トに対する電源電圧の
供給が阻止されるようにしたユニット誤挿入検出装置に
関する。
る場合には、該複数個のユニｙ トに対する電源電圧の
供給が阻止されるようにしたユニット誤挿入検出装置に
関する。
一般にシェルフ状に形成されたバ、りが−Ｐ上には電源
盤と複数個の所定のユニットが挿着されるのであるが、
その場合、電源盤と複数個の各ユニ、トに対するパック
デート上における挿着個所としては、それぞれ特定の個
所が規定されているのが通常である。しかしこのような
挿着作業を行うにあたり、特定のバックボードに挿着さ
れるべきユニ、トを誤まって別のバックボードに挿着し
たり、あるいは当該パックが−ドに挿着されるべきユニ
ットではあってもその挿着個所を誤まった夛することが
ある。
盤と複数個の所定のユニットが挿着されるのであるが、
その場合、電源盤と複数個の各ユニ、トに対するパック
デート上における挿着個所としては、それぞれ特定の個
所が規定されているのが通常である。しかしこのような
挿着作業を行うにあたり、特定のバックボードに挿着さ
れるべきユニ、トを誤まって別のバックボードに挿着し
たり、あるいは当該パックが−ドに挿着されるべきユニ
ットではあってもその挿着個所を誤まった夛することが
ある。
そのような場合、従来のように、パクク？−ドにユニッ
トを挿着することＫよってその挿着されたユニットに直
ちに電源電圧が供給されるように構成されたものでは、
そのような誤まった挿着作業にもとづいてユニット上に
設けられた回路部品に不当な信号電流が流れ、それらの
部品が電気的に破壊されるおそれがある。
トを挿着することＫよってその挿着されたユニットに直
ちに電源電圧が供給されるように構成されたものでは、
そのような誤まった挿着作業にもとづいてユニット上に
設けられた回路部品に不当な信号電流が流れ、それらの
部品が電気的に破壊されるおそれがある。
本発明は、このような問題点を解決したもので、パ、り
メート上に挿着されるべき複数個のユニ。
メート上に挿着されるべき複数個のユニ。
トのうちに、その挿着個所を誤まっているものが存在す
る場合には、該複数個のユニットに対する電源電圧の供
給が阻止されることによって、それらのユニ、トに設け
られた回路部品の電気的破壊を未然に防止することを目
的としている。
る場合には、該複数個のユニットに対する電源電圧の供
給が阻止されることによって、それらのユニ、トに設け
られた回路部品の電気的破壊を未然に防止することを目
的としている。
本発明によれば、バックボード上に複数個のユニットを
挿着するにあたり、該複数個のユニ、トがすべて該パ、
りぎ−ド上の決められた個所に挿着された場合のみその
閉回路が形成されるユニット挿入信号検出部が設けられ
該ユニ、ト挿入信号検出部の閉回路が形成された場合の
み該複数個のユニ、トに電源電圧が供給されるユニット
誤挿入検出装置が提供される。
挿着するにあたり、該複数個のユニ、トがすべて該パ、
りぎ−ド上の決められた個所に挿着された場合のみその
閉回路が形成されるユニット挿入信号検出部が設けられ
該ユニ、ト挿入信号検出部の閉回路が形成された場合の
み該複数個のユニ、トに電源電圧が供給されるユニット
誤挿入検出装置が提供される。
上記ユニット誤挿入検出装置によれば、・り、りぎ−ド
上に挿着されるべき複数個のユニットのうちに、その挿
着個所を誤まっているものが存在する場合には、ユニッ
ト挿入信号検出部に対する閉回路が形成されない。
上に挿着されるべき複数個のユニットのうちに、その挿
着個所を誤まっているものが存在する場合には、ユニッ
ト挿入信号検出部に対する閉回路が形成されない。
このようにユニット挿入信号検出部においてその挿着個
所を誤まっているユニ、トの存在が検出された場合には
、咳信号検出部の作動にもとづく該複数個のユニットへ
の電源電圧の供給が阻止される。
所を誤まっているユニ、トの存在が検出された場合には
、咳信号検出部の作動にもとづく該複数個のユニットへ
の電源電圧の供給が阻止される。
以下図面にもとづいて本発明の詳細な説明するＯ
まず第２図は、パ、りメート１上に電源盤２と複数個（
第２図においては６個）のユニット３ｉ。
第２図においては６個）のユニット３ｉ。
３２．３３，３４，３５および３６が挿着された状態を
示している。この場合パ、りメート１上には電源盤と複
数個の各ユニットが挿着される個所に第３図に示すよう
なコネクタｌＯが設けられており、該コネクタ１０は複
数個の接続端子（例えば雄端子としての端子ビン）で構
成される。
示している。この場合パ、りメート１上には電源盤と複
数個の各ユニットが挿着される個所に第３図に示すよう
なコネクタｌＯが設けられており、該コネクタ１０は複
数個の接続端子（例えば雄端子としての端子ビン）で構
成される。
一方電源盤と複数個の各ユニットには、該バ。
りが−ド側のコネクタ１０に対応するコネクタが設けら
れており（例えばユニット３１には第３図に示すような
コネクタ３１０が設けられる）、これら電源盤および各
ユニ、トのコネクタはパックメート側のコネクタ１０が
有する接続端子と嵌合する複数個の接続端子（例えばバ
ックボード側の接続端子が雄端子としての端子ビンで構
成される場合は、該端子ビンと嵌合する雌端子）で構成
される。
れており（例えばユニット３１には第３図に示すような
コネクタ３１０が設けられる）、これら電源盤および各
ユニ、トのコネクタはパックメート側のコネクタ１０が
有する接続端子と嵌合する複数個の接続端子（例えばバ
ックボード側の接続端子が雄端子としての端子ビンで構
成される場合は、該端子ビンと嵌合する雌端子）で構成
される。
また上記パックデートｌには、後述するユニット挿入信
号検出部２１に接続されるパックが一ド配線１１が配設
されており、該バックボード配線１１は、各ユニ、ｙ）
３１乃至３６間においては例えば第２図に示すように斜
めに配設される。そして各ユニット３１乃至３６は、そ
れらユニ、トに配設された所定の接続端子３１１乃至３
６１（第１図参照）をそれぞれバックボード側における
対応する接続端子に嵌合することによシ上記パックメー
ト配線１１間に接続される。
号検出部２１に接続されるパックが一ド配線１１が配設
されており、該バックボード配線１１は、各ユニ、ｙ）
３１乃至３６間においては例えば第２図に示すように斜
めに配設される。そして各ユニット３１乃至３６は、そ
れらユニ、トに配設された所定の接続端子３１１乃至３
６１（第１図参照）をそれぞれバックボード側における
対応する接続端子に嵌合することによシ上記パックメー
ト配線１１間に接続される。
ここで該パックボード配置１Ｊ１１間に接続されるべき
各ユニットの接続端子３１１乃至３６１は、例えば各ユ
ニットに設けられた複数個の接続端子のうちから選択さ
れた２本の空き端子を相互接続したもので構成される（
第１図および第３図参照）。
各ユニットの接続端子３１１乃至３６１は、例えば各ユ
ニットに設けられた複数個の接続端子のうちから選択さ
れた２本の空き端子を相互接続したもので構成される（
第１図および第３図参照）。
そしてこの場合、このようにして構成される各ユニット
の接続端子３１１乃至３６１は、上述したように例えば
斜めに配設されたパックデート配線１１に対応するよう
に各ユニット毎にその長さ方向においてそれぞれ異なる
位置に配設されており、その位置は、各ユニ、）３１乃
至３６がそれぞれバックボード上の決められた個所、例
えばそれぞれ第２図に示される所定の個所に挿着された
場合に、当該ユニットの接続端子３１１乃至３６１が当
該個所のパックデート配線１１間に接続されるような位
置とされる。
の接続端子３１１乃至３６１は、上述したように例えば
斜めに配設されたパックデート配線１１に対応するよう
に各ユニット毎にその長さ方向においてそれぞれ異なる
位置に配設されており、その位置は、各ユニ、）３１乃
至３６がそれぞれバックボード上の決められた個所、例
えばそれぞれ第２図に示される所定の個所に挿着された
場合に、当該ユニットの接続端子３１１乃至３６１が当
該個所のパックデート配線１１間に接続されるような位
置とされる。
したがって上記複数個のユニ、トの何れかがそのユニッ
トに対して決められた個所以外の個所に挿着された場合
には、そのユニ、トの接続端子３１１乃至３６１によっ
ては、上記パックデード配線１１間が接続されることは
ない。なお第２図では上記バックボード配線１１が各ユ
ニット間において斜めに配設されているが、必ずしもこ
のような配設形態のみに限定されるものではなく、要は
、各ユニット３１乃至３６がそれぞれパックポード上の
決められた個所に挿着された場合のみ各ユニ、トに設け
られた接続端子３１１乃至３６１が当該個所のバックぎ
一ド配線１１間に接続されるように配設すればよい。
トに対して決められた個所以外の個所に挿着された場合
には、そのユニ、トの接続端子３１１乃至３６１によっ
ては、上記パックデード配線１１間が接続されることは
ない。なお第２図では上記バックボード配線１１が各ユ
ニット間において斜めに配設されているが、必ずしもこ
のような配設形態のみに限定されるものではなく、要は
、各ユニット３１乃至３６がそれぞれパックポード上の
決められた個所に挿着された場合のみ各ユニ、トに設け
られた接続端子３１１乃至３６１が当該個所のバックぎ
一ド配線１１間に接続されるように配設すればよい。
第１図は、本発明の１実施例としての、ユニット誤挿入
検出装置の回路構成図であって、パックデートに挿着さ
れる電源盤２にはユニット挿入信号検出部２１が設けら
れる。そして該バックが一ドに挿着されるべき複数個の
ユニット３１乃至３６がすべてパック♂−ド上の決めら
れた個所に挿着された場合のみ、上記バックぎ−ド配線
１１ト各ユニ、トにおいてそれぞれ異なる位置に配設さ
れた接続端子３１１乃至３６１とＫより上記ユニ、ト挿
入信号検出部２１に対する閉回路が形成され、これによ
り該検出部２１が作動する。
検出装置の回路構成図であって、パックデートに挿着さ
れる電源盤２にはユニット挿入信号検出部２１が設けら
れる。そして該バックが一ドに挿着されるべき複数個の
ユニット３１乃至３６がすべてパック♂−ド上の決めら
れた個所に挿着された場合のみ、上記バックぎ−ド配線
１１ト各ユニ、トにおいてそれぞれ異なる位置に配設さ
れた接続端子３１１乃至３６１とＫより上記ユニ、ト挿
入信号検出部２１に対する閉回路が形成され、これによ
り該検出部２１が作動する。
２２は該検出部２１の作動によシ閉成する接点（例えば
検出部２１に設けられたリレーの接点）を示しており、
該接点２２の閉成によって所定の電源電圧（例えば４８
ｖ）がＤＣ／ＤＣコンバータ２３により所定の電圧（例
えば５Ｖ１１２Ｖなど）Ｋ変換されて、各ユニット３１
乃至３６の電源端子に供給される。
検出部２１に設けられたリレーの接点）を示しており、
該接点２２の閉成によって所定の電源電圧（例えば４８
ｖ）がＤＣ／ＤＣコンバータ２３により所定の電圧（例
えば５Ｖ１１２Ｖなど）Ｋ変換されて、各ユニット３１
乃至３６の電源端子に供給される。
第４図は、上記第１図におけるユニット挿入信号検出部
２１の回路構成の一例を示すもので、上述したように各
ユニ、ト３１乃至３６がすべてパ、クゴード上の決めら
れた個所に挿着された場合のみ、接地側から各抵抗２１
２，２１１、バックボード配線１１．および該パックメ
ート配線間に接続される各ユニットの接続端子を経て一
４８Ｖの電源端子に至る閉回路が形成され、これによフ
トランジスタ２１３が導通しリレー２１４が作動するよ
うになっておフ、該リレー２１４の接点は第１図におい
て２２として示される。なお２１５はリレー２１４に並
列に接続された定電圧ダイオードを示す。この場合図示
のものでは、検出部２１の作動によって電源回路を閉成
する手段として接点性のリレー２１４を用いているが、
これは任意のスイッチング手段におきがえることができ
る。
２１の回路構成の一例を示すもので、上述したように各
ユニ、ト３１乃至３６がすべてパ、クゴード上の決めら
れた個所に挿着された場合のみ、接地側から各抵抗２１
２，２１１、バックボード配線１１．および該パックメ
ート配線間に接続される各ユニットの接続端子を経て一
４８Ｖの電源端子に至る閉回路が形成され、これによフ
トランジスタ２１３が導通しリレー２１４が作動するよ
うになっておフ、該リレー２１４の接点は第１図におい
て２２として示される。なお２１５はリレー２１４に並
列に接続された定電圧ダイオードを示す。この場合図示
のものでは、検出部２１の作動によって電源回路を閉成
する手段として接点性のリレー２１４を用いているが、
これは任意のスイッチング手段におきがえることができ
る。
本発明によれば、パ、り？−ド上に複数個のユニットを
挿着する場合、その挿着個所を誤まって挿着したとして
も、それらのユニ、トに設けられた回路部品の電気的破
壊を未然に防止することができ、回路部品に対する安全
性を確保することができる。
挿着する場合、その挿着個所を誤まって挿着したとして
も、それらのユニ、トに設けられた回路部品の電気的破
壊を未然に防止することができ、回路部品に対する安全
性を確保することができる。
第１図は、本発明の１実施例としてのユニット誤挿入検
出装置についてその電気的接続関係を示す回路図、 第２図は、バックボードに電源盤と複数個のユニットを
挿着した状態を示す図、 第３図は、バ、りメートおよび該バックボードに挿着さ
れるユニ、トの接続端子を示す図、第４図は、第１図装
置におけるユニット挿入信号検出部の具体的回路の１例
を示す図である。 （符号の説明） ｌ・・・バックボード、１１・・・バックボード配線、
２・・・電源盤、２１・・・ユニ、ト挿入信号検出部、
２１４・・・リレー、２２・・・リレー接点、２３・・
・ＤＣ／ｌ）Ｃコ／ ／Ｚ −タ、３１，３２．３３．
３４゜３５．３６・・・ユニｙ）、３１１，３２１，３
６１・・・ユニット側接続端子。 特許出願人 富士通株式会社 特許出願代理人 弁理士 青 木 朗 弁理士 西舘和之 弁理士 内田幸男 弁理士 山 口 昭 之 第１図 第２図 第３図 第４図
出装置についてその電気的接続関係を示す回路図、 第２図は、バックボードに電源盤と複数個のユニットを
挿着した状態を示す図、 第３図は、バ、りメートおよび該バックボードに挿着さ
れるユニ、トの接続端子を示す図、第４図は、第１図装
置におけるユニット挿入信号検出部の具体的回路の１例
を示す図である。 （符号の説明） ｌ・・・バックボード、１１・・・バックボード配線、
２・・・電源盤、２１・・・ユニ、ト挿入信号検出部、
２１４・・・リレー、２２・・・リレー接点、２３・・
・ＤＣ／ｌ）Ｃコ／ ／Ｚ −タ、３１，３２．３３．
３４゜３５．３６・・・ユニｙ）、３１１，３２１，３
６１・・・ユニット側接続端子。 特許出願人 富士通株式会社 特許出願代理人 弁理士 青 木 朗 弁理士 西舘和之 弁理士 内田幸男 弁理士 山 口 昭 之 第１図 第２図 第３図 第４図
Claims (1)
- １、バックボード上に複数個のユニ、トを挿着するＫあ
たり、該複数個のユニットがすべて該パ、り？−ド上の
決められた個所に挿着された場合のみその閉回路が形成
されるユニット挿入信号検出部が設けられ、該ユニット
挿入信号検出部の閉回路が形成された場合のみ該複数個
のユニットに電源電圧が供給されることを特徴とするユ
ニット誤挿入検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59108530A JPS60252932A (ja) | 1984-05-30 | 1984-05-30 | ユニツト誤插入検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59108530A JPS60252932A (ja) | 1984-05-30 | 1984-05-30 | ユニツト誤插入検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60252932A true JPS60252932A (ja) | 1985-12-13 |
Family
ID=14487134
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59108530A Pending JPS60252932A (ja) | 1984-05-30 | 1984-05-30 | ユニツト誤插入検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60252932A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02129711A (ja) * | 1988-11-10 | 1990-05-17 | Nec Corp | 回路カードの実装認識回路 |
| JPH0442730A (ja) * | 1990-06-08 | 1992-02-13 | Nec Corp | 誤実装パツケージ破損防止方式 |
-
1984
- 1984-05-30 JP JP59108530A patent/JPS60252932A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02129711A (ja) * | 1988-11-10 | 1990-05-17 | Nec Corp | 回路カードの実装認識回路 |
| JPH0442730A (ja) * | 1990-06-08 | 1992-02-13 | Nec Corp | 誤実装パツケージ破損防止方式 |
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