JPS60245012A - Ｃｐｕおよびメモリのバツクアツプ電源回路 - Google Patents
Ｃｐｕおよびメモリのバツクアツプ電源回路Info
- Publication number
- JPS60245012A JPS60245012A JP59100772A JP10077284A JPS60245012A JP S60245012 A JPS60245012 A JP S60245012A JP 59100772 A JP59100772 A JP 59100772A JP 10077284 A JP10077284 A JP 10077284A JP S60245012 A JPS60245012 A JP S60245012A
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- JP
- Japan
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- memory
- cpu
- voltage
- battery
- secondary battery
- Prior art date
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- Pending
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- Charge And Discharge Circuits For Batteries Or The Like (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）技術分野
この発明は停電時にＣＰＵおよびメモリをバッテリでバ
ックアップするバックアップ電源回路に関する。
ックアップするバックアップ電源回路に関する。
（ｂ）従来技術とその欠点
一般にＣＰＵおよびメモリをバックアップしなければな
らない電子機器においては、ＣＰＵは一定期間バツクア
ップすればそれ以後バックアップする必要がないが、メ
モリは長期間に亘ってバックアップする必要のあるもの
が多い。例えば電子式キャッシュレジスタではＣＰＵは
一定時間バツクアップすればいいが、メモリに記憶され
ている登録データは長期間保持しておく必要がある。こ
のような電子機器において、従来は一つの電池でＣＰＵ
およびメモリをバックアップするようにしていた。しか
し、このような構成であると、バッテリの容量はメモリ
のデータ保持期間だけ十分にバックアップできる大きさ
にしなければならないために、ＣＰＵは必要期間を越え
てもバックアップされることになり、その分バッテリが
必要以上に大型化するとともに、バッテリ容量も大きく
しなければならず無駄なパワーロスがあった。
らない電子機器においては、ＣＰＵは一定期間バツクア
ップすればそれ以後バックアップする必要がないが、メ
モリは長期間に亘ってバックアップする必要のあるもの
が多い。例えば電子式キャッシュレジスタではＣＰＵは
一定時間バツクアップすればいいが、メモリに記憶され
ている登録データは長期間保持しておく必要がある。こ
のような電子機器において、従来は一つの電池でＣＰＵ
およびメモリをバックアップするようにしていた。しか
し、このような構成であると、バッテリの容量はメモリ
のデータ保持期間だけ十分にバックアップできる大きさ
にしなければならないために、ＣＰＵは必要期間を越え
てもバックアップされることになり、その分バッテリが
必要以上に大型化するとともに、バッテリ容量も大きく
しなければならず無駄なパワーロスがあった。
（Ｃ）発明の目的
この発明の目的は上記の不都合を解消し、小容量の電池
でＣＰＵの動作とメモリのデータを同時に保持し、且つ
メモリのデータの保持時間を十分に確保できるようにし
たバックアンプ電源回路を提供することにある。
でＣＰＵの動作とメモリのデータを同時に保持し、且つ
メモリのデータの保持時間を十分に確保できるようにし
たバックアンプ電源回路を提供することにある。
（ｄ）発明の構成および効果
この発明はＣＰＵの動作状態可能な電圧とメモリのデー
タ保持可能な電圧を比較した場合、通常前者の電圧が高
いという点に着目してなされたものである。この発明は
バンクアップ用の電池を二個並列に接続し、一方の電池
はＣＰＵの動作状態の保持可能な電圧を維持し、他方の
電池はＣＰＵの動作状態の保持は不可能であるが、メモ
リもデする必要がある場合には、高い電圧を供給する第
一の電池でバックアップし、メモリのデータ保持のみが
必要な場合には、ＣＰＵは動作しないがメモリのデータ
の保持の可能な電圧を供給できる第二の電池を使用して
バンクアップするようにしたものである。
タ保持可能な電圧を比較した場合、通常前者の電圧が高
いという点に着目してなされたものである。この発明は
バンクアップ用の電池を二個並列に接続し、一方の電池
はＣＰＵの動作状態の保持可能な電圧を維持し、他方の
電池はＣＰＵの動作状態の保持は不可能であるが、メモ
リもデする必要がある場合には、高い電圧を供給する第
一の電池でバックアップし、メモリのデータ保持のみが
必要な場合には、ＣＰＵは動作しないがメモリのデータ
の保持の可能な電圧を供給できる第二の電池を使用して
バンクアップするようにしたものである。
上記のように構成することにより、この発明によれば、
電池の無駄なパワーロスが全くなく、またメモリデータ
を長時間保持することができ、さらには電池を小型化で
きる利点がある。
電池の無駄なパワーロスが全くなく、またメモリデータ
を長時間保持することができ、さらには電池を小型化で
きる利点がある。
（ｅ）実施例
第１図はこの発明の実施例であるバックアンプ電源回路
を適用した小型電子供給の要部結線図である。ＣＰＵＩ
、メモリ２にはバックアップ電源回路３が並列に接続さ
れている。ＣＰＵＩ、メモＩ７２への電源供給は通常、
図示しないメイン電源から端子ａ、ｂを介して行われる
。またバンクアンプ電源回路３に対しても通常時は充電
電圧が供給されている。バックアンプ電源回路３は第一
の二次電池Ｅｌ、第二の二次電池Ｅ２、電流制限抵抗Ｒ
１，Ｒ２およびバックアップ時に導通するダイオードＤ
２．Ｄ３で構成されている。第一の二次電池Ｅ１は端子
ａ、ｂから一次側電源が供給されないときにＣＰＵＩの
動作状態の保持可能な電圧を維持する。また第二の二次
電池Ｅ２は同様に一次側電源が供給されないときメモリ
２のデータ保持が可能で、ＣＰＵＩの動作状態の保持が
不可能な電圧を維持する。
を適用した小型電子供給の要部結線図である。ＣＰＵＩ
、メモリ２にはバックアップ電源回路３が並列に接続さ
れている。ＣＰＵＩ、メモＩ７２への電源供給は通常、
図示しないメイン電源から端子ａ、ｂを介して行われる
。またバンクアンプ電源回路３に対しても通常時は充電
電圧が供給されている。バックアンプ電源回路３は第一
の二次電池Ｅｌ、第二の二次電池Ｅ２、電流制限抵抗Ｒ
１，Ｒ２およびバックアップ時に導通するダイオードＤ
２．Ｄ３で構成されている。第一の二次電池Ｅ１は端子
ａ、ｂから一次側電源が供給されないときにＣＰＵＩの
動作状態の保持可能な電圧を維持する。また第二の二次
電池Ｅ２は同様に一次側電源が供給されないときメモリ
２のデータ保持が可能で、ＣＰＵＩの動作状態の保持が
不可能な電圧を維持する。
上記の構成で今、−次側電源からの供給が停止すると、
まず、二次電池Ｅ１が電圧供給を始め、ＣＰＵＩとメモ
リ２の動作を保持する。このとき二次電池Ｅ２の電圧は
二次電池Ｅｌの電圧よりも低いために放電しない。二次
電池Ｅ１の電池がなくなってくると、Ｋ１点の電位が下
がりＣＰＵＩが動作を停止し、消費電流が少なくなる。
まず、二次電池Ｅ１が電圧供給を始め、ＣＰＵＩとメモ
リ２の動作を保持する。このとき二次電池Ｅ２の電圧は
二次電池Ｅｌの電圧よりも低いために放電しない。二次
電池Ｅ１の電池がなくなってくると、Ｋ１点の電位が下
がりＣＰＵＩが動作を停止し、消費電流が少なくなる。
さらにＫ１点の電位が下がると、今度は二次電池Ｅ２が
電圧供給を始める。この状態ではＣＰＵＩの動作が停止
しているため、消費電流が非常に少なくなっている。そ
して、この状態は二次電池Ｅ２が完全に放電し終わるま
で続く。
電圧供給を始める。この状態ではＣＰＵＩの動作が停止
しているため、消費電流が非常に少なくなっている。そ
して、この状態は二次電池Ｅ２が完全に放電し終わるま
で続く。
第２図はバックアンプ電源回路３の放電曲線を示す図で
ある。ＰはＫ１点の電位を表し、ＱはＣＰＵＩとメモリ
２の消費電流を表す。電圧ｖ１は二次電池Ｅ１による保
持電圧、電圧ｖ２は二次電池Ｅ２による保持電圧である
。またＡ点は二次電池Ｅ１がなくなり、ＣＰＵＩの動作
が停止し、消費電流が急激に少なくなった点である。電
・流１１はＣＰＵＩの動作時の消費電流値、電流Ｉ２は
ＣＰＵＩが停止時のメモリ２の消費電流値である。
ある。ＰはＫ１点の電位を表し、ＱはＣＰＵＩとメモリ
２の消費電流を表す。電圧ｖ１は二次電池Ｅ１による保
持電圧、電圧ｖ２は二次電池Ｅ２による保持電圧である
。またＡ点は二次電池Ｅ１がなくなり、ＣＰＵＩの動作
が停止し、消費電流が急激に少なくなった点である。電
・流１１はＣＰＵＩの動作時の消費電流値、電流Ｉ２は
ＣＰＵＩが停止時のメモリ２の消費電流値である。
Ｂ点は二次電池Ｅ１の電池が無くなり、Ｋ１点の電位が
下がり、二次電池Ｅ２の電池による電圧供給に代わった
点を示す。また０点は二次電池Ｅ２の電池も無くなりメ
モリ２のデータ保持もできなくなった状態を示す。
下がり、二次電池Ｅ２の電池による電圧供給に代わった
点を示す。また０点は二次電池Ｅ２の電池も無くなりメ
モリ２のデータ保持もできなくなった状態を示す。
上記の実施例では、ＣＰＵＩの動作時間は二次電池Ｅ１
で保証され、メモリ２のデータ保持時間は二次電池Ｅ２
で保証される。したがって、二次電池Ｅ２での保持中は
ＣＰＵＩの動作が停止しているため、消費電流が極めて
少なく長時間の保持が可能となる。また電池として充電
可能な二次電池を使用しているために、二次電池Ｅ１が
無（なったとしても二次電池Ｅ２が無くなる前に一次電
源の供給が行われると、二次電池Ｅｌ、Ｅ２とも充電さ
れために元の状態に回復し、メモリ２のデータが失われ
ることはない。尚、上記実施例では、電池として二次電
池を使用したが、通常の乾電池のような一次電池であっ
てもよく、また電池Ｅ２には大容量のコンデンサを利用
してもよい。
で保証され、メモリ２のデータ保持時間は二次電池Ｅ２
で保証される。したがって、二次電池Ｅ２での保持中は
ＣＰＵＩの動作が停止しているため、消費電流が極めて
少なく長時間の保持が可能となる。また電池として充電
可能な二次電池を使用しているために、二次電池Ｅ１が
無（なったとしても二次電池Ｅ２が無くなる前に一次電
源の供給が行われると、二次電池Ｅｌ、Ｅ２とも充電さ
れために元の状態に回復し、メモリ２のデータが失われ
ることはない。尚、上記実施例では、電池として二次電
池を使用したが、通常の乾電池のような一次電池であっ
てもよく、また電池Ｅ２には大容量のコンデンサを利用
してもよい。
第１図はこの発明の実施例であるバックアップ電源回路
を適用した小型電子機器の要部結線図、第２図は同バッ
クアップ電源回路の放電特性を示す図である。 Ｅ １−第一の二次電池、Ｅ２−４二の二次電池。 出願人 立石電機株式会社 代理人 弁理士 小森久夫 第１図
を適用した小型電子機器の要部結線図、第２図は同バッ
クアップ電源回路の放電特性を示す図である。 Ｅ １−第一の二次電池、Ｅ２−４二の二次電池。 出願人 立石電機株式会社 代理人 弁理士 小森久夫 第１図
Claims (1)
- （１）ＣＰＵと、ＣＰＵの動作電圧より低い電圧でデー
タ保持可能なメモリと、をバックアップする電源回路に
おいて、−次側電源が供給されないときにＣＰＵの動作
状態の保持可能な電圧を維持する第一の電池と、メモリ
のデータ保持が可能でＣＰＵの動作状態が保持不可能な
電圧を維持する第二の電池と、をそれぞれＣＰＵおよび
メモリに並列に接続したことを特徴とするＣＰＵおよび
メモリのバックアップ電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59100772A JPS60245012A (ja) | 1984-05-18 | 1984-05-18 | Ｃｐｕおよびメモリのバツクアツプ電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59100772A JPS60245012A (ja) | 1984-05-18 | 1984-05-18 | Ｃｐｕおよびメモリのバツクアツプ電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60245012A true JPS60245012A (ja) | 1985-12-04 |
Family
ID=14282775
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59100772A Pending JPS60245012A (ja) | 1984-05-18 | 1984-05-18 | Ｃｐｕおよびメモリのバツクアツプ電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60245012A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63128411A (ja) * | 1986-11-19 | 1988-06-01 | Fujitsu Ltd | 充電状態検査方式 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5722253U (ja) * | 1980-07-15 | 1982-02-04 | ||
| JPS58195912A (ja) * | 1982-05-11 | 1983-11-15 | Omron Tateisi Electronics Co | デ−タ保持装置 |
-
1984
- 1984-05-18 JP JP59100772A patent/JPS60245012A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5722253U (ja) * | 1980-07-15 | 1982-02-04 | ||
| JPS58195912A (ja) * | 1982-05-11 | 1983-11-15 | Omron Tateisi Electronics Co | デ−タ保持装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63128411A (ja) * | 1986-11-19 | 1988-06-01 | Fujitsu Ltd | 充電状態検査方式 |
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