JPS6020169Y2 - 記録再生兼用ヘツドの切換回路 - Google Patents
記録再生兼用ヘツドの切換回路Info
- Publication number
- JPS6020169Y2 JPS6020169Y2 JP1978091998U JP9199878U JPS6020169Y2 JP S6020169 Y2 JPS6020169 Y2 JP S6020169Y2 JP 1978091998 U JP1978091998 U JP 1978091998U JP 9199878 U JP9199878 U JP 9199878U JP S6020169 Y2 JPS6020169 Y2 JP S6020169Y2
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- Japan
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- terminal
- recording
- switching circuit
- transistor
- circuit
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Description
【考案の詳細な説明】
この考案は、テープレコーダなどの磁気記録再生装置の
記録再生兼用ヘッドを記録または再生状態にそれぞれ切
換える場合に、従来の機械的接点を有するスイッチの代
わりに半導体スイッチング回路を用い、特にバイアス発
振器が接続された方のヘッド端子側をオン、オフするに
は、スイッチオフの場合の交流耐電圧を高めた半導体ス
イッチング回路を用いるようにした記録再生兼用ヘッド
の切換回路を提供することを目的とする。
記録再生兼用ヘッドを記録または再生状態にそれぞれ切
換える場合に、従来の機械的接点を有するスイッチの代
わりに半導体スイッチング回路を用い、特にバイアス発
振器が接続された方のヘッド端子側をオン、オフするに
は、スイッチオフの場合の交流耐電圧を高めた半導体ス
イッチング回路を用いるようにした記録再生兼用ヘッド
の切換回路を提供することを目的とする。
第１図に示すものは、従来のテープレコーダにおけるこ
の種ヘッド切換回路を示すもので、録音再生ヘッドＨの
一方のヘッド端子１には記録回路（以下、録音回路とい
う）２とバイアス発振器３が接続されており、他方のヘ
ッド端子４には再生回路５が接続されている。
の種ヘッド切換回路を示すもので、録音再生ヘッドＨの
一方のヘッド端子１には記録回路（以下、録音回路とい
う）２とバイアス発振器３が接続されており、他方のヘ
ッド端子４には再生回路５が接続されている。
Ｓは切換スイッチで、録音時には接点す側に切換えられ
て上記ヘッド端子４をアースし、再生時には接点ａ側に
切換えられて上記ヘッド端子１をアースする。
て上記ヘッド端子４をアースし、再生時には接点ａ側に
切換えられて上記ヘッド端子１をアースする。
このように機械的スイッチによってヘッドの切換えを行
なう場合には切換ノイズが発生し易く、また、繰返し使
用による接点の摩耗によって切換動作の信頼性が低下す
るなどの欠点があった。
なう場合には切換ノイズが発生し易く、また、繰返し使
用による接点の摩耗によって切換動作の信頼性が低下す
るなどの欠点があった。
このような機械的スイッチによる欠点を除くためには、
これに代わってトランジスタなどの半導体を用いたスイ
ッチング回路を採用すればよいが、この場合には次のよ
うな別の問題が生ずる。
これに代わってトランジスタなどの半導体を用いたスイ
ッチング回路を採用すればよいが、この場合には次のよ
うな別の問題が生ずる。
トランジスタを用いたスイッチング回路の一例は第２図
に示したようなもので、入力端子６に現われた信号を出
力端子７に出力したり、あるいはショートするためにＮ
ＰＮ型トランジスタＴｒ１のエミッタを出力端子７に接
続し、コレクタをアースするようにしている。
に示したようなもので、入力端子６に現われた信号を出
力端子７に出力したり、あるいはショートするためにＮ
ＰＮ型トランジスタＴｒ１のエミッタを出力端子７に接
続し、コレクタをアースするようにしている。
すなわち、制御端子８から抵抗Ｒ１を介してベース電流
を流すことによって、トランジスタＴｒ１はオンになり
、出力端子７はアースされるが、制御端子８からのベー
ス電流が断たれるとオフとなって信号は出力端子７より
出力される。
を流すことによって、トランジスタＴｒ１はオンになり
、出力端子７はアースされるが、制御端子８からのベー
ス電流が断たれるとオフとなって信号は出力端子７より
出力される。
ただし、通常のシリコントランジスタにおいては、トラ
ンジスタオフの場合の逆耐電圧はコレクタ・ベース間で
は任意のものを選べるが、エミッタ・ベース間では５Ｖ
程度で、かつ、トランジスタの種類に拘らずほぼ一定値
であるから、もし、出力端子７に現われる信号の尖頭値
が５Ｖを超える場合には、出力波形の正の半サイクルが
クリップされてしまうので、このような信号電圧を上記
トランジスタスイッチング回路でオン、オフすることは
できない。
ンジスタオフの場合の逆耐電圧はコレクタ・ベース間で
は任意のものを選べるが、エミッタ・ベース間では５Ｖ
程度で、かつ、トランジスタの種類に拘らずほぼ一定値
であるから、もし、出力端子７に現われる信号の尖頭値
が５Ｖを超える場合には、出力波形の正の半サイクルが
クリップされてしまうので、このような信号電圧を上記
トランジスタスイッチング回路でオン、オフすることは
できない。
また、所定の逆耐電圧を超えた電圧を印加して逆電流を
流すと、トランジスタＴｒ１は次第に劣化する。
流すと、トランジスタＴｒ１は次第に劣化する。
ところで、録音時にヘッド端子に印加されるバイアス電
圧は、カセットテープレコーダにおいてノーマルテープ
を用いた場合でも、尖頭値で４０Ｖ位であり、さらに、
クロームテープなどの使用によってこの値はさらに大き
くなる傾向にあるから、第２図に示すトランジスタスイ
ッチング回路は再生回路に接続された方のヘッド端子４
のオン、オフに用いられるが、バイアス発振器が接続さ
れた方のヘッド端子には使用することができないもので
ある。
圧は、カセットテープレコーダにおいてノーマルテープ
を用いた場合でも、尖頭値で４０Ｖ位であり、さらに、
クロームテープなどの使用によってこの値はさらに大き
くなる傾向にあるから、第２図に示すトランジスタスイ
ッチング回路は再生回路に接続された方のヘッド端子４
のオン、オフに用いられるが、バイアス発振器が接続さ
れた方のヘッド端子には使用することができないもので
ある。
この考案は、以上のような欠点および問題点を除去した
もので、以下、第３図に示す実施例によって説明する。
もので、以下、第３図に示す実施例によって説明する。
第３図はその実施例を示すヘッド切換回路で、録音再生
兼用ヘッドＨ（以下単にヘッドという）のヘッド端子４
に現われるのはヘッドの再生出力で、信号レベルが低い
ことから、このオン、オフは第２図に示したものと同様
な１個のトランジス・りＴｒｌによって行なっている。
兼用ヘッドＨ（以下単にヘッドという）のヘッド端子４
に現われるのはヘッドの再生出力で、信号レベルが低い
ことから、このオン、オフは第２図に示したものと同様
な１個のトランジス・りＴｒｌによって行なっている。
すなわち、録音時には制御回路９より抵抗Ｒ１を介して
ベース電流が流されてトランジスタＴｒ１がオンとなっ
て、ヘッド端子４がアースされるが、再生時にはベース
電流が断たれることによって、トランジスタＴｒ１はオ
フとなって、ヘッドＨよりの再生信号は再生回路５に加
えられる次に、ヘッド端子１のオン、オフは同じ型の２
個のＮＰＮ型トランジスタＴｒ２とＴｒ３とによって行
なわれ、ヘッド端子１にはトランジスタＴｒ２のコレク
タが、また、アース側にはトランジスタＴｒ３のコレク
タが接続されており、さらに、２個のトランジスタＴｒ
２．Ｔｒ３のエミッタ同志が接続されンている。
ベース電流が流されてトランジスタＴｒ１がオンとなっ
て、ヘッド端子４がアースされるが、再生時にはベース
電流が断たれることによって、トランジスタＴｒ１はオ
フとなって、ヘッドＨよりの再生信号は再生回路５に加
えられる次に、ヘッド端子１のオン、オフは同じ型の２
個のＮＰＮ型トランジスタＴｒ２とＴｒ３とによって行
なわれ、ヘッド端子１にはトランジスタＴｒ２のコレク
タが、また、アース側にはトランジスタＴｒ３のコレク
タが接続されており、さらに、２個のトランジスタＴｒ
２．Ｔｒ３のエミッタ同志が接続されンている。
Ｔｒ、はトランジスタＴｒ２とＴｒ３のベース電流制御
用のＰＮＰ型トランジスタで、再生時には制御回路１０
によってトランジスタＴｒ、にベース電流が流されて、
これがオンになると、トランジスタＴｒ２１とＴｒ３は
電源子Ｂより低損ア。
用のＰＮＰ型トランジスタで、再生時には制御回路１０
によってトランジスタＴｒ、にベース電流が流されて、
これがオンになると、トランジスタＴｒ２１とＴｒ３は
電源子Ｂより低損ア。
とＲ３を介してベース電流が流れて共にオンとなり、ヘ
ッド端子１がアースされる。
ッド端子１がアースされる。
また、録音時には上記のベース電流が全て断たれるので
、トランジスタＴｒ２．Ｔｒ３．Ｔｒ４は全てオフとな
り、バイアス発振器３の出力はヘッドＨに供給される。
、トランジスタＴｒ２．Ｔｒ３．Ｔｒ４は全てオフとな
り、バイアス発振器３の出力はヘッドＨに供給される。
なお、以上のスイッチング回路に用いられるトランジス
タＴｒ２とＴｒ３としては、トランジスタオフの場合の
コレクタ・ベース間の逆極性の耐電圧がバイアス電圧の
尖頭値（約４０Ｖ）より大きいものを選定してあり、ま
た、トランジスタＴｒ４にもバイアス電圧の尖頭値より
大きいベース・コレクタ間の逆耐電圧を有するものが用
いられている。
タＴｒ２とＴｒ３としては、トランジスタオフの場合の
コレクタ・ベース間の逆極性の耐電圧がバイアス電圧の
尖頭値（約４０Ｖ）より大きいものを選定してあり、ま
た、トランジスタＴｒ４にもバイアス電圧の尖頭値より
大きいベース・コレクタ間の逆耐電圧を有するものが用
いられている。
したがって、トランジスタＴｒ２．Ｔｒ３．Ｔｒ、の全
てがオフの場合に、バイアス電圧の正の半サイクルはト
ランジスタＴｒ２のコレクタ・ベース間の逆極性によっ
て阻止され、また、負の半サイクルはトランジスタＴｒ
３のコレクタ・ベース間の逆極性によって阻止され、さ
らに、上記バイアス電圧の負の半サイクルが別の経路す
なわち比較的低い電源インピーダンスとトランジスタＴ
ｒ４を通じてトランジスタＴｒ２のベース・コレクタ間
の順方向極性に印加されたとしても、トランジスタＴｒ
、のベース・コレクタ間の逆極性によって阻止される。
てがオフの場合に、バイアス電圧の正の半サイクルはト
ランジスタＴｒ２のコレクタ・ベース間の逆極性によっ
て阻止され、また、負の半サイクルはトランジスタＴｒ
３のコレクタ・ベース間の逆極性によって阻止され、さ
らに、上記バイアス電圧の負の半サイクルが別の経路す
なわち比較的低い電源インピーダンスとトランジスタＴ
ｒ４を通じてトランジスタＴｒ２のベース・コレクタ間
の順方向極性に印加されたとしても、トランジスタＴｒ
、のベース・コレクタ間の逆極性によって阻止される。
このために、ヘッドＨに供給されるバイアス電圧の波形
がクリップされたり、トランジスタが耐電圧を超えた逆
電圧によって次第に劣化するなどの問題は全く生じない
。
がクリップされたり、トランジスタが耐電圧を超えた逆
電圧によって次第に劣化するなどの問題は全く生じない
。
また、トランジスタＴｒ２とＴｒ３あるいはＴｒ、とし
て逆耐電圧がこれよりさらに大きなシリコントランジス
タを用いることも容易であるから、上記のヘッド切換回
路は前述のようなりロームテープその他によるバイアス
電圧の増加傾向にも充分に対処することができる。
て逆耐電圧がこれよりさらに大きなシリコントランジス
タを用いることも容易であるから、上記のヘッド切換回
路は前述のようなりロームテープその他によるバイアス
電圧の増加傾向にも充分に対処することができる。
なお、２個のトランジスタＴｒ２とＴｒ３を用いた基本
的なスイッチング回路については先に本出願人が実願昭
５２−１７０８吋をもって出願ずみであるが、この考案
はこれを記録再生兼用ヘッドの切換回路に適用したもの
である。
的なスイッチング回路については先に本出願人が実願昭
５２−１７０８吋をもって出願ずみであるが、この考案
はこれを記録再生兼用ヘッドの切換回路に適用したもの
である。
この考案は、以上のように、記録再生兼用ヘッドＨの一
方の端子１に記録回路２とバイアス発振器３を接続し、
また、他方の端子４には再生回路５を接続して、記録時
には再生回路５を接続した他方の端子４をアースし、再
生時には記録回路２とバイアス発振器３を接続した一方
の端子１をアースするようにした記録再生兼用ヘッドの
切換回路において、記録時には再生回路５を接続した他
方の端子４を第１のトランジスタＴｒ工を用いた半導体
スイッチング回路によってアースし、再生時には上記記
録回路２とバイアス発振器３を接続した一方の端子１を
、エミッタとエミッタを接続した同じ型の第２および第
３の２個のトランジスタＴｒ２．Ｔｒ３の一方のコレク
タをスイッチング回路の信号端子と腰他方のコレクタを
スイッチング回路のアース端子とし、両方のベースを共
に上記第２および第３のトランジスタＴｒ２．Ｔｒ３と
は異なる極性を有する第４のトランジスタＴｒ４のコレ
クタに接続し、エミッタに電源を供給し、ベースには制
御電圧を供給して、第２および第３の２個のトランジス
タＴｒ２．Ｔｒ３のオン、オフをこれらのトランジスタ
Ｔｒ２．Ｔｒ３に流すベース電流の有無を上記第４のト
ランジスタＴｒ４のベース’ＷＩ流によって制御するよ
うにしてスイッチオフの場合の交流耐電圧を高めた半導
体スイッチング回路、によってアースするように構成し
た記録再生兼用ヘッドの切換回路を提供したので、従来
の機械的スイッチを用いる場合に比較し゛Ｃ１切換ノズ
ルの発生は殆んど皆無となり、かつ、繰返し使用に対す
る劣化も殆んどなく、スイッチング動作の信頼性が高い
という長所があり、さらに、比較的高電圧のバイアス電
圧が印加される方のヘッド端子のオン、オフには、２個
のトランジスタを用いたトランジスタスイッチング素子
によって、スイッチオフの場合の交流耐電圧を高めるよ
うにしているので、すなわち、第３図に示す実施例にお
いて、印加電圧の正の半サイクルはトランジスタＴｒ２
のコレクタ・ベース間の逆耐電圧により、また、負の半
サイクルはトランジスタＴｒ３のコレクタ・ベース間の
逆耐電圧により、各々のトランジスタのコレクタ・ベー
ス間に印加される逆耐電圧を定格以下にすることができ
、この耐電圧を超えるバイアス電圧が印加されてヘッド
に供給されるバイアス電流に歪を生じることがなく、ま
た、耐電圧を超えるバイアス電圧の印加によって逆電流
が流れて、スイッチング素子自体の劣化を招くこともな
、＜、また、第２および第３のトランジスタのオン、オ
フは、第４のトランジスタのベースＮ流を制御するだけ
で行なわれ、第２および第３のトランジスタの共通に接
続されたエミッタにはバイアス電圧を印加する必要もな
く、その他、再生信号のみが印加されるヘッド端子のオ
ン、オフは１個のトランジスタによって行なっているた
めに、コスト的にも有利となるなどの特長がある。
方の端子１に記録回路２とバイアス発振器３を接続し、
また、他方の端子４には再生回路５を接続して、記録時
には再生回路５を接続した他方の端子４をアースし、再
生時には記録回路２とバイアス発振器３を接続した一方
の端子１をアースするようにした記録再生兼用ヘッドの
切換回路において、記録時には再生回路５を接続した他
方の端子４を第１のトランジスタＴｒ工を用いた半導体
スイッチング回路によってアースし、再生時には上記記
録回路２とバイアス発振器３を接続した一方の端子１を
、エミッタとエミッタを接続した同じ型の第２および第
３の２個のトランジスタＴｒ２．Ｔｒ３の一方のコレク
タをスイッチング回路の信号端子と腰他方のコレクタを
スイッチング回路のアース端子とし、両方のベースを共
に上記第２および第３のトランジスタＴｒ２．Ｔｒ３と
は異なる極性を有する第４のトランジスタＴｒ４のコレ
クタに接続し、エミッタに電源を供給し、ベースには制
御電圧を供給して、第２および第３の２個のトランジス
タＴｒ２．Ｔｒ３のオン、オフをこれらのトランジスタ
Ｔｒ２．Ｔｒ３に流すベース電流の有無を上記第４のト
ランジスタＴｒ４のベース’ＷＩ流によって制御するよ
うにしてスイッチオフの場合の交流耐電圧を高めた半導
体スイッチング回路、によってアースするように構成し
た記録再生兼用ヘッドの切換回路を提供したので、従来
の機械的スイッチを用いる場合に比較し゛Ｃ１切換ノズ
ルの発生は殆んど皆無となり、かつ、繰返し使用に対す
る劣化も殆んどなく、スイッチング動作の信頼性が高い
という長所があり、さらに、比較的高電圧のバイアス電
圧が印加される方のヘッド端子のオン、オフには、２個
のトランジスタを用いたトランジスタスイッチング素子
によって、スイッチオフの場合の交流耐電圧を高めるよ
うにしているので、すなわち、第３図に示す実施例にお
いて、印加電圧の正の半サイクルはトランジスタＴｒ２
のコレクタ・ベース間の逆耐電圧により、また、負の半
サイクルはトランジスタＴｒ３のコレクタ・ベース間の
逆耐電圧により、各々のトランジスタのコレクタ・ベー
ス間に印加される逆耐電圧を定格以下にすることができ
、この耐電圧を超えるバイアス電圧が印加されてヘッド
に供給されるバイアス電流に歪を生じることがなく、ま
た、耐電圧を超えるバイアス電圧の印加によって逆電流
が流れて、スイッチング素子自体の劣化を招くこともな
、＜、また、第２および第３のトランジスタのオン、オ
フは、第４のトランジスタのベースＮ流を制御するだけ
で行なわれ、第２および第３のトランジスタの共通に接
続されたエミッタにはバイアス電圧を印加する必要もな
く、その他、再生信号のみが印加されるヘッド端子のオ
ン、オフは１個のトランジスタによって行なっているた
めに、コスト的にも有利となるなどの特長がある。
第１図は従来のヘッド切換回路図、第２図はトランジス
タスイッチング回路の一例を示す回路図、第３図はこの
考案になるヘッド切換回路の第１実施例を示す回路図で
ある。 Ｈ・・・・・・録音（記録）再生兼用ヘッド、Ｔｒ１〜
Ｔｒ４・・・・・・トランジスタ、Ｒ□〜Ｒ３・・・・
・・抵抗、１−−−−−−ヘッド端子、２・・・・・・
録音回路、３・・・・・・バイアス発振器、４・・・・
・・ヘッド端子、５・・・・・・再生回路、９゜１０・
・・・・・制御回路。
タスイッチング回路の一例を示す回路図、第３図はこの
考案になるヘッド切換回路の第１実施例を示す回路図で
ある。 Ｈ・・・・・・録音（記録）再生兼用ヘッド、Ｔｒ１〜
Ｔｒ４・・・・・・トランジスタ、Ｒ□〜Ｒ３・・・・
・・抵抗、１−−−−−−ヘッド端子、２・・・・・・
録音回路、３・・・・・・バイアス発振器、４・・・・
・・ヘッド端子、５・・・・・・再生回路、９゜１０・
・・・・・制御回路。
Claims (1)
- 記録再生用ヘッドの一方の端子に記録回路とバイアス発
振器を接続し、また、他方の端子には再生回路を接続し
て、記録時には再生回路を接続した他方の端子をアース
し、再生時には記録回路とバイアス発振器を接続した一
方の端子をアースするようにした記録再生兼用ヘッドの
切換回路において、記録時には再生回路を接続した他方
の端子を第１のトランジスタを用いた半導体スイッチン
グ回路によってアースし、再生時には上記記録回路とバ
イアス発振器を接続して一方の端子を、エミッタとエミ
ッタを接続した同じ型の第２および第３の２個のトラン
ジスタの一方のコレクタをスイッチング回路の信号端子
とし、他方のコレクタをスイッチング回路のアース端子
とし、両方のベースを共に上記第２および第３のトラン
ジスタとは異なる極性を有する第４のトランジスタのコ
レクタに接続し、エミッタに電源を供給し、ベースには
制御電圧を供給して、第２および第３の２個のトランジ
スタのオン、オフをこれらのトランジスタに流すベース
電流の有無を上記第４のトランジスタのベース電流によ
って制御するようにしてスイッチオフの場合の交流耐電
圧を高めた半導体スイッチング回路、によってアースす
るように構成した記録再生兼用ヘッドの切換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1978091998U JPS6020169Y2 (ja) | 1978-07-04 | 1978-07-04 | 記録再生兼用ヘツドの切換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1978091998U JPS6020169Y2 (ja) | 1978-07-04 | 1978-07-04 | 記録再生兼用ヘツドの切換回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5511630U JPS5511630U (ja) | 1980-01-25 |
| JPS6020169Y2 true JPS6020169Y2 (ja) | 1985-06-17 |
Family
ID=29021776
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1978091998U Expired JPS6020169Y2 (ja) | 1978-07-04 | 1978-07-04 | 記録再生兼用ヘツドの切換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6020169Y2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57113833U (ja) * | 1981-01-07 | 1982-07-14 | ||
| JPS58161450U (ja) * | 1982-04-24 | 1983-10-27 | 株式会社クボタ | 脱穀機の排ワラ処理装置 |
| JPS59218608A (ja) * | 1984-05-09 | 1984-12-08 | Matsushita Electric Ind Co Ltd | ステレオ磁気記録再生装置の切換回路 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4984624A (ja) * | 1972-12-19 | 1974-08-14 | ||
| JPS5012294A (ja) * | 1973-06-02 | 1975-02-07 | ||
| JPS5142267U (ja) * | 1974-09-24 | 1976-03-29 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5211481Y2 (ja) * | 1972-06-30 | 1977-03-12 |
-
1978
- 1978-07-04 JP JP1978091998U patent/JPS6020169Y2/ja not_active Expired
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4984624A (ja) * | 1972-12-19 | 1974-08-14 | ||
| JPS5012294A (ja) * | 1973-06-02 | 1975-02-07 | ||
| JPS5142267U (ja) * | 1974-09-24 | 1976-03-29 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5511630U (ja) | 1980-01-25 |
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