JPS60178651A - 半導体装置 - Google Patents
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- H01L2924/30—Technical effects
- H01L2924/301—Electrical effects
- H01L2924/3025—Electromagnetic shielding
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(技術分野)
本発明は半導体装置に係シ、特に樹脂封止型半導体装置
の構造に関するものである。
の構造に関するものである。
(従来技術)
従来、樹脂封止型半導体装置はセラミツクツくツケージ
封止型半導体装置と比して安価で、大量生産向きという
理由から、主流の半導体装置となっておシ、特にモール
ド樹脂封止方式が多く用いられている。
封止型半導体装置と比して安価で、大量生産向きという
理由から、主流の半導体装置となっておシ、特にモール
ド樹脂封止方式が多く用いられている。
しかしながらモールド樹脂封止の半導体装置には以下の
如き欠点がめる。
如き欠点がめる。
(1)モールド樹脂は硬化収縮や熱膨張係数が大きく、
半導体素子に対する内部応力が大きい。
半導体素子に対する内部応力が大きい。
(2)モールド樹脂は半導体素子との密着性に乏しく、
熱ストレスによシ牛導体素子とモールド樹脂との界面が
剥離しやすい。
熱ストレスによシ牛導体素子とモールド樹脂との界面が
剥離しやすい。
(3)モールド樹脂の改質材として用いられている充填
材(通常シリカ・・・s io、が用いられる)等の添
加剤にはウラン(U)やトリウム(Th)等の放射性元
素を含有しているものがある。
材(通常シリカ・・・s io、が用いられる)等の添
加剤にはウラン(U)やトリウム(Th)等の放射性元
素を含有しているものがある。
上記(1)については半導体素子の特性変動や破壊の原
因となる。
因となる。
上記(2)については特に半田浸し等の急激な熱ストレ
スが原因となつて界面の剥離が起こり、耐湿性が極端に
低下することがあった。
スが原因となつて界面の剥離が起こり、耐湿性が極端に
低下することがあった。
上記(3)についてウランやトリウム等より放射される
α粒子が半導体メモリーの記憶内容を反転させるいわゆ
るソフトエラーの原因となる。
α粒子が半導体メモリーの記憶内容を反転させるいわゆ
るソフトエラーの原因となる。
以上(1)〜(3)で説明したように従来の樹脂封止型
半導体装置には信頼性上の欠点があった。
半導体装置には信頼性上の欠点があった。
そこで上記(1)〜(3)の問題点を解決する手段の1
つとして半導体素子表面を低応力でかつ高純度な液状シ
リコ−7J CR(Junction (:oatin
gResin)等の樹脂で30〜300μm程度の膜厚
のコーティングを施すことが考えられている。しかしな
がらコーテイング膜とモールド樹脂との熱膨張係数の違
い等が起因して温度サイクルのような環境試験7行なう
と、数十サイクル程度からボンディング、ワイヤーの破
断現象が起こるという欠点があり、実用化には問題があ
った。
つとして半導体素子表面を低応力でかつ高純度な液状シ
リコ−7J CR(Junction (:oatin
gResin)等の樹脂で30〜300μm程度の膜厚
のコーティングを施すことが考えられている。しかしな
がらコーテイング膜とモールド樹脂との熱膨張係数の違
い等が起因して温度サイクルのような環境試験7行なう
と、数十サイクル程度からボンディング、ワイヤーの破
断現象が起こるという欠点があり、実用化には問題があ
った。
また別の手段としてモールド樹脂自体を低応力化し、か
つ充填材等の添加剤の見直しを行ないα線束レベルを低
く押える方法も考えられているが、モールド樹脂の低応
力化には限度があること、高純度の原材料を用いること
による高価格化等の問題があり、このような手法も不充
分であった。
つ充填材等の添加剤の見直しを行ないα線束レベルを低
く押える方法も考えられているが、モールド樹脂の低応
力化には限度があること、高純度の原材料を用いること
による高価格化等の問題があり、このような手法も不充
分であった。
(発明の目的)
本発明の目的は上記多数の問題点を一挙に解決し、信頼
性が高い新規な樹脂封止型半導体装置を提供することに
ある。
性が高い新規な樹脂封止型半導体装置を提供することに
ある。
(発明の構成)
上記目的の達成するため本発明の要旨は、樹脂封止型半
導体メモリーにおいて、外部との電気的接続をとるため
のボンディングを行なった後に、ボンディングワイヤー
と半導体素子の接続部であるボンディングボール部の直
上部を被覆しないようにゲル状乃至ゴム状の液状樹脂に
て該半導体素子表面全体に薄膜を形成し、その後メモリ
ー回路の能動域上にα線遮へい層を形成したことを特徴
とする。
導体メモリーにおいて、外部との電気的接続をとるため
のボンディングを行なった後に、ボンディングワイヤー
と半導体素子の接続部であるボンディングボール部の直
上部を被覆しないようにゲル状乃至ゴム状の液状樹脂に
て該半導体素子表面全体に薄膜を形成し、その後メモリ
ー回路の能動域上にα線遮へい層を形成したことを特徴
とする。
(発明の作用)
本発明によれば、ポンディングボール部以下の部分をゲ
ル状乃至ゴム状の低応力液状樹脂にて表面全体をコーテ
ィングしたことによシ、半導体素子へのストレスが無く
すことができ、かつ温度サイクル試験によるボンデイン
ワイヤーの破断を回避することが可能となる。その理由
としては半導体素子に膜厚を変えてコーティングした試
料を調査したところ、コーテイング膜がボンディングボ
ール真上部を被覆したものが%温度サイクル試験で不良
発生しやすく、ボンディングワイヤーの切れる箇所は大
部分が該ボンディングボール真上部であることを見出し
たからである。
ル状乃至ゴム状の低応力液状樹脂にて表面全体をコーテ
ィングしたことによシ、半導体素子へのストレスが無く
すことができ、かつ温度サイクル試験によるボンデイン
ワイヤーの破断を回避することが可能となる。その理由
としては半導体素子に膜厚を変えてコーティングした試
料を調査したところ、コーテイング膜がボンディングボ
ール真上部を被覆したものが%温度サイクル試験で不良
発生しやすく、ボンディングワイヤーの切れる箇所は大
部分が該ボンディングボール真上部であることを見出し
たからである。
またこの傾向は半導体素子へのストレスを低減できるゲ
ル状乃至ゴム状の樹脂の方が著しかった。
ル状乃至ゴム状の樹脂の方が著しかった。
またゲル状乃至ゴム状のコーティングは半田浸し等の急
激な熱ストレスでも界面の剥離を生じることが無く、耐
湿性の向上に効果があった。
激な熱ストレスでも界面の剥離を生じることが無く、耐
湿性の向上に効果があった。
さらにコーテイング後メモリー回路の能動域上にα線遮
へい層を形成したことによシα線によるソフトエラーの
防止もできる。
へい層を形成したことによシα線によるソフトエラーの
防止もできる。
(実施例)
次に本発明について図面を用いて説明する。
従来の半導体装置の断面図は第1図に示すように金や銀
メッキ等の施された半導体素子載置部を有するリードフ
レーム1に半導体メモリー素子2を金属ロー相等で接着
し、紀半導体メモリー素子2とリード部とをボンディン
グワイヤー3で接続した後、モールド樹脂4により封止
されていた。
メッキ等の施された半導体素子載置部を有するリードフ
レーム1に半導体メモリー素子2を金属ロー相等で接着
し、紀半導体メモリー素子2とリード部とをボンディン
グワイヤー3で接続した後、モールド樹脂4により封止
されていた。
このような構造の場合、モールド樹脂4と半導体メモリ
ー素子2とが直接接しているため、モールド樹脂4の熱
膨張や硬化収縮が大きい仁とが原因で半導体メモリー索
子2の特性が変動したり。
ー素子2とが直接接しているため、モールド樹脂4の熱
膨張や硬化収縮が大きい仁とが原因で半導体メモリー索
子2の特性が変動したり。
またモールド樹脂の密着性が乏しいことにより半田浸し
等の急激な熱ストレスによシ半導体メモリー素子2との
界面で剥離を起こし、耐湿性が低下する問題があった。
等の急激な熱ストレスによシ半導体メモリー素子2との
界面で剥離を起こし、耐湿性が低下する問題があった。
さらにモールド樹脂に通常70 wt%配合されている
シリカ等の無機充填剤からはα線が放射され、半導体メ
モリー素子の能動域5に当たりた場合、ソフトエラーを
起こすことがあった。
シリカ等の無機充填剤からはα線が放射され、半導体メ
モリー素子の能動域5に当たりた場合、ソフトエラーを
起こすことがあった。
このような問題点を改善するため考えられたのが第2図
に示した従来例である。第2図は半導体メモリー素子1
2上にコーテイング膜16を従来技術にて30〜300
μm被覆したものの断面図である。このような構造の場
合、上述の問題点は改善されるものの、温度サイクルの
ような環境試験により、ボンディング・ワイヤーが破断
する現象が起こる。この現象はモールド樹脂14とコー
ディング膜16との熱膨張差によるストレスがボンディ
ング・ワイヤー13の引張り強度の弱くなるボンディン
グボールの真上部17を引張シ、その際に強度の弱いコ
ーテイング膜では該ポンディグワイヤーの直上部17を
被覆しても破断を防止しきれないことが原因と考えられ
る。
に示した従来例である。第2図は半導体メモリー素子1
2上にコーテイング膜16を従来技術にて30〜300
μm被覆したものの断面図である。このような構造の場
合、上述の問題点は改善されるものの、温度サイクルの
ような環境試験により、ボンディング・ワイヤーが破断
する現象が起こる。この現象はモールド樹脂14とコー
ディング膜16との熱膨張差によるストレスがボンディ
ング・ワイヤー13の引張り強度の弱くなるボンディン
グボールの真上部17を引張シ、その際に強度の弱いコ
ーテイング膜では該ポンディグワイヤーの直上部17を
被覆しても破断を防止しきれないことが原因と考えられ
る。
以上説明したように従来技術では信頼性上の大きな欠点
が多数あった。
が多数あった。
これに対して本発明によ・る半導体装置の一実施例は第
3図に示すように、ワイヤーボンディング済の半導体メ
モリー素子22上にゲル状乃至ゴム状の低応力液状樹脂
の薄膜26をコーティングしである。その膜厚はボンデ
ィングボールの直上部27を被機しなければ良いが、調
査の結果5〜15μm程度が使い易かった。また材質と
してはゲル状シリコーン樹脂がストレスの低減の意味か
らも最も好ましい結果が得られたが、本発明の内容を限
定するものではない。
3図に示すように、ワイヤーボンディング済の半導体メ
モリー素子22上にゲル状乃至ゴム状の低応力液状樹脂
の薄膜26をコーティングしである。その膜厚はボンデ
ィングボールの直上部27を被機しなければ良いが、調
査の結果5〜15μm程度が使い易かった。また材質と
してはゲル状シリコーン樹脂がストレスの低減の意味か
らも最も好ましい結果が得られたが、本発明の内容を限
定するものではない。
続いてメモリー素子回路の能動域25上にα線遮へい層
28を設け、モールド樹脂封止しである。
28を設け、モールド樹脂封止しである。
該αm遮へい層28はボンディングワイヤー23を変形
させることが無く、かつ能動域25を完全に遮へいして
おシ、さらにα線を元号に阻止できる厚さであればいか
なる形状、大きさ、厚さであっても限定されることはな
い。
させることが無く、かつ能動域25を完全に遮へいして
おシ、さらにα線を元号に阻止できる厚さであればいか
なる形状、大きさ、厚さであっても限定されることはな
い。
また材質についてはα線発生量の少ない材料であれば有
機材料、無機材料を問わず限定されることはない。
機材料、無機材料を問わず限定されることはない。
なお検討の結果厚さ30μ以上の/リコーン・ゴム、厚
さ30μ以上のポリイミドフィルムなどの有機系の材料
が取シ扱い易く、また純度が高くα線量も少ないため、
好ましいものであった。
さ30μ以上のポリイミドフィルムなどの有機系の材料
が取シ扱い易く、また純度が高くα線量も少ないため、
好ましいものであった。
α線遮へい膜の形成方法は薄膜のコーテイング膜をディ
スペンサー等で滴下した後、硬化前に遮へい膜を貼り付
は同時に硬化させても良いし、別工程にて接着剤等で貼
り付けても良い。
スペンサー等で滴下した後、硬化前に遮へい膜を貼り付
は同時に硬化させても良いし、別工程にて接着剤等で貼
り付けても良い。
(発明の効果)
以上詳述したように本発明の一実施例の新規な半導体装
置では温度サイクル性、樹脂の応力による特性変動、半
田浸し等による耐湿性劣化、α線によるリフトエラー等
の諸問題を一度に解決でき、その効果は非常に大きいも
のである。
置では温度サイクル性、樹脂の応力による特性変動、半
田浸し等による耐湿性劣化、α線によるリフトエラー等
の諸問題を一度に解決でき、その効果は非常に大きいも
のである。
第1図及び第2図は従来の半導体装置の断面図であシ、
第3図は本発明による半導体装置の一実施例を示す断面
図である。 なお図において1.11.21・・・・・・リードフレ
ム、2,12.22・・・・・・半導体メモリー素子、
3゜13.23・・・・・・ボンディング・ワイヤー、
4,14゜24・・・・・・モールド樹脂、5,15.
25・・・・・・メモリー回路の能動域、16・・・・
・・従来技術におけるコーティング膜、17.27・・
・・・・ボンデインボールボール:直上部、26・・・
・・・ゲル状乃至ゴム状のコーティング薄膜、28・・
・・・・αlfi!遮へい層を各々示す。 第1図 +2図 第3図
第3図は本発明による半導体装置の一実施例を示す断面
図である。 なお図において1.11.21・・・・・・リードフレ
ム、2,12.22・・・・・・半導体メモリー素子、
3゜13.23・・・・・・ボンディング・ワイヤー、
4,14゜24・・・・・・モールド樹脂、5,15.
25・・・・・・メモリー回路の能動域、16・・・・
・・従来技術におけるコーティング膜、17.27・・
・・・・ボンデインボールボール:直上部、26・・・
・・・ゲル状乃至ゴム状のコーティング薄膜、28・・
・・・・αlfi!遮へい層を各々示す。 第1図 +2図 第3図
Claims (1)
- 【特許請求の範囲】 (1〕 樹脂封止型半導体メモリーにおいて、外部との
電気的接続をとるためのボンディングを行なった後に、
ボンディングワイヤーと半導体素子との接続部のボンデ
ィングボールの直上部を被覆しないようにゲール状乃至
ゴム状の液状樹脂にて該半導体素子の表面に薄膜を形成
し、その後メモリー回路の能動域上にα線遮へい層を形
成したことを特徴とする半導体装置。 (2)該薄膜が5〜15μIn厚のゲル状乃至ゴム状シ
リコーン樹脂で形成されていることを特徴とする特許請
求の範囲第(1)項記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59033456A JPS60178651A (ja) | 1984-02-24 | 1984-02-24 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59033456A JPS60178651A (ja) | 1984-02-24 | 1984-02-24 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60178651A true JPS60178651A (ja) | 1985-09-12 |
Family
ID=12387037
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59033456A Pending JPS60178651A (ja) | 1984-02-24 | 1984-02-24 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60178651A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5866953A (en) * | 1996-05-24 | 1999-02-02 | Micron Technology, Inc. | Packaged die on PCB with heat sink encapsulant |
US6117797A (en) * | 1998-09-03 | 2000-09-12 | Micron Technology, Inc. | Attachment method for heat sinks and devices involving removal of misplaced encapsulant |
US6297960B1 (en) | 1998-06-30 | 2001-10-02 | Micron Technology, Inc. | Heat sink with alignment and retaining features |
US6297548B1 (en) | 1998-06-30 | 2001-10-02 | Micron Technology, Inc. | Stackable ceramic FBGA for high thermal applications |
US6326687B1 (en) | 1998-09-01 | 2001-12-04 | Micron Technology, Inc. | IC package with dual heat spreaders |
-
1984
- 1984-02-24 JP JP59033456A patent/JPS60178651A/ja active Pending
Cited By (21)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6617684B2 (en) | 1996-05-24 | 2003-09-09 | Micron Technology, Inc. | Packaged die on PCB with heat sink encapsulant |
US5866953A (en) * | 1996-05-24 | 1999-02-02 | Micron Technology, Inc. | Packaged die on PCB with heat sink encapsulant |
US6853069B2 (en) | 1996-05-24 | 2005-02-08 | Micron Technology, Inc. | Packaged die on PCB with heat sink encapsulant and methods |
US6534858B2 (en) | 1996-05-24 | 2003-03-18 | Micron Technology, Inc. | Assembly and methods for packaged die on pcb with heat sink encapsulant |
US7285442B2 (en) | 1998-06-30 | 2007-10-23 | Micron Technology, Inc. | Stackable ceramic FBGA for high thermal applications |
US6858926B2 (en) | 1998-06-30 | 2005-02-22 | Micron Technology, Inc. | Stackable ceramic FBGA for high thermal applications |
US6297960B1 (en) | 1998-06-30 | 2001-10-02 | Micron Technology, Inc. | Heat sink with alignment and retaining features |
US6297548B1 (en) | 1998-06-30 | 2001-10-02 | Micron Technology, Inc. | Stackable ceramic FBGA for high thermal applications |
US6760224B2 (en) | 1998-06-30 | 2004-07-06 | Micron Technology, Inc. | Heat sink with alignment and retaining features |
US6650007B2 (en) | 1998-06-30 | 2003-11-18 | Micron Technology, Inc. | Stackable ceramic fbga for high thermal applications |
US6525943B2 (en) | 1998-06-30 | 2003-02-25 | Micron Technology, Inc. | Heat sink with alignment and retaining features |
US6326687B1 (en) | 1998-09-01 | 2001-12-04 | Micron Technology, Inc. | IC package with dual heat spreaders |
US6518098B2 (en) | 1998-09-01 | 2003-02-11 | Micron Technology, Inc. | IC package with dual heat spreaders |
US6765291B2 (en) | 1998-09-01 | 2004-07-20 | Micron Technology, Inc. | IC package with dual heat spreaders |
US6920688B2 (en) | 1998-09-01 | 2005-07-26 | Micron Technology, Inc. | Method for a semiconductor assembly having a semiconductor die with dual heat spreaders |
US6596565B1 (en) | 1998-09-03 | 2003-07-22 | Micron Technology, Inc. | Chip on board and heat sink attachment methods |
US6451709B1 (en) | 1998-09-03 | 2002-09-17 | Micron Technology, Inc. | Methodology of removing misplaced encapsulant for attachment of heat sinks in a chip on board package |
US6806567B2 (en) | 1998-09-03 | 2004-10-19 | Micron Technology, Inc. | Chip on board with heat sink attachment and assembly |
US6432840B1 (en) | 1998-09-03 | 2002-08-13 | Micron Technology, Inc. | Methodology of removing misplaced encapsulant for attachment of heat sinks in a chip on board package |
US6229204B1 (en) | 1998-09-03 | 2001-05-08 | Micron Technology, Inc. | Chip on board with heat sink attachment |
US6117797A (en) * | 1998-09-03 | 2000-09-12 | Micron Technology, Inc. | Attachment method for heat sinks and devices involving removal of misplaced encapsulant |
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