JPS60158315U - 低電圧用増幅回路 - Google Patents

低電圧用増幅回路

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JPS60158315U
JPS60158315U JP4434084U JP4434084U JPS60158315U JP S60158315 U JPS60158315 U JP S60158315U JP 4434084 U JP4434084 U JP 4434084U JP 4434084 U JP4434084 U JP 4434084U JP S60158315 U JPS60158315 U JP S60158315U
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JP
Japan
Prior art keywords
transistor
circuit
amplifier circuit
differential amplifier
current mirror
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Pending
Application number
JP4434084U
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English (en)
Inventor
鈴木　康三
Original Assignee
東光株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は一般的な増幅回路の例を示す回路図であり、第
２図は本考案に係る低電圧用増幅回路の土実施例を示す
回路図である。 １：電源端子、２：接地端子、３：信号入力端子、５：
出力端子、６，７：電流ミラー回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 差動増幅器とその出力回路からなる低電圧用増幅回路に
    於いて、該差動増幅器が差動対トランジスタＱ６．Ｑ７
    、トランジスタＱ８とダイオード接続したトランジスタ
    Ｑ９からなる能動負荷回路−と電流源回路４から形成さ
    れ、該出力回路が電流ミラー回路６，７と負荷低損ＢＬ
    から形成されてなり、差動対トランジスタＱ６．Ｑ７の
    ベース間に抵抗Ｒ１が接続され、抵抗Ｒ１とトランジス
    タＱ７のベースとの接続点にバイアス源Ｅ１が接続され
    、トランジスタＱ８のコレクタがトランジスタＱ６のコ
    レクタに接続され、トランジスタＱ８のベースがダイオ
    ード接続されたトランジスタＱ９のカソードに接続され
    ると共に、トランジスタＱ７のコレクタに接続されてお
    り、トランジスタ”Ｑ９のエミッタ面積に対してトラン
    ジスタＱ８のエミッタ面積を大きな値に鰻定し、且つト
    ランジスタＱ６とトランジスタＱ８の共通接続されたコ
    レクタを電流ミラー回路６に接続し、電流ミラー回路６
    から得られた出力を、更に電流ミラー回路−７を介して
    負荷抵抗ＲＬに流し込むようになされ、該差動増幅回路
    から得られる出力電流を通増幅する電流ミラー回路６を
    形成するトランジスタＱＩＯ，Ｑｌｌのエミツタ面積比
    を変えることによって該差動増幅回路の利得を制御する
    ことを特徴とする低電圧増幅回路。
JP4434084U 1984-03-28 1984-03-28 低電圧用増幅回路 Pending JPS60158315U (ja)

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JP4434084U JPS60158315U (ja) 1984-03-28 1984-03-28 低電圧用増幅回路

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JPS60158315U true JPS60158315U (ja) 1985-10-22

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