JPS60130244A - 随伴信号伝送方式 - Google Patents

随伴信号伝送方式

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JPS60130244A
JPS60130244A JP58239313A JP23931383A JPS60130244A JP S60130244 A JPS60130244 A JP S60130244A JP 58239313 A JP58239313 A JP 58239313A JP 23931383 A JP23931383 A JP 23931383A JP S60130244 A JPS60130244 A JP S60130244A
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JP
Japan
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signal
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converter
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JP58239313A
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Inventor
Shuji Murakami
修司 村上
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NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
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Publication of JPH0340986B2 publication Critical patent/JPH0340986B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/38Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40Transmitting circuits; Receiving circuits
    • H04L25/49Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H04L25/4906Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes
    • H04L25/4908Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes using mBnB codes

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  • Physics & Mathematics (AREA)
  • Spectroscopy & Molecular Physics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
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  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明rXm’B−nB変換符号伝送方式にエリ、監視
信号等の随伴信号およびフレーム向期信号分伝送する方
式に関する。
ティジタル信号の伝送において、マーク率の平衡化およ
びタイミングi号の消失防止のための一つの方法として
mB−nB符号が使わhている。こね汀、入力信号im
ビット毎(区切り−nビットの符号(m(n)VC変換
して伝送するもので、(n−m)ピッ1の余剰ピッl″
を利用してマーク率?平衡化し、且つマーク・スペース
の変化点4増してタイミング信号の消失ケ防いでいる。
このような伝送路で監視信号、打合せ回線あるいロフレ
ーム同期信号?伝送する方法として、こわら随伴信号の
ための余剰ビットの挿入とmB−nB符符号変換網縦続
て行うという方法が採用さhでいた。
TfZわち、まず元の信号(主信号)の−足周期毎に余
剰ビット?挿入してフレーム′lr構成し、しかる後r
cmB−nBf換?して伝送路rc送出していた。
この方法でa伝送路符号が元金にmB−nB変換則′(
c−満丁という利点がある。しかしながら、受信側で復
号する場合11(1’ff2重の同期操作すなわち、m
B−nB符号語r対する語同期とフレーム同期全縦続し
てとlなけわばならなかった0このため同期に必要な回
路の規模が大きくなると共【同期引込み時間が長くなる
という欠点があった0 不発明の目的a従来方法におけるこの工うl欠点を除き
受信側で容易に同期がとれる随伴信号伝送方式全提供す
ることrc gる○ 本発明汀、ティジタル主信号imB−nB変換則rc従
ってmビットごとicnビットからなる第1の符号語r
c変換する手段と、前記mB−nB変換則で未使用のn
ビット符号のうち互いに補符号となる二組の第2の符号
語全随伴信号に応じて変換する第2の符号化手段と、前
記第1の符号語の所定の符号語長毎に前屈二組の第2の
符号語を交互VC挿入する手段とを営む随伴信号伝送装
置が得られるC不発明で汀、上記二組の第2の符g語會
随伴信号伝送符号語とするとともにフレーム同期信号と
することがでさる0 ?Kに不発明の実施例を図面?参照して詳細rc説明す
る。
第1図a本発明の笑施例?示すブロック図である○ 本実施例a、入力ディジタル主信号を直列・並列変換し
てmビットの並列符号?形成する直列・並列変換器10
2と、mビット並列符号全第1のmB−nBB号則に基
づいて符号化するmB−nH変換器1 (13と、mB
−nBB換器103から出力されるnビット並列符号の
速度を早め、入力nビット並列符号の一定飴長ごとにダ
ミー符号を挿入する速度変換器104と、打合せ信号や
監視信号等の随伴信号を記憶して並列変換する緩衝記憶
回路106と、緩衝記憶回路106の出力f m B 
−n H変換器103と異なる第2のm B−n B変
換則で符号化して互いfC補符芳となる2つの符号@全
形成する随伴信号符号器107と、2つの符号語のうち
のどちらかを父互に選択するスイッチ回路lo8と、速
度変換器104がダミー符号送出時にスイッチ回路10
8側rcスイッチ全切換えるスイッチ回路109と、ス
イッチ(ロ)路109の出力ヲ運列・直列変換する並列
・直列変換器110と、スイッチ回路108お工び10
9の切換えのタイミングを設定するカウンタ112お工
びフリッ1フロッ1回路113とから構成されている。
第2図(a)乃至(g)に示す本実施例の動作を説明す
るためのタイムチャートを合わせて参照すると、端子t
otrcrrティジタル主信号が印加され、直列・並列
変換器1021c工り (a)に示すようにmビットず
つに区切ら力mビット並列符号vc変換された後、mB
−nByB器103に人力する0mB−nBB換器+0
3rr、直列・並列変換器102の2m種類の出力符号
語をそれぞれmB−nBB号則で符号化したに個のmB
−nB符号語yc対応させ、そのl1113− il 
B符号語(第2図(b) )f出力する。mB−nBB
号則げ、rnB−nBB号語の不平衡(tt lrtビ
ットと゛°0″ビットの数の差)が+2(−2)のと@
a、次VC形成するmB−nB符語として不平衡が−2
(+2 )のものを選択するもので、こflに工vmH
−nl:l符号語aマーク率が平衡化し、且つマーり・
スペースの変化が多くなるomB−nlB変換器の出力
げ速度変換器104 k介してスイッチ回路109vc
印加される0スイッチ回路1090通常mB−nBK換
器103側に設定されている0速度変換器1040バッ
クアメモリとダミー符号送出回路とを含み、バックアメ
モリでmB−nBB換器103から供給されるmB−n
B符符号語一時蓄積し、そのmB−nH符号語を入力時
エリ早い速度で読出し、後述するカウンタ112の出力
でダミー符号送出回路が起動するとt個目のmB−nl
B符号語の次VCダミー符号5(i7送出する0第2図
((J&−Jこの速度変換器の出力符号列を示す。
3つの端子105/C1’ff七ねそれ第2図(d) 
(C示1゛監視信号等の随伴信号d、、d2.d3が加
えらhる。
こわら信号口、端す101に入力する王侶号rc比較し
て低速で、緩衝記憶器1 (16[−担貯えられた後、
3ピツトの並列信号VC変換されて第2図(e)に示す
工うに随伴信号符号器107の入力信号となる。随伴信
号符号器LO7Hnピットで構成され−る2n個のmB
−nBB号語からmB−r+]B変換器103で使用す
るに個のmB−nB符号語を除いた残り (2’−k)
個のmB−nH符号語で入力信号全符号化し、入力信号
を互い(C補符号となる2つのmB−nB符号語に割り
当てる。したがって第2図(e)の入力信号から第2図
(f)iC示すnビットの並列符号語とその補符号がス
イッチ回路108/C出力される。
端子lllにに(C)で示す速度変換器104の出力符
号語VC同期したクロック信号が加えられる。
カウンタ1121”rこのクロック信号をカウントして
t個のm1=l−nk3符号語に相当したクロックのカ
ウント?打い、を個目のクロック信号のカウント毎VC
スイッチ薗路to9rcI71換信号(第2図(g))
を出力し、スイッチ(ロ)路1(19’1k(t+1)
個目のクロック信号入力時Tなわち速度変換器104が
ダミー符号発生中にスイッチ10Hの側に切換える。こ
の結果、主信号のrnB−nB符号語がt符号語続いた
後に随伴信号が符号化されたnビットから収る符号語が
スイッチ(ロ)路108から供給される。スイッチ回路
108rJ、カウンタ112の出力に、Cり反転するフ
リしプフロップ113の出力に工v1随伴信号符号器1
07からの互いに補符号となる2つの符号語が又互vc
171換えらねる。
このため、スイッチ回路108からa、1回毎にマーク
率の反転した随伴信号のnビット符号語が得らh、全体
としてマーク率が平衡化される。′符号器107で使わ
れる符g語に符+5′gシl 03で使わわる符号語と
に異なるため足、受信側で容易に識別することができ、
随伴信号ケ容易rc分離できる0さらに符号器107の
出力tフレーム同期信号として使用することもできる。
なお、符号器107で使われる符号としてl符号器の中
IC少なくとも一つのマークあるいにスペース管含むも
のを使用して同符号の連続全防止する。
以上詳細fc説明し7?:j′)に本発明ンで1力ば、
マーク率を平衡させたま咬監視信号、打合せh線等の随
伴信号音伝送することがでさるので、ティジタル伝送機
器VC適用して極めて大きな効果?得ることができる0 ′!また、ティジタル生信号のmB−r+H符号と随伴
信号のmB−nB符号と汀容易′/c識別できるので、
受信側でg m 13− n H符号の同期と随伴信号
検出のためのフレーム同期の21の同期ケとる必要がな
く同期引込み時間の短縮ができる。
【図面の簡単な説明】
第1図(σ本発明の実施例?示すブロック図、第り図a
実施世1の動作全説明するクイムチヤードである。

Claims (1)

  1. 【特許請求の範囲】 1、主信号である入力ティジタル信号imH−nB変換
    則/Il″従ってmビットととvc n’ビットから収
    る第1の符号語に変換する第1の符号化手段と、前記r
    r+B−nlB変換則で未使用のnビット符号のうち互
    いに補符号となる二組の第2の符号語?随伴信号VC応
    じて変換する第2の符号化手段と− 前記第lの符号語の所定の符号語長毎九、前記二組の第
    2の符号語?交互rc挿入する手段と?廿む随伴信号伝
    送装置。 2、前記二組の第2の符号語に前記随伴信号伝送のため
    の符号語であるとともrCフレーム同期のための符号語
    であることを特徴とする特許請求の範囲第(IJ項把載
    の随伴信号伝送方式。
JP58239313A 1983-12-19 1983-12-19 随伴信号伝送方式 Granted JPS60130244A (ja)

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JPH0340986B2 JPH0340986B2 (ja) 1991-06-20

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JPH0340986B2 (ja) 1991-06-20

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