JPS60104998A - 楽音合成回路 - Google Patents
楽音合成回路Info
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- JPS60104998A JPS60104998A JP58213637A JP21363783A JPS60104998A JP S60104998 A JPS60104998 A JP S60104998A JP 58213637 A JP58213637 A JP 58213637A JP 21363783 A JP21363783 A JP 21363783A JP S60104998 A JPS60104998 A JP S60104998A
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- JP
- Japan
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- waveform
- musical tone
- frequency
- musical
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- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H5/00—Instruments in which the tones are generated by means of electronic generators
- G10H5/02—Instruments in which the tones are generated by means of electronic generators using generation of basic tones
- G10H5/06—Instruments in which the tones are generated by means of electronic generators using generation of basic tones tones generated by frequency multiplication or division of a basic tone
-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H7/00—Instruments in which the tones are synthesised from a data store, e.g. computer organs
- G10H7/02—Instruments in which the tones are synthesised from a data store, e.g. computer organs in which amplitudes at successive sample points of a tone waveform are stored in one or more memories
- G10H7/04—Instruments in which the tones are synthesised from a data store, e.g. computer organs in which amplitudes at successive sample points of a tone waveform are stored in one or more memories in which amplitudes are read at varying rates, e.g. according to pitch
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S84/00—Music
- Y10S84/11—Frequency dividers
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Acoustics & Sound (AREA)
- Multimedia (AREA)
- General Engineering & Computer Science (AREA)
- Electrophonic Musical Instruments (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明げ楽音合成回路に関し、とくにその中に設けられ
る音階補正回路に関する。
る音階補正回路に関する。
従来、デジタル回路を使用して、所定の音階の楽音を合
成する方法として、楽音の基本ピッチ波形を時間軸上で
複数のサンプリングポイン）ＩＣ分割し、各サンプリン
グポイントでの波形のｆｉ！幅値？波形データとしてメ
モリに記憶しておき、その波形データをくり返して使用
することｒｃエク、少ないデータ量で楽音を合成するデ
ータ圧縮方法が知られている。
成する方法として、楽音の基本ピッチ波形を時間軸上で
複数のサンプリングポイン）ＩＣ分割し、各サンプリン
グポイントでの波形のｆｉ！幅値？波形データとしてメ
モリに記憶しておき、その波形データをくり返して使用
することｒｃエク、少ないデータ量で楽音を合成するデ
ータ圧縮方法が知られている。
第１図げ前記の方法を利用した従来の楽音合成回路の一
笑施例のブロック図であるｏｌｒｒこの楽音合成回路全
体の動作全タイミング制御するクロックジェネレータで
あるｏ２ｒＪクロックジェネレータ１エク発生された基
本クロック信号を所定の音階に対応する周波数に分周し
、サンプリングタイミング信号ｔ、２発生させ６九めの
分周回路である。３ａ分周回路２で作られたブングリン
グタイきング信号ｔ８に同期して波形振幅データを出力
する波形合成回路であり、分周回路３エク出力される波
形振幅データｒｒＤ／Ａコンバータ４を介してスピーカ
５エリ楽音として発生される０また６げ合成しようとす
る楽音に対応した分局比を分周回路２１Ｃ送るための分
周比設定回路である０しかしながらこのような従来回路
を用いて、例えは１波形を３２分割したデータを使用し
て楽音を合成しようとする場合、クロックジェネレータ
ｌの基本クロック信号の周期ｆ：Ｔ１１分周回路２の分
周比ＩＮとすれば、分周回路２工リ発生されるサンプリ
ングタイミング信号ｔ、の周期’ｒＳｒｒ ’ｒＳ＝
Ｎｘ’ｌ’ｌで規定され、また合成した楽音のピッチ周
期Ｔｐｒｒ’ｒｐ＝３２ｘＴＳ＝３２ｘＮｘＴｔ ト’
１ｘｒ）、楽ＴＯピッチ周期ｒｒＮを変化させても３２
ＸＴ１単位でしか設定できない。従って長音階にわたる
任意の音階を合成する場合、ピッチ周期で最大１６ Ｘ
’Ｉ’ｌの誤差を生じる可能性があり、この誤差が音
階のずれとして感じられてしまう欠点がある０例えば、
基本タロツク周波数を１５０ＫＨ２としてピッチ周波数
４４０Ｈｚ（ピッチ周期２．２７ｍ８ ）の楽音を合成
しょうとした場合、Ｎ＝Ｌｌとなり合成できるピッチ周
期ａＴｐ＝３２Ｘ１１Ｘ６．６６６μｓ＝２．３５ｍ５
（ｆｐ＝４２６Ｈｚ）となる。従ってピッチ周波数で３
．２％の誤差を生じ、人間に耳ざわジな音階のずれとし
て感じられてしまり。これらの誤差を少なくするＩＣ汀
１波形の分割数を小さくするか、基本クロック周波数を
上げればよいが、前者の１波形の分割数を小さくＴるこ
とａ１波形Ｐ３に表現できる高調波成分が少なくなるこ
とを憲法し、楽音に例えばトランペットとかピアノのよ
うな音色効果をつけようとすれば１波形尚りの分割数１
−６６一定数以上にしなければならない。そのため従来
に音階精度を上げるために基本クロック周波数を高くし
ていた。しかしこのような楽音合成回路を半導体集積回
路チップ上に作る場合、半導体集積回路においてに一般
にクロック周波数を上げて動作スピード管速くすること
ば１設計が非常に複雑となり、かつチップサイズも大き
くなるため価格が高くなってしまうと９９欠点があった
ｏｆた相補型の半導体集積回路においてａ消費電流ａ動
作周波数の２乗に比例するということが知られており、
音階精度を上げるために基本クロック信号の周波数を上
げれば消費電流も大きくなってしまい相補型のメリット
が失われてしまう。
笑施例のブロック図であるｏｌｒｒこの楽音合成回路全
体の動作全タイミング制御するクロックジェネレータで
あるｏ２ｒＪクロックジェネレータ１エク発生された基
本クロック信号を所定の音階に対応する周波数に分周し
、サンプリングタイミング信号ｔ、２発生させ６九めの
分周回路である。３ａ分周回路２で作られたブングリン
グタイきング信号ｔ８に同期して波形振幅データを出力
する波形合成回路であり、分周回路３エク出力される波
形振幅データｒｒＤ／Ａコンバータ４を介してスピーカ
５エリ楽音として発生される０また６げ合成しようとす
る楽音に対応した分局比を分周回路２１Ｃ送るための分
周比設定回路である０しかしながらこのような従来回路
を用いて、例えは１波形を３２分割したデータを使用し
て楽音を合成しようとする場合、クロックジェネレータ
ｌの基本クロック信号の周期ｆ：Ｔ１１分周回路２の分
周比ＩＮとすれば、分周回路２工リ発生されるサンプリ
ングタイミング信号ｔ、の周期’ｒＳｒｒ ’ｒＳ＝
Ｎｘ’ｌ’ｌで規定され、また合成した楽音のピッチ周
期Ｔｐｒｒ’ｒｐ＝３２ｘＴＳ＝３２ｘＮｘＴｔ ト’
１ｘｒ）、楽ＴＯピッチ周期ｒｒＮを変化させても３２
ＸＴ１単位でしか設定できない。従って長音階にわたる
任意の音階を合成する場合、ピッチ周期で最大１６ Ｘ
’Ｉ’ｌの誤差を生じる可能性があり、この誤差が音
階のずれとして感じられてしまう欠点がある０例えば、
基本タロツク周波数を１５０ＫＨ２としてピッチ周波数
４４０Ｈｚ（ピッチ周期２．２７ｍ８ ）の楽音を合成
しょうとした場合、Ｎ＝Ｌｌとなり合成できるピッチ周
期ａＴｐ＝３２Ｘ１１Ｘ６．６６６μｓ＝２．３５ｍ５
（ｆｐ＝４２６Ｈｚ）となる。従ってピッチ周波数で３
．２％の誤差を生じ、人間に耳ざわジな音階のずれとし
て感じられてしまり。これらの誤差を少なくするＩＣ汀
１波形の分割数を小さくするか、基本クロック周波数を
上げればよいが、前者の１波形の分割数を小さくＴるこ
とａ１波形Ｐ３に表現できる高調波成分が少なくなるこ
とを憲法し、楽音に例えばトランペットとかピアノのよ
うな音色効果をつけようとすれば１波形尚りの分割数１
−６６一定数以上にしなければならない。そのため従来
に音階精度を上げるために基本クロック周波数を高くし
ていた。しかしこのような楽音合成回路を半導体集積回
路チップ上に作る場合、半導体集積回路においてに一般
にクロック周波数を上げて動作スピード管速くすること
ば１設計が非常に複雑となり、かつチップサイズも大き
くなるため価格が高くなってしまうと９９欠点があった
ｏｆた相補型の半導体集積回路においてａ消費電流ａ動
作周波数の２乗に比例するということが知られており、
音階精度を上げるために基本クロック信号の周波数を上
げれば消費電流も大きくなってしまい相補型のメリット
が失われてしまう。
本発明の目的ｔ’ｆｆ１波形の分割数を大きくした場合
でも基本クロック信号の周波数管上げずに音階精度の工
い楽音を合成できる音階補正回路をもつ合成回路全提供
することにある０ 本発明ｒｒ１波形当りの分割数ｉｋとすれば、その中の
１個のサンプリングポイン）［対してサンプリング周波
数全変化させる手段を設けたことを特徴とし、同じ基本
クロック周波数で楽音のピッチ周期の設定誤差を従来の
回路に対して最大Ｖｃにすることができるようにし穴も
のでお６０次１ｃ第２図を用いて本発明の一笑流例を説
明する。第２図において１ｔｔｕと異なるところげ分周
回路２全分周比を一時記憶しておくレジスタ１１とダウ
ンカウンタ１２でＳ成しているところでおる。ダウンカ
ウンタ１２ａ基本クロック信号が入力されるとカウンタ
のＰ３＠＊−１Ｔ６ｌ１ｂので、ダウンカウンタ１２の
内容が丁べてＯｒｃなるとサンプリングタイミング信号
ｔ、を発生し、同時に分局比一時記憶レジスタ１１工り
分周比Ｎ′ｆｔダウンカウンタ１２にロードする。スト
ップ信号１３がＨ＃の間σダウンカウンタ１２の内容ぼ
変化しない。従ってストップ信号１３が′″Ｌ＃の場合
ａダウンカウンタ１２ｒｒ定められたＮ分周を行うが、
分局中ＩＣ１基本クロック周期の間ストップ信号１３を
＠Ｈ″にすればＮ＋１分周することができる。
でも基本クロック信号の周波数管上げずに音階精度の工
い楽音を合成できる音階補正回路をもつ合成回路全提供
することにある０ 本発明ｒｒ１波形当りの分割数ｉｋとすれば、その中の
１個のサンプリングポイン）［対してサンプリング周波
数全変化させる手段を設けたことを特徴とし、同じ基本
クロック周波数で楽音のピッチ周期の設定誤差を従来の
回路に対して最大Ｖｃにすることができるようにし穴も
のでお６０次１ｃ第２図を用いて本発明の一笑流例を説
明する。第２図において１ｔｔｕと異なるところげ分周
回路２全分周比を一時記憶しておくレジスタ１１とダウ
ンカウンタ１２でＳ成しているところでおる。ダウンカ
ウンタ１２ａ基本クロック信号が入力されるとカウンタ
のＰ３＠＊−１Ｔ６ｌ１ｂので、ダウンカウンタ１２の
内容が丁べてＯｒｃなるとサンプリングタイミング信号
ｔ、を発生し、同時に分局比一時記憶レジスタ１１工り
分周比Ｎ′ｆｔダウンカウンタ１２にロードする。スト
ップ信号１３がＨ＃の間σダウンカウンタ１２の内容ぼ
変化しない。従ってストップ信号１３が′″Ｌ＃の場合
ａダウンカウンタ１２ｒｒ定められたＮ分周を行うが、
分局中ＩＣ１基本クロック周期の間ストップ信号１３を
＠Ｈ″にすればＮ＋１分周することができる。
このような回路を用いて、１波形ｆ：に分割した楽音波
形を合成する場合、１波形内の１個のサンプリングポイ
ントに対しＮ＋１分周する工うｒｃ音階補正データ発生
回路１４よりストップ信号１３を制御してやれば、その
時のピッチ周期ｒｔＴｐ＝ｉｘ（Ｎ＋１ ） ｘＴｌ
＋（ｋ −ｉ ）ＸＮ ｘＴｌ ＝＋ＫｘＮｘＴ’１
＋ ｌ ＸＴ１（但し：＝ｏ、 ｌ、 ２．・・； ｋ
−１）で表わされる。従って、ｉ１変化させればｌｌ１
１単位で基本ピッチ波形の周期Ｙ！：変化させることが
でき、従来の方法に対しピッチ周期の設定誤差を１／ｋ
ＩＣ圧縮することができる。
形を合成する場合、１波形内の１個のサンプリングポイ
ントに対しＮ＋１分周する工うｒｃ音階補正データ発生
回路１４よりストップ信号１３を制御してやれば、その
時のピッチ周期ｒｔＴｐ＝ｉｘ（Ｎ＋１ ） ｘＴｌ
＋（ｋ −ｉ ）ＸＮ ｘＴｌ ＝＋ＫｘＮｘＴ’１
＋ ｌ ＸＴ１（但し：＝ｏ、 ｌ、 ２．・・； ｋ
−１）で表わされる。従って、ｉ１変化させればｌｌ１
１単位で基本ピッチ波形の周期Ｙ！：変化させることが
でき、従来の方法に対しピッチ周期の設定誤差を１／ｋ
ＩＣ圧縮することができる。
第３図ＩＣｋ＝８．ｉ＝４とした場合の各信号のタイミ
ングを示している０第３図でにストップ信号１ｉ−１つ
おきのサンプリングポイントに対してｌ基本クロック周
期ずつａ Ｈｎにしているため、１波！ 形のピッチ周期ｒｒＴｐ＝８×（Ｎ＋ｉ）×Ｔｌ とな
り、従来の回路において分局比をＮにした場合とＮ＋１
にした場合の中間の音階を出すことが可能となっている
。同様化ストップ信号１３ｔ−”Ｈ’レベルにしてＮ＋
１分周させたタイミングで出力するサンプリングポイン
ト数を変化させれば従来の回路に対して８倍の音階精度
を出すことができる。なおストップ信号１３を発生させ
る音階補正データ発生回路に従来のデジタル技術を使用
すれば容易に実現できる。
ングを示している０第３図でにストップ信号１ｉ−１つ
おきのサンプリングポイントに対してｌ基本クロック周
期ずつａ Ｈｎにしているため、１波！ 形のピッチ周期ｒｒＴｐ＝８×（Ｎ＋ｉ）×Ｔｌ とな
り、従来の回路において分局比をＮにした場合とＮ＋１
にした場合の中間の音階を出すことが可能となっている
。同様化ストップ信号１３ｔ−”Ｈ’レベルにしてＮ＋
１分周させたタイミングで出力するサンプリングポイン
ト数を変化させれば従来の回路に対して８倍の音階精度
を出すことができる。なおストップ信号１３を発生させ
る音階補正データ発生回路に従来のデジタル技術を使用
すれば容易に実現できる。
従って本発明ｖｃ工ｊば、基本クロック周波数？上げず
に音階精度を上げることができるため、特に半導体集積
回路チップ上に楽音合成回路を作る場合、字導体集積回
路の設計が容易となり、かつチップ面積も小さくできる
という大＠な効果が得られる。また相補型半導体集積回
路においてに。
に音階精度を上げることができるため、特に半導体集積
回路チップ上に楽音合成回路を作る場合、字導体集積回
路の設計が容易となり、かつチップ面積も小さくできる
という大＠な効果が得られる。また相補型半導体集積回
路においてに。
同時に消費電力も小さくできるという効果も得られる。
第４図ａ本発明の他の一実施例であり、第１図で示した
従来回路に加算回路２１に加えたもので、分周回路２ａ
従米の回路と同じもの全使用するかわりに加算回路２１
ｔ−用いて分周比を変化させており、動作ａ第２図で示
した回路と同様である。
従来回路に加算回路２１に加えたもので、分周回路２ａ
従米の回路と同じもの全使用するかわりに加算回路２１
ｔ−用いて分周比を変化させており、動作ａ第２図で示
した回路と同様である。
また分局比の設定、Ｎ分周とＮ＋１分周以外の組合せで
も同様の効果を得ることかで＠ること灯明らかである０
も同様の効果を得ることかで＠ること灯明らかである０
第１図ａ従米の楽音合成回路を示すブロック図、第２図
ａ本発明の一実施例？示すブロック図、第３図ａ本発明
の詳細な説明するための波形図、第４図ａ本発明の他の
一実施例を示すブロック図である０ ！・・・りｐツクシネレータ、２・・・分局回路、３・
・・波形合成回路、４・・・坪償コンバータ、５・・・
スピーカ、６・・・分周比設定回路、ｉｔ・・・分局比
一時記憶用レジスタ、１２・・°ダウンカウンター１１
４・・・背筋 ／ 図 鱈 Ｚ Ｖ 篤 ３ 図 ８４ 図
ａ本発明の一実施例？示すブロック図、第３図ａ本発明
の詳細な説明するための波形図、第４図ａ本発明の他の
一実施例を示すブロック図である０ ！・・・りｐツクシネレータ、２・・・分局回路、３・
・・波形合成回路、４・・・坪償コンバータ、５・・・
スピーカ、６・・・分周比設定回路、ｉｔ・・・分局比
一時記憶用レジスタ、１２・・°ダウンカウンター１１
４・・・背筋 ／ 図 鱈 Ｚ Ｖ 篤 ３ 図 ８４ 図
Claims (1)
- 楽音の基本ピッチ波形を時間軸上で複数のサンプリング
ポイントに分割し、各サンプリングポイントでの波形振
幅値ｔディジタル波形データとして記憶しておき、前記
波形データ？くり返し使用して楽音を合成する楽音合成
回路九おいて、波形のサン１リングポイント数に細巾の
ｉ個（Ｏ≦ｌ＜ｋ）のサンプリングポイン）ＩＣ対して
、そのサンプリング周期を他のサンプリング周期とａ異
なる値に設定する手段と、音階に応じてｉの値を変更す
る手段とを具備することを特徴とする楽音合成回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58213637A JPS60104998A (ja) | 1983-11-14 | 1983-11-14 | 楽音合成回路 |
| US07/077,546 US4805508A (en) | 1983-11-14 | 1987-07-24 | Sound synthesizing circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58213637A JPS60104998A (ja) | 1983-11-14 | 1983-11-14 | 楽音合成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60104998A true JPS60104998A (ja) | 1985-06-10 |
| JPH0369118B2 JPH0369118B2 (ja) | 1991-10-30 |
Family
ID=16642447
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58213637A Granted JPS60104998A (ja) | 1983-11-14 | 1983-11-14 | 楽音合成回路 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4805508A (ja) |
| JP (1) | JPS60104998A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3041484B2 (ja) * | 1988-03-09 | 2000-05-15 | セイコーエプソン株式会社 | 音信号発生装置及びこれを用いた楽音発生装置 |
| US5804749A (en) * | 1995-12-28 | 1998-09-08 | Yamaha Corporation | Sound source chip having variable clock to optimize external memory access |
| US6140569A (en) * | 1998-11-10 | 2000-10-31 | Winbond Electronics Corp. | Memory reduction method and apparatus for variable frequency dividers |
| US20080154605A1 (en) * | 2006-12-21 | 2008-06-26 | International Business Machines Corporation | Adaptive quality adjustments for speech synthesis in a real-time speech processing system based upon load |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4011516A (en) * | 1975-11-03 | 1977-03-08 | Rockwell International Corporation | Frequency correction arrangement |
| JPS5919356B2 (ja) * | 1977-10-26 | 1984-05-04 | ヤマハ株式会社 | 電子楽器 |
| JPS5919355B2 (ja) * | 1977-10-26 | 1984-05-04 | ヤマハ株式会社 | 電子楽器 |
| JPS57211834A (en) * | 1981-06-23 | 1982-12-25 | Nippon Gakki Seizo Kk | Frequency dividing device |
-
1983
- 1983-11-14 JP JP58213637A patent/JPS60104998A/ja active Granted
-
1987
- 1987-07-24 US US07/077,546 patent/US4805508A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US4805508A (en) | 1989-02-21 |
| JPH0369118B2 (ja) | 1991-10-30 |
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