JPS6231360B2 - - Google Patents
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- JPS6231360B2 JPS6231360B2 JP55119929A JP11992980A JPS6231360B2 JP S6231360 B2 JPS6231360 B2 JP S6231360B2 JP 55119929 A JP55119929 A JP 55119929A JP 11992980 A JP11992980 A JP 11992980A JP S6231360 B2 JPS6231360 B2 JP S6231360B2
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- JP
- Japan
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- envelope
- information
- accumulator
- circuit
- tone
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- 230000015654 memory Effects 0.000 claims description 23
- 230000033764 rhythmic process Effects 0.000 claims description 14
- 238000010586 diagram Methods 0.000 description 6
- 238000000034 method Methods 0.000 description 3
- 101100495835 Oryza sativa subsp. japonica Cht1 gene Proteins 0.000 description 2
- 230000006870 function Effects 0.000 description 1
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- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】
本発明は周波数情報とエンベロープ情報とを共
通の累算器を用いて構成を簡単にしたリズム発生
装置に関するものである。
通の累算器を用いて構成を簡単にしたリズム発生
装置に関するものである。
従来、音源加算係数とアタツクデイケイ係数を
用いて複数音源を発生させるリズム発生回路等に
つき既に数次に亘り提案を行なつている。このリ
ズム発生回路はリズム選択による音源周波数を発
生する音源部と、これにエンベロープ波形を与え
るエンベロープ部より成り、音源加算係数とアタ
ツクデイケイ係数をそれぞれのメモリに格納して
おき、各係数の累算器により各種の音源波形また
はエンベロープ波形を発生し所定の組合せで乗算
することにより所望のリズム音を発生させるもの
である。
用いて複数音源を発生させるリズム発生回路等に
つき既に数次に亘り提案を行なつている。このリ
ズム発生回路はリズム選択による音源周波数を発
生する音源部と、これにエンベロープ波形を与え
るエンベロープ部より成り、音源加算係数とアタ
ツクデイケイ係数をそれぞれのメモリに格納して
おき、各係数の累算器により各種の音源波形また
はエンベロープ波形を発生し所定の組合せで乗算
することにより所望のリズム音を発生させるもの
である。
第１図はこのリズム発生回路の１例の構成説明
図である。この場合、音源数を16種類とすれば16
チヤンネルが必要となる。そしてエンベロープ波
形と音源波形の形成を時分割で行なうものとし、
選択されたリズムパターン信号に対応したリズム
音を出力する。同図において、リズムパターン信
号（以下アタツク信号という）Ａ，Ｂのうちのア
タツク信号Ａをエンベロープ制御回路１７に入力
し、エンベロープ波形のアタツクとデイケイのタ
イミングを後述の信号Ｃ１，Ｃ２により形成し、
タイミング発生回路１９で駆動するアドレスカウ
ンタ２０を介して指定されるチヤンネルデコーダ
２１からのチヤンネル指定信号CH１をエンベロ
ープ制御回路１７に与え、指定されたアドレス信
号をOR回路１５を介してエンベロープ係数メモ
リ１３に入力する。エンベロープ係数メモリ１３
はアドレスカウンタ２０からのアドレスにより、
後述のアタツクとデイケイの加算係数を読み出
し、オン制御された係数ゲート２６を通して加算
器、ゲート回路、レジスタ、記憶回路（RAM）
より成る累算器１１に与える。次にアタツク信号
Ｂをエンベロープ制御回路１８に入力し、エンベ
ロープ制御回路１７と同様にエンベロープ波形の
アタツクとデイケイのタイミングを信号Ｃ１，Ｃ
２により形成し、チヤンネルデコーダ２１からの
チヤンネル指定信号CH１６をエンベロープ制御
回路１８に与え、指定されたアドレス信号をOR
回路１５を介してエンベロープ係数メモリ１３に
入力する。この場合係数ゲート２６は累算器１１
からのアタツク終了信号Ｃ１の発生時、エンベロ
ープ制御回路１８を介して得られた制御信号が
“Ｈ”となることによりオフ制御され、エンベロ
ープ係数メモリ１３から累算器１１へ与えられる
係数を遮断する。その結果、累算器１１は“０”
を加算することになり、同じ値をホールドして出
力し続ける。すなわち、エンベロープ制御回路１
７，１８では累算器１１からのアタツク終了信号
Ｃ１の発生時係数ゲート２６のオンオフ状態を異
にするもので、これによりホールド状態のないエ
ンベロープか、ホールド状態を有するエンベロー
プかを選択する。そして、本回路ではこの両種の
波形が指定チヤンネル内に含まれる。
図である。この場合、音源数を16種類とすれば16
チヤンネルが必要となる。そしてエンベロープ波
形と音源波形の形成を時分割で行なうものとし、
選択されたリズムパターン信号に対応したリズム
音を出力する。同図において、リズムパターン信
号（以下アタツク信号という）Ａ，Ｂのうちのア
タツク信号Ａをエンベロープ制御回路１７に入力
し、エンベロープ波形のアタツクとデイケイのタ
イミングを後述の信号Ｃ１，Ｃ２により形成し、
タイミング発生回路１９で駆動するアドレスカウ
ンタ２０を介して指定されるチヤンネルデコーダ
２１からのチヤンネル指定信号CH１をエンベロ
ープ制御回路１７に与え、指定されたアドレス信
号をOR回路１５を介してエンベロープ係数メモ
リ１３に入力する。エンベロープ係数メモリ１３
はアドレスカウンタ２０からのアドレスにより、
後述のアタツクとデイケイの加算係数を読み出
し、オン制御された係数ゲート２６を通して加算
器、ゲート回路、レジスタ、記憶回路（RAM）
より成る累算器１１に与える。次にアタツク信号
Ｂをエンベロープ制御回路１８に入力し、エンベ
ロープ制御回路１７と同様にエンベロープ波形の
アタツクとデイケイのタイミングを信号Ｃ１，Ｃ
２により形成し、チヤンネルデコーダ２１からの
チヤンネル指定信号CH１６をエンベロープ制御
回路１８に与え、指定されたアドレス信号をOR
回路１５を介してエンベロープ係数メモリ１３に
入力する。この場合係数ゲート２６は累算器１１
からのアタツク終了信号Ｃ１の発生時、エンベロ
ープ制御回路１８を介して得られた制御信号が
“Ｈ”となることによりオフ制御され、エンベロ
ープ係数メモリ１３から累算器１１へ与えられる
係数を遮断する。その結果、累算器１１は“０”
を加算することになり、同じ値をホールドして出
力し続ける。すなわち、エンベロープ制御回路１
７，１８では累算器１１からのアタツク終了信号
Ｃ１の発生時係数ゲート２６のオンオフ状態を異
にするもので、これによりホールド状態のないエ
ンベロープか、ホールド状態を有するエンベロー
プかを選択する。そして、本回路ではこの両種の
波形が指定チヤンネル内に含まれる。
累算器１１においては、アドレスカウンタ２０
からのアドレスと、エンベロープ制御回路１７，
１８からOR回路１６を介して与えられるチヤン
ネル指定信号により指定され、加算係数が累算さ
れて累算出力信号として８ビツトの２進のアドレ
ス情報を出力し、エンベロープ波形テーブル１４
に与える。累算器１１の処理データは10ビツトと
し、前記８ビツトのアドレスデータの外に桁上げ
信号Ｃ１，Ｃ２が含まれる。そして８ビツトのア
ドレスデータがエンベロープ波形テーブル１４に
送られる場合上位５ビツトをアドレスとし、下位
３ビツトは切り捨てられる。また信号Ｃ１はアタ
ツク期間が終了したことを示し、信号Ｃ２でデイ
ケイが終了したことを表わし、前述のエンベロー
プ制御回路１７に送られる。この累算器１１にお
いては16チヤンネルに対応し16個のエンベロープ
波の累算出力信号が得られる。
からのアドレスと、エンベロープ制御回路１７，
１８からOR回路１６を介して与えられるチヤン
ネル指定信号により指定され、加算係数が累算さ
れて累算出力信号として８ビツトの２進のアドレ
ス情報を出力し、エンベロープ波形テーブル１４
に与える。累算器１１の処理データは10ビツトと
し、前記８ビツトのアドレスデータの外に桁上げ
信号Ｃ１，Ｃ２が含まれる。そして８ビツトのア
ドレスデータがエンベロープ波形テーブル１４に
送られる場合上位５ビツトをアドレスとし、下位
３ビツトは切り捨てられる。また信号Ｃ１はアタ
ツク期間が終了したことを示し、信号Ｃ２でデイ
ケイが終了したことを表わし、前述のエンベロー
プ制御回路１７に送られる。この累算器１１にお
いては16チヤンネルに対応し16個のエンベロープ
波の累算出力信号が得られる。
次にエンベロープ波形テーブル１４の内容を排
他的（EX）OR回路２２に入れ、信号Ｃ１により
アタツク波形32ワード終了後、信号Ｃ１が次のサ
イクルの初期値より高レベルになると、エンベロ
ープ波形テーブル１４からのデータを反転させデ
イケイ波形を形成する。このEX―OR回路２２の
出力をＤ―Ａ変換器２３を通してアナログ量に変
換してエンベロープ波形が得られる。
他的（EX）OR回路２２に入れ、信号Ｃ１により
アタツク波形32ワード終了後、信号Ｃ１が次のサ
イクルの初期値より高レベルになると、エンベロ
ープ波形テーブル１４からのデータを反転させデ
イケイ波形を形成する。このEX―OR回路２２の
出力をＤ―Ａ変換器２３を通してアナログ量に変
換してエンベロープ波形が得られる。
音源部はエンベロープ部と同様の構成を有し、
アドレスカウンタ２０からのチヤンネルアドレス
に同期してトーン係数メモリ３０から音源加算係
数を読み出し、加算器、ゲート回路、レジスタ、
記憶回路（RAM）より成るトーン累算器３１に
与える。このトーン係数が累算され音源周波数に
対応する累算出力信号をアドレスとして256ワー
ドの正弦波テーブル３２より半波長の正弦波を出
力する。この出力をエンベロープの場合と同様に
EX―OR回路３３に入力しトーン累算器３１の累
算出力信号の桁上げ信号Ｃ１′により反転させデ
ジタルの正弦波音源波形が得られる。この音源波
形の周波数を乗算形のＤ／Ａ変換器３４に入力
し、前述のエンベロープ部の１部のＤ／Ａ変換器
２３からのエンベロープ波形と乗算されたアナロ
グ信号に変換される。そして次のアナログマルチ
プレクサ３５により時分割されたアナログデータ
を各チヤンネルCH１〜CH１６に振り分け、サン
プルホールド回路３６により1/16単位時間のアナ
ログデータをホールドして出力する。
アドレスカウンタ２０からのチヤンネルアドレス
に同期してトーン係数メモリ３０から音源加算係
数を読み出し、加算器、ゲート回路、レジスタ、
記憶回路（RAM）より成るトーン累算器３１に
与える。このトーン係数が累算され音源周波数に
対応する累算出力信号をアドレスとして256ワー
ドの正弦波テーブル３２より半波長の正弦波を出
力する。この出力をエンベロープの場合と同様に
EX―OR回路３３に入力しトーン累算器３１の累
算出力信号の桁上げ信号Ｃ１′により反転させデ
ジタルの正弦波音源波形が得られる。この音源波
形の周波数を乗算形のＤ／Ａ変換器３４に入力
し、前述のエンベロープ部の１部のＤ／Ａ変換器
２３からのエンベロープ波形と乗算されたアナロ
グ信号に変換される。そして次のアナログマルチ
プレクサ３５により時分割されたアナログデータ
を各チヤンネルCH１〜CH１６に振り分け、サン
プルホールド回路３６により1/16単位時間のアナ
ログデータをホールドして出力する。
上述の構成をさらに簡単にするため、本発明者
は周波数情報とエンベロープ情報を累算する各累
算器の構成が同一であることに着目し、これを共
通にして時分割で動作させることを考えたもので
ある。
は周波数情報とエンベロープ情報を累算する各累
算器の構成が同一であることに着目し、これを共
通にして時分割で動作させることを考えたもので
ある。
本発明の目的は周波数情報とエンベロープ情報
を累算する累算器につき構成を簡単にして小形化
したリズム発生装置を提供することである。
を累算する累算器につき構成を簡単にして小形化
したリズム発生装置を提供することである。
前記目的を達成するため、本発明のリズム発生
装置はトーン係数メモリに周波数情報を格納して
おき該情報を累算することにより、楽音波形メモ
リから楽音を読み出す楽音発生回路、エンベロー
プ係数メモリにエンベロープ情報を格納しておき
該情報を累算することにより、エンベロープメモ
リからエンベロープ波形を読み出すエンベロープ
形成回路、および前記楽音発生回路とエンベロー
プ形成回路の動作を時分割で行なわせるためのア
ドレス指定をするアドレスカウンタを具えたリズ
ム発生装置において、前記周波数情報とエンベロ
ープ情報とを共通の累算器を用いて各々の情報を
時分割で独立に累算するようにしたことを特徴と
するものである。
装置はトーン係数メモリに周波数情報を格納して
おき該情報を累算することにより、楽音波形メモ
リから楽音を読み出す楽音発生回路、エンベロー
プ係数メモリにエンベロープ情報を格納しておき
該情報を累算することにより、エンベロープメモ
リからエンベロープ波形を読み出すエンベロープ
形成回路、および前記楽音発生回路とエンベロー
プ形成回路の動作を時分割で行なわせるためのア
ドレス指定をするアドレスカウンタを具えたリズ
ム発生装置において、前記周波数情報とエンベロ
ープ情報とを共通の累算器を用いて各々の情報を
時分割で独立に累算するようにしたことを特徴と
するものである。
以下本発明を実施例につき詳述する。
第２図は本発明の実施例の構成を示す説明図で
あり、第３図ａ〜ｃはその要部の動作波形図であ
る。
あり、第３図ａ〜ｃはその要部の動作波形図であ
る。
同図において、第１図のアドレスカウンタ２０
からのアドレスでトーン係数メモリ（ROM）３
０とエンベロープ係数メモリ（ROM）１３をア
クセスする。そして、それぞれANDゲート４１
とANDゲート４２により、第３図ａ〜ｃに示す
ように、同図ｃのアドレス区間中を時分割に同図
ａ，ｂのT1，T2時間に区分して係数を出力す
る。この出力をORゲート４３を通して破線内に
示す共通の累算器４４に入れる。
からのアドレスでトーン係数メモリ（ROM）３
０とエンベロープ係数メモリ（ROM）１３をア
クセスする。そして、それぞれANDゲート４１
とANDゲート４２により、第３図ａ〜ｃに示す
ように、同図ｃのアドレス区間中を時分割に同図
ａ，ｂのT1，T2時間に区分して係数を出力す
る。この出力をORゲート４３を通して破線内に
示す共通の累算器４４に入れる。
累算器４４は、全加算器５１を共通にしてトー
ン累算器として全加算器５１、トーンレジスタ５
２、トーン記憶回路（RAM）５３より成るルー
プと、エンベロープ累算器として全加算器５１、
ANDゲート５４、エンベロープレジスタ５５、
エンベロープ記憶回路（RAM）５６より成るル
ープより構成されている。
ン累算器として全加算器５１、トーンレジスタ５
２、トーン記憶回路（RAM）５３より成るルー
プと、エンベロープ累算器として全加算器５１、
ANDゲート５４、エンベロープレジスタ５５、
エンベロープ記憶回路（RAM）５６より成るル
ープより構成されている。
トーン累算器のループでは、トーン係数メモリ
３０からT1時間のデータをANDゲート４１とOR
ゲート４３を介して全加算器５１に入力し、同時
にトーン記憶回路５３からの前のデータを全加算
器５１に読み出して加算され、トーンレジスタ５
２にラツチされ、この内容がトーン記憶回路５３
に記憶されるとともに、正弦波テーブル３２に送
られ半波長の正弦波を読み出し、第１図の手順に
従いＤ／Ａ変換器３４に送出される。
３０からT1時間のデータをANDゲート４１とOR
ゲート４３を介して全加算器５１に入力し、同時
にトーン記憶回路５３からの前のデータを全加算
器５１に読み出して加算され、トーンレジスタ５
２にラツチされ、この内容がトーン記憶回路５３
に記憶されるとともに、正弦波テーブル３２に送
られ半波長の正弦波を読み出し、第１図の手順に
従いＤ／Ａ変換器３４に送出される。
エンベロープ累算器のループでは、エンベロー
プ係数メモリ１３からT2時間のデータをANDゲ
ート４２とORゲート４３を介して全加算器５１
に入力し、同時にエンベロープ記憶回路５６から
の前のデータを全加算器５１に読み出して加算
し、ANDゲート５４で第１図で説明したエンベ
ロープ制御器からの制御信号によりゲートされ、
エンベロープレジスタ５５にラツチされ、この内
容がエンベロープ記憶回路５６に記憶されるとと
もに、エンベロープ波形テーブル１４に送られ、
エンベロープ波形を読み出し、第１図の手順に従
いＤ／Ａ変換器２３に送出される。
プ係数メモリ１３からT2時間のデータをANDゲ
ート４２とORゲート４３を介して全加算器５１
に入力し、同時にエンベロープ記憶回路５６から
の前のデータを全加算器５１に読み出して加算
し、ANDゲート５４で第１図で説明したエンベ
ロープ制御器からの制御信号によりゲートされ、
エンベロープレジスタ５５にラツチされ、この内
容がエンベロープ記憶回路５６に記憶されるとと
もに、エンベロープ波形テーブル１４に送られ、
エンベロープ波形を読み出し、第１図の手順に従
いＤ／Ａ変換器２３に送出される。
以下の手順は第１図のとおりである。
以上説明したように、本発明によれば、トーン
係数メモリに格納された周波数情報とエンベロー
プ係数メモリに格納されたエンベロープ情報とを
共通の累算器を用いて時分割に区分して累算する
ことにより、別々に累算器を有する場合と同等の
機能を果すことができ、しかも構成を簡単化し小
形化の目的に副うことができる。
係数メモリに格納された周波数情報とエンベロー
プ係数メモリに格納されたエンベロープ情報とを
共通の累算器を用いて時分割に区分して累算する
ことにより、別々に累算器を有する場合と同等の
機能を果すことができ、しかも構成を簡単化し小
形化の目的に副うことができる。
第１図は従来提案例の説明図、第２図は本発明
の実施例の構成を示す説明図、第３図は第２図の
要部の動作波形図であり、図中１３はエンベロー
プ係数メモリ、１４はエンベロープ波形テーブ
ル、２０はアドレスカウンタ、２３，２４はＤ／
Ａ変換器、３０はトーン係数メモリ、３２は正弦
波テーブル、４１，４２，５４はANDゲート、
４３はORゲート、４４は共通の累算器、５１は
全加算器、５２はトーンレジスタ、５３はトーン
記憶回路、５５はエンベロープレジスタ、５６は
エンベロープ記憶回路を示す。
の実施例の構成を示す説明図、第３図は第２図の
要部の動作波形図であり、図中１３はエンベロー
プ係数メモリ、１４はエンベロープ波形テーブ
ル、２０はアドレスカウンタ、２３，２４はＤ／
Ａ変換器、３０はトーン係数メモリ、３２は正弦
波テーブル、４１，４２，５４はANDゲート、
４３はORゲート、４４は共通の累算器、５１は
全加算器、５２はトーンレジスタ、５３はトーン
記憶回路、５５はエンベロープレジスタ、５６は
エンベロープ記憶回路を示す。
Claims (1)
- １ トーン係数メモリに周波数情報を格納してお
き該情報を累算することにより、楽音波形メモリ
から楽音を読み出す楽音発生回路、エンベロープ
係数メモリにエンベロープ情報を格納しておき該
情報を累算することにより、エンベロープメモリ
からエンベロープ波形を読み出すエンベロープ形
成回路、および前記楽音発生回路とエンベロープ
形成回路の動作を時分割で行なわせるためのアド
レス指定をするアドレスカウンタを具えたリズム
発生装置において、前記周波数情報とエンベロー
プ情報とを共通の累算器を用いて各々の情報を時
分割で独立に累算するようにしたことを特徴とす
るリズム発生装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55119929A JPS5744196A (en) | 1980-08-30 | 1980-08-30 | Rhythm generator |
| US06/510,231 US4487098A (en) | 1980-08-30 | 1983-08-12 | Rhythm generator |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55119929A JPS5744196A (en) | 1980-08-30 | 1980-08-30 | Rhythm generator |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5744196A JPS5744196A (en) | 1982-03-12 |
| JPS6231360B2 true JPS6231360B2 (ja) | 1987-07-08 |
Family
ID=14773657
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55119929A Granted JPS5744196A (en) | 1980-08-30 | 1980-08-30 | Rhythm generator |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5744196A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59118094U (ja) * | 1983-01-28 | 1984-08-09 | 松下電工株式会社 | 煙感知器 |
| JPS60109188U (ja) * | 1983-12-23 | 1985-07-24 | 松下電工株式会社 | 自動復帰型煙感知器 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5384709A (en) * | 1976-12-30 | 1978-07-26 | Kawai Musical Instr Mfg Co | Electronic musical instrument |
-
1980
- 1980-08-30 JP JP55119929A patent/JPS5744196A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5384709A (en) * | 1976-12-30 | 1978-07-26 | Kawai Musical Instr Mfg Co | Electronic musical instrument |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5744196A (en) | 1982-03-12 |
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