JPS6010345U - メモリ保護回路 - Google Patents

メモリ保護回路

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Publication number
JPS6010345U
JPS6010345U JP1983100003U JP10000383U JPS6010345U JP S6010345 U JPS6010345 U JP S6010345U JP 1983100003 U JP1983100003 U JP 1983100003U JP 10000383 U JP10000383 U JP 10000383U JP S6010345 U JPS6010345 U JP S6010345U
Authority
JP
Japan
Prior art keywords
signal
input terminal
read
write
gate
Prior art date
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Pending
Application number
JP1983100003U
Other languages
English (en)
Inventor
宏幸 高橋
Original Assignee
横河電機株式会社
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Publication date
Application filed by 横河電機株式会社 filed Critical 横河電機株式会社
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Publication of JPS6010345U publication Critical patent/JPS6010345U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロック図、第２図は
第１図の動作を説明するためのタイムチャートである。 １・・・・・・ＲＡＭ（ランダムアクセスメモリ）、２
・・・・・・ＳＷ（スイッチ）、３・・・・・・Ｇ１（
第１のゲート）、４・・・・・・Ｇ２（１２のゲート）
、５・・・・・・ＡＢ（アドレスバス）、６・・・・・
・ＤＢ（データバス）、７・・・・・・Ｃ８（チップセ
レクト）信号入力端子、８・・・・・・Ｒ／Ｗ（リード
／ライト）信号入力端子、９・・・・・・電源子Ｖｃｃ
入力端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. リード／ライト信号及びチップセレクト信号に従ってリ
    ード／ライト動作を行うメモリと、ライト動作を制御す
    るための接点信号を発生するスイッチと、一方の入力端
    子にはスイッチの接点信号が加えられ他方の入力端子に
    はり一ド／ライト信号が加えられる第１のゲートと、一
    方の入力端子には第１のゲートの出力信号が加えられ他
    方の入力端子にはチップセレクト信号が加えられる第２
    のゲートとを具備し、メモリのり一ド／ライト信号入力
    端子には直接リード／ライト信号が加えられ、チップセ
    レクト信号入力端子には第２のゲートを介してチップセ
    レクト信号が加えられることを特徴とするメモリ保護回
    路。
JP1983100003U 1983-06-28 1983-06-28 メモリ保護回路 Pending JPS6010345U (ja)

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JP1983100003U JPS6010345U (ja) 1983-06-28 1983-06-28 メモリ保護回路

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JPS6010345U true JPS6010345U (ja) 1985-01-24

Family

ID=30236755

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