JPS5996949U - ミユ−テイング回路 - Google Patents

ミユ−テイング回路

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Publication number
JPS5996949U
JPS5996949U JP19248182U JP19248182U JPS5996949U JP S5996949 U JPS5996949 U JP S5996949U JP 19248182 U JP19248182 U JP 19248182U JP 19248182 U JP19248182 U JP 19248182U JP S5996949 U JPS5996949 U JP S5996949U
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JP
Japan
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turned
signal
switching element
circuit
preset
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Pending
Application number
JP19248182U
Other languages
English (en)
Inventor
秀次 川崎
増原 正美
Original Assignee
三洋電機株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図面は、この考案のミューティング回路の1実施例の結
線図である。 2・・・PLLシンセサイザ用集積回路、PC・・・メ
モリ書込み信号入力端子、Pd−Pk・・・第1〜第8
プリセツトメモリ指定信号入力端子、13・・・第1ト
ランジスタ、14・−・・第2トランジスタ、16・・
・第9ダイオード、33.34・・・左、右チヤンネル
用バッファアンプ、35・・・作動部。

Claims (1)

    【実用新案登録請求の範囲】
  1. メモリ書込み信号入力端子および複数個のプリセットメ
    モリ指定信号入力端子を有するPLLシンーセサイザ回
    路部と、前記各プリセットメモリ指定信号入力端子への
    プリセット信号によりオンする第1スイツチング素子と
    、該第1スイツチング素子のオンによりオフする第2ス
    イツチング素子と、該第2スイツチング素子のオフによ
    り前記メモリ書込み入力端子からの駆動信号により駆動
    制御信号を出力する駆動制御部と゛、前記駆動制御信号
    により作動して出力部からの出力信号を低減する作動部
    とを備えたミューティング回路。
JP19248182U 1982-12-20 1982-12-20 ミユ−テイング回路 Pending JPS5996949U (ja)

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JPS5996949U true JPS5996949U (ja) 1984-06-30

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