JPS60100823A - スイツチングトランジスタの駆動回路 - Google Patents
スイツチングトランジスタの駆動回路Info
- Publication number
- JPS60100823A JPS60100823A JP58209585A JP20958583A JPS60100823A JP S60100823 A JPS60100823 A JP S60100823A JP 58209585 A JP58209585 A JP 58209585A JP 20958583 A JP20958583 A JP 20958583A JP S60100823 A JPS60100823 A JP S60100823A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- level
- time
- circuit
- switching transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/082—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
- H03K17/0826—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in bipolar transistor switches
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明はスイッチングトランジスタの駆動回路に関し、
特に、インバータ(直流交流変換装置)、サイクロコン
バータ等のモータドライブエレクトロニクスに適用され
るものである。
特に、インバータ(直流交流変換装置)、サイクロコン
バータ等のモータドライブエレクトロニクスに適用され
るものである。
く解決課題〉
従来のパワートランジスタの保護回路は、コレクタ電流
を検出し、これが過大になると電源を断つ方式が広く用
いられていた。
を検出し、これが過大になると電源を断つ方式が広く用
いられていた。
しかし、例えば毎分敵方回転という超高速モータの駆動
回路をこのような従来方式で保護すると、過電流検出に
より電源回路が断たれたのち、モータが慣性により回転
しつづけ、その間逆起電力を発生しつづけるため、モー
タが完全に停止するまで電源を再投入できないという問
題がある。
回路をこのような従来方式で保護すると、過電流検出に
より電源回路が断たれたのち、モータが慣性により回転
しつづけ、その間逆起電力を発生しつづけるため、モー
タが完全に停止するまで電源を再投入できないという問
題がある。
一般に、トランジスタの過負荷の原因は一瞬に消滅して
しまう場合が多く、過電流を検出するごとに電源回路を
完全に断つことは、装置の使用者にとって決して好まし
いことではない。
しまう場合が多く、過電流を検出するごとに電源回路を
完全に断つことは、装置の使用者にとって決して好まし
いことではない。
また、トランジスタはコレクタ電流の過大のみで破壊す
るものではなく、コレクタ・エミッタ間電圧、活性領域
通過時間を要因として決まる安全動作領域(A S O
)から外れると危険な状態になる。そのために、スイッ
チングトランジスタがオフからオンに転するべくベース
電流が増大したとき所定時間内にコレクタ電位が所定の
低電位まで低下することを検出しなければならない。
るものではなく、コレクタ・エミッタ間電圧、活性領域
通過時間を要因として決まる安全動作領域(A S O
)から外れると危険な状態になる。そのために、スイッ
チングトランジスタがオフからオンに転するべくベース
電流が増大したとき所定時間内にコレクタ電位が所定の
低電位まで低下することを検出しなければならない。
〈発明の目的〉
本発明の目的は、トランジスタが正常な状態のときは入
力される制御信号に従ってトランジスタをオンオフ駆動
し、何らかの原因でトランジスタが危険状態になれば速
やかにベース電流を断って強制的にオフに戻して破壊を
防止し、次の制御信号到来時に危険状態が消滅しておれ
ば自動的に元のオンオフ制御状態に回復する自己復帰機
能を備えたスイッチングトランジスタの駆動回路を提供
することある。
力される制御信号に従ってトランジスタをオンオフ駆動
し、何らかの原因でトランジスタが危険状態になれば速
やかにベース電流を断って強制的にオフに戻して破壊を
防止し、次の制御信号到来時に危険状態が消滅しておれ
ば自動的に元のオンオフ制御状態に回復する自己復帰機
能を備えたスイッチングトランジスタの駆動回路を提供
することある。
〈発明の構成〉
本発明は、要約すれば、制御信号が到来するごとに所定
時間例えば5μsだけベース電流を供給し、その間にコ
レクタ電位が所定レベル以下に低下すればトランジスタ
が正常状態にあるとしてベース電流をひきつづき供給し
、もし上記所定時間内にコレクタ電位が上記所定レベル
以下に低下しなければ上記所定時間経過後ベース電流の
供給を断ってトランジスタを強制的にオフにするよう構
成したことを特徴としている。
時間例えば5μsだけベース電流を供給し、その間にコ
レクタ電位が所定レベル以下に低下すればトランジスタ
が正常状態にあるとしてベース電流をひきつづき供給し
、もし上記所定時間内にコレクタ電位が上記所定レベル
以下に低下しなければ上記所定時間経過後ベース電流の
供給を断ってトランジスタを強制的にオフにするよう構
成したことを特徴としている。
上記所定時間は、スイッチングトランジスタのスイッチ
ング時間よりも長く且つ安全動作領域を進展しない時間
、すなわちトランジスタが破壊しない時間内に選ばれる
。
ング時間よりも長く且つ安全動作領域を進展しない時間
、すなわちトランジスタが破壊しない時間内に選ばれる
。
〈実施例〉
第1図に本発明の一実施例を示す。図において、1は直
流電源を供給するための全波整流器、2は制御信号を導
入するためのホトカブラ、3は例えば5μsの遅延時間
をもつ遅延回路、4と5はNOT回路、6と7はNAN
D回路、R1はホトカプラ2の負荷抵抗、R2とR3は
トランジスタのコレクタ・エミッタ電圧を検出するため
の分圧用抵抗、8はトランジスタQ、、Q2よりなる相
補形増幅回路、9はトランジスタQ3.Q4よりなる相
補形電流増幅回路、10は本発明により駆動されるスイ
ッチング用パワートランジスタである。
流電源を供給するための全波整流器、2は制御信号を導
入するためのホトカブラ、3は例えば5μsの遅延時間
をもつ遅延回路、4と5はNOT回路、6と7はNAN
D回路、R1はホトカプラ2の負荷抵抗、R2とR3は
トランジスタのコレクタ・エミッタ電圧を検出するため
の分圧用抵抗、8はトランジスタQ、、Q2よりなる相
補形増幅回路、9はトランジスタQ3.Q4よりなる相
補形電流増幅回路、10は本発明により駆動されるスイ
ッチング用パワートランジスタである。
次に作用を説明する。この実施例はホトカプラ2がオン
のときパワートランジスタ10がオフになるよう構成さ
れている。すなわち、ホトカブラ2がオンのとき、その
出力点AはLoSNOT回路4の出力BはH1SNAN
D回路6の一方の入力線CはHlである。いま、パワー
トランジスタ10はオフであるから、抵抗R1,R2に
よる分圧点りはLoであってNAND回路6の他方の入
力線EはHl、従ってNAND回路6の出力Fはり。
のときパワートランジスタ10がオフになるよう構成さ
れている。すなわち、ホトカブラ2がオンのとき、その
出力点AはLoSNOT回路4の出力BはH1SNAN
D回路6の一方の入力線CはHlである。いま、パワー
トランジスタ10はオフであるから、抵抗R1,R2に
よる分圧点りはLoであってNAND回路6の他方の入
力線EはHl、従ってNAND回路6の出力Fはり。
になる。また、後段のNAND回路7の一方の入力に前
述したB点のHlが入力されているからNAND回路7
の出力点Gもl、o、2個の相補形増幅回路8,9を通
った後の出力点G′すなわちパワートランジスタ10の
ベースはLOレベルになる。
述したB点のHlが入力されているからNAND回路7
の出力点Gもl、o、2個の相補形増幅回路8,9を通
った後の出力点G′すなわちパワートランジスタ10の
ベースはLOレベルになる。
これと反対に、ホトカプラ2がオフであってパワートラ
ンジスタ10のコクフタ・エミッタ電圧が所定電圧以下
であれば、分圧点りが依然としてLo、NAND回路6
の他方の入力線EはHlである。ホトカブラ2のオフに
より点AがH11点B及び点CがLoとなってもNAN
D回路6の出力はLOのままである。しかし、後段のN
AND回路7は2人力がLOlLoであるから出力Gは
Hlとなり、パワートランジスタ10のベース端子はH
iになってオン状態が維持される。
ンジスタ10のコクフタ・エミッタ電圧が所定電圧以下
であれば、分圧点りが依然としてLo、NAND回路6
の他方の入力線EはHlである。ホトカブラ2のオフに
より点AがH11点B及び点CがLoとなってもNAN
D回路6の出力はLOのままである。しかし、後段のN
AND回路7は2人力がLOlLoであるから出力Gは
Hlとなり、パワートランジスタ10のベース端子はH
iになってオン状態が維持される。
しかし、この状態において、何らかの原因でパワートラ
ンジスタ10のコレクタ・エミッタ電圧が上昇して所定
値、例えば7■をこえると、NAND回路6の入力線E
がHiからLOに反転してその出力点FはLoからHi
に反転し、その結果、NAND回路7の出力GはHiか
らLOに反転し、パワートランジスタ10のベース電流
の供給が断たれる。
ンジスタ10のコレクタ・エミッタ電圧が上昇して所定
値、例えば7■をこえると、NAND回路6の入力線E
がHiからLOに反転してその出力点FはLoからHi
に反転し、その結果、NAND回路7の出力GはHiか
らLOに反転し、パワートランジスタ10のベース電流
の供給が断たれる。
パワートランジスタ10のコレクタ・エミノタ電圧が、
低下しないまま、ホトカプラ2がオンからオフに変わる
と、第2図にタイムチャートで示すように、点Aがl、
oからHlに反転し、点BはHlからLOに反転し、点
Cは所定の遅延時間遅れてHlからLOに反転する。前
段のNAND回路6の入力Eはl、oであるからその出
力Fは入力CがLoに反転したtltHiに転する。そ
の結果、後段のNAND回路7の入力は遅延時間Δtの
間だけ2人力ともLOlLoになって出力GはΔtの間
だけHiになるが、その後は再びLoに戻る。そのため
、パワートランジスタは破壊に至ることなくオフ状態に
戻される。
低下しないまま、ホトカプラ2がオンからオフに変わる
と、第2図にタイムチャートで示すように、点Aがl、
oからHlに反転し、点BはHlからLOに反転し、点
Cは所定の遅延時間遅れてHlからLOに反転する。前
段のNAND回路6の入力Eはl、oであるからその出
力Fは入力CがLoに反転したtltHiに転する。そ
の結果、後段のNAND回路7の入力は遅延時間Δtの
間だけ2人力ともLOlLoになって出力GはΔtの間
だけHiになるが、その後は再びLoに戻る。そのため
、パワートランジスタは破壊に至ることなくオフ状態に
戻される。
〈発明の効果〉
本発明によれば、コレクタ・エミッタ電圧を分圧回路で
検出し直接に論理回路へ導入しているので、従来のよう
にコレクタ電流検出手段が不要になって構成が簡素化さ
れ、しかもベース電流の多少にかかわらずスイッチング
トランジスタの安全領域の逸税を検出していることにな
り、確実にパワートランジスタが保護される。
検出し直接に論理回路へ導入しているので、従来のよう
にコレクタ電流検出手段が不要になって構成が簡素化さ
れ、しかもベース電流の多少にかかわらずスイッチング
トランジスタの安全領域の逸税を検出していることにな
り、確実にパワートランジスタが保護される。
また、本発明によれば、パワートランジスタの危険状態
が消滅すると自動的かつ直ちに正常なオンオフ制御状態
に戻るので、監視や復帰操作が不要であり、使用上至便
である。
が消滅すると自動的かつ直ちに正常なオンオフ制御状態
に戻るので、監視や復帰操作が不要であり、使用上至便
である。
第1図は本発明実施例の回路図、第2図はその作用説明
図である。 2−・・ホトカプラ 3−遅延回路 4.5−・N07回路 6.7・・−NAND回路 R2,R3−・・分圧抵抗 10・−スイッチングトランジスタ 特許出願人 日本インバータ株式会社 代理人 弁理士西1)新 手続補正書 昭和60年 1月Σ)日 特許庁長官 殿 2、 発明の名称 スイッチングトランジスタの駆動回路 3、?ili正をする者 事件との関係 特許出願人 住所 大阪府寝屋川市太間2番3号(本日訂正)氏名
日本インバータ株式会社 代表者 横井弥寿雄 4、代理人 住所 大阪市北区兎我野町15番13号ミユキビル 電
話(06) 315−7481〜27、補正の内容
図である。 2−・・ホトカプラ 3−遅延回路 4.5−・N07回路 6.7・・−NAND回路 R2,R3−・・分圧抵抗 10・−スイッチングトランジスタ 特許出願人 日本インバータ株式会社 代理人 弁理士西1)新 手続補正書 昭和60年 1月Σ)日 特許庁長官 殿 2、 発明の名称 スイッチングトランジスタの駆動回路 3、?ili正をする者 事件との関係 特許出願人 住所 大阪府寝屋川市太間2番3号(本日訂正)氏名
日本インバータ株式会社 代表者 横井弥寿雄 4、代理人 住所 大阪市北区兎我野町15番13号ミユキビル 電
話(06) 315−7481〜27、補正の内容
Claims (1)
- 制御対象であるスイッチングトランジスタのコレクタ・
エミッタ間電圧を検出してLo又はHlの2値レベルを
得る検出手段と、入力された制御信号に関連してレベル
変化する2値信号を、上記スイッチングトランジスタの
スイッチング時間よりも長く且つトランジスタが破壊し
ない時間内に選ばれた所定時間遅延させる遅延回路と、
上記検出信号が所定値以下のLoレベルであって且つ上
記スイッチングトランジスタをオンにすべき制御信号が
入力されているときのみ上記所定時間経過後上記スイッ
チングトランジスタにベース電流を供給し、且つ、上記
検出信号が所定値以上のHiレベルであって且つ上記制
御信号がオフにすべき信号からオンにすべき信号に反転
したとき上記所定時間のみ上記スイッチングトランジス
タにベース電流を供給する論理回路を有する、スイッチ
ングトランジスタの駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58209585A JPS60100823A (ja) | 1983-11-07 | 1983-11-07 | スイツチングトランジスタの駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58209585A JPS60100823A (ja) | 1983-11-07 | 1983-11-07 | スイツチングトランジスタの駆動回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60100823A true JPS60100823A (ja) | 1985-06-04 |
JPH0560283B2 JPH0560283B2 (ja) | 1993-09-02 |
Family
ID=16575267
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58209585A Granted JPS60100823A (ja) | 1983-11-07 | 1983-11-07 | スイツチングトランジスタの駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60100823A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4906876A (en) * | 1988-10-25 | 1990-03-06 | Msi Corporation | Base drive circuit |
EP0361211A2 (de) * | 1988-09-28 | 1990-04-04 | Siemens Aktiengesellschaft | Schutzschaltung für einen Leistungshalbleiterbaustein |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5140263A (ja) * | 1974-09-28 | 1976-04-03 | Hitachi Maxell | Shindoshikidenkikamisorinochibatai no seizoho |
-
1983
- 1983-11-07 JP JP58209585A patent/JPS60100823A/ja active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5140263A (ja) * | 1974-09-28 | 1976-04-03 | Hitachi Maxell | Shindoshikidenkikamisorinochibatai no seizoho |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0361211A2 (de) * | 1988-09-28 | 1990-04-04 | Siemens Aktiengesellschaft | Schutzschaltung für einen Leistungshalbleiterbaustein |
US4906876A (en) * | 1988-10-25 | 1990-03-06 | Msi Corporation | Base drive circuit |
Also Published As
Publication number | Publication date |
---|---|
JPH0560283B2 (ja) | 1993-09-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |