JPS5978734U - 遅延出力回路 - Google Patents

遅延出力回路

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JPS5978734U
JPS5978734U JP17496182U JP17496182U JPS5978734U JP S5978734 U JPS5978734 U JP S5978734U JP 17496182 U JP17496182 U JP 17496182U JP 17496182 U JP17496182 U JP 17496182U JP S5978734 U JPS5978734 U JP S5978734U
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JP
Japan
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signal
pulse
pulse signal
count value
counter
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JP17496182U
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Inventor
川崎　一政
Original Assignee
トキコ株式会社
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Publication date
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  • Pulse Circuits (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案による好ましい一員体例の遅延出力回路
を有する漏洩検出器の説明図、第２図は第１図の遅延出
力回路の説明図、第３図は第２図の遅延出力回路での信
号のタイムチャートである。 ８・・・計数器、９．１９・・・パルス発生器、１１・
・・カウンタ、１５・・・フリップフロップ、Ｆｌ、Ｆ
３・・・パルス信号。

Claims (1)

  1. 【実用新案登録請求の範囲】 第一人力に入力される第一のパルス信号によって計数値
    か一つずつ増加せしめられ、第一のパルス信号の繰り返
    し周波数以上の繰り返し周波数を有しており、第二人力
    に入力される第二のパルス信号によって計数値が一つず
    つ減少せしめられ、且つ計数値が初期設定された値に一
    致している場合第一の一致信号を発生するように構成さ
    れた第一一の計数器と、 第−及び第二のパルス信号の繰り返し周波数よりも大き
    い第一の設定周波数で第三〇パルス信号を出力する第一
    のパルス発生器と、 第三のパルス信号の数を計数すべく構成されており、且
    つ計数値が所与の値に一致する毎に第二の一致信号を発
    すると共に計数値が零に再設定され、更に第一の計数器
    から前記第一の一致信号を受けている場合計数値が零に
    保持されるべく構成された第二の計数器と、 前記第二の一致信号によってセットされると共に、前記
    第一の一致信号によってリセットされるべく構成された
    フリップフロップ回路と、フリップフロップ回路がセッ
    トされている場合にのみ前記第二のパルス信号を出力す
    べく構成された第二のパルス発生器とを有してなる遅延
    出力回路。
JP17496182U 1982-11-19 1982-11-19 遅延出力回路 Granted JPS5978734U (ja)

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JP17496182U JPS5978734U (ja) 1982-11-19 1982-11-19 遅延出力回路

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JP17496182U JPS5978734U (ja) 1982-11-19 1982-11-19 遅延出力回路

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JPS5978734U true JPS5978734U (ja) 1984-05-28
JPH0218600Y2 JPH0218600Y2 (ja) 1990-05-24

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