JPS61154025U - - Google Patents
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- Publication number
- JPS61154025U JPS61154025U JP3630685U JP3630685U JPS61154025U JP S61154025 U JPS61154025 U JP S61154025U JP 3630685 U JP3630685 U JP 3630685U JP 3630685 U JP3630685 U JP 3630685U JP S61154025 U JPS61154025 U JP S61154025U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- delay
- rectangular wave
- wave signal
- generates
- Prior art date
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- Pending
Links
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- 230000001360 synchronised effect Effects 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 1
- 238000003708 edge detection Methods 0.000 description 1
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
- Manipulation Of Pulses (AREA)
Description
第１図は本考案の一実施例を示すブロツク図で
ある。 １……カウンタ、２……第１遅延回路、３……
第２遅延回路、４……エツヂ検出回路、ａ……磁
気デイスク装置の基準パルス、ｂ……分周パルス
ａ、ｃ……第１遅延パルス、ｄ……第２遅延パル
ス、ｅ……バイトパルス。
ある。 １……カウンタ、２……第１遅延回路、３……
第２遅延回路、４……エツヂ検出回路、ａ……磁
気デイスク装置の基準パルス、ｂ……分周パルス
ａ、ｃ……第１遅延パルス、ｄ……第２遅延パル
ス、ｅ……バイトパルス。
Claims (1)
- 立上り及び立下りの時点が磁気デイスク装置の
基準パルスに同期しており、時間幅がその基準パ
ルスの整数倍である矩形波の信号を生ずる回路と
、前記矩形波信号を初段に受けて遅延時間が同一
である遅延回路を直列に多段接続した遅延回路群
と前記矩形波信号及び前記遅延回路群の出力を受
けて、それぞれの立上り又は立下りに同期したパ
ルスを論理和して出力する回路とからなるパルス
発生器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3630685U JPS61154025U (ja) | 1985-03-14 | 1985-03-14 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3630685U JPS61154025U (ja) | 1985-03-14 | 1985-03-14 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61154025U true JPS61154025U (ja) | 1986-09-24 |
Family
ID=30541358
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3630685U Pending JPS61154025U (ja) | 1985-03-14 | 1985-03-14 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61154025U (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5029305A (ja) * | 1973-07-06 | 1975-03-25 | ||
| JPS54100651A (en) * | 1978-01-26 | 1979-08-08 | Fujitsu Ltd | Pulse-width/pusle-period converter circuit |
| JPS5753729B2 (ja) * | 1980-11-21 | 1982-11-15 |
-
1985
- 1985-03-14 JP JP3630685U patent/JPS61154025U/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5029305A (ja) * | 1973-07-06 | 1975-03-25 | ||
| JPS54100651A (en) * | 1978-01-26 | 1979-08-08 | Fujitsu Ltd | Pulse-width/pusle-period converter circuit |
| JPS5753729B2 (ja) * | 1980-11-21 | 1982-11-15 |
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