JPS5967947U - 混成回路 - Google Patents
混成回路Info
- Publication number
- JPS5967947U JPS5967947U JP16372182U JP16372182U JPS5967947U JP S5967947 U JPS5967947 U JP S5967947U JP 16372182 U JP16372182 U JP 16372182U JP 16372182 U JP16372182 U JP 16372182U JP S5967947 U JPS5967947 U JP S5967947U
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- flat package
- delay line
- hybrid circuit
- board
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Filters And Equalizers (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図:集積回路と遅延線を接続した従来の混成回路の
斜視図、第2N:本考案を用い得る混成回路の斜視図、
第3図、第4図:第2図の部分拡大斜視図、第5図:第
2図の回路図、第6図:第2図の混成回路の製造方法を
説明するための平面図、第7図二本考案の混成回路の実
施例を示す部分斜視図、 1:基板、2:フラットパッケージ、3. 3A。 3B:フラットパッケージ2の端子、4A、 4B。 4C,4D、 4E:端子、9:リードパターン、1
0:Lll:デュアルインラインパッケージ、14・・
・リード線、15,16:端子、17:切溝、18:切
欠部、19:リードフレーム、24. 25゜26、
27. 28:水平面。
斜視図、第2N:本考案を用い得る混成回路の斜視図、
第3図、第4図:第2図の部分拡大斜視図、第5図:第
2図の回路図、第6図:第2図の混成回路の製造方法を
説明するための平面図、第7図二本考案の混成回路の実
施例を示す部分斜視図、 1:基板、2:フラットパッケージ、3. 3A。 3B:フラットパッケージ2の端子、4A、 4B。 4C,4D、 4E:端子、9:リードパターン、1
0:Lll:デュアルインラインパッケージ、14・・
・リード線、15,16:端子、17:切溝、18:切
欠部、19:リードフレーム、24. 25゜26、
27. 28:水平面。
Claims (2)
- (1) 複数のコイルとコンデンサを配置して構成さ
れた遅延線の基板が集積回路のフラットパッケージ上に
載置してあり、フラットパッケージの端子を上側に折り
曲げ該基板の側辺で遅延線の回路と集積回路とが接続さ
れており、フラットパッケージの折り曲げなかった端子
を別の端子に接続して該別の端子を下側に折り曲げ該フ
ラットパッケージを挾んで2列に引き出すと共に該別の
端子の一端を露呈させた状態で全体を樹脂封止しである
混成回路において、少くとも1つの該別の端子のフラッ
トパッケージ側の端はU字形に形成され、U字形の片方
の先端がフラットパッケージの折り曲げなかった端子と
接続しており、他方の先端が遅延線の基板の側辺に固着
されていることを特徴とする混成回路。 - (2)フラットパッケージの端子と別の端子との接続部
分では別の端子の幅がフラットパッケージの幅よりも広
くしであると共に上下いずれかの側に折り曲げである先
端に設けられた切欠部にフラットパッケージの該端子が
嵌合している実用新案登録請求の範囲第1項記載の混成
回路。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16372182U JPS5967947U (ja) | 1982-10-28 | 1982-10-28 | 混成回路 |
US06/448,630 US4506238A (en) | 1981-12-14 | 1982-12-10 | Hybrid circuit device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16372182U JPS5967947U (ja) | 1982-10-28 | 1982-10-28 | 混成回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5967947U true JPS5967947U (ja) | 1984-05-08 |
JPS6233345Y2 JPS6233345Y2 (ja) | 1987-08-26 |
Family
ID=30359148
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16372182U Granted JPS5967947U (ja) | 1981-12-14 | 1982-10-28 | 混成回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5967947U (ja) |
-
1982
- 1982-10-28 JP JP16372182U patent/JPS5967947U/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS6233345Y2 (ja) | 1987-08-26 |
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