JPS596557A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPS596557A
JPS596557A JP11653282A JP11653282A JPS596557A JP S596557 A JPS596557 A JP S596557A JP 11653282 A JP11653282 A JP 11653282A JP 11653282 A JP11653282 A JP 11653282A JP S596557 A JPS596557 A JP S596557A
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JP
Japan
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oxide film
film
silicon oxide
nitride film
silicon
Prior art date
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JP11653282A
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JPS6316903B2 (ja
Inventor
Kuniyuki Hamano
浜野 邦幸
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NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
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Publication of JPS596557A publication Critical patent/JPS596557A/ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/76Making of isolation regions between components
    • H01L21/762Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
    • H01L21/76202Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using a local oxidation of silicon, e.g. LOCOS, SWAMI, SILO

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は集積回路装置の製造方法に関し、特に集積回路
の素子間分離方法に関する。
集積回路装置に於いては近年高密度化の要請が強くなり
内部に組み込まれる素子の面積が微細になっている。
この様に素子の面積が微少になると共に素子間を分離す
る領域の集積回路装置に占める面積が集積度の向上に大
きな障害となる事が明確となってきた。
従来、集積回路装置に於ける素子間分離は選択的に成長
されたシリコン酸化膜によって行われていた。このシリ
コン酸化膜を選択的lこ成長させる為には通常シリコン
基板を熱酸化して選択的に埋設する酸化膜を形成する方
法が採用されている。
この方法に於いては、シリコン基板上に500〜100
0人程度の薄い熱酸化シリコン酸化膜と1000〜20
00Aの気相成長シリコン窒化膜を選択的に形成し、こ
れらの二層膜を熱酸化時の酸化マスクとして用い、シリ
コン基板上に約1.0μmの厚い熱酸化膜を形成してい
た。この二層膜に於ける薄いシリコン酸化膜の役割は、
熱酸化時に於けるシリコン基板と気相成長シリコン窒化
膜の間のストレスを緩和する事であり、この薄いシリコ
ン酸化膜がある事によりシリコン基板表面にストレスに
よる欠陥が入る事が防がれている。他方この薄いシリコ
ン酸化膜中は、酸素や水酸基等の酸化因子が拡散しやす
いために、1.0μm程度の厚い酸化膜を形成する時に
窒化膜の端の部分に於いて、薄いシリコン酸化膜も厚く
なり厚い酸化膜が酸マスクである気相成長窒化膜の下側
にまで入り込んでしまうという現象があった。この為素
子分離領域が拡がってし才い能動素子領域が減少し集積
度の向上に対して大きな障害となっていた。
この様な、従来の素子間分離法に於ける欠点を除去する
為に上記分離領域を予め溝状にエツチングしてから厚い
酸化膜を形成する等、種々の方法が提案されているが、
それらの新しい分離方式は非常に複雑な工程をへる事が
多く実用上に難点を生じていた。
従って本発明の目的は上記の欠点を除いた素子間分離法
を提供する事である。
本発明は数百Aの厚さのシリコン酸化を予め熱窒化をし
て酸化のマスクとなる気相成長窒化膜の下に用いれば、
厚い酸化膜形成的に基板シリコンに歪を生じさせる事な
く又、厚い酸化膜の横方向の拡がりもなく、素子間分離
の為の厚い酸化膜を形成できるという知見に基く。
本発明の素子間分離方法は、シリコン基板を熱酸化する
工程と、該シリコン酸化膜をたとえばアンモニアを含む
ガス中に於いて熱窒化する工程と、該シリコン酸化膜上
に選択的に気相成長シリコン窒化膜を形成する工程と、
該シリコン窒化膜をマスクとしてシリコン基板を選択的
に酸化する工程を有するものである。
欠番こ本発明をよりよく理解する為に図面を用いて説明
しよう。第1図は従来の素子間分離法を説明する為の断
面図である。この従来の方法に於いては、先づ第1図(
a)に示す如く、シリコン基板101上に熱酸化により
数百人の厚さのシリコン酸化膜102を形成し、次に第
1図(b)に示す様に気相成長によりシリコン窒化膜1
03を成長させ、第1図(C)に示す如く素子間分離領
域から該シリコン酸化膜102シリコン窒化膜103を
エツチング除去し選択的に後の酸化的のマスクとなる。
シリコン酸化膜102.シリコン窒化膜103を残し、
最後に第1図(d)に示す如く該シリコン窒化膜103
、シリコン酸化膜102をマスクとしてシリコン基板1
01を1000℃前後の温度で通常はスチーム雰囲気中
に於いて酸化し約1.0μの厚さの素子間分離酸化膜1
04を形成する。
この従来の素子間分離法に於いては厚い酸化膜104は
マスクとなる。シリコン窒化膜103の端から横方向に
拡がり長さLlだけシリコン窒化膜103の下に入り込
む。このLBの値は厚いシリコン酸化膜104の厚さの
7割からlθ割位の値に及ぶ。この為に素子間分離領域
の面積が拡がってしまい、従って後からトランジスタ等
の能動素子を形成する領域が狭くなり集積度の向上が阻
害されるという大きな欠点があった。
第2図は本発明の素子間分離法を説明する為の断面図で
ある。本発明の素子間分離法は先づ第2図(II)に示
す如く、シリコン基板201上に熱酸化により数百^の
厚さのシリコン酸化膜202を形成し次に第2図(b)
に示す様にアンモニアガスを含む雰囲気中で熱処理する
事でシリコン酸化膜202を熱窒化されたシリコン酸化
膜203に変える。
次にシリコン窒化膜を気相成長させて選択的にエツチン
グする事により、第2図(C)に示される如く選択的に
残された熱窒化シリコン酸化膜203とシリコン窒化膜
204を形成し最後第2図(d)に示される如くに該熱
窒化シリコン酸化膜203とシリコン窒化膜204を酸
化マスクとして厚い素子間分離用絶縁膜205を形成す
る。
この本発明の素子間分離法に於いては、シリコン窒化膜
204の下の薄いシリコン酸化膜は熱窒化されたシリコ
ン酸化膜203である。この熱窒化されたシリコン酸化
膜204は酸化に対してバリヤー性をもっているために
、厚い酸化膜205を形成する際に該酸化膜205の横
方向への拡がりが非常に少い。そのためにシリコン窒化
膜204の下の、後で(能動)素子が形成される領域の
面積が狭くなる事が防がれ集積度が大きく向上するとい
う利点を有する。更に又、熱窒化されたシリコン酸化膜
203は通常のシリコン酸化膜と同様シリコン窒化膜2
04とシリコン基板201の間に入る応力を緩和する働
きをもち、シリコン基板201には歪が入らないため後
で形成される素子の特性を劣化させる事もない。
【図面の簡単な説明】
第1図は従来技術の半導体装置の製造方法を示す断面図
であり、第2図は本発明の一実施例を示す断面図である
。 尚、図において、101,201・・・・・・シリコン
基板、102,202・・・・・・シリコン酸化膜、1
03,204・・・・・・気相成長によるシリコン窒化
膜、104,205・・・・・・素子間分離の厚い酸化
膜、203・・・・・・熱窒化されたシリコン酸化膜で
ある。 (αン (ルン (C] (d) 狛 1 回 (aン (レフ (C] (1!/) $2’e

Claims (1)

    【特許請求の範囲】
  1. シリコン基板を熱酸化してシリコン酸化膜を形成する工
    程と、該シリコン酸化膜を熱窒化する工程と、該熱窒化
    されたシリコン酸化膜上にシリコン窒化膜を気相成長す
    る工程と、該シリコン窒化膜と熱窒化されたシリコン酸
    化膜とを選択的にエツチング除去する工程と、残された
    シリコン窒化膜及び熱窒化されたシリコン酸化膜をマス
    クとしてシリコン基板を熱酸化する工程を含む事を%徴
    とする半導体装置の製造方法。
JP11653282A 1982-07-05 1982-07-05 半導体装置の製造方法 Granted JPS596557A (ja)

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JP11653282A JPS596557A (ja) 1982-07-05 1982-07-05 半導体装置の製造方法

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Publications (2)

Publication Number Publication Date
JPS596557A true JPS596557A (ja) 1984-01-13
JPS6316903B2 JPS6316903B2 (ja) 1988-04-11

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ID=14689451

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JP (1) JPS596557A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6321848A (ja) * 1986-07-16 1988-01-29 Sanyo Electric Co Ltd 素子分離領域の形成方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50123275U (ja) * 1974-03-22 1975-10-08
JPS5154378A (en) * 1974-11-07 1976-05-13 Fujitsu Ltd Handotaisochino seizohoho
JPS56125859A (en) * 1980-03-06 1981-10-02 Fujitsu Ltd Manufacture of semiconductor device

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50123275U (ja) * 1974-03-22 1975-10-08
JPS5154378A (en) * 1974-11-07 1976-05-13 Fujitsu Ltd Handotaisochino seizohoho
JPS56125859A (en) * 1980-03-06 1981-10-02 Fujitsu Ltd Manufacture of semiconductor device

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6321848A (ja) * 1986-07-16 1988-01-29 Sanyo Electric Co Ltd 素子分離領域の形成方法

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