JPS5961152A - 半導体装置 - Google Patents
半導体装置Info
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- JPS5961152A JPS5961152A JP57171260A JP17126082A JPS5961152A JP S5961152 A JPS5961152 A JP S5961152A JP 57171260 A JP57171260 A JP 57171260A JP 17126082 A JP17126082 A JP 17126082A JP S5961152 A JPS5961152 A JP S5961152A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(1) 発明の技術分野
本発明は、リードレスチップキャリア(以下LCCと記
す)のモジュールに係り、特に発熱部分をモジュール上
平均化し実装密度を高めた半導体装置に関する。
す)のモジュールに係り、特に発熱部分をモジュール上
平均化し実装密度を高めた半導体装置に関する。
(2) 技術の背景
近年1例えばLSI等にみられるように高密度化の傾向
は著しい進歩が見られるが、またこれに伴って例えば実
装密度等の面からも技術的進歩が各種口られていること
は既に周知である。
は著しい進歩が見られるが、またこれに伴って例えば実
装密度等の面からも技術的進歩が各種口られていること
は既に周知である。
例えば、リードレスチップキャリア
(LCC)と呼ばれ従来の例えばDIPに比較して長さ
が1/2乃至1/3と大幅に小型化されたリード部を持
たない新しいパッケージが出現している。
が1/2乃至1/3と大幅に小型化されたリード部を持
たない新しいパッケージが出現している。
(3) 従来技術と問題点
従来9例えばICのパッケージとしてはフラットパッケ
ージ、デュアルインラインパッケージ等が各種開発され
て来ているが、何れも例えば高密度実装等に際しては放
熱等に関して不都合を生じている。
ージ、デュアルインラインパッケージ等が各種開発され
て来ているが、何れも例えば高密度実装等に際しては放
熱等に関して不都合を生じている。
例えば、複数のワンチップパッケージを同一基板上に並
べてモジュール化する際に、ICのパッケージのうち同
時に動作する種類のパンケージどうしを隣接して基板上
に並べる等各種パッケージを任意に並べて基板上に搭載
すると、各種パッケージのうち全ての種類のICが等し
い頻度で動作するとは限らないために、特定の種類のI
Cのみが多く動作した場合にはICの動作時に流れる電
流の発熱によって上記基板上での温度にムラが生しるこ
とがある。このため例えば基板の温度上昇によるICチ
ップの動作の遅延等各種不都合を生じている。
べてモジュール化する際に、ICのパッケージのうち同
時に動作する種類のパンケージどうしを隣接して基板上
に並べる等各種パッケージを任意に並べて基板上に搭載
すると、各種パッケージのうち全ての種類のICが等し
い頻度で動作するとは限らないために、特定の種類のI
Cのみが多く動作した場合にはICの動作時に流れる電
流の発熱によって上記基板上での温度にムラが生しるこ
とがある。このため例えば基板の温度上昇によるICチ
ップの動作の遅延等各種不都合を生じている。
(4) 発明の目的
本発明の目的は、上記従来の欠点に鑑b L CGの各
種異なるパッケージを基板上に−まとまりのブロックと
してまとめてブロック毎に配列してモジュール化するこ
とによって」動作中のLCCにより発生する熱が基板上
平均化された。従って。
種異なるパッケージを基板上に−まとまりのブロックと
してまとめてブロック毎に配列してモジュール化するこ
とによって」動作中のLCCにより発生する熱が基板上
平均化された。従って。
動作速度の遅延が少いしかも基板上での温度の偏りが少
いために、LCCを高密度化することが可能なモジール
化した半導体装置を提供することにある。
いために、LCCを高密度化することが可能なモジール
化した半導体装置を提供することにある。
(5) 発明の構成
本発明の特徴とするところは、それぞれ異なる回路機能
を有するチップを搭載した複数のり一ドレスチップキャ
リアを、該チップから発生した熱による配線基板上の温
度分布が均一化されるように該配線基板上に配置したこ
とを特徴とする半導体装置を提供することによって達成
される。
を有するチップを搭載した複数のり一ドレスチップキャ
リアを、該チップから発生した熱による配線基板上の温
度分布が均一化されるように該配線基板上に配置したこ
とを特徴とする半導体装置を提供することによって達成
される。
(6) 発明の実施例
以下1本発明についての実施例を図面を用いて説明する
。
。
第1図は本発明のLCCモジュールの平面図である。
各LCCモジールは例えばセラミック等からなる基板1
上にメモリが収納口のリードレスチップキャリア(LC
C)のパンケージ2が例えばA。
上にメモリが収納口のリードレスチップキャリア(LC
C)のパンケージ2が例えばA。
Bの2種それぞれ4個ずつ都合8個搭載されている。そ
して、これらA、82種のLCCのパッケージは交互に
配列されている。各LCCのパッケージには、外リード
部を設&Jておらず例えば基板1上にプリント配線され
た回路を介して電気的に接続されており、更にLCCモ
ジュールの例えば側口1;に設りである外リード部の各
端子であるピン3にて外部との電気的接続が図られてい
る。
して、これらA、82種のLCCのパッケージは交互に
配列されている。各LCCのパッケージには、外リード
部を設&Jておらず例えば基板1上にプリント配線され
た回路を介して電気的に接続されており、更にLCCモ
ジュールの例えば側口1;に設りである外リード部の各
端子であるピン3にて外部との電気的接続が図られてい
る。
本装置の外リード部の各端子はΔ、Bを1つの組として
構成して共用させであるために全体の端子数は従来に比
して大幅に減少し、従って端子を取付けている基板1も
飛躍的に小型化することが可能となっている。
構成して共用させであるために全体の端子数は従来に比
して大幅に減少し、従って端子を取付けている基板1も
飛躍的に小型化することが可能となっている。
論理演算等において、LCCモジールの例えば上記2種
のメモリA、Bから構成さる場合には。
のメモリA、Bから構成さる場合には。
Δ、BIJ<瞬間的に同時刻に動作することは無いため
にA、81組で外リード部の各端子を共用することが可
能である。
にA、81組で外リード部の各端子を共用することが可
能である。
例えば、任意の時刻t1においてはLCCのAのみが動
作するため、ずなわち411!Jc))Aが同時刻t1
で動作し、且つ4111i1のBは同時刻t1では動作
しておらず、従って1個おきに配列された4個のAのみ
からその時刻t1では電流が流れて熱が発生する。そし
て上述の如く配列されたパッケージを有するモジュール
であるため、すなわちΔ。
作するため、ずなわち411!Jc))Aが同時刻t1
で動作し、且つ4111i1のBは同時刻t1では動作
しておらず、従って1個おきに配列された4個のAのみ
からその時刻t1では電流が流れて熱が発生する。そし
て上述の如く配列されたパッケージを有するモジュール
であるため、すなわちΔ。
Bのパンケージを交互に配列しであるので、」二記時刻
L1で発熱による基板1」二での温度の偏りはみられな
い。次に時刻t2ではLCCのBが動作をする場合、ず
なわち4個のAが時刻t2では動作をしておらず、4個
のBのみが同時刻t2で動作をする場合にば1111i
1おきに配列された4個の動作をしている13にのみ時
刻t2で瞬間的に電流が流れて熱が発生する。従って、
この場合にも1個おきにBが配列されているために上記
時刻L2での発熱による基板1上での温度の部分的な偏
りは見られずほぼ平均化した温度分布となる。
L1で発熱による基板1」二での温度の偏りはみられな
い。次に時刻t2ではLCCのBが動作をする場合、ず
なわち4個のAが時刻t2では動作をしておらず、4個
のBのみが同時刻t2で動作をする場合にば1111i
1おきに配列された4個の動作をしている13にのみ時
刻t2で瞬間的に電流が流れて熱が発生する。従って、
この場合にも1個おきにBが配列されているために上記
時刻L2での発熱による基板1上での温度の部分的な偏
りは見られずほぼ平均化した温度分布となる。
以上の如く、上記論理演算等での各素子の動作は通例同
時刻には各組のうち何れか一方が動作するために、LC
Cのモジュールにおいて上記の如き配列すなわち例えば
2種のパッケージの場合には交互に配列することによっ
て発熱による基板上での温度の偏りを防止することがで
きる。従って。
時刻には各組のうち何れか一方が動作するために、LC
Cのモジュールにおいて上記の如き配列すなわち例えば
2種のパッケージの場合には交互に配列することによっ
て発熱による基板上での温度の偏りを防止することがで
きる。従って。
このためにバ・7ケージの実装密度を高めても発熱によ
る精度の低下、動作の遅延が阻止できるようになった。
る精度の低下、動作の遅延が阻止できるようになった。
第2図(al及び(blは1本発明のLCCモジュール
の他の実施例におけるそれぞれ表と裏の平面図である。
の他の実施例におけるそれぞれ表と裏の平面図である。
第1図と同一部分には同一符号を付して重複説明は省略
する。
する。
第1図(alにおいて1例えば2種類のパッケージA、
Bを基板1上にそれぞれ2個ずつ搭載されている。また
、第1図tb)において、第1図ta+の表面に対応す
る部分の裏面での搭載するパッケージの種類は同一種類
のパンケージは避りるようにすることで基板上でのパッ
ケージの発熱による温度分布を平均化さ・已ることが可
能となる。
Bを基板1上にそれぞれ2個ずつ搭載されている。また
、第1図tb)において、第1図ta+の表面に対応す
る部分の裏面での搭載するパッケージの種類は同一種類
のパンケージは避りるようにすることで基板上でのパッ
ケージの発熱による温度分布を平均化さ・已ることが可
能となる。
第3図(81及び(blは1本発明のLCCモジュール
の他の実施例におけるそれぞれ表と裏を表す平面図であ
る。
の他の実施例におけるそれぞれ表と裏を表す平面図であ
る。
第1図、第2図と同一部分には同一符号をイ;1して重
複説明は省略する。
複説明は省略する。
基板1上に搭載するパンケージ2は第3図と同様に2種
類へ、Bを用いである。第3図(alにおいて、第2図
とは異りA及びBのパッケージ2をそれぞれ交互に配列
さセており、第2図の場合より更に基板1上でのパンケ
ージによる発熱の均一化を図ることが可能となっている
。これは隣どうし及び同一部分の表裏両面での搭載され
るパッケージの種類を全て異るように並べて配列したた
めである。
類へ、Bを用いである。第3図(alにおいて、第2図
とは異りA及びBのパッケージ2をそれぞれ交互に配列
さセており、第2図の場合より更に基板1上でのパンケ
ージによる発熱の均一化を図ることが可能となっている
。これは隣どうし及び同一部分の表裏両面での搭載され
るパッケージの種類を全て異るように並べて配列したた
めである。
本装置の外リード部の各端子はA、Bを1つの組として
構成して共用させであるために、全体の端子数は従来に
比して大幅に減少し、従って端子を取付けている基板1
も飛躍的に小型化することが可能となっている。
構成して共用させであるために、全体の端子数は従来に
比して大幅に減少し、従って端子を取付けている基板1
も飛躍的に小型化することが可能となっている。
(7) 発明の効果
以上述べて来たように1本発明の如< LCCの異る種
類のものを1組としてまとめて何組かこれ等を配列して
モジール化することによって、更に゛演理演算等での同
時に異種のLCCは動作゛しないことを利用して各組毎
に電気接続端子を共用することによって、従来に比べ飛
躍的に実装密度を高め且つ発熱による動作の遅延及び積
度の低下を抑えた半導体装置を得ることが可能となった
。
類のものを1組としてまとめて何組かこれ等を配列して
モジール化することによって、更に゛演理演算等での同
時に異種のLCCは動作゛しないことを利用して各組毎
に電気接続端子を共用することによって、従来に比べ飛
躍的に実装密度を高め且つ発熱による動作の遅延及び積
度の低下を抑えた半導体装置を得ることが可能となった
。
第1図は1本発明のLCCモジュール半導体装置の平面
図、第2図ta+及び(blは本発明のLCCモジュー
ル半導体装置の他の実施例におけるそれぞれ表と裏の平
面図、第3図(al及び[blは本発明のLCCモジュ
ール半導体装置のもう一つの他の実施例におけるそれぞ
れ表と裏の平面図である。 1・・・Xtt、 2・・・)々・ノケージ、3・
・・ピン 23 第1図 第2図 第3図 1 1
図、第2図ta+及び(blは本発明のLCCモジュー
ル半導体装置の他の実施例におけるそれぞれ表と裏の平
面図、第3図(al及び[blは本発明のLCCモジュ
ール半導体装置のもう一つの他の実施例におけるそれぞ
れ表と裏の平面図である。 1・・・Xtt、 2・・・)々・ノケージ、3・
・・ピン 23 第1図 第2図 第3図 1 1
Claims (1)
- それぞれ異なる回路機能を有するチップを搭載した複数
のり一ドレスチップキャリアを、該チップから発生した
熱による配線基板上の温度分布が均一化されるように該
配線基板上に配置したことを特徴とする半導体装置。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57171260A JPS5961152A (ja) | 1982-09-30 | 1982-09-30 | 半導体装置 |
DE8383305762T DE3377686D1 (en) | 1982-09-30 | 1983-09-27 | A modular semiconductor device |
US06/536,324 US4689658A (en) | 1982-09-30 | 1983-09-27 | Modular semiconductor device |
EP83305762A EP0110512B1 (en) | 1982-09-30 | 1983-09-27 | A modular semiconductor device |
CA000438042A CA1200321A (en) | 1982-09-30 | 1983-09-29 | Modular semiconductor device |
KR1019830004654A KR870002065B1 (ko) | 1982-09-30 | 1983-09-30 | 모듀울형 반도체 장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57171260A JPS5961152A (ja) | 1982-09-30 | 1982-09-30 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5961152A true JPS5961152A (ja) | 1984-04-07 |
Family
ID=15920023
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57171260A Pending JPS5961152A (ja) | 1982-09-30 | 1982-09-30 | 半導体装置 |
Country Status (6)
Country | Link |
---|---|
US (1) | US4689658A (ja) |
EP (1) | EP0110512B1 (ja) |
JP (1) | JPS5961152A (ja) |
KR (1) | KR870002065B1 (ja) |
CA (1) | CA1200321A (ja) |
DE (1) | DE3377686D1 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4802099A (en) * | 1986-01-03 | 1989-01-31 | International Business Machines Corporation | Physical parameter balancing of circuit islands in integrated circuit wafers |
JP2960560B2 (ja) * | 1991-02-28 | 1999-10-06 | 株式会社日立製作所 | 超小型電子機器 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3459999A (en) * | 1967-07-03 | 1969-08-05 | Trw Inc | Circuit module and assembly |
US3815106A (en) * | 1972-05-11 | 1974-06-04 | S Wiedmann | Flip-flop memory cell arrangement |
DE2107549A1 (de) * | 1970-02-19 | 1971-09-02 | Texas Instruments Inc | Trager einer elektronischen Schaltung mit einem Sammelsystem mit Warmeleitungs eigenschaften fur alle Richtungen |
US3697831A (en) * | 1970-12-28 | 1972-10-10 | Us Navy | Series electrical, parallel thermal gunn devices |
DE2121865C3 (de) * | 1971-05-04 | 1983-12-22 | Ibm Deutschland Gmbh, 7000 Stuttgart | Speicher-Adressierschaltung |
JPS5229133A (en) * | 1975-09-01 | 1977-03-04 | Hitachi Ltd | Wiring common-ownership type double xy memory array system |
JPS5352322A (en) * | 1976-10-25 | 1978-05-12 | Toshiba Corp | Memory unit |
US4344156A (en) * | 1980-10-10 | 1982-08-10 | Inmos Corporation | High speed data transfer for a semiconductor memory |
JPS6059677B2 (ja) * | 1981-08-19 | 1985-12-26 | 富士通株式会社 | 半導体記憶装置 |
-
1982
- 1982-09-30 JP JP57171260A patent/JPS5961152A/ja active Pending
-
1983
- 1983-09-27 DE DE8383305762T patent/DE3377686D1/de not_active Expired
- 1983-09-27 US US06/536,324 patent/US4689658A/en not_active Expired - Fee Related
- 1983-09-27 EP EP83305762A patent/EP0110512B1/en not_active Expired
- 1983-09-29 CA CA000438042A patent/CA1200321A/en not_active Expired
- 1983-09-30 KR KR1019830004654A patent/KR870002065B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
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EP0110512A3 (en) | 1985-07-31 |
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