JPS5945305B2 - 直接中継方式 - Google Patents
直接中継方式Info
- Publication number
- JPS5945305B2 JPS5945305B2 JP55019615A JP1961580A JPS5945305B2 JP S5945305 B2 JPS5945305 B2 JP S5945305B2 JP 55019615 A JP55019615 A JP 55019615A JP 1961580 A JP1961580 A JP 1961580A JP S5945305 B2 JPS5945305 B2 JP S5945305B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- signal
- input
- circuit
- terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/14—Relay systems
- H04B7/15—Active relay systems
- H04B7/155—Ground-based stations
Description
【発明の詳細な説明】
本発明は無線回路に使用される同一周波数直接中継器、
さらに詳しく云えば比較的狭い帯域に多くの無線チャン
ネルが存在するようなシステムにおいて、前記無線チャ
ンネルの特定の１チャンネルを選択して中継するたゆに
供せられる無線中継器の中継方式に関する。
さらに詳しく云えば比較的狭い帯域に多くの無線チャン
ネルが存在するようなシステムにおいて、前記無線チャ
ンネルの特定の１チャンネルを選択して中継するたゆに
供せられる無線中継器の中継方式に関する。
無線通信システムにおいては、周波数の有効利用のため
に比較的狭い周波数帯に多数の無線チャンネルを構成す
る。
に比較的狭い周波数帯に多数の無線チャンネルを構成す
る。
例えば８００ＭＨ２帯の自動車電話システムを例にとる
と、８００ＭＨ２帯の１５ＭＨ２の帯域に２５ＫＨ２間
隔で割り当てられた無線チャンネルが、６００チャンネ
ルも存在するシステムが考えられている。
と、８００ＭＨ２帯の１５ＭＨ２の帯域に２５ＫＨ２間
隔で割り当てられた無線チャンネルが、６００チャンネ
ルも存在するシステムが考えられている。
第１図はこのようなシステムにおいて特定の１チャンネ
ルのみを選択して中継するためのよく知られた中継方式
を示すものである。
ルのみを選択して中継するためのよく知られた中継方式
を示すものである。
第１図において、端子１は信号入力端子、２は送信信号
出力端子、１０は周波数ダウンコンバータ、１１は局発
信号発生器、１２は中間周波数（以下ＩＦと記す）の選
択増幅回路、１３は周波数アップコンバータである。
出力端子、１０は周波数ダウンコンバータ、１１は局発
信号発生器、１２は中間周波数（以下ＩＦと記す）の選
択増幅回路、１３は周波数アップコンバータである。
端子１より入力された信号は周波数ジウンコンバータ１
０により周波数変換され、ＩＦ選択増幅回路１２に入力
される。この回路１２は通常狭帯域の帯域フィルタ（以
下ＩＦＢＰＥと記す）とレベル制限器付増幅器より構成
される。回路１２において希望波が選択されかつ振幅変
動分も抑圧された後、周波数アップコンバータ１３に入
力されて回線周波数に変換される。回路１３の出力は端
子２より空中線に導びかれる。この方式はＩＦ中継方式
と言われるものであり良く知られている。しかし、この
方法はＩＦＢＰＥの遅延特性が大きいためシステム構成
上人きな問題点となる場合がある。
０により周波数変換され、ＩＦ選択増幅回路１２に入力
される。この回路１２は通常狭帯域の帯域フィルタ（以
下ＩＦＢＰＥと記す）とレベル制限器付増幅器より構成
される。回路１２において希望波が選択されかつ振幅変
動分も抑圧された後、周波数アップコンバータ１３に入
力されて回線周波数に変換される。回路１３の出力は端
子２より空中線に導びかれる。この方式はＩＦ中継方式
と言われるものであり良く知られている。しかし、この
方法はＩＦＢＰＥの遅延特性が大きいためシステム構成
上人きな問題点となる場合がある。
第２図はこの問題を解決するために検討され考えられて
いる中継方式である。
いる中継方式である。
この方式は中継時の遅延時間を短縮するため、フェイズ
ロックループ回路（以下ＰＬＬ回路と略す）技術を使用
したものである。第２図において、端子１，２は第１図
の場合と同一である。
ロックループ回路（以下ＰＬＬ回路と略す）技術を使用
したものである。第２図において、端子１，２は第１図
の場合と同一である。
２０は前置増幅器、２１はＰＬＬ回路、２２はスイツチ
回路、２３は後置増幅器である。
回路、２３は後置増幅器である。
ＰＬＬ回路２１は通常、位相比較器、電圧可変発振器（
以下ＶＣＯと略す）、低域ろ波器を主構成要素としてい
る。ＰＬＬ回路の動作の概要は次の通りである。端子１
より入力した受信信号は前置増幅器２０により増幅され
、ＰＬＬ回路２１に入力される。入力受信信号は位相比
較器においてＶＣＯの発振周波数と比較され、希望受信
波のみがホモダイン検波され、他の不要波は周波数変換
されて位相比較器より出力される。この出力成分を低域
ろ波器に入力し不要波を減衰させた後、ＶＣＯの電圧制
御端子に導入する。以上の結果ＰＬＬ回路により希望波
を選択すること、すなわちフイルタリングを行なう目的
が達成される。ＰＬＬ回路において一巡伝達利得を有す
る周波数領域においては、ＣＯの位相は入力周波数の位
相に追随して変化するから、例えば入力波がＰＭ変調ま
たは、ＦＭ変調されている場合には、ＣＯの出力周波数
の位相変化または周波数変化も入力波に追随する。それ
故ＣＯの出力を増幅して端子２に導びくことにより中継
装置を構成できる。ＰＬＬ回路に希望入力波が入力して
いない場合にはＣＯはフリーランニング状態となるため
ＶＣＯの出力を端子に導びくことは不都合である。
以下ＶＣＯと略す）、低域ろ波器を主構成要素としてい
る。ＰＬＬ回路の動作の概要は次の通りである。端子１
より入力した受信信号は前置増幅器２０により増幅され
、ＰＬＬ回路２１に入力される。入力受信信号は位相比
較器においてＶＣＯの発振周波数と比較され、希望受信
波のみがホモダイン検波され、他の不要波は周波数変換
されて位相比較器より出力される。この出力成分を低域
ろ波器に入力し不要波を減衰させた後、ＶＣＯの電圧制
御端子に導入する。以上の結果ＰＬＬ回路により希望波
を選択すること、すなわちフイルタリングを行なう目的
が達成される。ＰＬＬ回路において一巡伝達利得を有す
る周波数領域においては、ＣＯの位相は入力周波数の位
相に追随して変化するから、例えば入力波がＰＭ変調ま
たは、ＦＭ変調されている場合には、ＣＯの出力周波数
の位相変化または周波数変化も入力波に追随する。それ
故ＣＯの出力を増幅して端子２に導びくことにより中継
装置を構成できる。ＰＬＬ回路に希望入力波が入力して
いない場合にはＣＯはフリーランニング状態となるため
ＶＣＯの出力を端子に導びくことは不都合である。
そのためにＶＣＯ出力信号のスイツチ回路２２が用意さ
れている。このようなＰＬＬ技術を用いた信号選択回路
の選択特性は低域ろ波器の性能により特性を決定するの
が通常の方法である。
れている。このようなＰＬＬ技術を用いた信号選択回路
の選択特性は低域ろ波器の性能により特性を決定するの
が通常の方法である。
この低域ろ波器はループ伝達特性上多段構成は困難であ
るが、しや断周波数を低くできるために、隣接波または
それ以上の周波数に関係する位相比較器の不要出力成分
に対して減衰量を大きくとることができる。
るが、しや断周波数を低くできるために、隣接波または
それ以上の周波数に関係する位相比較器の不要出力成分
に対して減衰量を大きくとることができる。
したがつてＰＬＬ回路を用いた中継器は周波数選択特性
が良く、しかも遅延時間の少ないという利点を有してい
る。しかるに、ＰＬＬ回路を用いた中継器においても次
に記す欠点を有している。すなわち、無線回線周波数帯
、例えばＨＦ帯、ＵＨＦ帯において位相比較器としては
ダイオードバランスドミキサ等の使用が考えられるが、
位相比較器に求められる特性として入出力特性の直線性
がある。これは入力信号が希望波および多数の不要波を
含むために、それらの複数波間の混変調特性により擬似
希望波が発生したり、または希望波が抑圧されるような
事態の発生をもたらすことがないようにするためである
。したがつて、位相比較器の入出力特性の直線性を得た
場合、位相比較器としての復調感度（位相復調器として
動作している）特性が希望波の入力レベル変動に応じて
変化をし、ＰＬＬ回路の一巡伝達利得が入力レベル変動
に応じて変化することになる。
が良く、しかも遅延時間の少ないという利点を有してい
る。しかるに、ＰＬＬ回路を用いた中継器においても次
に記す欠点を有している。すなわち、無線回線周波数帯
、例えばＨＦ帯、ＵＨＦ帯において位相比較器としては
ダイオードバランスドミキサ等の使用が考えられるが、
位相比較器に求められる特性として入出力特性の直線性
がある。これは入力信号が希望波および多数の不要波を
含むために、それらの複数波間の混変調特性により擬似
希望波が発生したり、または希望波が抑圧されるような
事態の発生をもたらすことがないようにするためである
。したがつて、位相比較器の入出力特性の直線性を得た
場合、位相比較器としての復調感度（位相復調器として
動作している）特性が希望波の入力レベル変動に応じて
変化をし、ＰＬＬ回路の一巡伝達利得が入力レベル変動
に応じて変化することになる。
そのため中継器の遅延時間が変動したり、隣接波の減衰
量が不十分となつたり、さらにひどい場合にはＰＬＬ回
路の動作を不安定にしてしまうという欠点が存在する。
量が不十分となつたり、さらにひどい場合にはＰＬＬ回
路の動作を不安定にしてしまうという欠点が存在する。
本発明の目的は前記ＰＬＬ回路を利用した中継器の持つ
利点を損なうことなく、この中継器の有する前記欠点を
除去した中継方式を提供することにある。
利点を損なうことなく、この中継器の有する前記欠点を
除去した中継方式を提供することにある。
前記目的を達成するために本発明による直接中継方式は
、受信信号を分配する信号分配器と、受信信号入力端子
特定の受信信号と同一周波数の出力信号を出力するため
の出力端子および外部より一巡伝達利得を制御するため
の制御端子を具備するフエイズロツクループ回路と、特
定の受信入力信号のレベルを検知する検知器とを具備し
、受信信号を前記分配器に入力し分配器の出力の一部を
前記フエイズロツクループ回路受信信号入力端子に入力
し、かつ分配器の他の出力を前記検知器の入力端子に入
力し、この検知器の出力を前記フエイズロツクループ回
路の制御端子に入力することにより、所望の受信信号の
レベルの変動に応じて前記ＰＬＬの一巡伝達利得を制御
するように構成してある。
、受信信号を分配する信号分配器と、受信信号入力端子
特定の受信信号と同一周波数の出力信号を出力するため
の出力端子および外部より一巡伝達利得を制御するため
の制御端子を具備するフエイズロツクループ回路と、特
定の受信入力信号のレベルを検知する検知器とを具備し
、受信信号を前記分配器に入力し分配器の出力の一部を
前記フエイズロツクループ回路受信信号入力端子に入力
し、かつ分配器の他の出力を前記検知器の入力端子に入
力し、この検知器の出力を前記フエイズロツクループ回
路の制御端子に入力することにより、所望の受信信号の
レベルの変動に応じて前記ＰＬＬの一巡伝達利得を制御
するように構成してある。
前記構成によれば中継器の遅延時間が変動したり隣接波
の減衰量が不十分となつたりする等の問題は解決され、
本発明の目的を完全に達成することができる。
の減衰量が不十分となつたりする等の問題は解決され、
本発明の目的を完全に達成することができる。
以下、本発明の中継方式の詳細について図面等を参照し
てさらに詳しく説明する。
てさらに詳しく説明する。
第３図は本発明による直接中継方式を適用した実施例を
示す回路プロツク図である。
示す回路プロツク図である。
第３図において、回路プロツク番号が第２図と同一のも
のは同等機能を有するものであるとして説明は省略する
。
のは同等機能を有するものであるとして説明は省略する
。
３０は受信信号を分配するための信号分配器であり、３
１は外部より一巡伝達利得を制御するための制御端子を
具備するＰＬＬ回路であり、３２は希望する受信信号入
力のレベルを検知するための検知器である。
１は外部より一巡伝達利得を制御するための制御端子を
具備するＰＬＬ回路であり、３２は希望する受信信号入
力のレベルを検知するための検知器である。
端子１よりの受信入力信号は前置増幅器２０により増幅
され、信号分配器３０に入力される。
され、信号分配器３０に入力される。
信号分配器３０の出力は二分され、一方はＰＬＬ回路３
１の位相比較器に入力され、他方は検知器３２に入力さ
れる。検知器３２の回路は一実施例として次のように構
成される。検知器３２への入力信号はまず周波数ダウン
コンバータによりＩＦ周波数に変換する。
１の位相比較器に入力され、他方は検知器３２に入力さ
れる。検知器３２の回路は一実施例として次のように構
成される。検知器３２への入力信号はまず周波数ダウン
コンバータによりＩＦ周波数に変換する。
ＩＦ周波数においてＦＢＰＦにより希望波を選択し、適
当なレベルに増幅した後整流回路で整流する。
当なレベルに増幅した後整流回路で整流する。
これにより希望する受信波の入力レベルに応じた直流電
圧を得ることができる。この直流電圧をＰＬＬ回路３１
の制御端子に供給して、ＰＬＬ回路の一巡伝達利得がほ
マ一定となるように制御することにより目的を達成する
。検知器３２は希望受信入力の入力レベルの検知をする
のみであるからＦＢＰＥが狭帯域となり遅延時間が大き
くなつても問題は生じない。また検知器３２の出力電圧
でＰＬＬ回路３１の一巡伝達利得を制御する方法は制御
方式としては開ループ制御であるから、制御誤差を小と
するためには制御端子入力電圧と一巡伝達利得の関係を
最適化する必要は当然要求される。
圧を得ることができる。この直流電圧をＰＬＬ回路３１
の制御端子に供給して、ＰＬＬ回路の一巡伝達利得がほ
マ一定となるように制御することにより目的を達成する
。検知器３２は希望受信入力の入力レベルの検知をする
のみであるからＦＢＰＥが狭帯域となり遅延時間が大き
くなつても問題は生じない。また検知器３２の出力電圧
でＰＬＬ回路３１の一巡伝達利得を制御する方法は制御
方式としては開ループ制御であるから、制御誤差を小と
するためには制御端子入力電圧と一巡伝達利得の関係を
最適化する必要は当然要求される。
第３図には記してないが検知器３２の出力電圧によりス
イツチ回路２２を制御することも可能である。
イツチ回路２２を制御することも可能である。
すなわち、希望受信波の入力レベルが一定値以下となつ
て回線品質が悪い場合等においては、スイツチ回路２２
により回線をしや断するようなことも可能となる。以上
詳しく説明したように本発明による中継方式によれば中
継器の遅延時間を大きくすることなしに、しかも不要波
の減衰特性も安定に確保できるといつた優れた特徴が得
られる。
て回線品質が悪い場合等においては、スイツチ回路２２
により回線をしや断するようなことも可能となる。以上
詳しく説明したように本発明による中継方式によれば中
継器の遅延時間を大きくすることなしに、しかも不要波
の減衰特性も安定に確保できるといつた優れた特徴が得
られる。
第１図は従来のＩＦ中継方式の一構成例を示す回路プロ
ツク図、第２図はＰＬＬ回路を用いた従来の直接中継方
式の一構成例を示す回路プロツク図．第３図は本発明に
よる直接中継方式にもとずいて構成した中継器の一実施
例を示す回路プロツク図である。 １・・・・・・受信信号入力端子、２・・・・・・希望
信号出力端子、１０・・・・・・周波数ダウンコンバー
タ、１１・・・・・・局発信号発生器、１２・・・・・
・ＩＦ選択増幅回路、１３・・・・・・周波数アツプコ
ンバータ、２０・・・・・・前置増幅器、２１・・・・
・・ＰＬＬ回路、２２・・・・・・スイツチ回路、２３
・・・・・・後置増幅器、３０・・・・・・信号分配器
、３１・・・・・・一巡利得制御用端子付ＰＬＬ回路、
３２・・・・・・希望受信波の入力レベル検知器。
ツク図、第２図はＰＬＬ回路を用いた従来の直接中継方
式の一構成例を示す回路プロツク図．第３図は本発明に
よる直接中継方式にもとずいて構成した中継器の一実施
例を示す回路プロツク図である。 １・・・・・・受信信号入力端子、２・・・・・・希望
信号出力端子、１０・・・・・・周波数ダウンコンバー
タ、１１・・・・・・局発信号発生器、１２・・・・・
・ＩＦ選択増幅回路、１３・・・・・・周波数アツプコ
ンバータ、２０・・・・・・前置増幅器、２１・・・・
・・ＰＬＬ回路、２２・・・・・・スイツチ回路、２３
・・・・・・後置増幅器、３０・・・・・・信号分配器
、３１・・・・・・一巡利得制御用端子付ＰＬＬ回路、
３２・・・・・・希望受信波の入力レベル検知器。
Claims (1)
- １ 受信信号を分配する信号分配器と、受信信号入力端
子、特定の受信信号と同一周波数の出力信号を出力する
ための出力端子および外部より一巡伝達利得を制御する
ための制御端子を具備するフェイズロックループ回路と
、特定の受信入力信号のレベルを検知する検知器とを具
備し受信信号を前記分配器に入力し分配器の出力の一部
を前記フェイズロックループ回路受信信号入力端子に入
力し、かつ分配器の他の出力を前記検知器の入力端子に
入力し、この検知器の出力を前記フェイズロックループ
回路の制御端子に入力することにより、特定の受信信号
のレベルの変動に応じて、前記フェイズロックループ回
路の一巡伝達利得を制御することを特徴とした直接中継
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55019615A JPS5945305B2 (ja) | 1980-02-19 | 1980-02-19 | 直接中継方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55019615A JPS5945305B2 (ja) | 1980-02-19 | 1980-02-19 | 直接中継方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56116340A JPS56116340A (en) | 1981-09-12 |
| JPS5945305B2 true JPS5945305B2 (ja) | 1984-11-05 |
Family
ID=12004083
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55019615A Expired JPS5945305B2 (ja) | 1980-02-19 | 1980-02-19 | 直接中継方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5945305B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0259727B2 (ja) * | 1984-12-28 | 1990-12-13 | Matsushita Electric Ind Co Ltd |
-
1980
- 1980-02-19 JP JP55019615A patent/JPS5945305B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0259727B2 (ja) * | 1984-12-28 | 1990-12-13 | Matsushita Electric Ind Co Ltd |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56116340A (en) | 1981-09-12 |
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