JPS5945155B2 - 表示装置 - Google Patents
表示装置Info
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- JPS5945155B2 JPS5945155B2 JP51080906A JP8090676A JPS5945155B2 JP S5945155 B2 JPS5945155 B2 JP S5945155B2 JP 51080906 A JP51080906 A JP 51080906A JP 8090676 A JP8090676 A JP 8090676A JP S5945155 B2 JPS5945155 B2 JP S5945155B2
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- Japan
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- Expired
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Description
【発明の詳細な説明】
本発明はブラウン管（以下ＣＲＴと称す）土に表示する
デジタル情報（文字等）のちらつきを軽減する表示方式
に関する。
デジタル情報（文字等）のちらつきを軽減する表示方式
に関する。
最近、文字デスプレー等デジタル情報を入力とするＣＲ
Ｔデスプレーが多く使用されているが、このデスプレー
は普通の家庭用テレビジョンと同様フレーム周波数３０
Ｈ２（インターレース有り）のラスター ・スキャン形
が大部分である。
Ｔデスプレーが多く使用されているが、このデスプレー
は普通の家庭用テレビジョンと同様フレーム周波数３０
Ｈ２（インターレース有り）のラスター ・スキャン形
が大部分である。
このようなデスプレーに表示された文字は、目にちらつ
きを感じざせ、デスプレー使用者を疲れさせる欠点を持
つ。本発明は、デジタル情報に論理処理を施し、表示文
字（または図形等）を若干ぼかすことにより、上記欠点
を解消するとともに文字または図形等の自然な表示を得
ることを目的とするものである。
きを感じざせ、デスプレー使用者を疲れさせる欠点を持
つ。本発明は、デジタル情報に論理処理を施し、表示文
字（または図形等）を若干ぼかすことにより、上記欠点
を解消するとともに文字または図形等の自然な表示を得
ることを目的とするものである。
まず本発明の概念の説明を以下に行なう。デジタル情報
を入力とするＣＲＴ表示文字等がちらつぃて見える原因
は、フレーム周波数が低いためであるが、これをつぎの
ような方法で見掛土高めることが本発明の主旨である。
すなわち、例えば第１図のようにｉ番日の走査線に書か
れた線分ａｂは１／３０秒に１回の割合で表示される。
今、線分πを上下方向にぼかした場合（第１線の７ｎ’
、ａ″ｂ″）、ぽけの線分ａ ’ｂ ′およびａ″ｂ″
はインターレースの期間に表示される。即ちｉが表示さ
れて約−秒ののちａ’ｂ’およびａ″ｂ″が表示され、
さらに約−秒後にａｂが再び表示され、以下これを繰返
す。
を入力とするＣＲＴ表示文字等がちらつぃて見える原因
は、フレーム周波数が低いためであるが、これをつぎの
ような方法で見掛土高めることが本発明の主旨である。
すなわち、例えば第１図のようにｉ番日の走査線に書か
れた線分ａｂは１／３０秒に１回の割合で表示される。
今、線分πを上下方向にぼかした場合（第１線の７ｎ’
、ａ″ｂ″）、ぽけの線分ａ ’ｂ ′およびａ″ｂ″
はインターレースの期間に表示される。即ちｉが表示さ
れて約−秒ののちａ’ｂ’およびａ″ｂ″が表示され、
さらに約−秒後にａｂが再び表示され、以下これを繰返
す。
このように、ａｂ自身は一秒毎に表示されるが、ぼけの
部分も考慮に入れると、見掛上一秒毎に表示されている
ことになるため、ちらつきを軽減できる。
部分も考慮に入れると、見掛上一秒毎に表示されている
ことになるため、ちらつきを軽減できる。
このぼけの効果は、紙等に書かれた文字をテレビ・カメ
ラで撮影し、その映像信号をＣＲＴデイスプレ一に入力
して再生した画像があまりちらつかないことからも説明
できる。即ちテレビカメラで撮影した線分は第１図のよ
うに線分；Ｉの周辺にぼけの部分が存在するものと思わ
れる。以上述べたことかられかるように、入力デジタル
情報に論理処理を施して、ぼけ情報を得、それをＣＲＴ
デスプレ一の輝度変調回路に印加することにより上記発
明を実現できる。
ラで撮影し、その映像信号をＣＲＴデイスプレ一に入力
して再生した画像があまりちらつかないことからも説明
できる。即ちテレビカメラで撮影した線分は第１図のよ
うに線分；Ｉの周辺にぼけの部分が存在するものと思わ
れる。以上述べたことかられかるように、入力デジタル
情報に論理処理を施して、ぼけ情報を得、それをＣＲＴ
デスプレ一の輝度変調回路に印加することにより上記発
明を実現できる。
第２図において、１〜３は各々（１−１）〜（１＋１）
番目の走査線に対する情報５０１−１，５０１，５０１
＋，をクロツク信号６によりフレーム・メモリ一２０か
ら読み込み、読出すためのシフトレジスタ等からなるラ
インメモリーである。ここでｉ＝２，４，・・・・・・
，２ｎである。また４は論理回路であり、５はラインメ
モリー２の読出し情報２ａと論理回路４の出力情報４ａ
の関係により、第３図に示すアナログ情報（輝度偏調信
号）５ａを出力する回路である。第３図においてｋはぼ
かしの程度を表す量であり、０くｋ〈１の値をとる。す
なわち、情報２ａが１の場合は従来のぼかしを行なわな
い場合と同様に出力５ａは１であるが、情報２ａがＯの
場合でも、上下のラスタの情報１ａまたは３ａの少なく
とも一方が１の場合には出力５ａはｋ１即ち中間輝度の
輝度情報を出力する。以上の説明および実施例は上下方
向にぼかす場合であるが、このように輝点の上下方告に
のみ中間輝度の輝点を表示した場合、横方向の線分のみ
ぼかしが表われ、縦方向の線分には全くぼかしが表れな
いため、文字表示等が不自然になる。
番目の走査線に対する情報５０１−１，５０１，５０１
＋，をクロツク信号６によりフレーム・メモリ一２０か
ら読み込み、読出すためのシフトレジスタ等からなるラ
インメモリーである。ここでｉ＝２，４，・・・・・・
，２ｎである。また４は論理回路であり、５はラインメ
モリー２の読出し情報２ａと論理回路４の出力情報４ａ
の関係により、第３図に示すアナログ情報（輝度偏調信
号）５ａを出力する回路である。第３図においてｋはぼ
かしの程度を表す量であり、０くｋ〈１の値をとる。す
なわち、情報２ａが１の場合は従来のぼかしを行なわな
い場合と同様に出力５ａは１であるが、情報２ａがＯの
場合でも、上下のラスタの情報１ａまたは３ａの少なく
とも一方が１の場合には出力５ａはｋ１即ち中間輝度の
輝度情報を出力する。以上の説明および実施例は上下方
向にぼかす場合であるが、このように輝点の上下方告に
のみ中間輝度の輝点を表示した場合、横方向の線分のみ
ぼかしが表われ、縦方向の線分には全くぼかしが表れな
いため、文字表示等が不自然になる。
また輝点の周辺にぼかしの表示を行なうことにより斜め
の線分が階段状に見えることなくなめらかな表示となる
効果があるが、上下方向のぼかしのみでは特に縦方向に
近い方向の線分の表示が相変らず階段状になり、曲線を
用いた図形の表示などに不自然さが残る。そこで本発明
においては、上下方向のぼかしの表示によりインターレ
ース効果を用いて表示のちらつきを防止するとともに、
これと同等の左右方向のぼかしを表示し、自然でかつな
めらかな表示を得る。
の線分が階段状に見えることなくなめらかな表示となる
効果があるが、上下方向のぼかしのみでは特に縦方向に
近い方向の線分の表示が相変らず階段状になり、曲線を
用いた図形の表示などに不自然さが残る。そこで本発明
においては、上下方向のぼかしの表示によりインターレ
ース効果を用いて表示のちらつきを防止するとともに、
これと同等の左右方向のぼかしを表示し、自然でかつな
めらかな表示を得る。
第４図は上下左右方向にぼかす場合の実施例であり、第
５図は上下方向になだらかにぼかす場合の実施例である
。
５図は上下方向になだらかにぼかす場合の実施例である
。
第４図において、２１はラインメモリ２の出力２ａを入
力として、クロツク８で駆動されるメモリーである。
力として、クロツク８で駆動されるメモリーである。
上下情報１ａおよび３ａ１左右情報２ｃおよび２ｂを論
理和回路４１に入力することにより、上記実施例の場合
と同様に、上下左右方向にぼかすことができる。また第
５図では、５０１−２〜５０１＋２はラスタ１−２〜ｉ
＋２に対する信号で情報４ａは最隣接走査線の情報であ
り、情報９ａはつぎに近い走査線の情報である。
理和回路４１に入力することにより、上記実施例の場合
と同様に、上下左右方向にぼかすことができる。また第
５図では、５０１−２〜５０１＋２はラスタ１−２〜ｉ
＋２に対する信号で情報４ａは最隣接走査線の情報であ
り、情報９ａはつぎに近い走査線の情報である。
ここで回路１０は第２表に示す動作を行なう。したがつ
て上記実施例から類推できるように、上下方向に順にＫ
ｌ，ｋ２の階調を持つて信号がぼけることになる。以上
述べた方法は非常に簡単な回路構成で、文字等のデジタ
ル表示のちらつきを軽減できる利点を持つ。
て上記実施例から類推できるように、上下方向に順にＫ
ｌ，ｋ２の階調を持つて信号がぼけることになる。以上
述べた方法は非常に簡単な回路構成で、文字等のデジタ
ル表示のちらつきを軽減できる利点を持つ。
第第１図は本発明を説明するための図、第２図は本発明
の実施例、第３図は第２図に示した回路５の機能を説明
するための図、第４図および第５図は本発明の他の実施
例、第６図は第５図に示した回路１０の機能を説明する
ための図である。
の実施例、第３図は第２図に示した回路５の機能を説明
するための図、第４図および第５図は本発明の他の実施
例、第６図は第５図に示した回路１０の機能を説明する
ための図である。
Claims (1)
- １、少なくとも一画面分の輝点の集合を示す時系列信号
が蓄積されるフレームメモリと、該フレームメモリから
表示する走査線上の信号が読み出された蓄積される第１
のラインメモリを有するインターレースラスタスキャン
方式の表示装置において、表示する走査線の上下の走査
線上の信号が前記フレームメモリから読み出されて蓄積
される第２、第３のラインメモリと、前記ラインメモリ
の出力端子の１ビット前、及び１ビット後の出力を取り
出す補助出力手段と、前記第２、第３のラインメモリの
出力及び前記補助出力手段からの出力のオア論理と取る
論理回路を、前記第１のラインメモリの出力に加えて、
前記論理回路の出力を所定の階調で当該走査線上に表示
する階調表示手段を有することを特徴とする表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51080906A JPS5945155B2 (ja) | 1976-07-09 | 1976-07-09 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51080906A JPS5945155B2 (ja) | 1976-07-09 | 1976-07-09 | 表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS537136A JPS537136A (en) | 1978-01-23 |
| JPS5945155B2 true JPS5945155B2 (ja) | 1984-11-05 |
Family
ID=13731410
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP51080906A Expired JPS5945155B2 (ja) | 1976-07-09 | 1976-07-09 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5945155B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4484188A (en) * | 1982-04-23 | 1984-11-20 | Texas Instruments Incorporated | Graphics video resolution improvement apparatus |
| JPH0664665B2 (ja) * | 1982-08-02 | 1994-08-22 | 日本電気株式会社 | 警報の待ち受け回路 |
| US4649378A (en) * | 1983-11-18 | 1987-03-10 | Sperry Corporation | Binary character generator for interlaced CRT display |
| JPH04140792A (ja) * | 1990-10-02 | 1992-05-14 | Sega Enterp Ltd | 画像処理装置 |
-
1976
- 1976-07-09 JP JP51080906A patent/JPS5945155B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS537136A (en) | 1978-01-23 |
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