JPS5938755Y2 - 弛張発振器 - Google Patents
弛張発振器Info
- Publication number
- JPS5938755Y2 JPS5938755Y2 JP182180U JP182180U JPS5938755Y2 JP S5938755 Y2 JPS5938755 Y2 JP S5938755Y2 JP 182180 U JP182180 U JP 182180U JP 182180 U JP182180 U JP 182180U JP S5938755 Y2 JPS5938755 Y2 JP S5938755Y2
- Authority
- JP
- Japan
- Prior art keywords
- capacitor
- resistor
- gate thyristor
- negative gate
- vcv
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Description
【考案の詳細な説明】
本考案は負ゲートサイリスタを使用した弛張発振器の初
回動作時間誤差を小さくしたものを得ろことが目的であ
る。
回動作時間誤差を小さくしたものを得ろことが目的であ
る。
従来に於いては第１図に示す如く、直流電源Ｅの両端に
スイッチＳを介して分圧抵抗Ｒ３，Ｒ４の直列回路と時
限回路を構成する抵抗Ｒ１とコンデンサＣ１の直列回路
を接続し、抵抗Ｒ３，Ｒ４の接続点を負ゲートサイリス
タＱのゲートに接続し、抵抗Ｒ７とコンデンサＣ１の接
続点を負ゲトサイリスタＱのアノードに接続し、負ゲー
トサイリスタＱのカソードを抵抗Ｒ２を介して負極に接
続していた。
スイッチＳを介して分圧抵抗Ｒ３，Ｒ４の直列回路と時
限回路を構成する抵抗Ｒ１とコンデンサＣ１の直列回路
を接続し、抵抗Ｒ３，Ｒ４の接続点を負ゲートサイリス
タＱのゲートに接続し、抵抗Ｒ７とコンデンサＣ１の接
続点を負ゲトサイリスタＱのアノードに接続し、負ゲー
トサイリスタＱのカソードを抵抗Ｒ２を介して負極に接
続していた。
この回路であると、第２図に示す如く時間Ｔ＝Ｏかも始
まる周期Ｔ１ とＴ２以後ではＴ１〉Ｔ２−Ｔ３ と
なる。
まる周期Ｔ１ とＴ２以後ではＴ１〉Ｔ２−Ｔ３ と
なる。
これはコンデンサＣ１に充電する電荷が２回目から負ゲ
ートサイリスタＱのアノード、カソード間と抵抗Ｒ２の
電圧降下ＶＣＶが残るためである。
ートサイリスタＱのアノード、カソード間と抵抗Ｒ２の
電圧降下ＶＣＶが残るためである。
１例をとって初回周期時間誤差を説明すると、発振出力
の波高値をＶＣ，とすると、発振周期Ｔ０．Ｔ２は、Ｔ
１＝Ｃ１Ｒ，ｌｏｇ ｅ （１／（ＩＶｃｐ／Ｅ ）
） ・・”・・（１） ｔ Ｔ ２ ＝ Ｃ１Ｒｔ
Ｌｏ ｇ ｅ （１／（１−（ＶＣＰ−ＶＣＶ）／（Ｅ
−ＶＣＶ）））−（２）で表わされる。
の波高値をＶＣ，とすると、発振周期Ｔ０．Ｔ２は、Ｔ
１＝Ｃ１Ｒ，ｌｏｇ ｅ （１／（ＩＶｃｐ／Ｅ ）
） ・・”・・（１） ｔ Ｔ ２ ＝ Ｃ１Ｒｔ
Ｌｏ ｇ ｅ （１／（１−（ＶＣＰ−ＶＣＶ）／（Ｅ
−ＶＣＶ）））−（２）で表わされる。
スタンドオフ比Ｖｃｐ／Ｅは０．５〜０．７に通常設定
される。
される。
電源電圧１２〔Ｖ〕、ＶＣＰ／Ｅ＝０．６とするとＶｃ
ｐ＝７．２ （Ｖ）、Ｖｃｖ＝１〔ｖ〕 とすルト（１
）式、（２）式よりＴ、＝０．９１６Ｃ１Ｒ１，Ｔ２−
０．８２９Ｃ１Ｒ１となり、初回周期時間誤差−（（Ｔ
１−Ｔ２）／Ｔ□）Ｘ１００Ｃ係〕−１０，５〔多〕の
誤差が生じる。
ｐ＝７．２ （Ｖ）、Ｖｃｖ＝１〔ｖ〕 とすルト（１
）式、（２）式よりＴ、＝０．９１６Ｃ１Ｒ１，Ｔ２−
０．８２９Ｃ１Ｒ１となり、初回周期時間誤差−（（Ｔ
１−Ｔ２）／Ｔ□）Ｘ１００Ｃ係〕−１０，５〔多〕の
誤差が生じる。
本考案は上記欠点を改良しようとするもので、第３図に
示す本考案回路図は第１図に示す従来の回路図のスイッ
チＳの１端と負極間にコンデンサＣ２と抵抗Ｒ５の直列
回路を接続し、コンデンサＣ２と抵抗Ｒ５の接続点をダ
イオードＤを介して負ゲートサイリスタＱのアノードに
接続してなるものである。
示す本考案回路図は第１図に示す従来の回路図のスイッ
チＳの１端と負極間にコンデンサＣ２と抵抗Ｒ５の直列
回路を接続し、コンデンサＣ２と抵抗Ｒ５の接続点をダ
イオードＤを介して負ゲートサイリスタＱのアノードに
接続してなるものである。
次に動作について説明すると、スイッチＳを閉路すると
コンデンサＣ１の充電電圧はコンデンサＣ２とダイオー
ドＤを介してＶｃｏ−（電源電圧ＥダイオードＤの順方
向電圧降下ＶＤ）Ｃ２／（Ｃ１＋Ｃ２）の電圧捷で回路
インピーダンスが低いために瞬時（Ｔｏ時間）に充電さ
れ、その後コンデンサＣ１は充電抵抗Ｒ１を通じて充電
され第４図に示す如く所定電圧ＶＣＰ になると、負ゲ
ートサイリスタＱはＯＮＬコンデンサＣ１の電荷は放電
し弛張発振を繰返す。
コンデンサＣ１の充電電圧はコンデンサＣ２とダイオー
ドＤを介してＶｃｏ−（電源電圧ＥダイオードＤの順方
向電圧降下ＶＤ）Ｃ２／（Ｃ１＋Ｃ２）の電圧捷で回路
インピーダンスが低いために瞬時（Ｔｏ時間）に充電さ
れ、その後コンデンサＣ１は充電抵抗Ｒ１を通じて充電
され第４図に示す如く所定電圧ＶＣＰ になると、負ゲ
ートサイリスタＱはＯＮＬコンデンサＣ１の電荷は放電
し弛張発振を繰返す。
コンデンサＣ２がコンデンサＣ１の充電に寄与するのは
スイッチＳの閉路時のみで、抵抗Ｒ５を介してコンデン
サＣ２の充電電圧は電源電圧Ｅまで充電され、抵抗Ｒ５
の電圧降下は零となりダイオードＤは逆バイアスされて
ＯＦＦとなる。
スイッチＳの閉路時のみで、抵抗Ｒ５を介してコンデン
サＣ２の充電電圧は電源電圧Ｅまで充電され、抵抗Ｒ５
の電圧降下は零となりダイオードＤは逆バイアスされて
ＯＦＦとなる。
従って弛張発振器の動作中はダイオードＤがＯＦＦ と
なるため、時限回路抵抗Ｒ１とコンデンサＣ１にはコン
デンサＣ２と抵抗Ｒ５の直列回路は何らの影響もあたえ
ない。
なるため、時限回路抵抗Ｒ１とコンデンサＣ１にはコン
デンサＣ２と抵抗Ｒ５の直列回路は何らの影響もあたえ
ない。
その後、スイッチＳを開路するとコンデンサＣ１の充電
電荷は負ゲートサイリスタＱのゲート電位が零になるた
め負ゲートサイリスタＱが ＯＮシ、抵抗Ｒ２を通じて
放電すると共に抵抗 Ｒ，、Ｒ３，Ｒ４をも通じて放電
する。
電荷は負ゲートサイリスタＱのゲート電位が零になるた
め負ゲートサイリスタＱが ＯＮシ、抵抗Ｒ２を通じて
放電すると共に抵抗 Ｒ，、Ｒ３，Ｒ４をも通じて放電
する。
同様にコンデンサＣ２は抵抗Ｒ１、負ゲートサイリスタ
Ｑ、抵抗Ｒ２、Ｒ５及び抵抗Ｒ３、Ｒ４、Ｒ５を通じて
放電する。
Ｑ、抵抗Ｒ２、Ｒ５及び抵抗Ｒ３、Ｒ４、Ｒ５を通じて
放電する。
初回周期時間誤差を小さくするには、スイッチＳの閉路
時にコンデンサＣ２を介してコンデンサＣ１に充電され
る電圧ＶＣＯと電圧Ｖｃｖが等しくなればよい。
時にコンデンサＣ２を介してコンデンサＣ１に充電され
る電圧ＶＣＯと電圧Ｖｃｖが等しくなればよい。
即、Ｖｃｖ＝Ｖｃｏ−（Ｅ−ＶＤ ）Ｃ２／ＣＣ１＋０
２）よりコンデンサＣ２の静電容量をＣ２＝Ｃ，／１（
Ｅ−ＶＤ）／ＶＣＶ−１）に選ぶことにより初回周期時
間誤差は非常に小さくなる。
２）よりコンデンサＣ２の静電容量をＣ２＝Ｃ，／１（
Ｅ−ＶＤ）／ＶＣＶ−１）に選ぶことにより初回周期時
間誤差は非常に小さくなる。
以上の如く本考案は従来の弛張発振器にコンデンサＣ２
、抵抗Ｒ５、ダイオードＤを追加するのみで初回周期時
間誤差の小さい安価な弛張発振器を提供できる効果があ
る。
、抵抗Ｒ５、ダイオードＤを追加するのみで初回周期時
間誤差の小さい安価な弛張発振器を提供できる効果があ
る。
第１図は従来の弛張発振回路図、第２図は第１図の回路
における出力波形図、第３図は本考案に係る弛張発振回
路図、第４図は第３図の回路における出力波形図である
。 同一要素には同一符号で示しである。 Ｅは直流電源、Ｓはスイッチ、Ｒ７−Ｒ５は抵抗、ＣＩ
＋Ｃ２はコンデンサ、Ｑは負ゲートサイリスタ、Ｄ
はダイオードである。
における出力波形図、第３図は本考案に係る弛張発振回
路図、第４図は第３図の回路における出力波形図である
。 同一要素には同一符号で示しである。 Ｅは直流電源、Ｓはスイッチ、Ｒ７−Ｒ５は抵抗、ＣＩ
＋Ｃ２はコンデンサ、Ｑは負ゲートサイリスタ、Ｄ
はダイオードである。
Claims (1)
- 直流電源Ｅと、抵抗Ｒ３、Ｒ４で分圧して得た基準電圧
をゲートに印加する負ゲートサイリスタＱと該負ゲート
サイリスタＱのアノードに抵抗Ｒ１とコンデンサＣ１の
接続点を接続した時限回路と、負ゲートサイリスタＱの
カソードを抵抗Ｒ２を介して負極に接続した弛張発振器
において、直流電源Ｅの正極にコンデンサＣ２を、且つ
該コンデンサＣ２と直列に抵抗Ｒ６を接続し、コンデン
サＣ２と抵抗Ｒ５の接続点をダイオードＤを介して負ゲ
ートサイリスタＱのアノードに接続し、ダイオードＤの
順方向電圧降下をＶＤｚ負ゲ負ゲートサイリスタ子ノー
ド、カソード間と抵抗Ｒ２の電圧降下をＶＣＶ とする
時、Ｃ２＝Ｃ１／（（Ｅ−ＶＤ）／ＶＣＶ−１，）
とした弛張発振器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP182180U JPS5938755Y2 (ja) | 1980-01-11 | 1980-01-11 | 弛張発振器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP182180U JPS5938755Y2 (ja) | 1980-01-11 | 1980-01-11 | 弛張発振器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56104240U JPS56104240U (ja) | 1981-08-14 |
| JPS5938755Y2 true JPS5938755Y2 (ja) | 1984-10-29 |
Family
ID=29598705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP182180U Expired JPS5938755Y2 (ja) | 1980-01-11 | 1980-01-11 | 弛張発振器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5938755Y2 (ja) |
-
1980
- 1980-01-11 JP JP182180U patent/JPS5938755Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56104240U (ja) | 1981-08-14 |
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