JPS5935565A - 電源回路 - Google Patents
電源回路Info
- Publication number
- JPS5935565A JPS5935565A JP14408082A JP14408082A JPS5935565A JP S5935565 A JPS5935565 A JP S5935565A JP 14408082 A JP14408082 A JP 14408082A JP 14408082 A JP14408082 A JP 14408082A JP S5935565 A JPS5935565 A JP S5935565A
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- JP
- Japan
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- transistor
- load
- transformer
- detected
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- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
- H02M3/325—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野
本発明は、負荷電流に応じて主トランジスタの駆＆ＩＪ
電流を変化させることにより、消費電力を減少できる電
源回路に関する。
電流を変化させることにより、消費電力を減少できる電
源回路に関する。
従来技術及び問題点
従来の旬、源回路は、第１図に示゛す様に、商用周波数
を曵流器ＲＥＣ１によシ整流し、平滑コンデンサＣＩに
よシ平渭して、直流とし、トランスＴ。
を曵流器ＲＥＣ１によシ整流し、平滑コンデンサＣＩに
よシ平渭して、直流とし、トランスＴ。
の−次巻線に供給している。
そして、主トランジスタＱ１ヲオン、オフ制御して、２
次側に交流を供給シ１、再び整流器ｌζＥＣ２で整流後
、インダクタンスＬとコンデンサＣ２から成る積分回路
でオ＾を分して負荷Ｒに電圧を供給している。
次側に交流を供給シ１、再び整流器ｌζＥＣ２で整流後
、インダクタンスＬとコンデンサＣ２から成る積分回路
でオ＾を分して負荷Ｒに電圧を供給している。
そして、負荷Ｈの両端の電圧を検出して、制御回路Ｃ０
ＮＴに入力する。制御回路Ｃ０ＮＴは、入力した電圧に
より駆動トランジスタＱ２の導通幅を制御し、よってト
ランスＴ３ヲ介して主トランジスタＱ、のベースに流れ
る超動電流ｋＫｒ続させる。
ＮＴに入力する。制御回路Ｃ０ＮＴは、入力した電圧に
より駆動トランジスタＱ２の導通幅を制御し、よってト
ランスＴ３ヲ介して主トランジスタＱ、のベースに流れ
る超動電流ｋＫｒ続させる。
又同様のこと全トランスＴ、の一次巻れ！に流れる駆動
電流をカレントトランスＣＴで検出することによシ行な
っている。これにより負荷の両端の電圧を一定に保って
いる。尚駆動トランジスタＱ。
電流をカレントトランスＣＴで検出することによシ行な
っている。これにより負荷の両端の電圧を一定に保って
いる。尚駆動トランジスタＱ。
の電源は、トランスＴ２、整流回路ＲＥＣ３、平滑コン
デンサＣ８により作成される。
デンサＣ８により作成される。
又ダイオードＤ、、Ｄ２はトランジスタＱ＋ｔＱ２がオ
フの時にトランスＴ、、’Ｉ”、に蓄積されたエネルギ
ーをリセットするだめのものである０以上の構成におい
て、例えば負荷が短絡に近い状態に表った場合、トラン
ジスタＱ、のオン時間を短くするとともに駆動電流を小
さな値にし、負荷に流れる電流を小さくする必要がある
が、トランスＴ、の一次巻線に流れるｉ、が一定である
ため、主トランジスタＱ、の駆動電流も一定となってい
るため、駆動電流による消費電力を効率よく使用できず
、又負荷側及び−次側短絡時、カレントトランスにより
、過電流を検出するが、主トランジスタＱ＋の導通幅を
零にできないため、主トランジスタＱ、に過大電流が流
れる欠点がある。
フの時にトランスＴ、、’Ｉ”、に蓄積されたエネルギ
ーをリセットするだめのものである０以上の構成におい
て、例えば負荷が短絡に近い状態に表った場合、トラン
ジスタＱ、のオン時間を短くするとともに駆動電流を小
さな値にし、負荷に流れる電流を小さくする必要がある
が、トランスＴ、の一次巻線に流れるｉ、が一定である
ため、主トランジスタＱ、の駆動電流も一定となってい
るため、駆動電流による消費電力を効率よく使用できず
、又負荷側及び−次側短絡時、カレントトランスにより
、過電流を検出するが、主トランジスタＱ＋の導通幅を
零にできないため、主トランジスタＱ、に過大電流が流
れる欠点がある。
発明の目的
本発明は、上記欠点を除去し、駆動電流の効率的使用を
可能にし、又主トランジスタへの過電流の防止を行なう
ことができる電源回路を提供することを目的とする。
可能にし、又主トランジスタへの過電流の防止を行なう
ことができる電源回路を提供することを目的とする。
発明の構成
上記目的は、本発明によればト°ランスの一次巻線に直
列に接続された主トランジスタのオンオフ時間を該トラ
ンスの二次巻線に接続された負荷への電圧又は電流によ
シ制御する電源回路において、該トランスの一次巻線に
流れる電流に応じ該主トランジスタの電流の大きさを制
御する様にしたことを％徴とする電源回路によって達成
される。
列に接続された主トランジスタのオンオフ時間を該トラ
ンスの二次巻線に接続された負荷への電圧又は電流によ
シ制御する電源回路において、該トランスの一次巻線に
流れる電流に応じ該主トランジスタの電流の大きさを制
御する様にしたことを％徴とする電源回路によって達成
される。
発明の実施例
以下本発明を実施例に基づいて説明する。
卯、２図は、本発明の実施例を示す図で、図中Ｑ。
は制御用トランジスタ、Ａ、ＨＡ２ は演算増幅器、Ｄ
ｌｌｔＤ４はタイオート、ＶＲｔ、 ＶＲ２ｉｊ：基準
電源テあり、第１図と同一部材には、同一符号を付して
いる。
ｌｌｔＤ４はタイオート、ＶＲｔ、 ＶＲ２ｉｊ：基準
電源テあり、第１図と同一部材には、同一符号を付して
いる。
本願に卦いては、主トランジスタＱ１の駆動電流を制御
するために、制御回路に制御用トランジスタＱ３を直列
に接続し、この制御用トランジスタＱ３のベース電流を
コントロールする様にした。
するために、制御回路に制御用トランジスタＱ３を直列
に接続し、この制御用トランジスタＱ３のベース電流を
コントロールする様にした。
すなわち、カレントトランスＣＴ出力を演算増幅器Ａ、
の子端子と、演算増幅器Ａ２の一端子にそれぞれ入力す
る。
の子端子と、演算増幅器Ａ２の一端子にそれぞれ入力す
る。
演算増幅器、ＡＩの一端子には基準電源ＶＲＩが、演算
増幅器Ａ２の子端子には基１￥Ａ電源ＶＲ２が接続す１
１． ティ；ｂ ｏ （ＶＲＩ ＞ ＶＢ２ ）ここに
おいて、負荷Ｒ［流れる負荷電流１２に比例する一次電
流ｉｎ′ｔｌ−カレントトランスＣＴにて検出し、それ
を演算増幅器Ａ２にて誤差増幅し、その出力により制御
用トランジスタＱ３のベーδ電流を制御する。
増幅器Ａ２の子端子には基１￥Ａ電源ＶＲ２が接続す１
１． ティ；ｂ ｏ （ＶＲＩ ＞ ＶＢ２ ）ここに
おいて、負荷Ｒ［流れる負荷電流１２に比例する一次電
流ｉｎ′ｔｌ−カレントトランスＣＴにて検出し、それ
を演算増幅器Ａ２にて誤差増幅し、その出力により制御
用トランジスタＱ３のベーδ電流を制御する。
これにより主トランジスタＱ、のペースに流れる駆動電
流を制御する。又負荷又は内部短絡をカレントトランス
ＣＴにて検出すると、カレントトランスＣＴの出力がＶ
ＲＩよシ犬きくなるので、演鋳−増幅器Ａ、の出力によ
り、制御用トランジスタＱ、の導通度が小さくなる。こ
れによシトランスＴ３ に流れる電流を小さくする。更
に制御回路Ｃ０ＮＴに入力し、躯・勤トランジスタＱ３
の導通時ｌｔｌ ′ｆ！：短くすることによｐ主トラン
ジスタＱ、の導通時間を短くする。これにより主トラン
ジスタＱ＋ 。
流を制御する。又負荷又は内部短絡をカレントトランス
ＣＴにて検出すると、カレントトランスＣＴの出力がＶ
ＲＩよシ犬きくなるので、演鋳−増幅器Ａ、の出力によ
り、制御用トランジスタＱ、の導通度が小さくなる。こ
れによシトランスＴ３ に流れる電流を小さくする。更
に制御回路Ｃ０ＮＴに入力し、躯・勤トランジスタＱ３
の導通時ｌｔｌ ′ｆ！：短くすることによｐ主トラン
ジスタＱ、の導通時間を短くする。これにより主トラン
ジスタＱ＋ 。
に過電流が流れるのを防止する。
第３図は、本発明の他の実施例を示す図で、ＱＩＩ＋Ｑ
、ｔは主トランジスタ、Ｑｔ＋ｔ Ｑ２２は駆動トラン
ジスタ、Ｔ３．はトランスであｐＸ第２図と同一部材に
は四−符号を付与している。
、ｔは主トランジスタ、Ｑｔ＋ｔ Ｑ２２は駆動トラン
ジスタ、Ｔ３．はトランスであｐＸ第２図と同一部材に
は四−符号を付与している。
第３図の回路は、制御回路Ｃ０ＮＴにより、駆動トラン
ジスタＱ２１．Ｇｈ２ｆ交互にオン、オフし、よって主
トランジスタＱ＋ｘ Ｑ１０を交互にオンオンする。
ジスタＱ２１．Ｇｈ２ｆ交互にオン、オフし、よって主
トランジスタＱ＋ｘ Ｑ１０を交互にオンオンする。
従って、主トランスＴ、の一次巻線に交流が流れる様に
【７た電源回路に本発明ｆ適用した例である。
【７た電源回路に本発明ｆ適用した例である。
この実施例においても、演算増幅器Ａ２により短絡を検
出すると、制御用トランジスタＱ３をオフとする。
出すると、制御用トランジスタＱ３をオフとする。
発明の効果
Ｊ、Ｊ、土述べた如く、本発明によれば、主トランジス
タに流れる電流の大きさを制御できるので、ｊＧ大電流
による破壊を防止することができる。
タに流れる電流の大きさを制御できるので、ｊＧ大電流
による破壊を防止することができる。
＠ １１％ｉは、従来の電源回路を示す図、鉢）、２シ
１゜第３図は本発明の実施例を示す区１°Ｃある。 図中Ｑ＋＋ ＱＩＩ、Ｑ１０は主トランジスタ、ＡＩ＋
Ａ２ は演舞、増幅器、Ｑｓ ｌ’ｉ馴御トランジスタ
であるＯ
１゜第３図は本発明の実施例を示す区１°Ｃある。 図中Ｑ＋＋ ＱＩＩ、Ｑ１０は主トランジスタ、ＡＩ＋
Ａ２ は演舞、増幅器、Ｑｓ ｌ’ｉ馴御トランジスタ
であるＯ
Claims (1)
- トランスの一次巻線に直列に接続された主トランジスタ
のオンオフ時間ヲ該トラｙ ス（Ｄ 二次巻ｍに接続さ
れた負荷への電圧又は電流により制御する電源回路にお
いて、該トランスの一次巻線に流れる電流に応じ、該主
トランジスタの電流の大きさを制御する様にしたこと全
特徴とする電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14408082A JPS5935565A (ja) | 1982-08-20 | 1982-08-20 | 電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14408082A JPS5935565A (ja) | 1982-08-20 | 1982-08-20 | 電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5935565A true JPS5935565A (ja) | 1984-02-27 |
Family
ID=15353792
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14408082A Pending JPS5935565A (ja) | 1982-08-20 | 1982-08-20 | 電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5935565A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02116908U (ja) * | 1988-11-29 | 1990-09-19 |
-
1982
- 1982-08-20 JP JP14408082A patent/JPS5935565A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02116908U (ja) * | 1988-11-29 | 1990-09-19 |
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