JPS5935260A - デ−タ圧縮書込み装置 - Google Patents
デ−タ圧縮書込み装置Info
- Publication number
- JPS5935260A JPS5935260A JP14636382A JP14636382A JPS5935260A JP S5935260 A JPS5935260 A JP S5935260A JP 14636382 A JP14636382 A JP 14636382A JP 14636382 A JP14636382 A JP 14636382A JP S5935260 A JPS5935260 A JP S5935260A
- Authority
- JP
- Japan
- Prior art keywords
- data
- circuit
- comparison
- data frame
- storage circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T1/00—General purpose image data processing
- G06T1/0007—Image acquisition
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
本発明はデータ処理装置におけるデータ圧縮書込み装置
に関する。
に関する。
従来の記憶装置においては送られてきたデータをそのま
ま書込むため、記憶するデータ量が増大しかつデータの
転送に時間金製する欠点があった。
ま書込むため、記憶するデータ量が増大しかつデータの
転送に時間金製する欠点があった。
本発明の目的は、あらかじめ決められた複数組の数フレ
ーム以上のデータフレームパターンを監視し、一致する
データフレームパターンが送うれてきた場合は、マーカ
ービット全付加したｌフレームのデータとして書き込む
ことによシ記憶するデータ量が少くかつデータ転送時間
の少い記憶装置を提供することにある。
ーム以上のデータフレームパターンを監視し、一致する
データフレームパターンが送うれてきた場合は、マーカ
ービット全付加したｌフレームのデータとして書き込む
ことによシ記憶するデータ量が少くかつデータ転送時間
の少い記憶装置を提供することにある。
本発明によるとくシ返えし送られる可能性のある数フレ
ーム以上のデータフレームパターンを複数組格納する格
納回路と、前記格納回路に保持されたデータと新たに入
力されるデータと全順次比較する比較回路と、比較が完
全にとれ走時には、前記格納回路内のデータフレームパ
ターンと一致したデータフレームパターンであることを
示す圧縮データフレームパターン表示マーカピット２発
生する手段と、前記パターンが前記格納回路内の複数組
のパターン内のどれであるかを示す手段を含むこと全特
徴とするデータ圧縮書込み装置が得られる。
ーム以上のデータフレームパターンを複数組格納する格
納回路と、前記格納回路に保持されたデータと新たに入
力されるデータと全順次比較する比較回路と、比較が完
全にとれ走時には、前記格納回路内のデータフレームパ
ターンと一致したデータフレームパターンであることを
示す圧縮データフレームパターン表示マーカピット２発
生する手段と、前記パターンが前記格納回路内の複数組
のパターン内のどれであるかを示す手段を含むこと全特
徴とするデータ圧縮書込み装置が得られる。
次に本発明について図面を参照して説明する。
第１図は本発明の一実施例を示すブロック図、第２図は
入力データの書き込みデータへの変換例全示す図である
。第１図において１０は記憶する入力データをのせるデ
ータバス、３は圧縮する複数組ノ数フレーム以上のデー
タフレームパターン全格納する圧縮データフレーム格納
回路、４は圧縮データフレーム格納回路３の出力とデー
タバス１０の入力データを順次比較する比較回路、１２
は該比較回路４で圧縮データフレーム格納回１ｉ！３３
の出力と入力データバスの内容を順次比較していき最後
まで比較がとれたこと金示す比較一致信号、１３は比較
がとれなかったこと金示す比較不一致信号、２はデータ
バス１０の内容を１時的に記憶しておく１時記憶回路、
６は前記１時記憶回路２の出力と、比較がとれた時その
比較がとれた複数組のパターンのどれかを示す比較回路
４の出力である一致番号線１７上の信号とを切りかえる
切りかえ回路、７は該切りかえ回路６の出力を記憶する
記憶回路、１４は前記比較一致信号１２．比較不一致信
号１３によシ切シかえ回路６に対して切りかえを指示す
る切如かえ指示線、５は記憶回路７へ切りかえ回路６の
出力を格納することを指示する格納指示線１５を１″に
し、又マーカー線１６を制御する制御回路である。
入力データの書き込みデータへの変換例全示す図である
。第１図において１０は記憶する入力データをのせるデ
ータバス、３は圧縮する複数組ノ数フレーム以上のデー
タフレームパターン全格納する圧縮データフレーム格納
回路、４は圧縮データフレーム格納回路３の出力とデー
タバス１０の入力データを順次比較する比較回路、１２
は該比較回路４で圧縮データフレーム格納回１ｉ！３３
の出力と入力データバスの内容を順次比較していき最後
まで比較がとれたこと金示す比較一致信号、１３は比較
がとれなかったこと金示す比較不一致信号、２はデータ
バス１０の内容を１時的に記憶しておく１時記憶回路、
６は前記１時記憶回路２の出力と、比較がとれた時その
比較がとれた複数組のパターンのどれかを示す比較回路
４の出力である一致番号線１７上の信号とを切りかえる
切りかえ回路、７は該切りかえ回路６の出力を記憶する
記憶回路、１４は前記比較一致信号１２．比較不一致信
号１３によシ切シかえ回路６に対して切りかえを指示す
る切如かえ指示線、５は記憶回路７へ切りかえ回路６の
出力を格納することを指示する格納指示線１５を１″に
し、又マーカー線１６を制御する制御回路である。
データを書き込む場合あらかじめ複数組の圧縮データフ
レーム格納回路３へその時圧縮するデータフレームパタ
ーン全データバス１０に一開いて格納しておく。又最初
に送られてきたデータフレームは比較回路４で圧縮デー
タ、格納回路３に記憶されている複数組のデータパター
ンの最初のフレームと比較される。又同時に１時記憶回
路２に記憶される。
レーム格納回路３へその時圧縮するデータフレームパタ
ーン全データバス１０に一開いて格納しておく。又最初
に送られてきたデータフレームは比較回路４で圧縮デー
タ、格納回路３に記憶されている複数組のデータパター
ンの最初のフレームと比較される。又同時に１時記憶回
路２に記憶される。
順次送られて来たデータは同様の処理全行っていき、比
較回路４で比較した結果比較が最後までとれた場合、比
較一致信号１２が”１″とな多制御回路５に入力され、
又比較がとれた時その比較がとれた複数組のパターンの
どれかを示す信号が一致番号線１７に出力される。制御
回路５は比較一致信号１２が１′１″であれば切シかえ
指示線゛１４によシ切シかえ回路６を一致番号線１７側
に切シかえ、又格納指示線１５及びマーカ線１６のマー
カピッ）ｖｉ−” １”にして記憶回路７へ格納する。
較回路４で比較した結果比較が最後までとれた場合、比
較一致信号１２が”１″とな多制御回路５に入力され、
又比較がとれた時その比較がとれた複数組のパターンの
どれかを示す信号が一致番号線１７に出力される。制御
回路５は比較一致信号１２が１′１″であれば切シかえ
指示線゛１４によシ切シかえ回路６を一致番号線１７側
に切シかえ、又格納指示線１５及びマーカ線１６のマー
カピッ）ｖｉ−” １”にして記憶回路７へ格納する。
比較がとれなかった場合比較不一致信号１３が１″とな
多制御回路５に入力される。制御回路５は比較不一致信
号１３がＷ Ｉ ＩＩであれば、切シかえ指示線１４に
より切シかえ回路６全１時記憶回路２に切シかえ、それ
までに１時記憶回路２に格納されたデータフレームを記
憶回路７へ格納指示線１５を使用して格納する。
多制御回路５に入力される。制御回路５は比較不一致信
号１３がＷ Ｉ ＩＩであれば、切シかえ指示線１４に
より切シかえ回路６全１時記憶回路２に切シかえ、それ
までに１時記憶回路２に格納されたデータフレームを記
憶回路７へ格納指示線１５を使用して格納する。
第２図（ａ）（ｂ）（ｅ）はデータバス１０にのせられ
た入５− カデータの記憶回路７に書き込まれるデータへの変換例
であ１１） （ａ）は入力データ、Φ）は書込みデータ
、（Ｃ）はマーカピットを示す。
た入５− カデータの記憶回路７に書き込まれるデータへの変換例
であ１１） （ａ）は入力データ、Φ）は書込みデータ
、（Ｃ）はマーカピットを示す。
このようにくり返えし表われる特定データフレームパタ
ーンは１データフレームへと変換され全体の記憶データ
量は大幅にへらされる。
ーンは１データフレームへと変換され全体の記憶データ
量は大幅にへらされる。
本発明は以上説明したようにくシ返見しあられれる特定
データフレームパターンを１データフレームとして記憶
することによシデータが削減され転送速度を上げる効果
がある。
データフレームパターンを１データフレームとして記憶
することによシデータが削減され転送速度を上げる効果
がある。
第１図は本発明の一実施例を示すブロック図、第２図は
入力データの書き込みデータへの変換例を示す図である
。 １・・・・・・圧ｔｉ ｆ−タフレームパターン表示フ
レーム格納回路、２・・・・・・一時記憶回路、３・・
・・・・圧縮データフレーム格納回路、４・・・・・・
比較回路、５・・・・・・制御回路、６・・・・・・切
シかえ回路、７・・・・・・記憶回路、６− １０・・・・・・データバス、１２・・団・比較一致信
号、１３・・・・・・比較不一致信号、１５・・・・・
・格納指示線、１６・・・・、・・マーカー線、１７・
・・・・・一致番号線。 ７− 豫１圀 卒２別 （Ｃ１マーカじ−ノト ｌ θθθ０１３４１
入力データの書き込みデータへの変換例を示す図である
。 １・・・・・・圧ｔｉ ｆ−タフレームパターン表示フ
レーム格納回路、２・・・・・・一時記憶回路、３・・
・・・・圧縮データフレーム格納回路、４・・・・・・
比較回路、５・・・・・・制御回路、６・・・・・・切
シかえ回路、７・・・・・・記憶回路、６− １０・・・・・・データバス、１２・・団・比較一致信
号、１３・・・・・・比較不一致信号、１５・・・・・
・格納指示線、１６・・・・、・・マーカー線、１７・
・・・・・一致番号線。 ７− 豫１圀 卒２別 （Ｃ１マーカじ−ノト ｌ θθθ０１３４１
Claims (1)
- くシ返えし送られる可能性のある数フレーム以上のデー
タフレームパターン全複数組格納する格納回路と、前記
格納回路に保持されたデータと新たに入力されるデータ
とを順次比較する比較回路と、比較が完全にとれた時に
は前記格納回路内のデータフレームパターン、！ニー４
したデータフレームパターンであることを示す圧縮デー
タフレームパターン表示マーカビラトラ発生する手段と
、前記パターンが前記格納回路内の複数組のパターン内
のどれであるかを示す手段を含むことを特徴とするデー
タ圧縮書込み装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14636382A JPS5935260A (ja) | 1982-08-24 | 1982-08-24 | デ−タ圧縮書込み装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14636382A JPS5935260A (ja) | 1982-08-24 | 1982-08-24 | デ−タ圧縮書込み装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5935260A true JPS5935260A (ja) | 1984-02-25 |
Family
ID=15406021
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14636382A Pending JPS5935260A (ja) | 1982-08-24 | 1982-08-24 | デ−タ圧縮書込み装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5935260A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62186696A (ja) * | 1986-02-07 | 1987-08-15 | アールシーエー トムソン ライセンシング コーポレーシヨン | プログラムできる再構成可能な遠隔制御送信器 |
| US4891138A (en) * | 1986-12-25 | 1990-01-02 | Ebara Corporation | Method of separating and transferring ion-exchange resin |
| JPH0541883A (ja) * | 1991-07-31 | 1993-02-19 | Rca Thomson Licensing Corp | 遠隔制御送信器 |
| JPH0816458A (ja) * | 1994-06-29 | 1996-01-19 | Nec Corp | バッファアクセス制御回路 |
| JP2005141696A (ja) * | 2003-11-10 | 2005-06-02 | Nec Engineering Ltd | Ｆｉｆｏメモリ制御装置及び方法 |
-
1982
- 1982-08-24 JP JP14636382A patent/JPS5935260A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62186696A (ja) * | 1986-02-07 | 1987-08-15 | アールシーエー トムソン ライセンシング コーポレーシヨン | プログラムできる再構成可能な遠隔制御送信器 |
| US4891138A (en) * | 1986-12-25 | 1990-01-02 | Ebara Corporation | Method of separating and transferring ion-exchange resin |
| JPH0541883A (ja) * | 1991-07-31 | 1993-02-19 | Rca Thomson Licensing Corp | 遠隔制御送信器 |
| JPH0816458A (ja) * | 1994-06-29 | 1996-01-19 | Nec Corp | バッファアクセス制御回路 |
| JP2005141696A (ja) * | 2003-11-10 | 2005-06-02 | Nec Engineering Ltd | Ｆｉｆｏメモリ制御装置及び方法 |
| JP4511819B2 (ja) * | 2003-11-10 | 2010-07-28 | Ｎｅｃエンジニアリング株式会社 | Ｆｉｆｏメモリ制御装置及び方法 |
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