JPS5929983B2 - 双方向デイジタル信号伝送線の絶縁回路 - Google Patents
双方向デイジタル信号伝送線の絶縁回路Info
- Publication number
- JPS5929983B2 JPS5929983B2 JP15609080A JP15609080A JPS5929983B2 JP S5929983 B2 JPS5929983 B2 JP S5929983B2 JP 15609080 A JP15609080 A JP 15609080A JP 15609080 A JP15609080 A JP 15609080A JP S5929983 B2 JPS5929983 B2 JP S5929983B2
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- circuit
- photocoupler
- transmission line
- signal transmission
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Classifications
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/20—Repeater circuits; Relay circuits
- H04L25/26—Circuits with optical sensing means, i.e. using opto-couplers for isolation
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Bidirectional Digital Transmission (AREA)
- Dc Digital Transmission (AREA)
Description
【発明の詳細な説明】
本発明は２個の回路間に双方方向ディジタル信号の伝送
線で接続される場合の絶縁回路に関するもので、特にフ
ォトカプラを用いた双方向ディジタル信号伝送線の絶縁
回路に関する。
線で接続される場合の絶縁回路に関するもので、特にフ
ォトカプラを用いた双方向ディジタル信号伝送線の絶縁
回路に関する。
第１図に従来の双方向信号伝送線に接続されたシステム
又は回路１、２の入出力回路の制御状態を示す。
又は回路１、２の入出力回路の制御状態を示す。
図においてそれぞれシステム１、２の入出力回路はスリ
ーステートのゲート回路となつており、システム１から
システム２へ信号が伝達される時、イネーブル信号がシ
ステム１、２のＢに入力される。又、逆にシステム２か
ら１へ信号が伝達される場合には、イネーブル信号がシ
ステム１、２のＡに入力される。このように一つの信号
線で双方向に信号が伝達される。この伝送線をフォトカ
プラを用いて絶縁する場合には、第２図に示すような回
路が考えられる。この第２図に示した回路では２個のフ
ォトカプラ７、８はそれぞれ入出力側に信号の方向に応
じて切換えられるゲート回路が入つており、システム１
からシステム２への信号の伝達ではシステム１、２で与
えられたと同じイネーブル信号Ｂがスリーステートの回
路４、６に与えられ、逆の方向の信号の伝達ではイネー
ブル信号Ａが３、５に与えられる。このようにして双方
向信号の絶縁が行なわれている。この従来のものでは絶
縁回路自体に方向に応じて動作させるフォトカプラを選
択するゲート回路が必要となり、例えばマイクロコンピ
ュータのようなデータバスのように何点かの信号でもつ
て一つの情報がシステム間で伝達されている時にはフォ
トカプラ以外に半導体素子としてスリーステートのゲー
ト回路が多数必要となり、トラブルの要素が多くなると
ともに伝送線が増えるという欠点があつた。本発明は２
個のフォトカプラを信号線ハイレベルとローレベル線間
に直列に入れ信号伝達方向の切換部分をなくして信号が
伝達できるようにすることによりトラブルを少なくする
とともに伝送線を最少にすることができる双方向ディジ
タル信号伝送線の絶縁回路を提供する。
ーステートのゲート回路となつており、システム１から
システム２へ信号が伝達される時、イネーブル信号がシ
ステム１、２のＢに入力される。又、逆にシステム２か
ら１へ信号が伝達される場合には、イネーブル信号がシ
ステム１、２のＡに入力される。このように一つの信号
線で双方向に信号が伝達される。この伝送線をフォトカ
プラを用いて絶縁する場合には、第２図に示すような回
路が考えられる。この第２図に示した回路では２個のフ
ォトカプラ７、８はそれぞれ入出力側に信号の方向に応
じて切換えられるゲート回路が入つており、システム１
からシステム２への信号の伝達ではシステム１、２で与
えられたと同じイネーブル信号Ｂがスリーステートの回
路４、６に与えられ、逆の方向の信号の伝達ではイネー
ブル信号Ａが３、５に与えられる。このようにして双方
向信号の絶縁が行なわれている。この従来のものでは絶
縁回路自体に方向に応じて動作させるフォトカプラを選
択するゲート回路が必要となり、例えばマイクロコンピ
ュータのようなデータバスのように何点かの信号でもつ
て一つの情報がシステム間で伝達されている時にはフォ
トカプラ以外に半導体素子としてスリーステートのゲー
ト回路が多数必要となり、トラブルの要素が多くなると
ともに伝送線が増えるという欠点があつた。本発明は２
個のフォトカプラを信号線ハイレベルとローレベル線間
に直列に入れ信号伝達方向の切換部分をなくして信号が
伝達できるようにすることによりトラブルを少なくする
とともに伝送線を最少にすることができる双方向ディジ
タル信号伝送線の絶縁回路を提供する。
以下、本発明の一実施例を図について説明する。
第３図において、１、２はそれぞれディジタル信号を授
受する第１及び第２の回路であり、入出力部はスリース
テートのゲート回路である。７，８は信号線を絶縁する
フオトカプラで、発光側と受光側がそれぞれ図に示すよ
うに直列に接続されている。
受する第１及び第２の回路であり、入出力部はスリース
テートのゲート回路である。７，８は信号線を絶縁する
フオトカプラで、発光側と受光側がそれぞれ図に示すよ
うに直列に接続されている。
９，１０は抵抗であり、フオトカプラ７，８の受光側に
それぞれ並列に接続される。
それぞれ並列に接続される。
１１は抵抗であり、第１の回路１側の電源電圧とフオト
カプラ７の受光側の間に接続される。
カプラ７の受光側の間に接続される。
１２は抵抗であり、第２の回路２側の電源電圧とフオト
カプラ７の発光側の間に接続されている。
カプラ７の発光側の間に接続されている。
第３図において、第１の回路１をマスターシステム、第
２の回路２をスレーブシステムとし、信号の伝送方向の
制御は第１の回路１によつて行なわれるものとする。
２の回路２をスレーブシステムとし、信号の伝送方向の
制御は第１の回路１によつて行なわれるものとする。
つまり両回路１，２の入出力部にあるスリーステートゲ
ート回路のイネーブル信号は第１の回路１によつて出力
されているものとする。従つて、このイネーブル信号も
第１の回路１から第２の回路２へフオトカプラ８で絶縁
して伝達される。今、第１の回路１から第２の回路２へ
デイジタル信号が伝達される場合について説明する。
ート回路のイネーブル信号は第１の回路１によつて出力
されているものとする。従つて、このイネーブル信号も
第１の回路１から第２の回路２へフオトカプラ８で絶縁
して伝達される。今、第１の回路１から第２の回路２へ
デイジタル信号が伝達される場合について説明する。
両回路１，２のイネーブル信号はＢがハイレベル゛ビと
なり、信号Ａがローレベル゛０゛となる。第１の回路１
がハイレベル゛１”になると、出力ゲート回路電源、抵
抗９フオトカプラ８の発光側という電流経路ができ、フ
オトカプラ８が０Ｎとなる。すると、抵抗１２、フオト
カプラ７の発光側フオトカプラ８の受光側という電流経
路ができ、第２の回路２の入力レベル（第２の回路２の
イネーブルＢをもつスリーステートのゲート回路入力レ
ベル）はローレベル１０１となる。従つて、インバータ
ゲート回路の出力はハイレベル″１゛となり、第１の回
路１からの出力レベル″１”が第２の回路２へ絶縁して
伝達される。なお、この時フオトカプラ７も０Ｎするが
、これはフオトカプラ８の０Ｎ状態を助長する方向に働
く。逆に、第１の回路１がローレベル１０゛になるとい
うことは抵抗１１を介してスリーステートゲート回路へ
電流が流れ込み、抵抗１１一抵抗９−フオトカプラ８の
発光側への電流経路へ流れる電流はフオトカプラ８を０
Ｎするに十分な値に達しない。従つて、フオトカプラ８
の受光側トランジスタは０ＦＦのままであり、抵抗１２
−フオトカプラ７の発光側一抵抗１０の電流経路となり
、フオトカプラ７は０Ｎするが、フオトカプラ８の発光
側を０Ｎするだけの電流は流れない。従つて、第２の回
路２の入力レベルは抵抗１２，１０の分圧比と電源電圧
で決まる。この値がインバータゲートのハイレベルにな
るように抵抗１２，１０を決めることにより、インバー
タゲートの出力はローレベルとなる。よつて、第１の回
路１のローレベル″Ｏ゛出力が第２の回路２へ絶縁して
伝達される。次に、第２の回路２から第１の回路１へ信
号が伝達される場合は、両回路１，２のスリーステート
ゲート回路のイネーブル信号がＡにハイレベル゛１−Ｂ
にローレベル８０゛が与えられる。そして、さきほどの
第１の回路１から第２の回路２への伝達と同様にハイレ
ベル゛１゛ローレベル”０”が絶縁して伝達される。第
３図において、抵抗１１，１２を除いても同様の効果が
期待される。
なり、信号Ａがローレベル゛０゛となる。第１の回路１
がハイレベル゛１”になると、出力ゲート回路電源、抵
抗９フオトカプラ８の発光側という電流経路ができ、フ
オトカプラ８が０Ｎとなる。すると、抵抗１２、フオト
カプラ７の発光側フオトカプラ８の受光側という電流経
路ができ、第２の回路２の入力レベル（第２の回路２の
イネーブルＢをもつスリーステートのゲート回路入力レ
ベル）はローレベル１０１となる。従つて、インバータ
ゲート回路の出力はハイレベル″１゛となり、第１の回
路１からの出力レベル″１”が第２の回路２へ絶縁して
伝達される。なお、この時フオトカプラ７も０Ｎするが
、これはフオトカプラ８の０Ｎ状態を助長する方向に働
く。逆に、第１の回路１がローレベル１０゛になるとい
うことは抵抗１１を介してスリーステートゲート回路へ
電流が流れ込み、抵抗１１一抵抗９−フオトカプラ８の
発光側への電流経路へ流れる電流はフオトカプラ８を０
Ｎするに十分な値に達しない。従つて、フオトカプラ８
の受光側トランジスタは０ＦＦのままであり、抵抗１２
−フオトカプラ７の発光側一抵抗１０の電流経路となり
、フオトカプラ７は０Ｎするが、フオトカプラ８の発光
側を０Ｎするだけの電流は流れない。従つて、第２の回
路２の入力レベルは抵抗１２，１０の分圧比と電源電圧
で決まる。この値がインバータゲートのハイレベルにな
るように抵抗１２，１０を決めることにより、インバー
タゲートの出力はローレベルとなる。よつて、第１の回
路１のローレベル″Ｏ゛出力が第２の回路２へ絶縁して
伝達される。次に、第２の回路２から第１の回路１へ信
号が伝達される場合は、両回路１，２のスリーステート
ゲート回路のイネーブル信号がＡにハイレベル゛１−Ｂ
にローレベル８０゛が与えられる。そして、さきほどの
第１の回路１から第２の回路２への伝達と同様にハイレ
ベル゛１゛ローレベル”０”が絶縁して伝達される。第
３図において、抵抗１１，１２を除いても同様の効果が
期待される。
つまり、両回路１，２のインバータ入力ゲートの入力抵
抗で同等の作用を実現するのも可能である。本発明によ
り絶縁回路に方向判別回路を設けることなく、伝送線を
増加することなしに双方向のデイジタル信号を絶縁して
伝達できる。
抗で同等の作用を実現するのも可能である。本発明によ
り絶縁回路に方向判別回路を設けることなく、伝送線を
増加することなしに双方向のデイジタル信号を絶縁して
伝達できる。
又、マイクロコンビユータのような双方向のデータバス
を絶縁して伝送する場合には絶縁回路による伝送のトラ
ブルを少なくできる。
を絶縁して伝送する場合には絶縁回路による伝送のトラ
ブルを少なくできる。
第１図は従来の双方向デイジタル信号線の制御状態を示
す回路図、第２図は従来のホトカプラを用いた双方向デ
イジタル信号線の絶縁回路図、第３図は本発明の一実悔
例を示す双方向デイジタル信号伝送線の絶縁回路図であ
る。 図中、同一符号は同一または相当部分を示す。
す回路図、第２図は従来のホトカプラを用いた双方向デ
イジタル信号線の絶縁回路図、第３図は本発明の一実悔
例を示す双方向デイジタル信号伝送線の絶縁回路図であ
る。 図中、同一符号は同一または相当部分を示す。
Claims (1)
- １ 第１の回路と第２の回路との間で相互にディジタル
信号が伝達される双方向伝送線をフォトカプラを用いて
絶縁する絶縁回路において、２個のフォトカプラの発光
側と受光側とを直列に接続して、上記両回路間のハイレ
ベル線とローレベル線間に直列に接続するとともに、上
記ハイレベル線と電源との間に第１の抵抗を接続し、上
記各フォトカプラの受光側両端に第２の抵抗を並列に接
続したことを特徴とする双方向ディジタル信号伝送線の
絶縁回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15609080A JPS5929983B2 (ja) | 1980-11-05 | 1980-11-05 | 双方向デイジタル信号伝送線の絶縁回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15609080A JPS5929983B2 (ja) | 1980-11-05 | 1980-11-05 | 双方向デイジタル信号伝送線の絶縁回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5779750A JPS5779750A (en) | 1982-05-19 |
| JPS5929983B2 true JPS5929983B2 (ja) | 1984-07-24 |
Family
ID=15620081
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15609080A Expired JPS5929983B2 (ja) | 1980-11-05 | 1980-11-05 | 双方向デイジタル信号伝送線の絶縁回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5929983B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006157230A (ja) * | 2004-11-26 | 2006-06-15 | Asuka Electron Kk | データ搬送回路 |
-
1980
- 1980-11-05 JP JP15609080A patent/JPS5929983B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5779750A (en) | 1982-05-19 |
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