JPS5922558U - 信号処理装置の入力回路 - Google Patents

信号処理装置の入力回路

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JPS5922558U
JPS5922558U JP11633382U JP11633382U JPS5922558U JP S5922558 U JPS5922558 U JP S5922558U JP 11633382 U JP11633382 U JP 11633382U JP 11633382 U JP11633382 U JP 11633382U JP S5922558 U JPS5922558 U JP S5922558U
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JP
Japan
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signal
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signal processing
outputs
processing device
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JP11633382U
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JPH0342761Y2 (ja
Inventor
洋一 磯部
Original Assignee
松下電工株式会社
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Publication date
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  • Dc Digital Transmission (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来例の回路図、第2 区a ” c及び第3
図a〜Cは同上の動作説明用タイムチャート、第4図は
本考案の一実施例の回路図、第5図a〜hは同上の動作
説明用のタイムチャート、第6図a”−bは同上の信号
形式の説明図、第7図は同上使用のシステム説明用概略
構成図、第8図a”=h及び第9図a〜f1第10図a
 % fは同上の動作説明のタイムチャート、第11図
a、  bは同上に使用する時定数回路の他側の回路図
であり、2は信号処理論理回路、9は入力受付は部、1
0.〜103はラッチ回路、14は時定数回路、Trは
ト   ゛ ランジスタ、EOR□。〜EOR13は排
他的オア、io〜i3はデータ入力端子、0o−03は
データ出力端子で16°    第2図 第5図

Claims (1)

    【実用新案登録請求の範囲】
  1. 一   ストローブ信号によってトリガされた際にデー
    タ入力端子に入力する信号を読むとともに信号処理を行
    ない信号処理後データ入力端子に入力した信号と一致す
    る信号をデータ出力端子より出力する信号処理論理回路
    を備えた信号処理装置において、外部入力によってスイ
    ッチングするトランジスタのようなスイッチング素子を
    有し、該スイッチング素子のオン時に、“H”レベルの
    信号ヲ、オフ時に“Lルベルの信号を入力信号として出
    力する入力受付は部と、該入力信号と前記データ出力端
    子の出力信号とを比較する排他的オアと、該排他的オア
    の出力の立上がりをクロックとして前記入力信号をラッ
    チし該ラッチ出力を前記データ入力端子へ出力するラッ
    チ回路と、ラッチ回路のクロック端子と、排他的オアの
    出力との間に挿入した時定数回路を設け、スイッチング
    素子のオフ動作開始から上記入力信号のレベルが排他的
    オアのスレショルドレベルに至る時間までの時間幅より
    時定数回路の退廷時間を十分大きく設定して成ることを
    特徴とする信号処理装置の入力回路。
JP11633382U 1982-07-31 1982-07-31 信号処理装置の入力回路 Granted JPS5922558U (ja)

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JPS5922558U true JPS5922558U (ja) 1984-02-10
JPH0342761Y2 JPH0342761Y2 (ja) 1991-09-06

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01136430A (ja) * 1987-11-24 1989-05-29 Canon Inc 通信装置

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* Cited by examiner, † Cited by third party
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JPH01136430A (ja) * 1987-11-24 1989-05-29 Canon Inc 通信装置

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JPH0342761Y2 (ja) 1991-09-06

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