JPS59212059A - デイジタル符号化変復調方式 - Google Patents
デイジタル符号化変復調方式Info
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- JPS59212059A JPS59212059A JP8726383A JP8726383A JPS59212059A JP S59212059 A JPS59212059 A JP S59212059A JP 8726383 A JP8726383 A JP 8726383A JP 8726383 A JP8726383 A JP 8726383A JP S59212059 A JPS59212059 A JP S59212059A
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- Japan
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- signal
- digital
- parallel
- circuit
- nonlinear
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
- H04L27/02—Amplitude-modulated carrier systems, e.g. using on-off keying; Single sideband or vestigial sideband modulation
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は通信システムにおける振・幅変調による信号の
変復調方式に関し、特にディジタル符号化信号なディジ
タル形式で直接的にかつ高速で変復調する方式（＝関す
る。
変復調方式に関し、特にディジタル符号化信号なディジ
タル形式で直接的にかつ高速で変復調する方式（＝関す
る。
一般に、アナログ信号を対象としての振幅変調による信
号の変調または復調方式は、第１図に示すように、搬送
波信号Ａ。と変調信号または被変調信号Ａｓとを自乗回
路その他の非線形回路１に入力し、２つの入力信号の積
をとって、それらの信号周波数の差および和の周波数の
信号成分Ａ＃ −６およびＡＪＩ ＋ ｏを生成させ、
さらに、２の低域フィルタＬＰＦまたは高域フィルタＨ
ＰＦを用いて必要な信号を選択して、目的の信号を得て
いる。
号の変調または復調方式は、第１図に示すように、搬送
波信号Ａ。と変調信号または被変調信号Ａｓとを自乗回
路その他の非線形回路１に入力し、２つの入力信号の積
をとって、それらの信号周波数の差および和の周波数の
信号成分Ａ＃ −６およびＡＪＩ ＋ ｏを生成させ、
さらに、２の低域フィルタＬＰＦまたは高域フィルタＨ
ＰＦを用いて必要な信号を選択して、目的の信号を得て
いる。
しかし、搬送波信号と変調信号または被変調信号とがい
ずれもディジタル符号化されている場合には９種々の問
題が生じる。
ずれもディジタル符号化されている場合には９種々の問
題が生じる。
第２図に、従来のディジタル符号方式の復調回路の例を
示す。この例では、ディジタル符号化された搬送波信号
り。と被変調信号Ｄｚとを、ディジタル乗算回路３で乗
算し９乗算結果の信号をＤ／Ａ変換器（ディジタル−ア
ナログ変換器）４でアナログ信号に変換し、さらに截域
フィルタ５を通して変調信号Ａ＃ −６を復調している
。
示す。この例では、ディジタル符号化された搬送波信号
り。と被変調信号Ｄｚとを、ディジタル乗算回路３で乗
算し９乗算結果の信号をＤ／Ａ変換器（ディジタル−ア
ナログ変換器）４でアナログ信号に変換し、さらに截域
フィルタ５を通して変調信号Ａ＃ −６を復調している
。
通常、ディジタル符号化信号り。、ＤＪは直列型符号で
あり、またディジタル乗算回路３は一方の信号をビット
遅延させて加算する動作を多数回繰り返すことにより乗
算を実行する。そのため、演算時間が長くなる欠点があ
った。
あり、またディジタル乗算回路３は一方の信号をビット
遅延させて加算する動作を多数回繰り返すことにより乗
算を実行する。そのため、演算時間が長くなる欠点があ
った。
これは、変調回路についても原理的に全く同じであるた
め事情は共通している。したがって、従来は、ディジタ
ル符号化信号の振幅変復調回路を用いる場合、高速オン
ラインでのリアルタイム処理は困難であった。
め事情は共通している。したがって、従来は、ディジタ
ル符号化信号の振幅変復調回路を用いる場合、高速オン
ラインでのリアルタイム処理は困難であった。
本発明の目的は、ビット遅延のない高速のディジタル符
号化変復調方式を提供することにあり。
号化変復調方式を提供することにあり。
そのため、信号として並列型のディジタル信号を用いる
とともに、変復調回路を並列型の非線形論理−―回路で
構成することにより上記目的を達成する。
とともに、変復調回路を並列型の非線形論理−―回路で
構成することにより上記目的を達成する。
本発明の構成は、それにより、２つの並列型ディジタル
符号について並列に非線形論理演算を行なう非線形論理
回路を設け、該非線形論理回路に。
符号について並列に非線形論理演算を行なう非線形論理
回路を設け、該非線形論理回路に。
並列型ディジタル符号化された搬送波何月と変調信号ま
たは被変調信号とを印加して論理演算を実行し、その演
算結果として得られる並列型ディジタル符号化信号から
被変調信号または変調信号を取り出すことを特徴として
いる。
たは被変調信号とを印加して論理演算を実行し、その演
算結果として得られる並列型ディジタル符号化信号から
被変調信号または変調信号を取り出すことを特徴として
いる。
以下に９本発明の詳細を実施例にしたがって説明する。
第３図は本発明の基本概念の説明図であり、従来方式と
の比較のため、第２図の復調回路の例と対応的に示した
ものである。
の比較のため、第２図の復調回路の例と対応的に示した
ものである。
におけるディジタル乗算回路の代りに、非線形論理回路
６が使用される。ここにいう非線形論理回路は、アナロ
グ的には第１図の非線形回路１に対応するものであるが
、加減乗除の算術的論理演算回路を除いた。すなわちビ
ット遅延（あるいはシフト操作）、キャリ（桁上げ）、
ボロー（桁借り）などを含まない論理回路であり９時間
遅れが殆んど生じないような回路である。
６が使用される。ここにいう非線形論理回路は、アナロ
グ的には第１図の非線形回路１に対応するものであるが
、加減乗除の算術的論理演算回路を除いた。すなわちビ
ット遅延（あるいはシフト操作）、キャリ（桁上げ）、
ボロー（桁借り）などを含まない論理回路であり９時間
遅れが殆んど生じないような回路である。
このような非線形論理回路６を使用して、２つの並列型
の入力ディジタル符号化信号Ｄｏ 、 ＤＪの演算を行
なうことにより１回路の非線形特性にもとづいた２倍号
の積成分をディジタル的に生成させることができる。
の入力ディジタル符号化信号Ｄｏ 、 ＤＪの演算を行
なうことにより１回路の非線形特性にもとづいた２倍号
の積成分をディジタル的に生成させることができる。
非線形論理回路６の出力は、同じく並列型ディジタル符
号の形式をとり、Ｄ／Ａ変換器４によりアナログ信号に
変換し、さらに低域／高域フィルタ２を通して、もとの
変調信号Ａｓ −ｏ ／ Ａ＝＝ ＋ ｏを取り出すこ
とができる。
号の形式をとり、Ｄ／Ａ変換器４によりアナログ信号に
変換し、さらに低域／高域フィルタ２を通して、もとの
変調信号Ａｓ −ｏ ／ Ａ＝＝ ＋ ｏを取り出すこ
とができる。
第３図に示した本発明方式による復調回路の非線形論理
回路６は、搬送波信号および変調信号を対象とするディ
ジタル符号型の変調回路として。
回路６は、搬送波信号および変調信号を対象とするディ
ジタル符号型の変調回路として。
低域フィルタを高域フィルタに変更することで同様に適
用することができる。
用することができる。
次に本発明を、カラーテレビジョンシステムにおける色
復調回路に適用した実施例を、第４図乃至第１１図にし
たがって説明する。
復調回路に適用した実施例を、第４図乃至第１１図にし
たがって説明する。
第４図はカラーテレビジョン受像機の色信号および色復
調回路のブロック図であり、第５図はその色復調回路部
分の細部構成を示したものである〇両図において、７は
色信号トラップフィルタ、８は色信号帯域フィルタＢＰ
Ｆ、９は副搬送波周波数ｆｚｃの４倍の周波数４ ｆｓ
ｃのクロック発振器。
調回路のブロック図であり、第５図はその色復調回路部
分の細部構成を示したものである〇両図において、７は
色信号トラップフィルタ、８は色信号帯域フィルタＢＰ
Ｆ、９は副搬送波周波数ｆｚｃの４倍の周波数４ ｆｓ
ｃのクロック発振器。
１０は４位相副搬送波発生器、１１は色コード副搬送波
発生器、１２，１３．１４はそれぞれＲｌＢ、Ｇの色復
調器を示す。
発生器、１２，１３．１４はそれぞれＲｌＢ、Ｇの色復
調器を示す。
色信号トラップフィルタ７および色信号ＢＰＦ８は、入
力された８ビツトの搬送色信号から、各８ビツトの輝度
信号Ｙおよび色信号ＶＤを分離するディジタルフィルタ
である。
力された８ビツトの搬送色信号から、各８ビツトの輝度
信号Ｙおよび色信号ＶＤを分離するディジタルフィルタ
である。
４ ｆｚｃ発振器９は１４．３１８ ＭＨｚのクロック
（ＣＬＫ）パルスを発振する。この発振周波数は。
（ＣＬＫ）パルスを発振する。この発振周波数は。
図示されない同期回路との間の位相制御用の同期ループ
Ｃ二より９周波数１位相とも同期制御されているものと
する。
Ｃ二より９周波数１位相とも同期制御されているものと
する。
４位相副搬送波発生器１０は、クロック（ＣＬＫ）信号
にもとづいて１クロツクずつ位相がずれたパルス列φ１
．φ２．φ３．φ４を発生する。パルス列φ１．φ２．
φ３．φ４と色信号ＶＤおよびバースト信号との位相関
係は第９図（α）乃至（ｃ）に示されている。φ１．φ
２．φ３．φ４は、副搬送波（バースト信号）のθ°、
９０°、１８０’、２７０’の位相信号を表し、その各
位相信号で色信号ＶＤをサンプリングするため（二使用
される〇 色コード副搬送波発生器１１は９色信号ＶＤからＲ，Ｇ
、Ｂの各色信号を復調するための固有の副搬送波ＲＣ，
Ｂｅ、ＧＣを、φ１乃至φ４の各位相（二おいて発生す
る（第６図乃至第８図により後述）。
にもとづいて１クロツクずつ位相がずれたパルス列φ１
．φ２．φ３．φ４を発生する。パルス列φ１．φ２．
φ３．φ４と色信号ＶＤおよびバースト信号との位相関
係は第９図（α）乃至（ｃ）に示されている。φ１．φ
２．φ３．φ４は、副搬送波（バースト信号）のθ°、
９０°、１８０’、２７０’の位相信号を表し、その各
位相信号で色信号ＶＤをサンプリングするため（二使用
される〇 色コード副搬送波発生器１１は９色信号ＶＤからＲ，Ｇ
、Ｂの各色信号を復調するための固有の副搬送波ＲＣ，
Ｂｅ、ＧＣを、φ１乃至φ４の各位相（二おいて発生す
る（第６図乃至第８図により後述）。
色復調器１２，１３．１４のそれぞれは、８ビツト入力
に対応する８組のＢＸＯＲゲートすなわち排他的論理和
の否定論理ゲートと、該８組のゲートに縦続された１個
のＤ／Ａ変換器により構成されている。各Ｄ／Ａ変換器
からはアナログ形式の色信号Ｒ，Ｂ、Ｇが出力される。
に対応する８組のＢＸＯＲゲートすなわち排他的論理和
の否定論理ゲートと、該８組のゲートに縦続された１個
のＤ／Ａ変換器により構成されている。各Ｄ／Ａ変換器
からはアナログ形式の色信号Ｒ，Ｂ、Ｇが出力される。
第６図は１本実施例における８ビツトデイジタル化符号
のレベルと映像信号との対応を示す。例えば基底レベル
なＯとし、最大値を２５５とする。
のレベルと映像信号との対応を示す。例えば基底レベル
なＯとし、最大値を２５５とする。
またペデスタルのレベルを６３に設定し、バースト信号
レベルは３１と９５の範囲とする。
レベルは３１と９５の範囲とする。
第７図は、副搬送波ＲＣ，ＢＣ，ＧＣすなわち（Ｂ−Ｙ
）、 （Ｒ−Ｙ）、 （Ｇ−Ｙ）のそれぞれについ
て、φ１．φ２．φ３．φ４の各位相におけるレベルの
関係を示すための図である。第８図は。
）、 （Ｒ−Ｙ）、 （Ｇ−Ｙ）のそれぞれについ
て、φ１．φ２．φ３．φ４の各位相におけるレベルの
関係を示すための図である。第８図は。
これを表に配列した説明図である。
第９図（ａ）、 （Ａ）、 （ｃ）および第１０図（α
）Ｉ （ｈ）Ｉ ＣＤ））は組み合わされて装置全体の
動作タイミング関係を示している。
）Ｉ （ｈ）Ｉ ＣＤ））は組み合わされて装置全体の
動作タイミング関係を示している。
第１１図は９色復調器１４の動作例を示したもので９例
１乃至例４は１色信号ＶＤのレベルが９５から３１に変
化するときの、ＥＸＯＲゲート群の上位６ビツト出力Ｃ
ｏ−１乃至ＣＤ６の値を示している。
１乃至例４は１色信号ＶＤのレベルが９５から３１に変
化するときの、ＥＸＯＲゲート群の上位６ビツト出力Ｃ
ｏ−１乃至ＣＤ６の値を示している。
第１２図ハ、 同ＱＪＥｔ、テＶＤカ６０．３０．６６
゜９４と変化するときの色復調器１２および】３におけ
る動作例を示している。
゜９４と変化するときの色復調器１２および】３におけ
る動作例を示している。
このようにして１色復調器１２，１３．１４のそれぞれ
からは、第３図で説明した本発明の原理にしたがって、
Ｒ，Ｂ、Ｇの色信号が復調され。
からは、第３図で説明した本発明の原理にしたがって、
Ｒ，Ｂ、Ｇの色信号が復調され。
図示されないＣＲＴ制御回路へ送出される。
以上述べたように９本発明によればディジタル符号化信
号の変復調を、従来方式（二くらべて高速に実行するこ
とができ、それ故リアルタイムによる伝送が可能となる
。
号の変復調を、従来方式（二くらべて高速に実行するこ
とができ、それ故リアルタイムによる伝送が可能となる
。
第１図は一般的な変復調の原理説明図、第２図は従来の
ディジタル符号化信号の復調回路の構成図、第３図は本
発明方式の概念図、第４図は本発明の１実施例のブロッ
ク図、第５図はその細部構成図、第６図は本実施例にお
ける信号レベルの説明図、第７図および第８図はＲ，Ｂ
、Ｇのそれぞれの復調に使用される副搬送波レベルの説
明図。 第９図（α）乃至（Ｃ）および第１０図（α）乃至（Ｃ
）は動作タイミング図、第１１図および第１２図は色復
調器の動作側説明図である。 図中、４はＤ／Ａ変換器、５は低域フィルタＬＰＦ、６
は非線形論理回路、Ｄ。およびＤ＃は並列型のディジタ
ル符号化信号、ＡＪＩ−０はアナログ型の変調信号出力
を示す。 特許出願人 富士通株式会社 代理人弁理士 長谷用 文 廣 （外１名）δ −３２４− ｇ
ディジタル符号化信号の復調回路の構成図、第３図は本
発明方式の概念図、第４図は本発明の１実施例のブロッ
ク図、第５図はその細部構成図、第６図は本実施例にお
ける信号レベルの説明図、第７図および第８図はＲ，Ｂ
、Ｇのそれぞれの復調に使用される副搬送波レベルの説
明図。 第９図（α）乃至（Ｃ）および第１０図（α）乃至（Ｃ
）は動作タイミング図、第１１図および第１２図は色復
調器の動作側説明図である。 図中、４はＤ／Ａ変換器、５は低域フィルタＬＰＦ、６
は非線形論理回路、Ｄ。およびＤ＃は並列型のディジタ
ル符号化信号、ＡＪＩ−０はアナログ型の変調信号出力
を示す。 特許出願人 富士通株式会社 代理人弁理士 長谷用 文 廣 （外１名）δ −３２４− ｇ
Claims (3)
- （１）２つの並列型ディジタル符号について並列）；非
線形論理演算を行なう非線形論理回路を設け。 該非線形論理回路に、並列型ディジタル符号化された搬
送波信号と変調信号または被変調信号とを印加して論理
演算を実行し、その演算結果として得られる並列型ディ
ジタル符号化信号から被変調信号または変調信号を取り
出すことを特徴とするディジタル符号化変復調方式。 - （２）前記第１項記載のディジタル符号化変復調方式（
＝おいて、非線型論理回路は、ディジタル符号の各ビッ
トごとに並列に設けた複数の論理ゲートにより構成する
ことを特徴とするディジタル符号化変復調方式。 - （３） 前記第１項または第２項記載のディジタル符
号化変復調方式において、非線型論理回路から出力され
る並列型ディジタル符号化信号を、ディジタル−アナ四
グ変換器に入力し、アナログ信号として出力することを
特徴とするディジタル符号化変復調方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8726383A JPS59212059A (ja) | 1983-05-18 | 1983-05-18 | デイジタル符号化変復調方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8726383A JPS59212059A (ja) | 1983-05-18 | 1983-05-18 | デイジタル符号化変復調方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59212059A true JPS59212059A (ja) | 1984-11-30 |
Family
ID=13909882
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8726383A Pending JPS59212059A (ja) | 1983-05-18 | 1983-05-18 | デイジタル符号化変復調方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59212059A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57183161A (en) * | 1981-05-07 | 1982-11-11 | Nec Corp | 2n-phase phase modulator |
-
1983
- 1983-05-18 JP JP8726383A patent/JPS59212059A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57183161A (en) * | 1981-05-07 | 1982-11-11 | Nec Corp | 2n-phase phase modulator |
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