JPS59195826A - レジスト塗布装置 - Google Patents

レジスト塗布装置

Info

Publication number
JPS59195826A
JPS59195826A JP6918783A JP6918783A JPS59195826A JP S59195826 A JPS59195826 A JP S59195826A JP 6918783 A JP6918783 A JP 6918783A JP 6918783 A JP6918783 A JP 6918783A JP S59195826 A JPS59195826 A JP S59195826A
Authority
JP
Japan
Prior art keywords
substrate
resist
elastic ring
vacuum chuck
chuck plate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6918783A
Other languages
English (en)
Inventor
Eiji Nishimura
英二 西村
Tadahiro Takigawa
忠宏 滝川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP6918783A priority Critical patent/JPS59195826A/ja
Publication of JPS59195826A publication Critical patent/JPS59195826A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Coating Apparatus (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の属する技術外野〕 この発明は、レジストを塗布するためのスピナーを改良
したレジスト塗布装置に関する。
〔従来技術とその問題点〕
近年、′−子ビーム描画技術を用・ハで、サブミクロン
の寸法をもつLSIの製造が行なわれるようになった。
電子ビームは焦点深度が深いと言われ、下地基板の平坦
度についてはさほど関心が払われていなかった。
発明者らは、電子ビームによる描画では加速電圧を従来
の20 K Vから50KVまで高圧化した方が有利で
ちることをみいだした。ところが、加速電圧をあげると
共に焦点深度が浅くなることが判明したみこれは、空間
電荷効果の減少に伴い、電子ビームのボケが小さくなる
ためと考えられる。
焦点深度りの測定を行なったところ、近似的に次の式が
成立することが判明した。
D  =  、tぐ ・ d/α ここでαは最終段レンズの収束半値角、dはビームの直
径、Kは加速′電圧等に依存する比例定数で加速猷圧5
oicv時における値は200 (m rad )であ
る。ビームの直径0.18m1収束半1直角10mra
dでは焦点深度は2.5μm程度となる。
LSIの製造プロセスを辿ったウェーノーは、50μm
以上の凹凸がある。これを平坦化するために、静電気力
を用いる静電チャッキング技術が開兄されている。第1
図は従来用いられている靜′疏チャック装置である。等
電性基板1旧上に絶縁誘電層102を被着してなる本体
103、及びこの静電チャック本体103上に載置され
るウェーハ基板104と導電性基板101との間に高電
圧を印加する電源105から構成され、上記導電性基板
101とウェー・・基板104とが電極として作用する
ものとなっている。
ところが、芙際に静電チャックを用いると、期待される
ような平坦さは得られなかった。この1つの、9 因は
、スピナーベレジストを塗布する際にレジストがウェー
ハ裏面にまわシこむことであること盆つきとめた。第2
図において、201はウェーハ基板、202はウェーハ
上面に塗布されたレジスト、203はウェーハ裏面に貰
わりこんだレジストである。
第3図は、従来のレジスト塗布装置である。
301は、真空チャック板、302は吸着nJ 303
はウェーハである。この様な方法でレジスi・ヲ’y工
1−ハ上に塗布すると、基板裏面にレジストが廻シ込ん
でしまう。
このようなレジストのまわシこみは、光露光技術の分野
でも問題とされ、スピナーを最後に超高速回転すること
でと9除いていた。電子ビーム描画技術の場合は、レジ
ストの分子量が光レジストよフはるか警て大きく、粘度
が高い。それゆえスピナーを最後に高速回転させても、
レジストのまわりこみ゛は防げなかった。このような方
法でレジスト塗布した場合のまわシこみレジストの厚さ
h(第2図)は1〜7μmもあった。このため第1図に
示す、ウェーノ・基板104が斜めに傾いて載置された
〔発明の目的〕
本発明は電子ビームレジストの基板塗布時に、該レジス
トが基板裏面にまわりこまないようなレジスト塗布装置
を提供することである。
〔発明の概要〕
本発明の骨子は、基板に対するレジスト塗布装置の真空
チャック板に弾性リング、例えばゴムのリングを組み込
むことによpレジストが基板裏に廻り込まないようにし
た点にある。
〔発明の効果〕
基板櫻面に廻シ込もうとしたレジストを除去することに
よシ、中外な7ラツトネスが得られた。
〔発明の実施例〕
第4図は、レジストが基板裏面に姉9込まないようにし
た本発明による装置の一実施例を示している。401は
真空チャック板、402は吸着溝、403はウェーハ、
404はゴムのリングである。
このような方法で、真空チャック板4旧の中にゴムのリ
ング404を入れるが、その時ゴムリング404の厚さ
は真空チャック板401よシ多少茜めにしておく。真空
チャック板401の上に、ウェーノー403ヲノせ、ゴ
ムリング404の1隅のはlホ中心に、ウェーハ403
の縁がくるようにしておくことにより、ウェーノ・40
3の裏面に廻シ込もうとしたレジストを除去することが
出来、第2図に示すhが1μ1−rl以下になった。
【図面の簡単な説明】
M1図は従来の静電チャック装置を示す構成図、第2図
は従来のレジストを塗布したウェーノ・の状態を示す説
明図、第3図(a) 、 (b)は従来のレジスト塗布
装置の構成を示す各々平面図及び断面図、第4図(a)
 、 (b)は本発明の一実施例を示す各々平面図及び
断面図である。 401・・・真空チャック板、403・・・ウェーノー
、404・・ゴムリング。 代理人 弁理士 則 近 憲 佑(ほか1名)第  1
 図 1ρ3 第8図

Claims (1)

    【特許請求の範囲】
  1. 基板上に、レジストを塗布するスピンナにおいて、前記
    基板を固定する真空チャック板の基板周辺位置に弾性リ
    ングを設け、該弾性リングの上面は非チャック時に前記
    真空チャック板より多少突出させ、該弾性リングの幅の
    ほぼ中心に、その縁がくる様に前記基板を配置し、前記
    基板を真空吸着する際、該基板の縁が前記弾性り/グに
    多少くい込むことによシ、前記基板裏面にレジストが、
    −Zわシ込まないようにしたことを特徴とするレジスト
    塗布装置。
JP6918783A 1983-04-21 1983-04-21 レジスト塗布装置 Pending JPS59195826A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6918783A JPS59195826A (ja) 1983-04-21 1983-04-21 レジスト塗布装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP6918783A JPS59195826A (ja) 1983-04-21 1983-04-21 レジスト塗布装置

Publications (1)

Publication Number Publication Date
JPS59195826A true JPS59195826A (ja) 1984-11-07

Family

ID=13395468

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6918783A Pending JPS59195826A (ja) 1983-04-21 1983-04-21 レジスト塗布装置

Country Status (1)

Country Link
JP (1) JPS59195826A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61133222A (ja) * 1984-12-04 1986-06-20 Denki Kagaku Kogyo Kk エポキシ樹脂組成物
JP2018533763A (ja) * 2015-10-29 2018-11-15 エーエスエムエル ネザーランズ ビー.ブイ. リソグラフィ装置用基板テーブル、および基板の装填方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61133222A (ja) * 1984-12-04 1986-06-20 Denki Kagaku Kogyo Kk エポキシ樹脂組成物
JPH0477013B2 (ja) * 1984-12-04 1992-12-07 Denki Kagaku Kogyo Kk
JP2018533763A (ja) * 2015-10-29 2018-11-15 エーエスエムエル ネザーランズ ビー.ブイ. リソグラフィ装置用基板テーブル、および基板の装填方法
JP2020118983A (ja) * 2015-10-29 2020-08-06 エーエスエムエル ネザーランズ ビー.ブイ. リソグラフィ装置用基板テーブル、および基板の装填方法

Similar Documents

Publication Publication Date Title
US4554611A (en) Electrostatic chuck loading
JPS60214532A (ja) パタ−ン形成方法
US20240096668A1 (en) Method for producing an individualization zone of an integrated circuit
US20240128119A1 (en) Method for producing an individualization zone of an integrated circuit
JPS59195826A (ja) レジスト塗布装置
EP0138254A1 (en) Electrostatic chuck and loading method
JPS63244844A (ja) イメージ形成方法
US5186788A (en) Fine pattern forming method
JPH0458167B2 (ja)
JPS59197133A (ja) レジスト塗布装置
JP2657392B2 (ja) 回転処理装置
US20240113040A1 (en) Method for producing an individualization zone of an integrated circuit
JPS60153124A (ja) 塗膜形成方法
JPS59500436A (ja) 電子ビ−ム/光学的ハイブリドリソグラフイツクレジスト法
JPS59195827A (ja) レジスト塗布装置
JPS5893327A (ja) 微細加工法
JPH046086B2 (ja)
JP2002100558A (ja) 厚膜レジスト塗布方法
JPS6386434A (ja) レジストパタ−ン形成方法
JPH01187926A (ja) マスク及びレチクルの製造方法
JPH0632673Y2 (ja) レジスト塗布装置
JPS62113134A (ja) 微細パタ−ンの形成方法
KR0164611B1 (ko) 레지스트 패턴 형성방법
JPH02295107A (ja) 半導体装置の製造方法
JPS5934632A (ja) X線マスクの製造方法