JPS5917746A - Fmステレオ復調回路 - Google Patents
Fmステレオ復調回路Info
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- JPS5917746A JPS5917746A JP12868982A JP12868982A JPS5917746A JP S5917746 A JPS5917746 A JP S5917746A JP 12868982 A JP12868982 A JP 12868982A JP 12868982 A JP12868982 A JP 12868982A JP S5917746 A JPS5917746 A JP S5917746A
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- JP
- Japan
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- circuit
- noise
- pulse
- sampling
- signal
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- Pending
Links
- 238000005070 sampling Methods 0.000 claims abstract description 16
- 239000002131 composite material Substances 0.000 claims abstract description 7
- 238000007493 shaping process Methods 0.000 claims abstract description 5
- 230000001360 synchronised effect Effects 0.000 claims description 4
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- 230000008054 signal transmission Effects 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04H—BROADCAST COMMUNICATION
- H04H40/00—Arrangements specially adapted for receiving broadcast information
- H04H40/18—Arrangements characterised by circuits or components specially adapted for receiving
- H04H40/27—Arrangements characterised by circuits or components specially adapted for receiving specially adapted for broadcast systems covered by groups H04H20/53 - H04H20/95
- H04H40/36—Arrangements characterised by circuits or components specially adapted for receiving specially adapted for broadcast systems covered by groups H04H20/53 - H04H20/95 specially adapted for stereophonic broadcast receiving
- H04H40/45—Arrangements characterised by circuits or components specially adapted for receiving specially adapted for broadcast systems covered by groups H04H20/53 - H04H20/95 specially adapted for stereophonic broadcast receiving for FM stereophonic broadcast systems receiving
- H04H40/72—Arrangements characterised by circuits or components specially adapted for receiving specially adapted for broadcast systems covered by groups H04H20/53 - H04H20/95 specially adapted for stereophonic broadcast receiving for FM stereophonic broadcast systems receiving for noise suppression
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G3/00—Gain control in amplifiers or frequency changers
- H03G3/20—Automatic control
- H03G3/30—Automatic control in amplifiers having semiconductor devices
- H03G3/34—Muting amplifier when no signal is present or when only weak signals are present, or caused by the presence of noise signals, e.g. squelch systems
- H03G3/345—Muting during a short period of time when noise pulses are detected, i.e. blanking
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Stereo-Broadcasting Methods (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明にパルス性雑音抑圧回路ケ有す/)FMステレオ
復調回路の性能改善に関するものである。
復調回路の性能改善に関するものである。
第1図にこの種の従来の復調回路である。周波数復調出
力(複合信号)r[バッファ回路tt+v通して信号遅
延回路(2)及び、雑音検出回路(3)に接続される。
力(複合信号)r[バッファ回路tt+v通して信号遅
延回路(2)及び、雑音検出回路(3)に接続される。
遅延回路(2)4経た複合信号はゲート回路(4)を通
ってステレオ復調ノ(ルス発生回路(5)及び該ノ々ル
スによって左右のステレオ信号に振り分けるサンプルホ
ールド回路又はマルチプライア等の復調回路(6)に接
続され出力さり、ゐ〇一方雑音検出回路(3)?経た雑
音信号はワンショットマルチノ(イブレータ等の雑音パ
ルス発生回路(7)によりノ(ルス波形に整形された後
ゲート回路(41に供給名h−/) O従ってパルス性
雑音が発生した場合には、そσ)期間雑音パルスにエフ
ゲート(4)が閉ざされ、雑音2′lX発生−f/)直
前の信号卯′圧がクランプ用キャノ(シタCに貯えられ
ろことにエフ雑音電圧が直接出方に現れないよう抑圧さ
れ/)0 しかるにこのような回路にFM復調された複合信号が復
調回路(6)に至るまでの伝送経路にローノぐスフィル
タ等の遅延回路やクランプ用キャノくシタCが入ること
に19位相σ)乱れ?生じるため、広範囲にわたる高性
能な分離度特性を得られないという欠点を持っている。
ってステレオ復調ノ(ルス発生回路(5)及び該ノ々ル
スによって左右のステレオ信号に振り分けるサンプルホ
ールド回路又はマルチプライア等の復調回路(6)に接
続され出力さり、ゐ〇一方雑音検出回路(3)?経た雑
音信号はワンショットマルチノ(イブレータ等の雑音パ
ルス発生回路(7)によりノ(ルス波形に整形された後
ゲート回路(41に供給名h−/) O従ってパルス性
雑音が発生した場合には、そσ)期間雑音パルスにエフ
ゲート(4)が閉ざされ、雑音2′lX発生−f/)直
前の信号卯′圧がクランプ用キャノ(シタCに貯えられ
ろことにエフ雑音電圧が直接出方に現れないよう抑圧さ
れ/)0 しかるにこのような回路にFM復調された複合信号が復
調回路(6)に至るまでの伝送経路にローノぐスフィル
タ等の遅延回路やクランプ用キャノくシタCが入ること
に19位相σ)乱れ?生じるため、広範囲にわたる高性
能な分離度特性を得られないという欠点を持っている。
本発明((:KかS名欠点?持たない高性能な分離度特
ゲ1−を有するステレオ復訃〕回路、つ捷りFM復調出
カニリステレオ後:A回路に至る伝送紅路tで遅延回路
等の位相擾乱回路?有しないF Mステレオ復調回路ケ
提供すること全目的としている。
ゲ1−を有するステレオ復訃〕回路、つ捷りFM復調出
カニリステレオ後:A回路に至る伝送紅路tで遅延回路
等の位相擾乱回路?有しないF Mステレオ復調回路ケ
提供すること全目的としている。
第2図は本発明の一笑旗例ケ示すブロックダイヤグラム
、第3図はその回路の要部、の例1.第4区1及び第5
図に動作ケ説明するためσ)信号波形例ケ示す0 即ちFM復調さり、た複合信号(第4図s、 )汀入カ
バツファ[Ili経て雑音検出回路(3八副搬送波(3
8KHz)に同期したサンプリングパルス全発生するP
LL 等のサンプリングパルス列ら4L回路(6)及び
ステレオ復調(左右分+Vlf )用ゲート回路(6)
に接続はれる。副搬送波に同期したザンブリングバルス
は左右の分117II度を最適にす/)ために副搬速波
の1/2周期エリも充分小てい時間巾ケ有し、かつ1/
4周期に等しい時間たけ遅れて同期した第1のサンプリ
ングパルス列(第4図b)とし、−7Ch−よりもさら
に副搬送波の1周期以下の適当な時間遅ハ、7に持たし
た里2 tnサンプリングパルス列(第4夕10 )2
発生する遅延回路(8)の出力と共に制御回路1!+1
ic 、7JIJ乏−らり、る。・一方雑音検出回路
(3)で検出さね、た雑音パルス(第4り1d)はパル
ス整形回路t71 T A (、lJ fx r(]σ
)パルスに整形δfまた後制御入力として制御回路(9
)に印加される、制御回路(91Q−J雑音パルスdが
剛力[jされ、でいろル1間、サンプリングパルス列)
〕及びCがゲート回路+8+VC供給きれるのr禁止−
J−る工うに動作する。
、第3図はその回路の要部、の例1.第4区1及び第5
図に動作ケ説明するためσ)信号波形例ケ示す0 即ちFM復調さり、た複合信号(第4図s、 )汀入カ
バツファ[Ili経て雑音検出回路(3八副搬送波(3
8KHz)に同期したサンプリングパルス全発生するP
LL 等のサンプリングパルス列ら4L回路(6)及び
ステレオ復調(左右分+Vlf )用ゲート回路(6)
に接続はれる。副搬送波に同期したザンブリングバルス
は左右の分117II度を最適にす/)ために副搬速波
の1/2周期エリも充分小てい時間巾ケ有し、かつ1/
4周期に等しい時間たけ遅れて同期した第1のサンプリ
ングパルス列(第4図b)とし、−7Ch−よりもさら
に副搬送波の1周期以下の適当な時間遅ハ、7に持たし
た里2 tnサンプリングパルス列(第4夕10 )2
発生する遅延回路(8)の出力と共に制御回路1!+1
ic 、7JIJ乏−らり、る。・一方雑音検出回路
(3)で検出さね、た雑音パルス(第4り1d)はパル
ス整形回路t71 T A (、lJ fx r(]σ
)パルスに整形δfまた後制御入力として制御回路(9
)に印加される、制御回路(91Q−J雑音パルスdが
剛力[jされ、でいろル1間、サンプリングパルス列)
〕及びCがゲート回路+8+VC供給きれるのr禁止−
J−る工うに動作する。
第31121はFET QI J Q2奮スイッナ素子
として用いた制御回路(9)及びゲート回路(6)の要
部の例?示したものであろ0 今、gfL5図a VC示すようl鋭いパルス性雑音N
pが4Th号波形にM畳さh−ゐと制御用雑音パルスd
が生成式れその期間ザンブリングバルスb及びCはグー
) 1!!回路(G1への供給か停止され歯抜けの状態
となる。従って雑音の発生期間その直前のサンプル値が
保持されu1力波形七の如く雑音が直接出力端に伝送で
力、るのt抑圧″fゐことがでさろ0このよって本発明
の回路にはステレオ復調用ゲート回路(6]に至ゐ複合
信号伝送路に遅延回路等の位相擾乱回路?含まず、遅延
機能にゲート回路の2Nのザンブリングバルスvcより
復調と同時に行わせており、高分1=il1度が得られ
/)。
として用いた制御回路(9)及びゲート回路(6)の要
部の例?示したものであろ0 今、gfL5図a VC示すようl鋭いパルス性雑音N
pが4Th号波形にM畳さh−ゐと制御用雑音パルスd
が生成式れその期間ザンブリングバルスb及びCはグー
) 1!!回路(G1への供給か停止され歯抜けの状態
となる。従って雑音の発生期間その直前のサンプル値が
保持されu1力波形七の如く雑音が直接出力端に伝送で
力、るのt抑圧″fゐことがでさろ0このよって本発明
の回路にはステレオ復調用ゲート回路(6]に至ゐ複合
信号伝送路に遅延回路等の位相擾乱回路?含まず、遅延
機能にゲート回路の2Nのザンブリングバルスvcより
復調と同時に行わせており、高分1=il1度が得られ
/)。
以上のように本発明によれば高分離度特性ケ得られるサ
ンプリングカ弐FMステレオ復KIX4回路にパルス性
雑音除去回路を功みに絹合せ自動車用受信機等に最適な
FMステレオ復調回路?安価にかつ高性能に得られる効
果がめ60
ンプリングカ弐FMステレオ復KIX4回路にパルス性
雑音除去回路を功みに絹合せ自動車用受信機等に最適な
FMステレオ復調回路?安価にかつ高性能に得られる効
果がめ60
第1図に従来のパルス性雑音除去回路及びF Mステレ
オ復調回路の一例を下すブロック図1、第2図は本発明
に工ゐパルス性雑音除去回路付FMステレオ復調回路の
ブロック図、孕31ン1はその要部ケ示す回路図、巣4
区1、及び與5図に駆1図及び第2図の回路転作?益明
す^ためのイバ号仮形IXIである0 図中、(3)・・・パルス性雑音検出回路、(5)・・
・サンプリングパルス発生回路、(6)・・・ステレオ
復調用ゲート回路、(7)・・・波形整形回路、(8)
・・・遅延回路、(9)・・・制御回路でろ小。 なお、し1中同−符号は同一またげ相当部分ケ示′tO 代理人 葛野信− 第1図 第2図 第4図
オ復調回路の一例を下すブロック図1、第2図は本発明
に工ゐパルス性雑音除去回路付FMステレオ復調回路の
ブロック図、孕31ン1はその要部ケ示す回路図、巣4
区1、及び與5図に駆1図及び第2図の回路転作?益明
す^ためのイバ号仮形IXIである0 図中、(3)・・・パルス性雑音検出回路、(5)・・
・サンプリングパルス発生回路、(6)・・・ステレオ
復調用ゲート回路、(7)・・・波形整形回路、(8)
・・・遅延回路、(9)・・・制御回路でろ小。 なお、し1中同−符号は同一またげ相当部分ケ示′tO 代理人 葛野信− 第1図 第2図 第4図
Claims (1)
- 副搬送波の1/2周期よりも充分小ない時間巾を有し、
バイ四ット信号(19KHz)工9も略々副搬送波の1
/4周期だけ遅ね、て同期した早1のサンプリングパル
ス列?発生Tるザンブリングパルス発生回路、副搬送波
の1周期以下の時間上記サンプリングパルス列?遅延さ
せ第2のサンプリングパルス列を得る遅延回路、FM復
調された複合信号中のパルス性雑音?検出し、雑音発生
期間パルスを発生する波形整形回路、上記複合信号全開
閉しステレオ復調信号を得ろゲート回路、及び上記雑音
発生期間パルスにもとづき上記第1および舅2のサンプ
リングパルス列の上記ゲート回路への供給を制御する制
御回路に有するFMステレオ復調回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12868982A JPS5917746A (ja) | 1982-07-20 | 1982-07-20 | Fmステレオ復調回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12868982A JPS5917746A (ja) | 1982-07-20 | 1982-07-20 | Fmステレオ復調回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5917746A true JPS5917746A (ja) | 1984-01-30 |
Family
ID=14990985
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12868982A Pending JPS5917746A (ja) | 1982-07-20 | 1982-07-20 | Fmステレオ復調回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5917746A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0377965A2 (en) * | 1989-01-13 | 1990-07-18 | Delco Electronics Corporation | Combined deemphasis circuit and noise blanker |
US5156510A (en) * | 1989-12-05 | 1992-10-20 | Canon Kabushiki Kaisha | Bookbinding cover |
-
1982
- 1982-07-20 JP JP12868982A patent/JPS5917746A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0377965A2 (en) * | 1989-01-13 | 1990-07-18 | Delco Electronics Corporation | Combined deemphasis circuit and noise blanker |
US5156510A (en) * | 1989-12-05 | 1992-10-20 | Canon Kabushiki Kaisha | Bookbinding cover |
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