JPS59168661A - 半導体集積回路の製造方法 - Google Patents
半導体集積回路の製造方法Info
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- JPS59168661A JPS59168661A JP58042550A JP4255083A JPS59168661A JP S59168661 A JPS59168661 A JP S59168661A JP 58042550 A JP58042550 A JP 58042550A JP 4255083 A JP4255083 A JP 4255083A JP S59168661 A JPS59168661 A JP S59168661A
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体集積回路の製造方法C関する。
例えば、シリコンゲー)MO8半導体集積回路に於いて
、熱酸化膜と81 s Na等の耐酸化性物質とからな
る絶縁膜をゲート絶縁膜とする第10〕ゲート電極上に
第2の熱酸化膜を形成し、弓1き続き。
、熱酸化膜と81 s Na等の耐酸化性物質とからな
る絶縁膜をゲート絶縁膜とする第10〕ゲート電極上に
第2の熱酸化膜を形成し、弓1き続き。
第2のゲート電極を前記第1のゲート電極Q〕上音1及
び側面に形成する場合:二、前記耐酸イし性物質Q〕側
面に形成される熱酸化膜が薄いために、前言己第1のゲ
ート電極と前記第2のゲート電極力;ショートしやすく
なり、歩留が期待出来ないという欠、aを有していた。
び側面に形成する場合:二、前記耐酸イし性物質Q〕側
面に形成される熱酸化膜が薄いために、前言己第1のゲ
ート電極と前記第2のゲート電極力;ショートしやすく
なり、歩留が期待出来ないという欠、aを有していた。
不発明は、上記欠点を取り除く有効なる製造方法を枢供
することである。
することである。
本発明の特徴は、半導体集積回路O〕製造(=於いて、
半導体基板上に第1の酸化膜、耐酸化性111G、導電
性多結晶シリコンを順次形成した後感光性樹脂を塗布し
1通常の写真食刻技術(二より前君己導1毬性多結晶シ
リコンを所望の形状にノシターンニングし1次に前記導
電性多結晶シリコンをマスク(二前記耐酸化性膜を過度
にエツチングし引き続き前記第1の酸化膜をエツチング
し前記多結晶シリコンのパターン周辺部をひさし状の形
状とした後に、前記半導体基板を酸化性雰囲気に於いて
第2の酸化膜を形成し、引きつづき導電性被膜を形成す
ることを含む半導体集積回路の製造方法にある。
半導体基板上に第1の酸化膜、耐酸化性111G、導電
性多結晶シリコンを順次形成した後感光性樹脂を塗布し
1通常の写真食刻技術(二より前君己導1毬性多結晶シ
リコンを所望の形状にノシターンニングし1次に前記導
電性多結晶シリコンをマスク(二前記耐酸化性膜を過度
にエツチングし引き続き前記第1の酸化膜をエツチング
し前記多結晶シリコンのパターン周辺部をひさし状の形
状とした後に、前記半導体基板を酸化性雰囲気に於いて
第2の酸化膜を形成し、引きつづき導電性被膜を形成す
ることを含む半導体集積回路の製造方法にある。
まず、従来の方法について説明する。
第1図に示されるように、まず半導体基板1上に、第1
の酸化膜2、耐酸化性物質3及び導電性多結晶シリコン
を順次形成し1通常の写真食刻技術を用いて、所望のパ
ターンが形成されるように感光性樹脂5を残置させる。
の酸化膜2、耐酸化性物質3及び導電性多結晶シリコン
を順次形成し1通常の写真食刻技術を用いて、所望のパ
ターンが形成されるように感光性樹脂5を残置させる。
次に第2図に示すように、パターニングされた感光性樹
脂5をマスクに前記導電性多結晶シリコン4、耐酸化性
物質3、第1の酸化膜2を順次エツチングした後、第3
図に示すように、前記半導体基板1を熱酸化することに
より、第2の酸化膜6を形成する。
脂5をマスクに前記導電性多結晶シリコン4、耐酸化性
物質3、第1の酸化膜2を順次エツチングした後、第3
図に示すように、前記半導体基板1を熱酸化することに
より、第2の酸化膜6を形成する。
最後に第4図に示すように一導電性被膜7を被着し、所
定のパターン(−形成する。
定のパターン(−形成する。
上記、従来法に依れば、第3図の8に示される個所、す
なわち耐酸化性物質の側面に形成される酸化膜が薄くな
るために導電性多結晶シリコン3と導I戴性被着7とが
、第3図の8の個所がセ気的にショートする可能性が高
くなり、そのため;二、期待される歩留が得られないと
いう欠点を有していた。
なわち耐酸化性物質の側面に形成される酸化膜が薄くな
るために導電性多結晶シリコン3と導I戴性被着7とが
、第3図の8の個所がセ気的にショートする可能性が高
くなり、そのため;二、期待される歩留が得られないと
いう欠点を有していた。
本発明は、上記従来法の欠点を補うべくなされたもので
、以下実施例に基づいて説明する。
、以下実施例に基づいて説明する。
まず、半導体基板1上に、第1の酸化膜を熱酸化により
100〜200大形成し、引つづき、気相成長により、
耐酸化性物質3を200〜400X被着し、引きつづき
、気相成長により導電性多結晶シリコンを4000〜6
000 Jy被着し、通常の写真食刻技術により感光性
樹脂5を所望の形状となるよう残置させる。
100〜200大形成し、引つづき、気相成長により、
耐酸化性物質3を200〜400X被着し、引きつづき
、気相成長により導電性多結晶シリコンを4000〜6
000 Jy被着し、通常の写真食刻技術により感光性
樹脂5を所望の形状となるよう残置させる。
次に、バターニングされた感光性樹脂をマスクに、導電
性多結晶シリコン4をエツチングし、前記感光性樹脂5
を除去した後、バター二2ングさゎまた前記導電性多結
晶シリコン4をマスクに、前記耐酸化性物質3を、その
膜厚の2〜3倍リン酸系の液でオーバエッチさせ引き続
き、第1の酸化11Kを7ツ酸系の液で前記耐酸化性物
質3のオーバエッヂ分だけオーバエッチし2、第5図に
示される形状が得られる。
性多結晶シリコン4をエツチングし、前記感光性樹脂5
を除去した後、バター二2ングさゎまた前記導電性多結
晶シリコン4をマスクに、前記耐酸化性物質3を、その
膜厚の2〜3倍リン酸系の液でオーバエッチさせ引き続
き、第1の酸化11Kを7ツ酸系の液で前記耐酸化性物
質3のオーバエッヂ分だけオーバエッチし2、第5図に
示される形状が得られる。
次に、第6図に示されるように、前記半導体基板1を5
00〜600人熱酸化することにより、第2の酸化膜6
を形成する。この工程を経ること(二より、第5図に示
これる。導電性多結晶シリコン4のパターン周辺の空洞
9が前記酸化膜6の形成の際C二、第6図の10に示さ
れるように全て酸化膜10で埋められるために、前記導
電性多結晶シリコン4の側面下部に於ける局部的な酸化
膜厚の減小が防止出来、従来法の欠点ときれていた、第
00〜600人熱酸化することにより、第2の酸化膜6
を形成する。この工程を経ること(二より、第5図に示
これる。導電性多結晶シリコン4のパターン周辺の空洞
9が前記酸化膜6の形成の際C二、第6図の10に示さ
れるように全て酸化膜10で埋められるために、前記導
電性多結晶シリコン4の側面下部に於ける局部的な酸化
膜厚の減小が防止出来、従来法の欠点ときれていた、第
第1図乃至第4図は従来技術を示す断面図であり、第5
図乃至第7図は本発明の実施例を示す断面図である。 1・・・・・・半導体基板、2・・・・・・第1の酸化
膜、3・・・・・・耐酸化性物質、4・・・・・・導電
性多結晶シリコン、5・・・・・・感光性樹脂、6・・
・・・・第2の酸化膜、7・・・・・・導電性被膜、8
・・・・・・第1の酸化膜の膜厚の局部的に薄い部分、
9・・・・・・導電性多結晶シリコン下部の空洞、10
・・・・・・導電性多結晶シリコン下部C二形成される
第2の酸化膜。
図乃至第7図は本発明の実施例を示す断面図である。 1・・・・・・半導体基板、2・・・・・・第1の酸化
膜、3・・・・・・耐酸化性物質、4・・・・・・導電
性多結晶シリコン、5・・・・・・感光性樹脂、6・・
・・・・第2の酸化膜、7・・・・・・導電性被膜、8
・・・・・・第1の酸化膜の膜厚の局部的に薄い部分、
9・・・・・・導電性多結晶シリコン下部の空洞、10
・・・・・・導電性多結晶シリコン下部C二形成される
第2の酸化膜。
Claims (1)
- 【特許請求の範囲】 半導体基板上に第1の酸化膜、耐酸化性膜、導電性多結
晶シリコンを順次形成した後感光性樹脂を塗布し、通常
の写真食刻技術により前記導電性多結晶シリコンを所望
の形状にパターン周辺部し。 次に前記導電性多結晶シリコンをマスクに前記耐酸化性
膜を過度にエツチングし引き続き前記第1の酸化膜をエ
ツチングし前記多結晶シリコンのパターン周辺部をひさ
し状の形状とした後に、前記半導体基板を酸化性雰囲気
に於いて第2の酸化膜を形成し、引きつづき導電性被膜
を形成することを含むことを特徴とする半導体集積回路
の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58042550A JPS59168661A (ja) | 1983-03-15 | 1983-03-15 | 半導体集積回路の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58042550A JPS59168661A (ja) | 1983-03-15 | 1983-03-15 | 半導体集積回路の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS59168661A true JPS59168661A (ja) | 1984-09-22 |
Family
ID=12639159
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58042550A Pending JPS59168661A (ja) | 1983-03-15 | 1983-03-15 | 半導体集積回路の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59168661A (ja) |
-
1983
- 1983-03-15 JP JP58042550A patent/JPS59168661A/ja active Pending
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