JPS5915559B2 - 信号検出方式 - Google Patents
信号検出方式Info
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- JPS5915559B2 JPS5915559B2 JP51023821A JP2382176A JPS5915559B2 JP S5915559 B2 JPS5915559 B2 JP S5915559B2 JP 51023821 A JP51023821 A JP 51023821A JP 2382176 A JP2382176 A JP 2382176A JP S5915559 B2 JPS5915559 B2 JP S5915559B2
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- JP
- Japan
- Prior art keywords
- signal
- circuit
- value
- threshold
- signal detection
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q1/00—Details of selecting apparatus or arrangements
- H04Q1/18—Electrical details
- H04Q1/30—Signalling arrangements; Manipulation of signalling currents
- H04Q1/44—Signalling arrangements; Manipulation of signalling currents using alternate current
- H04Q1/444—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies
- H04Q1/446—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency
- H04Q1/448—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency with conversion of a single frequency signal into a digital signal
- H04Q1/4485—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using one signalling frequency with conversion of a single frequency signal into a digital signal which is transmitted in digital form
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
- Mobile Radio Communication Systems (AREA)
Description
【発明の詳細な説明】
本発明はディジタル信号の信号検出方式に関するもので
ある。
ある。
一般に複数種類の信号が混合された入力信号の１０中か
ら特定の種類の信号を１つ抽出するような場合ディジタ
ル受信器の構成としては、いわゆるｚ変換によるディジ
タルフィルタを用いるもの、あるいは相関器を用いた信
号検出方式のものが考えられているが、装置構成上、後
者の方が簡単であ１５る。
ら特定の種類の信号を１つ抽出するような場合ディジタ
ル受信器の構成としては、いわゆるｚ変換によるディジ
タルフィルタを用いるもの、あるいは相関器を用いた信
号検出方式のものが考えられているが、装置構成上、後
者の方が簡単であ１５る。
この相関器を用いた信号検出方式は、例えば「ＰＣＭ通
信の基礎と新技術（３．３ディジタル情報の検出）」猪
瀬博著（株式会社産報１９６８年６月１０日発行）に詳
述されているのでここではク０ その原理を簡単に説明
する。
信の基礎と新技術（３．３ディジタル情報の検出）」猪
瀬博著（株式会社産報１９６８年６月１０日発行）に詳
述されているのでここではク０ その原理を簡単に説明
する。
今、説明を簡単にするためにアナログ信号に関しての信
号検出方式を例にとる。
号検出方式を例にとる。
例えば高周波数の信号と低周波の信号とを組合せて情報
転送を行うＭＦ信号を例にとると、人力ノ５ 信号ｙが
ｙ−ＡＬｓｉｎ（ωＬｔ＋θＬ）＋ＡＨｓｉｎ（ωＨｔ
＋θＨ）の２つの正弦波が混合されたものとし、このう
ち信号Ａｌ、Ｓｉｎ（ωＬｔ＋θＬ）を検出するものと
する。
転送を行うＭＦ信号を例にとると、人力ノ５ 信号ｙが
ｙ−ＡＬｓｉｎ（ωＬｔ＋θＬ）＋ＡＨｓｉｎ（ωＨｔ
＋θＨ）の２つの正弦波が混合されたものとし、このう
ち信号Ａｌ、Ｓｉｎ（ωＬｔ＋θＬ）を検出するものと
する。
ただし、ここでＬのサフイツクスがついたもの］ ■０
は低周波の、Ｈは高周波の信号を示す。入力信号ｙの
電力スペクトラムＹ（一はＹ（ω）■Ｔｉヱ÷ＩｆＴｏ
ｙｅ−ｊωｔｄｔ１２（１）二”５により計算される。
は低周波の、Ｈは高周波の信号を示す。入力信号ｙの
電力スペクトラムＹ（一はＹ（ω）■Ｔｉヱ÷ＩｆＴｏ
ｙｅ−ｊωｔｄｔ１２（１）二”５により計算される。
そこてべ１）式においてωにωＬを代入すればωＬにお
ける電力が計算され、その結果Ｙ（ωＬ）が一定値以上
であれば信号ＡＬ８ｌｎ（ωＬｔ＋θＬ）ありと判定す
る。
ける電力が計算され、その結果Ｙ（ωＬ）が一定値以上
であれば信号ＡＬ８ｌｎ（ωＬｔ＋θＬ）ありと判定す
る。
従つて相関器によるデイジタル信号受信器は、ｙ−ＡＬ
８ｌｎ（ωＬｔ＋θＬ）＋ＡＨ８ｌｎ（ω１１ｔ＋θＨ
）の合成液を所定のサンプリング周期でサンプリングし
、それぞれのサンプリング値をデジタル変換した結果を
（１）式で有限期間Ｔにわたつて演算するものである。
以下、本発明を図面を参照して説明する。
８ｌｎ（ωＬｔ＋θＬ）＋ＡＨ８ｌｎ（ω１１ｔ＋θＨ
）の合成液を所定のサンプリング周期でサンプリングし
、それぞれのサンプリング値をデジタル変換した結果を
（１）式で有限期間Ｔにわたつて演算するものである。
以下、本発明を図面を参照して説明する。
第１図は従来のデイジタル受信器の回路構成を表す図で
、１は入力端、２および４は積回路、３は遅延回路、５
および７は累積加算器、８および１０は二乗回路、６は
アナログデイジタル変換回路、９は局部発振器、１１は
加算器、１２は比較器、１３は閾値設定回路、１４は出
力端を示す。
、１は入力端、２および４は積回路、３は遅延回路、５
および７は累積加算器、８および１０は二乗回路、６は
アナログデイジタル変換回路、９は局部発振器、１１は
加算器、１２は比較器、１３は閾値設定回路、１４は出
力端を示す。
局部発振器９はアナログ信号の特定角周波数ω１をもつ
正弦波Ｓｉｎ（ωＬｔ＋θ）を発生し、アナログデイジ
タル変換回路６を通つてデイジタル化されたＳｉｎ（ω
Ｌｔ＋θ）が積回路２に、また、遅延回路を通つてπ／
２位相の遅れたＣＯｓ（ωＬｔ＋θ）が積回路４に加わ
る。
正弦波Ｓｉｎ（ωＬｔ＋θ）を発生し、アナログデイジ
タル変換回路６を通つてデイジタル化されたＳｉｎ（ω
Ｌｔ＋θ）が積回路２に、また、遅延回路を通つてπ／
２位相の遅れたＣＯｓ（ωＬｔ＋θ）が積回路４に加わ
る。
そこで入力端１に入カデイジタル信号ｙ（ｔ）を与える
と積回路２および４においてｙ（ｔ）×Ｓｉｎ（ωＬｔ
＋θ）およびｙ（ｔ）×ＣＯｓ（ωＬｔ＋θ）が行われ
、累積加算器５および７で各積が期間Ｔだけ累積される
。これは（１）式における期間０−Ｔの積分に相当する
。さらに累積加算器５および７の値は、それぞれ二乗回
路８および１０で二乗され、その値が加算器１１で加算
される。
と積回路２および４においてｙ（ｔ）×Ｓｉｎ（ωＬｔ
＋θ）およびｙ（ｔ）×ＣＯｓ（ωＬｔ＋θ）が行われ
、累積加算器５および７で各積が期間Ｔだけ累積される
。これは（１）式における期間０−Ｔの積分に相当する
。さらに累積加算器５および７の値は、それぞれ二乗回
路８および１０で二乗され、その値が加算器１１で加算
される。
これは（１）式における絶対値の二乗に相当する。
加算結果は比較回路１２で閾値設定回路１３に予め設定
された値との比較が行われ、閾値を越えた時に出力端に
、信号ありとして出力信号が発生する。第２図ａは第１
図の二乗回路８の構成概略図である。
された値との比較が行われ、閾値を越えた時に出力端に
、信号ありとして出力信号が発生する。第２図ａは第１
図の二乗回路８の構成概略図である。
ここで８１および８２はレジスタ、８２は加算器を示し
、二乗回路１０も全く同じ構成である。この回路構成は
情報処理学会編「電子計算機・・ンドブツク」（昭和４
１年５月２５日発行）等に示された公知の乗算器の構成
を概略的に表わしたもので、その詳細な乗法演算操作は
前述の刊行物に詳述されているので、ここでは省略する
が、これらレジスタ、加算器を用いて加算や（桁の）シ
フトを複数回にわたつて行い、二乗計算をするものであ
る。従つて、このような二乗回路は複数個のレジスタや
加算器を必要とするので、一・−トウエアが大きくなる
と共にハードウエアの有効利用を図るため時分割多重使
用を試みても、二乗演算に際して、加算や（桁の）シフ
トを複数回行わねばならないので演算時間が長くなり、
この演算速度による制限のため、余り多重度を大きくす
ることができないという欠点を有する。
、二乗回路１０も全く同じ構成である。この回路構成は
情報処理学会編「電子計算機・・ンドブツク」（昭和４
１年５月２５日発行）等に示された公知の乗算器の構成
を概略的に表わしたもので、その詳細な乗法演算操作は
前述の刊行物に詳述されているので、ここでは省略する
が、これらレジスタ、加算器を用いて加算や（桁の）シ
フトを複数回にわたつて行い、二乗計算をするものであ
る。従つて、このような二乗回路は複数個のレジスタや
加算器を必要とするので、一・−トウエアが大きくなる
と共にハードウエアの有効利用を図るため時分割多重使
用を試みても、二乗演算に際して、加算や（桁の）シフ
トを複数回行わねばならないので演算時間が長くなり、
この演算速度による制限のため、余り多重度を大きくす
ることができないという欠点を有する。
本発明は、これらの欠点を解決し、回路構成の簡単な、
また演算時間が短かく、多重度の大きくとれるデイジタ
ル受信器を提供するものである。
また演算時間が短かく、多重度の大きくとれるデイジタ
ル受信器を提供するものである。
第２図ｂは第２図ａの回路における信号検出の原理を示
したものである。ここでＸ。
したものである。ここでＸ。
．Ｘ８は（１）式におけるＶ′１′ｙ（ｔ）８−ｊ（ｉ
）Ｌｔｄｔの余弦成分、正弦成分を示す。
）Ｌｔｄｔの余弦成分、正弦成分を示す。
従つて．５′１′ｙ（ｔ）ｅ−ＪＯＬｔｄｔ＝ＸＯ＋Ｊ
ｘ８と表わせ、電力はＩｆ′ＦＯｙ（ｔ）ｅ−ＪＯＬｔ
ｄｔＩ２＝Ｘ２ｃ＋Ｘ２−Ｒ２となり、Ｒ２が一定値を
越えるか否かＳで信号の有無を判定する。
ｘ８と表わせ、電力はＩｆ′ＦＯｙ（ｔ）ｅ−ＪＯＬｔ
ｄｔＩ２＝Ｘ２ｃ＋Ｘ２−Ｒ２となり、Ｒ２が一定値を
越えるか否かＳで信号の有無を判定する。
又ｂでｒ〉ＲＯの領域は信号有りと判定すべき領域、ｒ
＜Ｒ，の領域は信号無しと判定すべき領域でｒ１〈ｒ＜
ＲＯの領域は信号有りと判定すべきか、信号無しと判定
すべきか確定しない領域であるので、閾値設定回路１３
の設定値をＲ２−（ＲＯ＋ｒ１）２とし、Ｘ２ｃ＋Ｘ２
８≧（−２−）２の時に信号有りと判定するのが一般で
あつた。しかしながら、このような閾値の設定に当つて
はこの不確定な領域内（ｒ１くｒ＜ＲＯ）ならば、適当
な任意のレベルに設定することができる。
＜Ｒ，の領域は信号無しと判定すべき領域でｒ１〈ｒ＜
ＲＯの領域は信号有りと判定すべきか、信号無しと判定
すべきか確定しない領域であるので、閾値設定回路１３
の設定値をＲ２−（ＲＯ＋ｒ１）２とし、Ｘ２ｃ＋Ｘ２
８≧（−２−）２の時に信号有りと判定するのが一般で
あつた。しかしながら、このような閾値の設定に当つて
はこの不確定な領域内（ｒ１くｒ＜ＲＯ）ならば、適当
な任意のレベルに設定することができる。
本発明はこのことを利用して信号の有無を判定するため
の閾値を不確定な領域内で直線で表わされるレベルとし
、この閾値と比較する値を二乗和（Ｘ２ｃ＋Ｘ２８）の
演算により求めるのではなく、より簡単な処理、例えば
Ｉ＋、あるいは単に叉はＸ。そのものとすることに特徴
がある。第３図は従来の構成を簡素化し得る１例を示す
図でｂに示すように閾値をｒ１くｒ＜ＲＯの領域内で二
本の直線としこれら二本の直線で示される閾値とｊ又は
Ｘ８そのものの値とを比較するものであり、ａはこれを
実現するための回路構成図である。ａにおいて３１は比
較回路、３２，３３はアンド回路、３４はオア回路を示
し、その他は第１図と同じものを示す。
の閾値を不確定な領域内で直線で表わされるレベルとし
、この閾値と比較する値を二乗和（Ｘ２ｃ＋Ｘ２８）の
演算により求めるのではなく、より簡単な処理、例えば
Ｉ＋、あるいは単に叉はＸ。そのものとすることに特徴
がある。第３図は従来の構成を簡素化し得る１例を示す
図でｂに示すように閾値をｒ１くｒ＜ＲＯの領域内で二
本の直線としこれら二本の直線で示される閾値とｊ又は
Ｘ８そのものの値とを比較するものであり、ａはこれを
実現するための回路構成図である。ａにおいて３１は比
較回路、３２，３３はアンド回路、３４はオア回路を示
し、その他は第１図と同じものを示す。
いま、累積加算器５で３′ＲｆＯｙｅ−ＪＣｌ）Ｔｄｔ
の正弦成分Ｘ８が、累積加算器７で余弦成分Ｘ。
の正弦成分Ｘ８が、累積加算器７で余弦成分Ｘ。
が計算されると、比較回路３１でＸ８とＩの大小を比較
する。比較回路３１は例えばＸ８≧Ｘｃの時に出力１１
を送出する回路でＸ８≧ＸＯの場合にはアンド回路３２
をが通過し、オア回路３４を介して比較回路１２に達す
る。一方、Ｘ８〈Ｘｃの場合にはアンド回路３３をＸｃ
が通過し、オア回路３４を介して比較回路１２に達する
。即ち、ＸｃとＸｓのうちどちらか大きい方を比較回路
１２で閾値設定回路１３の閾値と比較するもので、ｂに
おいてＸ８≧Ｘｃの時にはＸ８と閾値Ｔｈｓを、Ｘ８〈
ＸＯの時にはＸ。
する。比較回路３１は例えばＸ８≧Ｘｃの時に出力１１
を送出する回路でＸ８≧ＸＯの場合にはアンド回路３２
をが通過し、オア回路３４を介して比較回路１２に達す
る。一方、Ｘ８〈Ｘｃの場合にはアンド回路３３をＸｃ
が通過し、オア回路３４を介して比較回路１２に達する
。即ち、ＸｃとＸｓのうちどちらか大きい方を比較回路
１２で閾値設定回路１３の閾値と比較するもので、ｂに
おいてＸ８≧Ｘｃの時にはＸ８と閾値Ｔｈｓを、Ｘ８〈
ＸＯの時にはＸ。
と閾値Ｔｈｃとを比較する。閾値Ｔｈｓ．Ｔｈｃについ
て好ましい値としての１例は図から明らかなようにＴｈ
ｓ＝ＴｈｃｌｒＯ＝一（一＋ｒ）であり、閾値設定回路
１３には２ ／ｈ ゛１ｒ０ 一（−＋ｒ１）を予め設定しておく。
て好ましい値としての１例は図から明らかなようにＴｈ
ｓ＝ＴｈｃｌｒＯ＝一（一＋ｒ）であり、閾値設定回路
１３には２ ／ｈ ゛１ｒ０ 一（−＋ｒ１）を予め設定しておく。
２ ／ｈ
叉、他の構成として累積加算器５からのＸ８と累積加算
器７からのＸ。
器７からのＸ。
の値をそれぞれ閾値１ｒ０一（一＋ｒ１）を持つ２つの
比較回路で比較し、２ｆ２それぞれの出力をオア回路で
結んでも同様に信号検出が可能である。
比較回路で比較し、２ｆ２それぞれの出力をオア回路で
結んでも同様に信号検出が可能である。
これらの信号検出方式ではＸ，ｘＯの値について何らの
演算も行なわず、比較動作を行うだけなので信号検出の
ための処理時間が短かくなるという利点を有する。また
第３図で示した信号検出回路をさらに単純化したものと
して、第４図に閾値を直線化した１例を示す。
演算も行なわず、比較動作を行うだけなので信号検出の
ための処理時間が短かくなるという利点を有する。また
第３図で示した信号検出回路をさらに単純化したものと
して、第４図に閾値を直線化した１例を示す。
第４図では、ｂに示すように閾値をｒ１〈ｒ＜ＲＯの領
域内で一本の直線とし、この一本の直線で示される閾値
とｊとＸ８の和（ＸＯ＋Ｘｓ）を比較するものであり、
ａはこれを実現するための回路構成図である。４１は加
算器を示し、その他は第１図と同じものを示す。
域内で一本の直線とし、この一本の直線で示される閾値
とｊとＸ８の和（ＸＯ＋Ｘｓ）を比較するものであり、
ａはこれを実現するための回路構成図である。４１は加
算器を示し、その他は第１図と同じものを示す。
ａにおいて累積加算器６，７でＸ８、ＸＯが計算される
と、これらを加算器４１で加算し、Ｘ８＋ＸＣをｂの閾
値Ｔｈｌと比較回路１２で比較する。閾値Ｔｈｌの好ま
しい値の１例としてはｂから明らかなようにＴｈＩ−＝
１−（１ｉｒ１＋ＲＯ）であり閾値設定回路１３には人
（ｊ】ｒ１＋ＲＯ）を予め設定しておく。この方式はＸ
ｃとの値を単に加算するだけなので、演算始間が短かい
と共に加算器だけを用いるので回路構成が簡単であると
いう利点を有する。
と、これらを加算器４１で加算し、Ｘ８＋ＸＣをｂの閾
値Ｔｈｌと比較回路１２で比較する。閾値Ｔｈｌの好ま
しい値の１例としてはｂから明らかなようにＴｈＩ−＝
１−（１ｉｒ１＋ＲＯ）であり閾値設定回路１３には人
（ｊ】ｒ１＋ＲＯ）を予め設定しておく。この方式はＸ
ｃとの値を単に加算するだけなので、演算始間が短かい
と共に加算器だけを用いるので回路構成が簡単であると
いう利点を有する。
これら第３図、第４図に示す構成により信号検出回路を
簡素化できるが、第３図、第４図の各ｂ図でも明らかな
如く、信号有無判定の不確定領域（ｒ１くｒ＜ＲＯ）は
、信号無しを判定すべき領域（ｒ１くｒ）の大きさ等に
よりある程度余裕（マージン）が必要となる。また、第
３図の構成では、矩形内側領域では信号有と判定し得る
部分も多く切捨てられ、第４図の構成ではＸｓあるいは
Ｘ。のいずれも相当のマージンが必要となり、第１図に
比べても有効領域の拡大には不利な面が生じる。本発明
は、かかる構成をさらに改良し、回路構成上では、Ｘ８
あるいはＸｃの一方にデコーダ及びメモリを用いて各値
に対応して閾値を設定し、該値に対する他方のＸ。ある
いはＸ８の値と比較するようにし、判定領域を有効に且
つ、簡単な回転構成で、信号検出を可能とする方式を提
供する。第５図は、本発明の実施例を示す図でｂに示す
ように閾値をｒ１〈ｒ＜ＲＯの領域内でステツプ状とし
、各Ｘ８に対応して予め定められた値を閾値とし、対応
するＸ。と比較するものであり、ａはこれを実現するた
めの回路構成図である。５１はデコーダ、５２はメモリ
、その他は第１図と同じものを示す。
簡素化できるが、第３図、第４図の各ｂ図でも明らかな
如く、信号有無判定の不確定領域（ｒ１くｒ＜ＲＯ）は
、信号無しを判定すべき領域（ｒ１くｒ）の大きさ等に
よりある程度余裕（マージン）が必要となる。また、第
３図の構成では、矩形内側領域では信号有と判定し得る
部分も多く切捨てられ、第４図の構成ではＸｓあるいは
Ｘ。のいずれも相当のマージンが必要となり、第１図に
比べても有効領域の拡大には不利な面が生じる。本発明
は、かかる構成をさらに改良し、回路構成上では、Ｘ８
あるいはＸｃの一方にデコーダ及びメモリを用いて各値
に対応して閾値を設定し、該値に対する他方のＸ。ある
いはＸ８の値と比較するようにし、判定領域を有効に且
つ、簡単な回転構成で、信号検出を可能とする方式を提
供する。第５図は、本発明の実施例を示す図でｂに示す
ように閾値をｒ１〈ｒ＜ＲＯの領域内でステツプ状とし
、各Ｘ８に対応して予め定められた値を閾値とし、対応
するＸ。と比較するものであり、ａはこれを実現するた
めの回路構成図である。５１はデコーダ、５２はメモリ
、その他は第１図と同じものを示す。
デコーダ５１は累積加算器５の計算結果Ｘ８の値により
メモリ５２の１番地を指定するものであり、メモリ５２
は、例えばリード・オンリー・メモリ（ＲＯＭ）でＢｆ
）Ｔｈｍに示されるようなＸ８の値に対応したＩの値を
記憶しているメモリである。
メモリ５２の１番地を指定するものであり、メモリ５２
は、例えばリード・オンリー・メモリ（ＲＯＭ）でＢｆ
）Ｔｈｍに示されるようなＸ８の値に対応したＩの値を
記憶しているメモリである。
いま累積加算器５，７でＸ８、ＸＯが計算されＸ８−Ｘ
８ｌである場合を例にとると、Ｘ８ｌがデコーダ５１で
デコードされてメモリ５２の一番地を指定する。指定さ
れた番地にはＸｃｌの値が記憶されており、これが読出
されて累積加算器７からのＸｃと比較回路１２で比較さ
れる。この方式はｒ１とＲ。の値が接近してｒ１くｒ＜
ＲＯの領域が狭い場合でも直線的な閾値レベルの設定が
できる、従つてＸｃとＸｓについての簡単な処理で済む
という利点をもつ。以上から明らかなように本発明によ
れば簡単な回路構成で・・−トウエアは大きくならず、
又、加算を複数回繰り返すこともなく演算時間も短縮で
き、時分割多重化において充分にその多重度を大きくす
ることができる。
８ｌである場合を例にとると、Ｘ８ｌがデコーダ５１で
デコードされてメモリ５２の一番地を指定する。指定さ
れた番地にはＸｃｌの値が記憶されており、これが読出
されて累積加算器７からのＸｃと比較回路１２で比較さ
れる。この方式はｒ１とＲ。の値が接近してｒ１くｒ＜
ＲＯの領域が狭い場合でも直線的な閾値レベルの設定が
できる、従つてＸｃとＸｓについての簡単な処理で済む
という利点をもつ。以上から明らかなように本発明によ
れば簡単な回路構成で・・−トウエアは大きくならず、
又、加算を複数回繰り返すこともなく演算時間も短縮で
き、時分割多重化において充分にその多重度を大きくす
ることができる。
さらには、本発明では閾値をメモリに格納し、デコーダ
により入力値に対応した閾値を抽出することにより、上
述した判定領域の変更等を容易とし、フレキシブルな信
号検出方式を提供できる。
により入力値に対応した閾値を抽出することにより、上
述した判定領域の変更等を容易とし、フレキシブルな信
号検出方式を提供できる。
第１図は従来のデイジタル受信器の回路構成を示す図、
第２図においてａは第１図における二乗回路８の詳細図
、ｂはａにおける閾値を示す図、第３図、第４図は従来
の回路構成を簡単化し得る例を示し、ａ図は回路構成、
ｂ図はその閾値領域をそれぞれ示す図、第５図は、本発
明の実施例を示し、ａ図はその該当部分、ｂ図は本発明
による閾値領域を示す図である。 ２，４は積回路、３は遅延回路、５，７は累積加算器、
８，９は二乗回路、１１は加算器、１２は比較回路、１
３は閾値設定回路、８１，８３はレジスタ、８２は加算
器、３１は比較回路、３２，３３はアンド回路、３４は
オア回路、４１は加算器、５１はデコーダ、５２はメモ
リ、ＴＯ，Ｔｈｓ，Ｔｈｃ，Ｔｈｌ，Ｔｈｍはそれぞれ
閾値を示す。
第２図においてａは第１図における二乗回路８の詳細図
、ｂはａにおける閾値を示す図、第３図、第４図は従来
の回路構成を簡単化し得る例を示し、ａ図は回路構成、
ｂ図はその閾値領域をそれぞれ示す図、第５図は、本発
明の実施例を示し、ａ図はその該当部分、ｂ図は本発明
による閾値領域を示す図である。 ２，４は積回路、３は遅延回路、５，７は累積加算器、
８，９は二乗回路、１１は加算器、１２は比較回路、１
３は閾値設定回路、８１，８３はレジスタ、８２は加算
器、３１は比較回路、３２，３３はアンド回路、３４は
オア回路、４１は加算器、５１はデコーダ、５２はメモ
リ、ＴＯ，Ｔｈｓ，Ｔｈｃ，Ｔｈｌ，Ｔｈｍはそれぞれ
閾値を示す。
Claims (1)
- １ 入力信号ｙ（ｔ）に対して特定の角周波数ω＿０に
ついての有限時間Ｔにわたるフーリエ積分▲数式、化学
式、表等があります▼の正弦成分をｘ＿ｓ（≧０）、余
弦成分をｘ＿ｃ（≧０）としたときにｘ＿ｓ−ｘ＿ｃ平
面上で信号有りと判定すべき領域と信号無しと判定すべ
き領域との間の不確定な領域に閾値を設け、該ｘ＿ｓと
ｘ＿ｃの値の処理結果が該閾値を越えるか否かで、特定
角周波数ω＿０をもつ信号の有無を決定する信号検出方
式において、前記正弦成分Ｘ＿ｓあるいは前記余弦成分
Ｘ＿ｃの各値に対応して予め定められた閾値と、前記Ｘ
＿ｓあるいは前記Ｘ＿ｃに対するＸ＿ｃあるいはＸ＿ｓ
の値とを比較することを特徴とする信号検出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51023821A JPS5915559B2 (ja) | 1976-03-04 | 1976-03-04 | 信号検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51023821A JPS5915559B2 (ja) | 1976-03-04 | 1976-03-04 | 信号検出方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS52106614A JPS52106614A (en) | 1977-09-07 |
| JPS5915559B2 true JPS5915559B2 (ja) | 1984-04-10 |
Family
ID=12121009
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP51023821A Expired JPS5915559B2 (ja) | 1976-03-04 | 1976-03-04 | 信号検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5915559B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5829035B2 (ja) * | 1978-09-28 | 1983-06-20 | 沖電気工業株式会社 | 信号検出方式 |
| JPS57143970A (en) * | 1981-03-02 | 1982-09-06 | Nec Corp | Self-testing system for multifrequency signal receiver |
-
1976
- 1976-03-04 JP JP51023821A patent/JPS5915559B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS52106614A (en) | 1977-09-07 |
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