JPS59140777A - 垂直同期装置 - Google Patents
垂直同期装置Info
- Publication number
- JPS59140777A JPS59140777A JP1487883A JP1487883A JPS59140777A JP S59140777 A JPS59140777 A JP S59140777A JP 1487883 A JP1487883 A JP 1487883A JP 1487883 A JP1487883 A JP 1487883A JP S59140777 A JPS59140777 A JP S59140777A
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- JP
- Japan
- Prior art keywords
- vertical
- pulse
- circuit
- composite
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/08—Separation of synchronising signals from picture signals
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Synchronizing For Television (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はテレにジョン受像機等の垂直同期装置に係り、
特に集積回路化によって、垂直積分用の端子が不要とさ
れた垂直同期装置に関する。
特に集積回路化によって、垂直積分用の端子が不要とさ
れた垂直同期装置に関する。
従来例の構成とその問題点
垂直同期装置は、複合映像信号より複合同期信号を導出
させる同期分離回路と、前記複合同期信号より垂直同期
パルスを導出させる垂直積分回路と、前記垂直同期パル
スに同期される垂直発振器から構成される。
させる同期分離回路と、前記複合同期信号より垂直同期
パルスを導出させる垂直積分回路と、前記垂直同期パル
スに同期される垂直発振器から構成される。
第１図は、従来の垂直同期装置の概要を示すブロック図
である。以下、構成とともに動作について説明する。
である。以下、構成とともに動作について説明する。
図中、点線内の１は集積回路装置を示す。複合映像信号
が入力端子２に加えられると、同期分離回路３によって
、映像信号と複合同期信号とは分離され、複合同期信号
のみが、同期分離出力端子４に出力される。この複合同
期信号は、垂直同期パルス、水平同期パルスおよび等化
パルスがａ合されたものである。ところで、垂直同期装
置には、垂直同期パルスが必要であり、このために、抵
抗５とコンデンサ６からなる第１段目の積分回路と、抵
抗７とコンデンサ８からなる第２段目の積分回路に、前
記複合同期信号を加えることによって、水平同期パルス
および等化パルスを除去し、垂直同期パルスのみを導出
することができる。
が入力端子２に加えられると、同期分離回路３によって
、映像信号と複合同期信号とは分離され、複合同期信号
のみが、同期分離出力端子４に出力される。この複合同
期信号は、垂直同期パルス、水平同期パルスおよび等化
パルスがａ合されたものである。ところで、垂直同期装
置には、垂直同期パルスが必要であり、このために、抵
抗５とコンデンサ６からなる第１段目の積分回路と、抵
抗７とコンデンサ８からなる第２段目の積分回路に、前
記複合同期信号を加えることによって、水平同期パルス
および等化パルスを除去し、垂直同期パルスのみを導出
することができる。
上記、第１段目および第２段目の積分回路で導出された
垂直同期パルスは、垂直同期パルス入力端子９に加えら
れ、垂直発振器１０を同期させるように作用する。ここ
で、１１は垂直発振出力部、１２は垂直発振入力端子、
１３は発振用コンデンサ、１４は垂直ホールドボリュー
ム、そして１５は電源端子である。
垂直同期パルスは、垂直同期パルス入力端子９に加えら
れ、垂直発振器１０を同期させるように作用する。ここ
で、１１は垂直発振出力部、１２は垂直発振入力端子、
１３は発振用コンデンサ、１４は垂直ホールドボリュー
ム、そして１５は電源端子である。
第１図のｉ置を単一半導体基板内に集積回路化する場合
、積分回路の構成要素となる抵抗６，７およびコンデン
サ６．８を半導体集積回路内に作り込むことは不可能に
近い。このことは、半導体集積回路内へ作り込捷れるコ
ンデンサは最大数十ＰＦ程度であって、積分回路、とり
わけ垂直積分回路を構成するには小さすぎることと、抵
抗も大きな値が必要であり、半導体集積回路内で積分回
路を構成することがむずかしいことに依拠する。
、積分回路の構成要素となる抵抗６，７およびコンデン
サ６．８を半導体集積回路内に作り込むことは不可能に
近い。このことは、半導体集積回路内へ作り込捷れるコ
ンデンサは最大数十ＰＦ程度であって、積分回路、とり
わけ垂直積分回路を構成するには小さすぎることと、抵
抗も大きな値が必要であり、半導体集積回路内で積分回
路を構成することがむずかしいことに依拠する。
さらに、垂直同期パルス入力端子９を集積回路装置１の
端子として用意しなければならず、このことは、多機能
な集積回路装置を望む場合、それぞれの機能に用いる端
子の数をできうる限り少く構成することに反することと
なる。
端子として用意しなければならず、このことは、多機能
な集積回路装置を望む場合、それぞれの機能に用いる端
子の数をできうる限り少く構成することに反することと
なる。
発明の目的
本発明は、上記の不都合を克服するだめに力されたもの
であって、集積回路装置内に垂直積分回路を内蔵するこ
とに加えて、垂直同期パルス入力端子が不要とされた垂
直同期装置を提供するものである。
であって、集積回路装置内に垂直積分回路を内蔵するこ
とに加えて、垂直同期パルス入力端子が不要とされた垂
直同期装置を提供するものである。
発明の構成
本発明は、同期分離回路と垂直発振器と垂直積分回路と
が同一の集積回路装置上に形成されてあって、前記垂直
積分回路は複合同期信号中の垂直同期パルスを除く他の
パルス振幅を減衰させるに足りる時定数を有するミラー
積分回路と同ミラー積分回路を介して得られた複合同期
信号を所定のレベルで切りとるように設定された電圧比
較器とから構成されることによって、前記集積回路装置
上に垂直積分用の端子が不要とされ、その結果、削減さ
れた端子を他の機能に用いるならば、多機能な集積回路
装置の実現が可能となる垂直同期装置が得られる。
が同一の集積回路装置上に形成されてあって、前記垂直
積分回路は複合同期信号中の垂直同期パルスを除く他の
パルス振幅を減衰させるに足りる時定数を有するミラー
積分回路と同ミラー積分回路を介して得られた複合同期
信号を所定のレベルで切りとるように設定された電圧比
較器とから構成されることによって、前記集積回路装置
上に垂直積分用の端子が不要とされ、その結果、削減さ
れた端子を他の機能に用いるならば、多機能な集積回路
装置の実現が可能となる垂直同期装置が得られる。
実施例の説明
第２図は、本発明の、一実施例にかかる垂直同期装置の
ブロック図を示す。従来例の第１図と比較して明らかな
ように、抵抗５，７およびコンデンサ６．８からなる垂
直積分回路が配置されていないこと、さらに垂直同期パ
ルス入力端子９が削減されたことが理解できよう。
ブロック図を示す。従来例の第１図と比較して明らかな
ように、抵抗５，７およびコンデンサ６．８からなる垂
直積分回路が配置されていないこと、さらに垂直同期パ
ルス入力端子９が削減されたことが理解できよう。
一方、集積回路装置１の中をみるならば、抵抗１６、コ
ンデンサ１７および増幅器１８から形成される第１のミ
ラー積分回路と、電圧比較器１９およびその基準電圧源
２ｏ、そして、抵抗２１゜コンデンサ２２および増幅器
２３から形成される第２のミラー積分回路が、従来例の
第１図に付加されていることも理解できよう。
ンデンサ１７および増幅器１８から形成される第１のミ
ラー積分回路と、電圧比較器１９およびその基準電圧源
２ｏ、そして、抵抗２１゜コンデンサ２２および増幅器
２３から形成される第２のミラー積分回路が、従来例の
第１図に付加されていることも理解できよう。
即ち、従来として用いられてきた垂直積分回路の形態は
、本発明によって、第１および第２のミラー積分回路と
、電圧比較器によって代替できたものとなった。
、本発明によって、第１および第２のミラー積分回路と
、電圧比較器によって代替できたものとなった。
第３図は、第２図のブロック図の中の、前記第１および
第２のミラー積分回路と、電圧比較器の具体的な一実施
例回路を示すものである。
第２のミラー積分回路と、電圧比較器の具体的な一実施
例回路を示すものである。
即ち、トランジスタ２４，２５．２６および抵抗２７，
２８．２９は第２図の増幅器１８を形成する。また、電
流源３０．トランジスタ３１ 、３２゜３３および抵抗
３４．３５は電圧比較器１９を形成する。さらに、トラ
ンジスタ３６，３７．３８および抵抗３９，４０．４１
は、増幅器１ｏを形成するものである。
２８．２９は第２図の増幅器１８を形成する。また、電
流源３０．トランジスタ３１ 、３２゜３３および抵抗
３４．３５は電圧比較器１９を形成する。さらに、トラ
ンジスタ３６，３７．３８および抵抗３９，４０．４１
は、増幅器１ｏを形成するものである。
第４図は、各部の動作波形図を示すものであり、第２図
のブロック図と共に参照しながら、動作をさらに詳細に
説明する。
のブロック図と共に参照しながら、動作をさらに詳細に
説明する。
入力端子２に、複合映像信号が加えられると、同期分離
回路３によって、第４図ａに示す複合同期信号が、同期
分離出力端子４ （Ａ点）に出力される。前記複合同期
信号は、前記Ａ点より、第１段目のミラー積分回路に加
えられ、その出力Ｂ点には、第４図すに示すように、等
化パルスと水平同期パルスの振幅が減衰され、垂直同期
パルスのみの振幅が減衰されることがないパルスが生じ
る。
回路３によって、第４図ａに示す複合同期信号が、同期
分離出力端子４ （Ａ点）に出力される。前記複合同期
信号は、前記Ａ点より、第１段目のミラー積分回路に加
えられ、その出力Ｂ点には、第４図すに示すように、等
化パルスと水平同期パルスの振幅が減衰され、垂直同期
パルスのみの振幅が減衰されることがないパルスが生じ
る。
□垂直同期パルスの中には、水平同期パルス幅とほぼ等
しいパルス幅が５μＳ程度の切込みパルスが挿入されて
いるが、この切込みパルスの振幅も同じように小さくな
る。
しいパルス幅が５μＳ程度の切込みパルスが挿入されて
いるが、この切込みパルスの振幅も同じように小さくな
る。
ミラー積分回路に矩形パルスを印加した場合の出力電圧
ＥＯは、一般に、つぎに示す（１）式で表わされること
が既に知られている。
ＥＯは、一般に、つぎに示す（１）式で表わされること
が既に知られている。
（１）式において、ＥＯは、第２図のＢ点に出力される
電圧、ＥｌはＢ点に生じる最大振幅値、ＯＲは積分時定
数を示すものであって、抵抗１６の抵抗値Ｒ１６とコン
デンサ１７の容量値Ｃ１７の積を示す値、また第２段目
のミラー積分回路においては、抵抗２１の抵抗値Ｒ２＋
とコンデンサ２２の容量値Ｃ２２の積で示される値とな
る。ｔは積分時間を示すものであって、パルス幅によっ
て定まるものである。
電圧、ＥｌはＢ点に生じる最大振幅値、ＯＲは積分時定
数を示すものであって、抵抗１６の抵抗値Ｒ１６とコン
デンサ１７の容量値Ｃ１７の積を示す値、また第２段目
のミラー積分回路においては、抵抗２１の抵抗値Ｒ２＋
とコンデンサ２２の容量値Ｃ２２の積で示される値とな
る。ｔは積分時間を示すものであって、パルス幅によっ
て定まるものである。
第（１）式から自明のごとく、積分時定数ＯＲを積分時
間ｔに比し充分大きく設定するならば、７ｆ、’。
間ｔに比し充分大きく設定するならば、７ｆ、’。
はほとんど零に近づき、逆にＯＲ＜＜ ｔ の関係が
あるならば、Ｅ ｏ −−Ｅ ｉとなる。すなわち、第
２図の第１および第２のミラー積分回路は、水平同期パ
ルスおよび等化パルスのようにパルス幅が小さいものに
は前者の関係が成立し、垂直同期パルスのように、パル
ス幅が大きいものには後者の関係が成立するようにＣＲ
の時定数を定めるところに着眼がおかれている。
あるならば、Ｅ ｏ −−Ｅ ｉとなる。すなわち、第
２図の第１および第２のミラー積分回路は、水平同期パ
ルスおよび等化パルスのようにパルス幅が小さいものに
は前者の関係が成立し、垂直同期パルスのように、パル
ス幅が大きいものには後者の関係が成立するようにＣＲ
の時定数を定めるところに着眼がおかれている。
なお、第４図すに示すように、等化パルスおよび水平同
期パルスを免全に零にすることは、むすかしい面がある
。すなわち、一方的にＯＲの時定数を犬きくすると垂直
同期パルスの振幅捷でも小さくする結果となる。したが
って、完全な垂直同期パルスを導出するには、電圧比較
器１９に基準電圧Ｖ２０を有する電圧源を設定すればよ
い。このような配慮を払うならはＶ２Ｏよりも高い電圧
で電圧比較器１９が作動することになり、電圧比較器１
９の出力端り点には第４図ｄに示すように、垂直同期パ
ルスのみが出力される。すなわち、電圧比較器１９では
基準電圧源Ｖ２０ にもとづくスライス動作（切９と
る動作）が実行される。第４図Ｃは第３図の０点に出力
される波形であって、第４図Ｃの極性反転されたものが
Ｄ点に生じ第４図ｄの波形となる。
期パルスを免全に零にすることは、むすかしい面がある
。すなわち、一方的にＯＲの時定数を犬きくすると垂直
同期パルスの振幅捷でも小さくする結果となる。したが
って、完全な垂直同期パルスを導出するには、電圧比較
器１９に基準電圧Ｖ２０を有する電圧源を設定すればよ
い。このような配慮を払うならはＶ２Ｏよりも高い電圧
で電圧比較器１９が作動することになり、電圧比較器１
９の出力端り点には第４図ｄに示すように、垂直同期パ
ルスのみが出力される。すなわち、電圧比較器１９では
基準電圧源Ｖ２０ にもとづくスライス動作（切９と
る動作）が実行される。第４図Ｃは第３図の０点に出力
される波形であって、第４図Ｃの極性反転されたものが
Ｄ点に生じ第４図ｄの波形となる。
ところで、縞４図すのＸで示すように正規な複合同期信
号とは異なるノイズ成分が混入した場合、パルス幅によ
ってはこのノイズが充分積分されずにＶ２［１よりも低
いレベルのままの状態でありうることがある。このよう
な場合は当然のことながら、Ｄ点には第４図ｄのＸに示
すよ、うな垂直同期パルスにノイズが混入し、正規な垂
直同期パルスを導出できないことになる。しかしながら
、第４図ｄのＸを含むパルスを、抵抗２１．コンデンサ
２２゜増幅器２３からなる第２段目のミラー積分回路に
通すとＸなるノイズ成分は除去され、第２段目のミラー
積分回路の出力端子Ｅ点には、第４図ｅに示すように垂
直同期パルスのみが出力される。したがって、第２段目
のミラー積分回路は、完全な垂直同期パルスを得るため
に効果がある。
号とは異なるノイズ成分が混入した場合、パルス幅によ
ってはこのノイズが充分積分されずにＶ２［１よりも低
いレベルのままの状態でありうることがある。このよう
な場合は当然のことながら、Ｄ点には第４図ｄのＸに示
すよ、うな垂直同期パルスにノイズが混入し、正規な垂
直同期パルスを導出できないことになる。しかしながら
、第４図ｄのＸを含むパルスを、抵抗２１．コンデンサ
２２゜増幅器２３からなる第２段目のミラー積分回路に
通すとＸなるノイズ成分は除去され、第２段目のミラー
積分回路の出力端子Ｅ点には、第４図ｅに示すように垂
直同期パルスのみが出力される。したがって、第２段目
のミラー積分回路は、完全な垂直同期パルスを得るため
に効果がある。
しかしながら、第２段目のミラー積分回路を具備するこ
とは本発明において必須条件ではなく、第１段目のミラ
ー積分回路と電圧比較器１９の構成であっても充分な効
果は得られる。上記の構成の場合、抵抗１６とコンデン
サ１７をできるだけ大きな値とし、すなわちＣＲ時定数
を大きくして、等化パルスおよび水平同期パルスの振幅
を零に近づけ、さらにＶ２Ｏを下げることによって、本
来の垂直同期パルス幅に近いものを得ることができる。
とは本発明において必須条件ではなく、第１段目のミラ
ー積分回路と電圧比較器１９の構成であっても充分な効
果は得られる。上記の構成の場合、抵抗１６とコンデン
サ１７をできるだけ大きな値とし、すなわちＣＲ時定数
を大きくして、等化パルスおよび水平同期パルスの振幅
を零に近づけ、さらにＶ２Ｏを下げることによって、本
来の垂直同期パルス幅に近いものを得ることができる。
このことは、垂直同期パルス振幅が小さくなると同時に
、パルス幅も電圧値の高くなるにつれ小さくなることに
基づくものである。
、パルス幅も電圧値の高くなるにつれ小さくなることに
基づくものである。
なお、第１段目および第２段目のミラー積分回路を構成
する抵抗１６および抵抗２１は、抵抗素子そのもの自体
である必要はない。たとえば、電流源で構成するならば
、′電流源の抵抗成分は相当高いものであることから、
コンデンサ１７およびコンデンサ２２の値を小さくでき
る効果を提供することができる。すなわち、ミラー積分
回路の入力段を電流源で構成することによって、コンデ
ンサ１７および２２の容量値を大きくせずに積分時定数
を大きくすることができるので集積回路化には好適なも
のである。
する抵抗１６および抵抗２１は、抵抗素子そのもの自体
である必要はない。たとえば、電流源で構成するならば
、′電流源の抵抗成分は相当高いものであることから、
コンデンサ１７およびコンデンサ２２の値を小さくでき
る効果を提供することができる。すなわち、ミラー積分
回路の入力段を電流源で構成することによって、コンデ
ンサ１７および２２の容量値を大きくせずに積分時定数
を大きくすることができるので集積回路化には好適なも
のである。
上記のようにミラー積分回路によって導出された第４図
ｅに示す垂直同期パルスは、垂直発振器１０の同期パル
スとして、集積回路装置１の中で供給されることが可能
となる。
ｅに示す垂直同期パルスは、垂直発振器１０の同期パル
スとして、集積回路装置１の中で供給されることが可能
となる。
発明・の効果
以上に説明したように、本発明の垂直同期装、置、とり
わけ、その中の垂直積分回路を、集積化が可能なミラー
積分回路によって構成することで、従来、必須とされた
垂直同期パルス入力端子の設置を不要とし、その削減で
きた端子を、垂直同期装置を含む大規模集積装置を実現
する場合には、他の機能に使用できる効果が得られ、そ
の工業的価値は大きい。
わけ、その中の垂直積分回路を、集積化が可能なミラー
積分回路によって構成することで、従来、必須とされた
垂直同期パルス入力端子の設置を不要とし、その削減で
きた端子を、垂直同期装置を含む大規模集積装置を実現
する場合には、他の機能に使用できる効果が得られ、そ
の工業的価値は大きい。
第１図は、従来の垂直同期装置のブロック図、第２図は
、本発明装置のブロック図、第３図は、本発明垂直同期
装置要部の一実施例回路を示す図第４図ａ −ｅは、本
発明の各部の動作波形図を示す。 、 集積回路装置、２・−入力端子、３同期分離回路
、４ 同期分離出力端子、１０−垂直発振器、１２−
垂直発振入力端子、１３発振用コンデンサ、１４
垂直ホールドボリューム、１６− 電源端子、１６．２
１ ミラー積分用抵抗、１７．２２ ミラー積分
用コンデンサ、１８．２３ 増幅器、１９ 電圧
比較器、２０・・基準電圧源。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名１１
図 ／ 第２図 １７？？ ＭＡ４図
、本発明装置のブロック図、第３図は、本発明垂直同期
装置要部の一実施例回路を示す図第４図ａ −ｅは、本
発明の各部の動作波形図を示す。 、 集積回路装置、２・−入力端子、３同期分離回路
、４ 同期分離出力端子、１０−垂直発振器、１２−
垂直発振入力端子、１３発振用コンデンサ、１４
垂直ホールドボリューム、１６− 電源端子、１６．２
１ ミラー積分用抵抗、１７．２２ ミラー積分
用コンデンサ、１８．２３ 増幅器、１９ 電圧
比較器、２０・・基準電圧源。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名１１
図 ／ 第２図 １７？？ ＭＡ４図
Claims (1)
- 同期分離回路と垂直発振器と垂直積分回路とを有し、前
記垂直積分回路は複合同期信号中の垂直同期パルスを除
く他のパルス振幅を減衰させるに足りる時定数を有する
ミラー積分回路と同ミラー積分回路を介して得られた複
合同期信号を所定のレベルで切りとるように設定された
電圧比較器とから構成される垂直同期装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1487883A JPS59140777A (ja) | 1983-01-31 | 1983-01-31 | 垂直同期装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1487883A JPS59140777A (ja) | 1983-01-31 | 1983-01-31 | 垂直同期装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59140777A true JPS59140777A (ja) | 1984-08-13 |
Family
ID=11873266
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1487883A Pending JPS59140777A (ja) | 1983-01-31 | 1983-01-31 | 垂直同期装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59140777A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1987006414A1 (en) * | 1986-04-14 | 1987-10-22 | Sanyo Electric Co., Ltd. | Circuit for generating vertical synchronizing pulses |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750176A (en) * | 1980-09-09 | 1982-03-24 | Sanyo Electric Co Ltd | Synchronizing separation circuit |
-
1983
- 1983-01-31 JP JP1487883A patent/JPS59140777A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750176A (en) * | 1980-09-09 | 1982-03-24 | Sanyo Electric Co Ltd | Synchronizing separation circuit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1987006414A1 (en) * | 1986-04-14 | 1987-10-22 | Sanyo Electric Co., Ltd. | Circuit for generating vertical synchronizing pulses |
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