JPS59101938A - フエ−ジングシミユレ−タ - Google Patents
フエ−ジングシミユレ−タInfo
- Publication number
- JPS59101938A JPS59101938A JP57211326A JP21132682A JPS59101938A JP S59101938 A JPS59101938 A JP S59101938A JP 57211326 A JP57211326 A JP 57211326A JP 21132682 A JP21132682 A JP 21132682A JP S59101938 A JPS59101938 A JP S59101938A
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- JP
- Japan
- Prior art keywords
- fading
- signal
- multipath
- memory
- simulator
- Prior art date
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- Pending
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Classifications
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B17/00—Monitoring; Testing
- H04B17/0082—Monitoring; Testing using service channels; using auxiliary channels
- H04B17/0087—Monitoring; Testing using service channels; using auxiliary channels using auxiliary channels or channel simulators
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B17/00—Monitoring; Testing
- H04B17/30—Monitoring; Testing of propagation channels
- H04B17/391—Modelling the propagation channel
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B17/00—Monitoring; Testing
- H04B17/30—Monitoring; Testing of propagation channels
- H04B17/391—Modelling the propagation channel
- H04B17/3911—Fading models or fading generators
Landscapes
- Physics & Mathematics (AREA)
- Electromagnetism (AREA)
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Monitoring And Testing Of Transmission In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
この発明は、マルチパスやフェージングの存在する伝送
路を伝搬した信号を模擬するフェージングシミュレータ
に関する。
路を伝搬した信号を模擬するフェージングシミュレータ
に関する。
〔発明の技術的背景およびその問題点〕フェージングシ
ミュレータは、無線変復調装置の評価試験、例えば移動
無線における特性試験等に用いられる。
ミュレータは、無線変復調装置の評価試験、例えば移動
無線における特性試験等に用いられる。
従来のフェージングシミュレータおよびマルチパスの影
響を考隋したフェージングシミュレータについて第１図
およ−び第２図を参照して説明する。
響を考隋したフェージングシミュレータについて第１図
およ−び第２図を参照して説明する。
まず、フェージングシばユレータは第１図に示す様な構
成である。即ち、入力端子［Ｈｌｌに供給されたキャリ
アの一部は平衡変調器（１２１に供給し、他は９０度移
相器０］１を介して平衡変調器（１３）に供給する。
成である。即ち、入力端子［Ｈｌｌに供給されたキャリ
アの一部は平衡変調器（１２１に供給し、他は９０度移
相器０］１を介して平衡変調器（１３）に供給する。
これら変調器Ｑ２１（１３１では、夫々独立な雑音発生
器（１４１（１５１から発生した各々のひずみ信号のう
ち夫々低域濾波器（１Ｇ＋（１７）を通過した信号によ
り前記キャリアを夫々平衡変調する。
器（１４１（１５１から発生した各々のひずみ信号のう
ち夫々低域濾波器（１Ｇ＋（１７）を通過した信号によ
り前記キャリアを夫々平衡変調する。
さらに、各変調器（１２＋（＋３１の出力は加算器０８
）で加算され、出力端子θ９）に模擬信号を得る構成に
なっている。
）で加算され、出力端子θ９）に模擬信号を得る構成に
なっている。
次に第１図のフェージングシミュレータを用いたマルチ
パスの影響を考慮した従来のフェージングシだユレータ
の構成は、第２図の通りである。
パスの影響を考慮した従来のフェージングシだユレータ
の構成は、第２図の通りである。
即ち、キャリアがフェージングの存在する６伝送路を径
て得られることを想定している。
て得られることを想定している。
凍ず入力端子（２１１）に供給されたキャリアは、予想
される多数の各伝送路の通路差による時間差に設定され
た複数個の遅延器（２１）〜（２ｎ）に供給して遅延し
た後、各遅延（Ｍ号は夫々対応して設けられたフェージ
ングシミュレータＩ、（１１〜（３ｎ）でフェージング
模擬信号を出力する。
される多数の各伝送路の通路差による時間差に設定され
た複数個の遅延器（２１）〜（２ｎ）に供給して遅延し
た後、各遅延（Ｍ号は夫々対応して設けられたフェージ
ングシミュレータＩ、（１１〜（３ｎ）でフェージング
模擬信号を出力する。
この各フェージングシミュレータ畦〜（３ｎ）出力信号
は、夫々の重み回路（４１）〜（４ｎ）により予め定め
られた媚、減衰した後、加算器（５１）により加算され
、マルチパスの彫物を受けたフェージング波を出力端子
（５２）に得る構成になっている。
は、夫々の重み回路（４１）〜（４ｎ）により予め定め
られた媚、減衰した後、加算器（５１）により加算され
、マルチパスの彫物を受けたフェージング波を出力端子
（５２）に得る構成になっている。
雑音発生器（１２１（１３１から発生するひずみ信号を
変調信号とするフェージング模擬装置としては、例えば
特開昭５５−３７．０４７号公報に開示されているＯ 即ち、フェージング周期、レベルの確率分布等のパラメ
ータは、雑音発生器（＋４）（１５１，！：低域ｉｉｅ
、ｊ 波器（Ｉ［ｉｌ Ｑ７１との定数によって決定し
ている。
変調信号とするフェージング模擬装置としては、例えば
特開昭５５−３７．０４７号公報に開示されているＯ 即ち、フェージング周期、レベルの確率分布等のパラメ
ータは、雑音発生器（＋４）（１５１，！：低域ｉｉｅ
、ｊ 波器（Ｉ［ｉｌ Ｑ７１との定数によって決定し
ている。
しかしながら、上記装置によると、所望のフェージング
パラメータを実現する様なひずみ信号および江Ｍ波器の
定数を求めることは一般に困雑である。
パラメータを実現する様なひずみ信号および江Ｍ波器の
定数を求めることは一般に困雑である。
また、特に低域濾波器（１６１（１７１はアナログ回路
で形成されることになり、十分な再現性が得られず、測
定では普遍的なデータを得られないとの欠点がある。
で形成されることになり、十分な再現性が得られず、測
定では普遍的なデータを得られないとの欠点がある。
烙らに上記の様に、各伝送路に対応する装置を設置しな
ければならない。
ければならない。
以上の様なマルチパスの存在する除のフェージングシミ
ユし・−夕においては、前記フェージングシミュレータ
における欠点がそのままあてはまり、また第２図から明
らかなようにマルチパスブランチの数だけ、即ち、マル
チパスの存在する伝送路数だけ上記フェージングシミュ
レータを組み込む必要があるとの欠点がある。
ユし・−夕においては、前記フェージングシミュレータ
における欠点がそのままあてはまり、また第２図から明
らかなようにマルチパスブランチの数だけ、即ち、マル
チパスの存在する伝送路数だけ上記フェージングシミュ
レータを組み込む必要があるとの欠点がある。
さらに、マルチパスの各ブランチの重み回路（４１）〜
（４ｎ）のパラメータの決定法についても有効な方法は
未だ提案されていない。
（４ｎ）のパラメータの決定法についても有効な方法は
未だ提案されていない。
この発明は上記欠点を改良したもので、所望のパラメー
タを持つマルチパスやフェージングの影響を受けた信号
の再現性、普遍性が極めて良好であり、また低コストの
フェージングシミュレータを提供するものである。
タを持つマルチパスやフェージングの影響を受けた信号
の再現性、普遍性が極めて良好であり、また低コストの
フェージングシミュレータを提供するものである。
〔発明の概要」
入力信号およびその入力信号と９００Ｏ’ｒ相の異なる
１６号の夫々に対して、マルチパスやフェージングの彫
物を受け７゛ヒ信＋」を記ｔはしたメモリから得られる
ひずみ（ｍ号で夫々振＋ｐ＋４変ｉ＋＋４し〕と後、加
：ｔＪ： ｔ、てフェージング模＆（Ｎ号をイ好るフェ
ージングシミュレータを得るものである。
１６号の夫々に対して、マルチパスやフェージングの彫
物を受け７゛ヒ信＋」を記ｔはしたメモリから得られる
ひずみ（ｍ号で夫々振＋ｐ＋４変ｉ＋＋４し〕と後、加
：ｔＪ： ｔ、てフェージング模＆（Ｎ号をイ好るフェ
ージングシミュレータを得るものである。
まず、この発明装随に用いるメモリ、例えばＲＯＩＶＩ
に記憶でせるデータの抽出例を具体的に説明する。
に記憶でせるデータの抽出例を具体的に説明する。
このマルチパスやフェージングの影較を受けた信号を記
憶したメモリ、例えばＲＯＭは、前記信号を複素平面上
の直交２成分で表すことにより得られる。
憶したメモリ、例えばＲＯＭは、前記信号を複素平面上
の直交２成分で表すことにより得られる。
即ち、マルチパスやフェージングの影剪を受ける前の被
変調波、例えばディジタル変調波の位相変調波、例えば
ディジタル変調波の位相変調波、例えばＭＳ Ｋ （Ｍ
ｉｎｉｍｕｍ ５ｈｉｆｔ Ｋｅｅｉｎｇ ）波におけ
る複素平面図は、第３図に示す通りである。
変調波、例えばディジタル変調波の位相変調波、例えば
ディジタル変調波の位相変調波、例えばＭＳ Ｋ （Ｍ
ｉｎｉｍｕｍ ５ｈｉｆｔ Ｋｅｅｉｎｇ ）波におけ
る複素平面図は、第３図に示す通りである。
これは、複素平面−上の単位円を１タイムスロット当り
９００回転して、その位置より情報を伝えている。
９００回転して、その位置より情報を伝えている。
時刻、例えは任意の時刻（ｔｏ）において、次のタイム
スロット（ｔＩ又は１１）により位相が９００進むか又
は９０°遅れるかにより１ビツトのディジタル信号を表
す。
スロット（ｔＩ又は１１）により位相が９００進むか又
は９０°遅れるかにより１ビツトのディジタル信号を表
す。
この様な信号波において、その軌跡は単位円と一致する
。
。
一方、任意の単一周波キャリアがフェージングの影響を
受けた信号を上記と同様に複素平面図で表すと第４図の
様な軌Ｖプ■・（ｔＯ′、ｔ１′、ｔ、′、ｔ３′、・
・・・・・）となる。
受けた信号を上記と同様に複素平面図で表すと第４図の
様な軌Ｖプ■・（ｔＯ′、ｔ１′、ｔ、′、ｔ３′、・
・・・・・）となる。
次に、被変調波、例えば第３図に示す様なＭ Ｓ ｔ＜
波がフェージングを受けた後の信号の軌跡は、第３図に
示すＩＶＩ Ｓ Ｋ波の複素ベクトルと単一周波キャリ
アがフェージングを受けた後の信号の複素ベクトル、例
えば第４図に示ず複素ベクトルとを乗算したネジ素ベク
トルＨＳａＰ、５図に示す様なベクトル軌跡（ｔｏｌ／
、１．、／／、ｔ２ｉｔ、ｔ３”、・・・・・・）とな
る。
波がフェージングを受けた後の信号の軌跡は、第３図に
示すＩＶＩ Ｓ Ｋ波の複素ベクトルと単一周波キャリ
アがフェージングを受けた後の信号の複素ベクトル、例
えば第４図に示ず複素ベクトルとを乗算したネジ素ベク
トルＨＳａＰ、５図に示す様なベクトル軌跡（ｔｏｌ／
、１．、／／、ｔ２ｉｔ、ｔ３”、・・・・・・）とな
る。
さらに、マルチパスの影響を受けた信号を複素平面上に
表す除は、第３図に示す様なＮｌ５Ｋ波の襟素ベクトル
とマルチパスの存在する各通路ごとに皓フェージングの
影響を受けた信号、例えば単一周波数キャリアの複素ベ
クトルとを各々乗りする。
表す除は、第３図に示す様なＮｌ５Ｋ波の襟素ベクトル
とマルチパスの存在する各通路ごとに皓フェージングの
影響を受けた信号、例えば単一周波数キャリアの複素ベ
クトルとを各々乗りする。
次に、この乗膳した後の各複素ベクトル軌跡から各伝送
路による時間差を考慮した各複素ベクトル軌跡をサンプ
ルした後、各加算合成して得られる。
路による時間差を考慮した各複素ベクトル軌跡をサンプ
ルした後、各加算合成して得られる。
以上の様にして、マルチパスやフェージングの影響を受
けたディジタル変調波を複素平面上の軌跡として得るこ
とができる。
けたディジタル変調波を複素平面上の軌跡として得るこ
とができる。
即ち、任意の時系列内におけるマルチパスやフェージン
グの影響を受けた被変調波は、複素平面上の直交成分の
実軸および虚軸成分に投影することができる。
グの影響を受けた被変調波は、複素平面上の直交成分の
実軸および虚軸成分に投影することができる。
この投影により得られる実軸成分および虚軸成分を各々
独立々メモリ、例えばＲＯＭに記憶することによりマル
チパスやフェージングの影嚢を受けた被変調波を再現す
るメモリ例えはＲＯＭを得ることができる。
独立々メモリ、例えばＲＯＭに記憶することによりマル
チパスやフェージングの影嚢を受けた被変調波を再現す
るメモリ例えはＲＯＭを得ることができる。
前記実地ｉｉ酸成分よび虚軸成分は、実際のでルチバス
やフェージングの影響を受けた被変調波を実軸および虚
軸に関して各同期検波して記録することにより得られる
。
やフェージングの影響を受けた被変調波を実軸および虚
軸に関して各同期検波して記録することにより得られる
。
また、この両成分は、計算機のシミュレーションによっ
て決定するととも可能である。
て決定するととも可能である。
以下、との発明装置の一実施例を第６図を参照して説明
する。
する。
ます、発＆器、例えはキャリア発振器（６１）により発
生したキャリアの一部は直接第１の振幅変調器、例えは
第１の平衡変調器（６２）に供給し、他は９０肛移相器
（６３）によす１１０°移相した後、第２の振幅７１周
器、し１１えは紀２の平衡変Ｅ器（６４）に供給して直
交変調をＩｒう。
生したキャリアの一部は直接第１の振幅変調器、例えは
第１の平衡変調器（６２）に供給し、他は９０肛移相器
（６３）によす１１０°移相した後、第２の振幅７１周
器、し１１えは紀２の平衡変Ｅ器（６４）に供給して直
交変調をＩｒう。
一方、鎖１のメモリ、例えばｉ：ｔｏＭ（６５）および
第２のメモリ、例え１１１１もＯＭ（６６）は、上記に
より秤られるマルチパスやフェージングの彫りを受けた
被変調波、例えはディジタル変調波の実軸成分および虚
軸成分か各データ、例えばディジタルデータとして記１
．へ塾れている。
第２のメモリ、例え１１１１もＯＭ（６６）は、上記に
より秤られるマルチパスやフェージングの彫りを受けた
被変調波、例えはディジタル変調波の実軸成分および虚
軸成分か各データ、例えばディジタルデータとして記１
．へ塾れている。
各ディジタルデータｌ：Ｊ、 、共ｉ１１のクロソゲパ
ルス発生器（６７）の発生するパルスにより順次、繰り
返してカ１１み出された後、ディジタル／アナログ変換
器（６Ｂ）Ｉ／こよりアブログ捕となって第１および氾
２の十衡変１周器（６２Ｘ６４）のベースバンド入力と
して加えられる。
ルス発生器（６７）の発生するパルスにより順次、繰り
返してカ１１み出された後、ディジタル／アナログ変換
器（６Ｂ）Ｉ／こよりアブログ捕となって第１および氾
２の十衡変１周器（６２Ｘ６４）のベースバンド入力と
して加えられる。
塙らに、前記第１および第２の平衡変調器（６２）（６
４）の各出力信号は、加ｎ ｆ’ｒｉ （６９）により
加算合成きれ出力端子（７０）にフェージング模擬１Ｃ
号を出力する。
４）の各出力信号は、加ｎ ｆ’ｒｉ （６９）により
加算合成きれ出力端子（７０）にフェージング模擬１Ｃ
号を出力する。
この様に、マルチパスやフェージングの影響を受けた信
号の実軸および虚軸両成分を夫々記憶した冴１】および
第２のメモ’） （６５Ｘ６６）により直交変調器のベ
ースバンド入力を一定のひずみ信号としで力［ｉえるこ
とか可能とＡる。
号の実軸および虚軸両成分を夫々記憶した冴１】および
第２のメモ’） （６５Ｘ６６）により直交変調器のベ
ースバンド入力を一定のひずみ信号としで力［ｉえるこ
とか可能とＡる。
以上ｍ’ｒｌ ［１ｌｌｉ Ｌだようにこの発明装置に
よれば、再明。
よれば、再明。
性、普納性が良いマルチパスやフェージングの影響を受
けたディジタル変調波を得ることができる。
けたディジタル変調波を得ることができる。
さらに、前記紀１および第２のメモリ、例えばＲＯ八へ
１の内容を計名′梠シミュレーションにより決定する際
は、フェージング周波数、レベルの確率分布の各パラメ
ータを任意に設定することが可能とン：；二 る。
１の内容を計名′梠シミュレーションにより決定する際
は、フェージング周波数、レベルの確率分布の各パラメ
ータを任意に設定することが可能とン：；二 る。
乃゛お、上記賓施例では、メモリとしてテイジタルメモ
リを用いたが、アナログメモリでも可能であり、また＋
’ｉ−１記谷平衡変調器（６２）（６４）のベースバン
ド入力としてディジタル入力が可能な除は、各々ディジ
タル／アナログ変換器（６８）を用いなくてよい０ また、前記キャリア発振器（６１）の代りに変調送信機
、例えばディジタルデータ変調送信機を用い、さらに第
１および第２の各メモリ（６５Ｘ６６）の内容を単一周
波キャリアがフェージングの彫物を受けた信号、例えは
８Ａ４図に示す様な信号の実軸および虚軸の各成分とす
る際は、マルチパスの考慮を必要とし女いフエージング
シごユレータとなる。
リを用いたが、アナログメモリでも可能であり、また＋
’ｉ−１記谷平衡変調器（６２）（６４）のベースバン
ド入力としてディジタル入力が可能な除は、各々ディジ
タル／アナログ変換器（６８）を用いなくてよい０ また、前記キャリア発振器（６１）の代りに変調送信機
、例えばディジタルデータ変調送信機を用い、さらに第
１および第２の各メモリ（６５Ｘ６６）の内容を単一周
波キャリアがフェージングの彫物を受けた信号、例えは
８Ａ４図に示す様な信号の実軸および虚軸の各成分とす
る際は、マルチパスの考慮を必要とし女いフエージング
シごユレータとなる。
また、離れた場所においてこの発明装置を実施する際は
、直交変調器の形式を前記直交変騨器と一＃させ、前記
第１および第２のメモリの内容を伝送することにより、
前記と同様のマルチパスやフェージングの影響を受けだ
信月を得ることができる。
、直交変調器の形式を前記直交変騨器と一＃させ、前記
第１および第２のメモリの内容を伝送することにより、
前記と同様のマルチパスやフェージングの影響を受けだ
信月を得ることができる。
即誂、この発明装置によりマルチパスやフェージングの
影響を受けた標準信号を設定することが可能となる。
影響を受けた標準信号を設定することが可能となる。
また、あらかじめマルチパスやフェージングの影響を受
けた各種信号を各種メモリ、例えばＲＯＭに記慎させて
おくことにより、各メモリ、例えばＲＯＭを選択し各種
の俳号を容易に得ることができる。
けた各種信号を各種メモリ、例えばＲＯＭに記慎させて
おくことにより、各メモリ、例えばＲＯＭを選択し各種
の俳号を容易に得ることができる。
この発明は、マルチパスやフェージングの影響を受けた
信号を極めて再現性、普遍性良く得ることができ、また
低コストで小形化が容易なフェージングシミュレータを
得ることかで傘る。
信号を極めて再現性、普遍性良く得ることができ、また
低コストで小形化が容易なフェージングシミュレータを
得ることかで傘る。
第１図は、従来のフェージング７ミユレータ構成図、第
２図は、第１図のフェージングシミュレータを用いてマ
ルチパスの影響を考慮した際の従来のフエージングシば
ユレータ構成図、第３図は、この発明の実施例を一説明
するだめのディジタル位相変調信号の複素平面図、第４
図は、この発明実施π１！のフェージングの影響を受け
だ単一の周波キャリアの複素平面図、第５図は、第３図
と第４図の複素ベクトルを乗算したフェージングの影響
を受けだディジタル位相変調信号の複素平面図、第６図
は、第５図の内容を配憶したメモリを用いたフェージン
グシミュレータの一実施例の構成図である０ １１．６３・・・・・・・・・・・・・・・・・・・・
・・・・移相器１４．１５・・・・・・・・・・・・・
・・・・・・・・・・・雑音発生器１２．１３．６２．
６４・・・・・・平衡変調器１８．５１．６９・・・・
・・・・・・・・・・・加算合成器１６．１７・・・・
・・・・・・・・・・・・・・・・・・・・低域端波器
２１〜２ｎ・・・・・・・・・・・・・・・・・・・・
・・・・遅延器３１〜３ｎ・・・・・・・・・・・・・
・・・・・・・・・・・ フェージングシミュレータ４
１〜４ｎ・・・・・・・・・・・・・・・・・・・・・
・・・重み回路６１・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・キャリア発振器６
５．６６・・・・・・・・・・・・・・・・・・・・・
・・・ メモリ（ＲＯＭ）６７・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・ クロ
ックパルス発生器６８・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・；ｒ・ ディジタル
／アナログ変換器１０、加・・・・・・・・・・・・・
・・・・・・・・・・・・・・入力端子１９．５２．７
０・・・・・・・・・・・・・・・出力端子代理人弁理
士 則 近 憲 佑 外１名第 １ 図 第 ２ 図 第 ４ 図
２図は、第１図のフェージングシミュレータを用いてマ
ルチパスの影響を考慮した際の従来のフエージングシば
ユレータ構成図、第３図は、この発明の実施例を一説明
するだめのディジタル位相変調信号の複素平面図、第４
図は、この発明実施π１！のフェージングの影響を受け
だ単一の周波キャリアの複素平面図、第５図は、第３図
と第４図の複素ベクトルを乗算したフェージングの影響
を受けだディジタル位相変調信号の複素平面図、第６図
は、第５図の内容を配憶したメモリを用いたフェージン
グシミュレータの一実施例の構成図である０ １１．６３・・・・・・・・・・・・・・・・・・・・
・・・・移相器１４．１５・・・・・・・・・・・・・
・・・・・・・・・・・雑音発生器１２．１３．６２．
６４・・・・・・平衡変調器１８．５１．６９・・・・
・・・・・・・・・・・加算合成器１６．１７・・・・
・・・・・・・・・・・・・・・・・・・・低域端波器
２１〜２ｎ・・・・・・・・・・・・・・・・・・・・
・・・・遅延器３１〜３ｎ・・・・・・・・・・・・・
・・・・・・・・・・・ フェージングシミュレータ４
１〜４ｎ・・・・・・・・・・・・・・・・・・・・・
・・・重み回路６１・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・・・キャリア発振器６
５．６６・・・・・・・・・・・・・・・・・・・・・
・・・ メモリ（ＲＯＭ）６７・・・・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・ クロ
ックパルス発生器６８・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・；ｒ・ ディジタル
／アナログ変換器１０、加・・・・・・・・・・・・・
・・・・・・・・・・・・・・入力端子１９．５２．７
０・・・・・・・・・・・・・・・出力端子代理人弁理
士 則 近 憲 佑 外１名第 １ 図 第 ２ 図 第 ４ 図
Claims (3)
- （１） 入力信号およびその入力信号と９０°位相の
異なる信号に対して各々ひずみ信号で夫々振幅変調した
後混合する装置において、前記ひずみ信号はメモリから
得ることを特徴とするフェージングシミュレータ。 - （２） メモリは、マルチパス若しくはフェージング
の影響を受けだ信号が記憶されたものであることを特徴
とする特許請求の範囲第１項記載のフェージングシミュ
レータ。 - （３） メモリは、単一周波キャリアがフェージング
を受けだ信号若しくはデジタル変調されたキャリアがマ
ルチパスを受けだ信号のうち少なくとも一方の信号の等
価ベースバンド信号の直交２成分信号が記憶されたもの
であることを特徴とする特許請求の範囲第１項記載のフ
ェージングシミュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57211326A JPS59101938A (ja) | 1982-12-03 | 1982-12-03 | フエ−ジングシミユレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57211326A JPS59101938A (ja) | 1982-12-03 | 1982-12-03 | フエ−ジングシミユレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59101938A true JPS59101938A (ja) | 1984-06-12 |
Family
ID=16604098
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57211326A Pending JPS59101938A (ja) | 1982-12-03 | 1982-12-03 | フエ−ジングシミユレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59101938A (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61196633A (ja) * | 1985-02-26 | 1986-08-30 | Oki Electric Ind Co Ltd | 無線機検査方法 |
| US4822451A (en) * | 1988-04-27 | 1989-04-18 | Minnesota Mining And Manufacturing Company | Process for the surface modification of semicrystalline polymers |
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