JPS5847917B2 - フゴウツウシンモコウセイホウシキ - Google Patents
フゴウツウシンモコウセイホウシキInfo
- Publication number
- JPS5847917B2 JPS5847917B2 JP6425475A JP6425475A JPS5847917B2 JP S5847917 B2 JPS5847917 B2 JP S5847917B2 JP 6425475 A JP6425475 A JP 6425475A JP 6425475 A JP6425475 A JP 6425475A JP S5847917 B2 JPS5847917 B2 JP S5847917B2
- Authority
- JP
- Japan
- Prior art keywords
- bit
- bits
- station
- parallel
- pam
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Description
【発明の詳細な説明】
符号化ビットの異る局が混在した場合に、容易に相互の
接続を可能とする方式に関するものである。
接続を可能とする方式に関するものである。
本発明の目的は、アナログ電話交換網をデジタル電話交
換網に遂次置換していく過程において、符号器の精粗に
差がある局が混在することが考えられる。
換網に遂次置換していく過程において、符号器の精粗に
差がある局が混在することが考えられる。
このような場合に容易に相互の接続を可能とする方式を
提供するものである。
提供するものである。
すなわち、入力（音声）情報を符号化するビットω数が
相違する局相互間の通信を行なう場合に符号化ビット数
の少ない局の符号化ビットに無効ビットを追加して、相
手局の符号化ビットの数に一致させるもので、また将来
市外回線のＰＣＭ化率が高くなり、すべてΦ局の符号化
ビット０数が少なくて済むようになればこの無効ビット
を回線の鳴音制御，エコー制御に転用することも考慮に
入れるものである。
相違する局相互間の通信を行なう場合に符号化ビット数
の少ない局の符号化ビットに無効ビットを追加して、相
手局の符号化ビットの数に一致させるもので、また将来
市外回線のＰＣＭ化率が高くなり、すべてΦ局の符号化
ビット０数が少なくて済むようになればこの無効ビット
を回線の鳴音制御，エコー制御に転用することも考慮に
入れるものである。
以下本発明を図面により詳しく説明する。
図は本発明に係る符号通信網構成方式の一実施例を示す
ブロック構成図を示す。
ブロック構成図を示す。
図において１は８ビット符号化局、２は伝送線路、３は
６ビット符号化局である。
６ビット符号化局である。
また４は８ビット符号化局の音声入力端子、５はＰＭＡ
変調器、６は８ビット符号器、７は並列一直列変換器、
８は送信線路インタフェース回路、１９は受信線路イン
タフェース回路、２０は直列一並列変換回路、２１は８
ビット復号器、２２はＰＡＭ復調器、２３は音声出力端
子である。
変調器、６は８ビット符号器、７は並列一直列変換器、
８は送信線路インタフェース回路、１９は受信線路イン
タフェース回路、２０は直列一並列変換回路、２１は８
ビット復号器、２２はＰＡＭ復調器、２３は音声出力端
子である。
１４は６ビット符号化局の音声入力端子、１５はＰＡＭ
変調器、１６は６ビット符号器、１７は並列一直列変換
器、１８は送信線路インタフェース回路、９は受信線路
インタフェース回路、１０は直列一変列変換回路、１１
は６ビット復号器、１２はＰＡＭ復調器、１３は音声出
力端子である。
変調器、１６は６ビット符号器、１７は並列一直列変換
器、１８は送信線路インタフェース回路、９は受信線路
インタフェース回路、１０は直列一変列変換回路、１１
は６ビット復号器、１２はＰＡＭ復調器、１３は音声出
力端子である。
図によって送受信動作を説明する。
１は８ビット符号化局で、音声入力端子４からの通話音
声電流はＰＡＭ変調器５においてＰＡＭ信号となり、図
示していない他の音声チャネルのＰＡＭ信号と時分割多
重化される。
声電流はＰＡＭ変調器５においてＰＡＭ信号となり、図
示していない他の音声チャネルのＰＡＭ信号と時分割多
重化される。
このＰＡＭ信号は８ビット符号器において、８ビットの
並列信号に符号化され、並列一直列変換器７によって直
列ＰＣＭ信号となり、さらに送信線路インタフェース回
路８によって、伝送線路２との接続条件が整えられ送出
される。
並列信号に符号化され、並列一直列変換器７によって直
列ＰＣＭ信号となり、さらに送信線路インタフェース回
路８によって、伝送線路２との接続条件が整えられ送出
される。
受信側の６ビット符号化局２においては、受信線路イン
タフェース回路９を経て受信したＰＣＭ信号は、並列一
直列変換回路１０によって並列信号に変換され、そのう
ち下位２ビットが切捨てられ、６．ビット復号器１１に
導かれる。
タフェース回路９を経て受信したＰＣＭ信号は、並列一
直列変換回路１０によって並列信号に変換され、そのう
ち下位２ビットが切捨てられ、６．ビット復号器１１に
導かれる。
６ビット復号器よりの出力はＰＡＭ復調器１２により再
サンプリングされ音声に復元され、音声出力端子１３に
出力する。
サンプリングされ音声に復元され、音声出力端子１３に
出力する。
次に６ビット符号化局３よりの送信動作について説明す
る。
る。
音声入力端子１４よりの通話音声電流は、ＰＡＭ変調器
１５を経て、６ビット符号器１６において、６ビットの
並列信号に変換され、並列一直列変換器１７により直列
ＰＣＭ信号となるが、このとき下位２ビットにＯが常に
外部より与えられる。
１５を経て、６ビット符号器１６において、６ビットの
並列信号に変換され、並列一直列変換器１７により直列
ＰＣＭ信号となるが、このとき下位２ビットにＯが常に
外部より与えられる。
この直列ＰＣＭ信号は送信線路インタフェース回路１８
、伝送線路２を経て、８ビット符号化局１に伝達され、
直列一並列変換回路２０により並列８ビ゛ノト信号に変
換されて、８ビット復号器２１で復号されるが、下位２
ビットは情報をもっていなため、６ビットの粗らい復号
が行なわれる。
、伝送線路２を経て、８ビット符号化局１に伝達され、
直列一並列変換回路２０により並列８ビ゛ノト信号に変
換されて、８ビット復号器２１で復号されるが、下位２
ビットは情報をもっていなため、６ビットの粗らい復号
が行なわれる。
ついでＰＡＭ復調器２２により音声に復元され、音声出
力端子２３より出力する。
力端子２３より出力する。
以上の説明は８ビット符号化局と６ビット符号化局との
組合せについて説明したが６ビット符号化局相互、８ビ
ット符号化局相互についても同じである。
組合せについて説明したが６ビット符号化局相互、８ビ
ット符号化局相互についても同じである。
但し８ビット符号局相互間については、８ビットの精密
な符号化が行なわれることは論をまたない。
な符号化が行なわれることは論をまたない。
坦上述べたように本発明によれば符号化ビット数の相違
する局が混在する場合に、相互通信の容易な通信網が構
成できる他市外回線のＰＣＭ化率が高かまり、すべての
局の符号化ビットの数が少なくて済むようになれば、剰
余ビットを利用して、鳴音制御，エコー制御などの回線
制御用に転用することも可能である。
する局が混在する場合に、相互通信の容易な通信網が構
成できる他市外回線のＰＣＭ化率が高かまり、すべての
局の符号化ビットの数が少なくて済むようになれば、剰
余ビットを利用して、鳴音制御，エコー制御などの回線
制御用に転用することも可能である。
図は本発明に係る符号通信網構成方式の一実施例を示す
ブロック構或図を示すものである。 符号の説明、１・・・８ビット符号化局、２・・・伝送
線路、３・・・６ビット符号化局、４，１４・・・音声
入力端子、５，１５・・・ＰＡＭ変調器、６・・・８ビ
ット符号器、７，１７・・・並列一直列変換器、８，１
８・・・送信娘路インタフェース回路、９，１９・・・
受信線路インタフェース回路、１０．２０・・・直列一
並列変換器、１１・・・６ビット復号器、１２，２２・
・・ＰＡＭ復調器、１３．２３・・・音声出力端子。
ブロック構或図を示すものである。 符号の説明、１・・・８ビット符号化局、２・・・伝送
線路、３・・・６ビット符号化局、４，１４・・・音声
入力端子、５，１５・・・ＰＡＭ変調器、６・・・８ビ
ット符号器、７，１７・・・並列一直列変換器、８，１
８・・・送信娘路インタフェース回路、９，１９・・・
受信線路インタフェース回路、１０．２０・・・直列一
並列変換器、１１・・・６ビット復号器、１２，２２・
・・ＰＡＭ復調器、１３．２３・・・音声出力端子。
Claims (1)
- １ 人力情報を符号化するビットの数が相違する局相互
の通信を行なう場合に、符号化ビット数の少ない局の符
号化ビットに無効ビットを追加して相手局の符号化ビッ
トの数に一致させることを特徴する符号通信網構成方式
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6425475A JPS5847917B2 (ja) | 1975-05-30 | 1975-05-30 | フゴウツウシンモコウセイホウシキ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6425475A JPS5847917B2 (ja) | 1975-05-30 | 1975-05-30 | フゴウツウシンモコウセイホウシキ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS51140412A JPS51140412A (en) | 1976-12-03 |
| JPS5847917B2 true JPS5847917B2 (ja) | 1983-10-25 |
Family
ID=13252841
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6425475A Expired JPS5847917B2 (ja) | 1975-05-30 | 1975-05-30 | フゴウツウシンモコウセイホウシキ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5847917B2 (ja) |
-
1975
- 1975-05-30 JP JP6425475A patent/JPS5847917B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS51140412A (en) | 1976-12-03 |
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