JPS5846830A - 電源保護回路 - Google Patents
電源保護回路Info
- Publication number
- JPS5846830A JPS5846830A JP56142786A JP14278681A JPS5846830A JP S5846830 A JPS5846830 A JP S5846830A JP 56142786 A JP56142786 A JP 56142786A JP 14278681 A JP14278681 A JP 14278681A JP S5846830 A JPS5846830 A JP S5846830A
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- JP
- Japan
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- signal
- power supply
- input terminal
- circuit
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- Protection Of Static Devices (AREA)
- Control Of Voltage And Current In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、特に過電流検出回路を改善し、異常状態に
おける電源供給を防止する電源保護回路に関する。
おける電源供給を防止する電源保護回路に関する。
一般に、電子装置等が安定に動作するには、電源が安定
に供給されると共に過電ｍｅの異常状態が発生した場合
には、確実にその電源供給を停止する必要がある。その
ために、過電流等の異常信号を検出し、この検出に応じ
て異常検出信号を発生する電源保護回路が設けられ、こ
の異常検出信号によって電子装置等への電源供給を確実
に防止する必要がある。従来、このような電源保護回路
は、第１図に示すように、電源入力信号Ｃ−が抵抗１１
ｍを介して一方の入力端子（員「−」側）に供給される
演算増幅器１１（以下オ、ペアンｌと称する）が設けら
れ。
に供給されると共に過電ｍｅの異常状態が発生した場合
には、確実にその電源供給を停止する必要がある。その
ために、過電流等の異常信号を検出し、この検出に応じ
て異常検出信号を発生する電源保護回路が設けられ、こ
の異常検出信号によって電子装置等への電源供給を確実
に防止する必要がある。従来、このような電源保護回路
は、第１図に示すように、電源入力信号Ｃ−が抵抗１１
ｍを介して一方の入力端子（員「−」側）に供給される
演算増幅器１１（以下オ、ペアンｌと称する）が設けら
れ。
このオペアンプ１１の他方の入力端子（正「＋」側）に
は電源入力信号畠が供給される。このオペアンｆｉｌの
出力端子には、並列接続のキャΔνりＣ，と抵抗６鵞、
からなろ過電流検出回路１ｊが設けられ、この検出回路
１２のキャノ譬νりＣ１と抵抗器Ｒ１の両端子に発生す
る電圧信号がそれぞれ一方および他方の入力端子に供給
され・る差動増幅器１１′が設けられる。またオペアン
！・１１の出力端子と入力信号・１の加えられる入力端
子（員「−」側）間には、帰還抵抗器Ｒ，が設けられ、
この出力端子には出力信号＠０が発生する。そして、差
動増幅器１３の出力信号Ｓ、が一方の入力端子（亀ｒ−
Ｊ側）に供給され、他方の入力端子（正「＋」側）には
検出基準信号すが供給される電圧比較器１４が設けられ
る。この電圧比較器１４の出力端子からは、信号８１に
応じて電源異常検出信号ｄが発生し１．この検出信号ｄ
によって電源基準信号町の供給停止を行なうなどの′４
＃供給手段°が制御される。
は電源入力信号畠が供給される。このオペアンｆｉｌの
出力端子には、並列接続のキャΔνりＣ，と抵抗６鵞、
からなろ過電流検出回路１ｊが設けられ、この検出回路
１２のキャノ譬νりＣ１と抵抗器Ｒ１の両端子に発生す
る電圧信号がそれぞれ一方および他方の入力端子に供給
され・る差動増幅器１１′が設けられる。またオペアン
！・１１の出力端子と入力信号・１の加えられる入力端
子（員「−」側）間には、帰還抵抗器Ｒ，が設けられ、
この出力端子には出力信号＠０が発生する。そして、差
動増幅器１３の出力信号Ｓ、が一方の入力端子（亀ｒ−
Ｊ側）に供給され、他方の入力端子（正「＋」側）には
検出基準信号すが供給される電圧比較器１４が設けられ
る。この電圧比較器１４の出力端子からは、信号８１に
応じて電源異常検出信号ｄが発生し１．この検出信号ｄ
によって電源基準信号町の供給停止を行なうなどの′４
＃供給手段°が制御される。
このような電源保護回路において、いま仮に電源基準信
号１を接地電位の場合、オ（アンプＪ１の出力信号ｅ０
は となり、電源利得Ｇは となる。このような、正常な罐源特性に対して電源に過
電流等の異常な状態が発生した場合、過電流検出回路１
１の抵抗器Ｒ１の両端子間に発生する電圧降下が変化す
る。したがって、この抵抗６遺、の両端子間の電圧が供
給される差動増幅器１１の出力信号ｓ１が変化して１通
常この出力信号８１が所定の検出基準信号すの電位より
も大きい場合には、電圧比較器１４の出力端子から電源
異常検出信号ｄが発生する。そして、この検出信号ｄに
よって電源基準信号＠ｉの遮断する手段または電源出方
ラインを線断するなどの電源供給手段が制御される。
号１を接地電位の場合、オ（アンプＪ１の出力信号ｅ０
は となり、電源利得Ｇは となる。このような、正常な罐源特性に対して電源に過
電流等の異常な状態が発生した場合、過電流検出回路１
１の抵抗器Ｒ１の両端子間に発生する電圧降下が変化す
る。したがって、この抵抗６遺、の両端子間の電圧が供
給される差動増幅器１１の出力信号ｓ１が変化して１通
常この出力信号８１が所定の検出基準信号すの電位より
も大きい場合には、電圧比較器１４の出力端子から電源
異常検出信号ｄが発生する。そして、この検出信号ｄに
よって電源基準信号＠ｉの遮断する手段または電源出方
ラインを線断するなどの電源供給手段が制御される。
このような電源保護回路によって、異常状態における電
源の供給を阻止できるが、過電流検出回路１２が第４ア
ンｆ１ｘの出力端子に設けられることによって、検出回
路ＩＪの抵抗器Ｒ。
源の供給を阻止できるが、過電流検出回路１２が第４ア
ンｆ１ｘの出力端子に設けられることによって、検出回
路ＩＪの抵抗器Ｒ。
が電１出力電圧りに対する負荷電流特性の低下および電
源出力特性の可変幅の範囲の低下をもたらす障害が発生
する。したがって、このような障害を防止するため、必
然的に抵抗器Ｒ１の抵抗値を微小抵抗値に選択設定する
必要があり、また、検出回路１２のキャΔνりｃｌは。
源出力特性の可変幅の範囲の低下をもたらす障害が発生
する。したがって、このような障害を防止するため、必
然的に抵抗器Ｒ１の抵抗値を微小抵抗値に選択設定する
必要があり、また、検出回路１２のキャΔνりｃｌは。
負荷が）譬ルスの電流負荷である場合、ノ臂ルス電流に
対しては応答しない機能をもたせるために設けられてい
るものであるため、このキャノ譬νりＣ３の容量値は大
容量となる。したがって、特ニ大定格電流、ノ臂ルス亀
荷の電源においてはこのような傾向が大となり、高価な
キヤ／＃シタが必要となり、スペースも大きくなる。
対しては応答しない機能をもたせるために設けられてい
るものであるため、このキャノ譬νりＣ３の容量値は大
容量となる。したがって、特ニ大定格電流、ノ臂ルス亀
荷の電源においてはこのような傾向が大となり、高価な
キヤ／＃シタが必要となり、スペースも大きくなる。
この発明は上記の事情を鑑みなされたもので、高ルー！
利得の帰還回路方式の電源回路にお％、ｓて、過電流等
の異常状態を演算増幅器の仮想接地電位の変化により検
出することによって、電源出力電圧に対する負荷電流特
性の向上、および電源出力特性の可変幅の範■を大きく
できる高性能の電源保護回路を提供することを目的とす
る。
利得の帰還回路方式の電源回路にお％、ｓて、過電流等
の異常状態を演算増幅器の仮想接地電位の変化により検
出することによって、電源出力電圧に対する負荷電流特
性の向上、および電源出力特性の可変幅の範■を大きく
できる高性能の電源保護回路を提供することを目的とす
る。
以下図面を参照してこの発明の一実施例直二ついて説明
する。第２図はそ、の構成を示すもので、上記第１図に
、示すと同＠ｌ：、電源入力信号ｅ直が抵抗器Ｒ１を介
して一方の入力端子（＊ ｒ−Ｊ側）に供給されるオペ
アンプ１１カ一般６すられ、このオペアンｆ１１の一方
の入力端子（ｊｌＬｒ−Ｊ側）と出力端子間に帰還抵抗
器Ｂ８が設けられる。さらにオペアン７’ＪＪの他方の
入力端子（正「＋」側）には、電源基準信号ａが供給さ
れ。
する。第２図はそ、の構成を示すもので、上記第１図に
、示すと同＠ｌ：、電源入力信号ｅ直が抵抗器Ｒ１を介
して一方の入力端子（＊ ｒ−Ｊ側）に供給されるオペ
アンプ１１カ一般６すられ、このオペアンｆ１１の一方
の入力端子（ｊｌＬｒ−Ｊ側）と出力端子間に帰還抵抗
器Ｂ８が設けられる。さらにオペアン７’ＪＪの他方の
入力端子（正「＋」側）には、電源基準信号ａが供給さ
れ。
このオペアンｆ１１の１紀八カ端子（員「−」側）のム
点（仮想接地点）から信号８．が取り出される。とのと
き、信号８．が／ｆルス電流である場合、非感応時間を
設定し、検出−動作め誤動作を防ぐため遅延回路２１が
設けられ、信号８鵞はと−の遅延回路１１を介して電圧
比較器１４の一方の入力端子（負「−」側）に供給され
る。この遅延回路２１は抵抗Ｒ４とキャΔνりＣ■の直
列回路で、オペアン７”ＪＪの各入力端子（負「−」側
）および（正「＋」側）間に接続さ°れている。そして
電圧比較器１４の他方の入力端′−Ｆ（正ｒ＋Ｊ側）に
は、ｓ１出基準信号すが供給され、この検出基準信号す
と信号８゜Φ差に応じて電圧比較器１４の出方端子から
異常検出信号櫨を発生する。そして、この検出信号−に
よって電源人力信号・１の供給停止またほ電源出力ライ
ンの遮断等の電源供給手段が制御される。
点（仮想接地点）から信号８．が取り出される。とのと
き、信号８．が／ｆルス電流である場合、非感応時間を
設定し、検出−動作め誤動作を防ぐため遅延回路２１が
設けられ、信号８鵞はと−の遅延回路１１を介して電圧
比較器１４の一方の入力端子（負「−」側）に供給され
る。この遅延回路２１は抵抗Ｒ４とキャΔνりＣ■の直
列回路で、オペアン７”ＪＪの各入力端子（負「−」側
）および（正「＋」側）間に接続さ°れている。そして
電圧比較器１４の他方の入力端′−Ｆ（正ｒ＋Ｊ側）に
は、ｓ１出基準信号すが供給され、この検出基準信号す
と信号８゜Φ差に応じて電圧比較器１４の出方端子から
異常検出信号櫨を発生する。そして、この検出信号−に
よって電源人力信号・１の供給停止またほ電源出力ライ
ンの遮断等の電源供給手段が制御される。
このように構成される電−保護回路において、電源出力
信号・。は、高ループ利得の帰還回路を構成するオペア
ンｆｘｘの出力端子から発生し、このときの電源利得Ｇ
は下記のように表現される。すなわち、 となり、ここで。
信号・。は、高ループ利得の帰還回路を構成するオペア
ンｆｘｘの出力端子から発生し、このときの電源利得Ｇ
は下記のように表現される。すなわち、 となり、ここで。
ム：オペアンプの順方向利得
Ｂ：帰還率
である、この式（１）より、ルー！利得が大きい場合、
すなわち、「Ｂム）１」であるとき、履表現される。こ
のような帰還回路では、オ（アンプ１１の一方の入力端
子（員「−」側）と帰還抵抗ｌ、の接続点は仮想接地点
（仮想零点）（勾となり、ここを流れる電流は電源入力
信号・伍と抵抗器量、のみに依存したものとなる。した
がって、上記式（１）が成立しているときに、電源入力
信号・１が供給された場合、仮想接地点（Ａ）から遅延
回路２１に電圧信号が供給され、この遅延回路２゛１の
抵抗６遺、とキャノ譬νりＣ２の共通接続点Ｂから電圧
信号８．が発生する。このとき、遅延回路２１は、オペ
アンプの出力特性の制約を受けないため、抵抗器量、の
値を太き（、キャΔＶりＣ１の値を小さくすることが可
能であ゛す、したがって小臘で廉価な装置を作ることが
できる。この信号Ｓ、が電圧比較器１４の一方の入力端
子（「−」側）に供給され、その他方の入力端子（「＋
」側）に供給される検出基準“信号すより信号８１が低
電位である場合、電圧比較器１４′の出力端子からは異
常検出信号−は発生しない。このような帰還回路におい
て１例えば電源出力信号・。が発生するオペアＶｆｌｌ
の出力端子の負荷の短絡等により上記式（りの条件が成
立しなくなったとき、すなわち過電流等の異常電源が発
生した場合、仮想接地電位の電位は、上記のよ引：上記
式（２）の条件が成立している正常状態のときの仮想接
地点（Ａ）の電位と比較して変化する。したカーって、
この仮想接地点ＩＡ）の変化した電圧信号（通常′鑵位
力を高い）が遅延回路２１に供給され、この遅延回路２
１の共通接続点Ｂから電圧信号Ｓ、カを発生し、電圧比
較器１４の一方の入力端子（「−」側）に供給、される
。このとき、＠圧比較器１４の他方の入力端子（「＋」
側）シニ供給される検出基準信号すより信号Ｓｍの方力
を高電位である場合、電圧比較器１４の出力端子カーら
をま異常検出信号ｄが発生し、この異常検出信彎ｄ信二
よって電源入力信号・轟の供給停止また）よＩＩｔＷＡ
出カライフカラインの電源供給手段力ｔ １！１１ ｍ
される。
すなわち、「Ｂム）１」であるとき、履表現される。こ
のような帰還回路では、オ（アンプ１１の一方の入力端
子（員「−」側）と帰還抵抗ｌ、の接続点は仮想接地点
（仮想零点）（勾となり、ここを流れる電流は電源入力
信号・伍と抵抗器量、のみに依存したものとなる。した
がって、上記式（１）が成立しているときに、電源入力
信号・１が供給された場合、仮想接地点（Ａ）から遅延
回路２１に電圧信号が供給され、この遅延回路２゛１の
抵抗６遺、とキャノ譬νりＣ２の共通接続点Ｂから電圧
信号８．が発生する。このとき、遅延回路２１は、オペ
アンプの出力特性の制約を受けないため、抵抗器量、の
値を太き（、キャΔＶりＣ１の値を小さくすることが可
能であ゛す、したがって小臘で廉価な装置を作ることが
できる。この信号Ｓ、が電圧比較器１４の一方の入力端
子（「−」側）に供給され、その他方の入力端子（「＋
」側）に供給される検出基準“信号すより信号８１が低
電位である場合、電圧比較器１４′の出力端子からは異
常検出信号−は発生しない。このような帰還回路におい
て１例えば電源出力信号・。が発生するオペアＶｆｌｌ
の出力端子の負荷の短絡等により上記式（りの条件が成
立しなくなったとき、すなわち過電流等の異常電源が発
生した場合、仮想接地電位の電位は、上記のよ引：上記
式（２）の条件が成立している正常状態のときの仮想接
地点（Ａ）の電位と比較して変化する。したカーって、
この仮想接地点ＩＡ）の変化した電圧信号（通常′鑵位
力を高い）が遅延回路２１に供給され、この遅延回路２
１の共通接続点Ｂから電圧信号Ｓ、カを発生し、電圧比
較器１４の一方の入力端子（「−」側）に供給、される
。このとき、＠圧比較器１４の他方の入力端子（「＋」
側）シニ供給される検出基準信号すより信号Ｓｍの方力
を高電位である場合、電圧比較器１４の出力端子カーら
をま異常検出信号ｄが発生し、この異常検出信彎ｄ信二
よって電源入力信号・轟の供給停止また）よＩＩｔＷＡ
出カライフカラインの電源供給手段力ｔ １！１１ ｍ
される。
このように、帰還回路を構成するオペアンプ１１の仮想
接地点の電位変イヒな検出すること書−よって、過電流
等の異常電源発生時ｇ二異常檜出信号を発生し、電源保
護動作を行なうこと力ｔできる。したがって、オ（アン
プ１１の出力端子に過電流検出抵抗器を不要Ｉ：できる
ことＩ：よって、電源出力電圧に対する負荷電流特性を
向上することができ、また出力ダイナミックレンジの崗
と、すなわち電源出力特性の可変幅の範囲を拡大するこ
とができる。
接地点の電位変イヒな検出すること書−よって、過電流
等の異常電源発生時ｇ二異常檜出信号を発生し、電源保
護動作を行なうこと力ｔできる。したがって、オ（アン
プ１１の出力端子に過電流検出抵抗器を不要Ｉ：できる
ことＩ：よって、電源出力電圧に対する負荷電流特性を
向上することができ、また出力ダイナミックレンジの崗
と、すなわち電源出力特性の可変幅の範囲を拡大するこ
とができる。
以上詳述したようにこの発明によれば、高ループ利得の
帰還回路方式の電源回路において。
帰還回路方式の電源回路において。
演算増幅器の仮想接地電位の変化によって、過電流等の
異常状態を検出し、電源供給を制御するものであるから
、電飾出力電圧に対する負荷電流特性が向上し、電−出
力特性の可変幅の範囲を大きくできる高性能の電源保護
回路を得ることができ、しかも従来のような大容量で高
価なキャΔνりを必要としないために装置も小型廉価に
′なる効果を有する。
異常状態を検出し、電源供給を制御するものであるから
、電飾出力電圧に対する負荷電流特性が向上し、電−出
力特性の可変幅の範囲を大きくできる高性能の電源保護
回路を得ることができ、しかも従来のような大容量で高
価なキャΔνりを必要としないために装置も小型廉価に
′なる効果を有する。
第１図は従来の電源保護回路の構成図、第２図はこの発
明の一実施例に係る電源保護回路の構成図である。 １１・・・演算増幅器、１２・・・過電流検出回路。 ＩＪ・・・差動増幅器、１４・・・電圧比較器、２１・
・・遅延回路、”１ ｍ ”ｍ ｓ Ｒｍ ＊
”４・・・抵抗器。 Ｃ１、Ｃ，・・・キャＩ譬シタ。 出願人代理人 弁理士 鈴 江 武 彦第１図 動
明の一実施例に係る電源保護回路の構成図である。 １１・・・演算増幅器、１２・・・過電流検出回路。 ＩＪ・・・差動増幅器、１４・・・電圧比較器、２１・
・・遅延回路、”１ ｍ ”ｍ ｓ Ｒｍ ＊
”４・・・抵抗器。 Ｃ１、Ｃ，・・・キャＩ譬シタ。 出願人代理人 弁理士 鈴 江 武 彦第１図 動
Claims (1)
- 【特許請求の範囲】 一方の入力端子に’Ｋ１１ｌ入力信号入力輪され。 この入力端子と出力端子間に帰還抵抗器が設けられ、さ
らに他方の入力端子にＩＩ＃！基準信号が供給される演
算増幅器と、この演算増幅器の・上記一方の入力端子と
他方の入力端子間に接続された抵抗器とキャノ４νりの
直列回路からなる遅延回路と、この遅延回路の出力信号
が一方の入力端子に供給され、他方の入力端子に検出基
準信号が供給される電圧比較器とを具備したことを特徴
とする電ｓｍｍ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142786A JPS5846830A (ja) | 1981-09-10 | 1981-09-10 | 電源保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142786A JPS5846830A (ja) | 1981-09-10 | 1981-09-10 | 電源保護回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5846830A true JPS5846830A (ja) | 1983-03-18 |
| JPS6315819B2 JPS6315819B2 (ja) | 1988-04-06 |
Family
ID=15323564
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56142786A Granted JPS5846830A (ja) | 1981-09-10 | 1981-09-10 | 電源保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5846830A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5034289A (en) * | 1989-02-23 | 1991-07-23 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery and method of producing negative electrode thereof |
| US5250369A (en) * | 1989-02-23 | 1993-10-05 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery |
| US5346781A (en) * | 1989-02-23 | 1994-09-13 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery |
-
1981
- 1981-09-10 JP JP56142786A patent/JPS5846830A/ja active Granted
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5034289A (en) * | 1989-02-23 | 1991-07-23 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery and method of producing negative electrode thereof |
| US5250369A (en) * | 1989-02-23 | 1993-10-05 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery |
| US5346781A (en) * | 1989-02-23 | 1994-09-13 | Matsushita Electric Industrial Co., Ltd. | Alkaline storage battery |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6315819B2 (ja) | 1988-04-06 |
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