JPS5844522A - 瞬時停電保護回路 - Google Patents
瞬時停電保護回路Info
- Publication number
- JPS5844522A JPS5844522A JP56142298A JP14229881A JPS5844522A JP S5844522 A JPS5844522 A JP S5844522A JP 56142298 A JP56142298 A JP 56142298A JP 14229881 A JP14229881 A JP 14229881A JP S5844522 A JPS5844522 A JP S5844522A
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- JP
- Japan
- Prior art keywords
- circuit
- reset
- timer
- capacitor
- time
- Prior art date
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- Granted
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/24—Resetting means
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Control Of Ac Motors In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はＯＲ時定数回路のコンデンサＣの両端電圧を電
源として作動する半導体素子を有する回路へ瞬時停電保
護回路に関するものである。この種の回路では、半導体
素子が蓼動作しない工うＫ、停電が生じ、回復したとき
に回路をリセットするが従来１夛用いられているリセッ
ト回路は、第１図に示すように構成してあつ友。この回
路ではＯＲ時定数回路によってリセツＦ信号を得ていた
。つまり停電時はＲと並列に設けられたダイオードＤに
よって時定数を小さくしているム停電になっても自動電
圧調整回路の出力端子の出力Ｖａがコンデンサ０とダイ
オードＤで分圧されコンデンサ００両肩電圧は零になら
ない九め実用的なリセット波形が得られない欠点があっ
た０な訃出カ端子ｌＬは、コンデンサ０の両端電圧を電
源として動作する半導体素子を有する回路１が接続され
る０上述の通り、従来の回路では停電時にリセット波形
が確実に得られない。即ち停電（＃時停電）の時間に１
つては、制御回路電圧が回路の半導体素子の正常動作を
保障できない程に低下しているため、電源ａ帰後もシス
テムは娯動作のま＼となる。っｔ９プｐグラム制御が暴
走する心とがあっム ｊｌｌＫ２図はこの状
ｍｉ−示してお９ｖｏは交流電源波形でｔ１時点で停電
が起き、ｔ、で回復したことを示している。
源として作動する半導体素子を有する回路へ瞬時停電保
護回路に関するものである。この種の回路では、半導体
素子が蓼動作しない工うＫ、停電が生じ、回復したとき
に回路をリセットするが従来１夛用いられているリセッ
ト回路は、第１図に示すように構成してあつ友。この回
路ではＯＲ時定数回路によってリセツＦ信号を得ていた
。つまり停電時はＲと並列に設けられたダイオードＤに
よって時定数を小さくしているム停電になっても自動電
圧調整回路の出力端子の出力Ｖａがコンデンサ０とダイ
オードＤで分圧されコンデンサ００両肩電圧は零になら
ない九め実用的なリセット波形が得られない欠点があっ
た０な訃出カ端子ｌＬは、コンデンサ０の両端電圧を電
源として動作する半導体素子を有する回路１が接続され
る０上述の通り、従来の回路では停電時にリセット波形
が確実に得られない。即ち停電（＃時停電）の時間に１
つては、制御回路電圧が回路の半導体素子の正常動作を
保障できない程に低下しているため、電源ａ帰後もシス
テムは娯動作のま＼となる。っｔ９プｐグラム制御が暴
走する心とがあっム ｊｌｌＫ２図はこの状
ｍｉ−示してお９ｖｏは交流電源波形でｔ１時点で停電
が起き、ｔ、で回復したことを示している。
ｖ６は第１図で示し友ｖｄと同じ電圧成形でるる０この
電圧を作る回路は交流電圧Ｖ＠を全波整流する回路と平
滑用コンデンサと自動電圧調整回路１（共に図示しない
）で構成しであるので、ｔ１時点で停電が起ってもしば
らくは低下しないＯｖ４＃：ｔコンデンサＣの両端電圧
波形である。この電圧のレベルがｔ、に達すると８．に
示すようにリセット信号が生成される。しかし停電が発
生してから回復する時間ｔｍ時点く至る間に、電圧Ｖ、
はレベルｔｍ以下にならないから時点１．でもリセット
信号が出ないことをこの図は示しているＯ この之め電圧ｖ、２＞ζこの電圧Ｖａｔ受けて制御され
る回路素子の動作保障以下のレベルまで低下していると
回路トは電源回復後に暴走することがあるのである。
電圧を作る回路は交流電圧Ｖ＠を全波整流する回路と平
滑用コンデンサと自動電圧調整回路１（共に図示しない
）で構成しであるので、ｔ１時点で停電が起ってもしば
らくは低下しないＯｖ４＃：ｔコンデンサＣの両端電圧
波形である。この電圧のレベルがｔ、に達すると８．に
示すようにリセット信号が生成される。しかし停電が発
生してから回復する時間ｔｍ時点く至る間に、電圧Ｖ、
はレベルｔｍ以下にならないから時点１．でもリセット
信号が出ないことをこの図は示しているＯ この之め電圧ｖ、２＞ζこの電圧Ｖａｔ受けて制御され
る回路素子の動作保障以下のレベルまで低下していると
回路トは電源回復後に暴走することがあるのである。
本発明の目的はこのような点を解決することにあるＯ
すなわち、本発明では従来のリセット回路に、次の回路
及びプログラム制御を追加する０そして、交流停電を検
出した後一定時間（この時点では制御回路電圧はまだ回
路の正常動作を保障するレベルにある）経過後、プログ
ラム制御に工り、リセット回路内コンデンサの蓄積電荷
の放電回路を動作させ、リセット信号を再生させる。
及びプログラム制御を追加する０そして、交流停電を検
出した後一定時間（この時点では制御回路電圧はまだ回
路の正常動作を保障するレベルにある）経過後、プログ
ラム制御に工り、リセット回路内コンデンサの蓄積電荷
の放電回路を動作させ、リセット信号を再生させる。
つまクリセツシ信号発生を時間を見計らって、７ａグラ
ムに工り指令するのが本発明の特徴でめるＯ 発明の実施例を第３図に、タイムチャートを第４図に示
す０交流停電−出手段２の出力Ｓ、が時点ｔ１で″１”
（停電を示す）を示すとタイマ３は針数を開始する。
ムに工り指令するのが本発明の特徴でめるＯ 発明の実施例を第３図に、タイムチャートを第４図に示
す０交流停電−出手段２の出力Ｓ、が時点ｔ１で″１”
（停電を示す）を示すとタイマ３は針数を開始する。
タイムアツプ（タイマ時間をｔ・とする）以前に停電検
出子段高ｊカが・。・となればタイマはクリアされる。
出子段高ｊカが・。・となればタイマはクリアされる。
１０”にならずにタイ−ｖ３の整定時間ｔ ｍ ｔ＆遇
するとタイマ３はペース回路４とＦランラスタ５とから
成る短絡手段６を動作させコンデンサ０の電荷を放出さ
せる。この時電圧ｖ１は回路動作を保障するレベルでな
ければならない（直流電源の保持時間 ）ｔｍと設計す
る）０ 放電指令Ｂ、によってコンデンサＣの電荷は非
常に短い時間内（ｔ−）に放電さね一強制的にり竜ツ）
信号８４が作られる０電ｇＩＪｂ（ｔ ＊で復帰すれけ
、一定時間（リセット時間５ｔＲ）後リセット信号発生
手段７が動作しリセット信号が解除されてプログラムは
初期状態からスタートすることになる。
するとタイマ３はペース回路４とＦランラスタ５とから
成る短絡手段６を動作させコンデンサ０の電荷を放出さ
せる。この時電圧ｖ１は回路動作を保障するレベルでな
ければならない（直流電源の保持時間 ）ｔｍと設計す
る）０ 放電指令Ｂ、によってコンデンサＣの電荷は非
常に短い時間内（ｔ−）に放電さね一強制的にり竜ツ）
信号８４が作られる０電ｇＩＪｂ（ｔ ＊で復帰すれけ
、一定時間（リセット時間５ｔＲ）後リセット信号発生
手段７が動作しリセット信号が解除されてプログラムは
初期状態からスタートすることになる。
なお電源が回復しないうちにコンデンサＣの電荷は決し
てレベルｔ、にはならない工うに、Ｖｄの減衰状況との
かね合いで難路時間ｔ８は決市される。
てレベルｔ、にはならない工うに、Ｖｄの減衰状況との
かね合いで難路時間ｔ８は決市される。
第１図は従来がらある保護回路の回′＠図、ｊＫ２図は
その動作を示すタイムチャート、第３図は本１は半導体
素子ｒ有する回路、２は停電構出手段、３はタイマ、６
は短絡手段、７はリセット信号発生手段、Ｃ及びＲはＯ
Ｒ時定数回路を構成するコンデンサ及び抵抗である０ 、″− ゛ −一 井３図
その動作を示すタイムチャート、第３図は本１は半導体
素子ｒ有する回路、２は停電構出手段、３はタイマ、６
は短絡手段、７はリセット信号発生手段、Ｃ及びＲはＯ
Ｒ時定数回路を構成するコンデンサ及び抵抗である０ 、″− ゛ −一 井３図
Claims (1)
- ＯＲ時定数回路の前記コンデンサ０の両端電圧を電源と
して動作する半導体素子を有するものに於いて、停電検
出手段と、この停電検出手段からの信号を受けて動作す
るタイマと、このタイマの整定時間後に前記コンデンサ
を短絡する短絡手段と、前記コンデンサの両端電圧が一
定値に達したとき前記半導体素子動作指令を出す、リセ
ット信号発生手段とから成る瞬時停電保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142298A JPS601642B2 (ja) | 1981-09-11 | 1981-09-11 | 瞬時停電保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142298A JPS601642B2 (ja) | 1981-09-11 | 1981-09-11 | 瞬時停電保護回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5844522A true JPS5844522A (ja) | 1983-03-15 |
| JPS601642B2 JPS601642B2 (ja) | 1985-01-16 |
Family
ID=15312120
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56142298A Expired JPS601642B2 (ja) | 1981-09-11 | 1981-09-11 | 瞬時停電保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS601642B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01163048A (ja) * | 1987-12-21 | 1989-06-27 | Yoshihiko Seki | 発泡樹脂成形装置 |
-
1981
- 1981-09-11 JP JP56142298A patent/JPS601642B2/ja not_active Expired
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01163048A (ja) * | 1987-12-21 | 1989-06-27 | Yoshihiko Seki | 発泡樹脂成形装置 |
| JPH0535671B2 (ja) * | 1987-12-21 | 1993-05-27 | Hitachi Chemical Co Ltd |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS601642B2 (ja) | 1985-01-16 |
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