JPS5834478Y2 - エンベロ−プ信号形成回路 - Google Patents
エンベロ−プ信号形成回路Info
- Publication number
- JPS5834478Y2 JPS5834478Y2 JP1977177101U JP17710177U JPS5834478Y2 JP S5834478 Y2 JPS5834478 Y2 JP S5834478Y2 JP 1977177101 U JP1977177101 U JP 1977177101U JP 17710177 U JP17710177 U JP 17710177U JP S5834478 Y2 JPS5834478 Y2 JP S5834478Y2
- Authority
- JP
- Japan
- Prior art keywords
- switching element
- variable resistor
- signal
- output
- capacitor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【考案の詳細な説明】
本考案は弦楽器、打楽器等の各種の楽器から奏せられる
音に類似した音を電気的に作るためのエンベロープ信号
の形成回路に関する。
音に類似した音を電気的に作るためのエンベロープ信号
の形成回路に関する。
従来から楽器に類似した音を電気的に形成する電子楽器
が開発されているが、従来のこの種の回路はアナログの
スイッチやコンパレータを用いて構成され、部品点数が
多く複雑な回路を必要とする等の欠点があった。
が開発されているが、従来のこの種の回路はアナログの
スイッチやコンパレータを用いて構成され、部品点数が
多く複雑な回路を必要とする等の欠点があった。
本考案は上記従来装置の欠点を除去して、簡単な回路で
しかも音を制御するための制御部をディジタル回路で構
成することができるエンベロープ信号形成回路を提供す
るものである。
しかも音を制御するための制御部をディジタル回路で構
成することができるエンベロープ信号形成回路を提供す
るものである。
次に実施例を挙げて本考案を詳細に説明する。
一般に弦楽器や打楽器等の楽器を奏することによって生
じる音を電気的に作る場合、音の発生から停止に到るま
でには、立上りのためのアタックＡＴ、減衰のためのデ
ィケイＤＥ、一定レベルに保持するサスティンＳＵ及び
停止のための解除ＲＥの期間が必要となり、このような
期間を備えた信号はエンベロープ信号と呼ばれ、該エン
ベロープ信号で電気制御増幅器ＶＣＡや電圧制御濾波器
ＶＣＦを制御することにより、各種楽器特有の効果音を
電気的に作り出している。
じる音を電気的に作る場合、音の発生から停止に到るま
でには、立上りのためのアタックＡＴ、減衰のためのデ
ィケイＤＥ、一定レベルに保持するサスティンＳＵ及び
停止のための解除ＲＥの期間が必要となり、このような
期間を備えた信号はエンベロープ信号と呼ばれ、該エン
ベロープ信号で電気制御増幅器ＶＣＡや電圧制御濾波器
ＶＣＦを制御することにより、各種楽器特有の効果音を
電気的に作り出している。
即ちエンベロープ信号を形成する上記各期間及びそのレ
ベルを調整してエンベロープ信号そのものの波形を制御
し、これにより音の高さ、強さ及び音色等の制御がなさ
れて楽器特有の音が電気的に奏せられる。
ベルを調整してエンベロープ信号そのものの波形を制御
し、これにより音の高さ、強さ及び音色等の制御がなさ
れて楽器特有の音が電気的に奏せられる。
第１図は本考案によるエンベロープ信号形成回路で、第
２図は同回路の動作説明に供する信号波形図である。
２図は同回路の動作説明に供する信号波形図である。
図に於て入力端ａは電子楽器等に設けられたキー人力部
に接続され、例えばキーが操作されている期間キー信号
Ａが与えられる。
に接続され、例えばキーが操作されている期間キー信号
Ａが与えられる。
上記入力端ａには第１スイツチング素子ＳＷ１を介して
第１可変抵抗器Ｒ１が接続され、該第１可変抵抗器Ｒ１
の他端と接地間に電位レベルを記憶させるためのコンテ
゛ンサＸが接続され、該第１可変抵抗器Ｒ１とコンデン
サＸの接続点が出力端ｆとして導出されている。
第１可変抵抗器Ｒ１が接続され、該第１可変抵抗器Ｒ１
の他端と接地間に電位レベルを記憶させるためのコンテ
゛ンサＸが接続され、該第１可変抵抗器Ｒ１とコンデン
サＸの接続点が出力端ｆとして導出されている。
ＦＦはＲＳフリップフロップで、該フリップフロラフ下
Ｆのセット信号Ｓには、上記入力端ａとセット端子Ｓ間
に接続された微分回路りを介した信号が入力される。
Ｆのセット信号Ｓには、上記入力端ａとセット端子Ｓ間
に接続された微分回路りを介した信号が入力される。
即ち上記キー人力信号Ａの立上りを検出する微分された
第２図の信号Ｂが人力され、フリップフロップＦＦをセ
ット状態にする。
第２図の信号Ｂが人力され、フリップフロップＦＦをセ
ット状態にする。
同フリップフロップＦＦのリセット端子は上記第１可変
抵抗器Ｒ１とコンテ゛ンサＸとの接続点に接続され、コ
ンテ゛ンサＸの電位が予め設定された所定のレベルに達
した状態でセット状態のフリップフロップＦＦをリセッ
トさせる。
抵抗器Ｒ１とコンテ゛ンサＸとの接続点に接続され、コ
ンテ゛ンサＸの電位が予め設定された所定のレベルに達
した状態でセット状態のフリップフロップＦＦをリセッ
トさせる。
フリップフロップＦＦのＱ出力は第１アンドゲートＧ１
の一方の入力端子に、−〇−出力は第２アンドゲートＧ
２の一方の入力端子に夫々与えられている。
の一方の入力端子に、−〇−出力は第２アンドゲートＧ
２の一方の入力端子に夫々与えられている。
第１及び第２アンドゲートＧ１．Ｇ２の各他方の入力端
子には上記キー信号Ａが入力され、キー信号Ａとフリッ
プフロップＦＦの出力信号Ｑ又はＱの論理積がとられて
ゲート出力信号Ｃ及びＤが導出される。
子には上記キー信号Ａが入力され、キー信号Ａとフリッ
プフロップＦＦの出力信号Ｑ又はＱの論理積がとられて
ゲート出力信号Ｃ及びＤが導出される。
即ちキー信号Ａがコンデ゛ンサＸの電位によって制御さ
れた信号がゲート出力として導出される。
れた信号がゲート出力として導出される。
第１アンドゲートＧ１の出力信号Ｃは上記第１スイツチ
ング素子ＳＷ１のオン・オフ動作を制御し、キー信号Ａ
の立上りで第１アンドゲートＧ１から信号Ｃとして高レ
ベルの信号が出力されることに基いて第１スイツチング
素子ＳＷ１はオンに変化し、第１可変抵抗器Ｒ１で設定
された抵抗値との時定数でコンデンサＸが充電される。
ング素子ＳＷ１のオン・オフ動作を制御し、キー信号Ａ
の立上りで第１アンドゲートＧ１から信号Ｃとして高レ
ベルの信号が出力されることに基いて第１スイツチング
素子ＳＷ１はオンに変化し、第１可変抵抗器Ｒ１で設定
された抵抗値との時定数でコンデンサＸが充電される。
該コンデンサＸの充電電位は出力端ｆに導出されて出力
波形Ｆｃｒ）１１〜１２時間に示す立上りのアタック期
間ＡＴを生じる。
波形Ｆｃｒ）１１〜１２時間に示す立上りのアタック期
間ＡＴを生じる。
該アタック期間ＡＴの信号波形：よ上記第１可変抵抗器
Ｒ１の抵抗値を調整することによって設定し得る。
Ｒ１の抵抗値を調整することによって設定し得る。
コンテ゛ンサＸの充電電位が予め設定された所定値■８
に達すると（時間ｔ２）フリップフロップＦＦのリセッ
ト端子Ｒに信号が入力されてリセットする。
に達すると（時間ｔ２）フリップフロップＦＦのリセッ
ト端子Ｒに信号が入力されてリセットする。
フリップフロラフ下Ｆのリセットにより第１アンドゲー
トＧ１の出力信号Ｃは低レベルに変化し、第１スイツチ
ング素子ＳＷ１をオフにする。
トＧ１の出力信号Ｃは低レベルに変化し、第１スイツチ
ング素子ＳＷ１をオフにする。
一方Ｑ出力“が入力された第２アンドゲートＧ２の出力
信号りは高レベルに変化し、第２スイツチング素子ＳＷ
２に入力されてオフ状態をオンに変化させる。
信号りは高レベルに変化し、第２スイツチング素子ＳＷ
２に入力されてオフ状態をオンに変化させる。
該第２スイツチング素子ＳＷ２は、上記第１可変抵抗器
Ｒ１の出力端側に第２可変抵抗器Ｒ２を介して接続され
、第２スイツチング素子ＳＷ２の他端は第３可変抵抗器
Ｒ３の可変端子ｒ３に接続されて、可変端子ｒ３の設定
値に基いた電圧が第２スイツチング素子ＳＷ２に印加さ
れる。
Ｒ１の出力端側に第２可変抵抗器Ｒ２を介して接続され
、第２スイツチング素子ＳＷ２の他端は第３可変抵抗器
Ｒ３の可変端子ｒ３に接続されて、可変端子ｒ３の設定
値に基いた電圧が第２スイツチング素子ＳＷ２に印加さ
れる。
向上記第３可変抵抗器Ｒ３は予め基準電圧■。
が印加され、該基準電圧Ｖ。を可変端子ｒ３によって分
圧した電圧が上記第２スイツチング素子ＳＷ２に印加さ
れる。
圧した電圧が上記第２スイツチング素子ＳＷ２に印加さ
れる。
上記フリップフロップＦＦのリセット及び第２アンドゲ
ートＧ２の高レベル出力によって第２スイツチング素子
ＳＷ２がオンに変化することにより、上記コンテ゛ンサ
Ｘに充電されていた電荷は第２可変抵抗器Ｒ２を介して
、上記第３可変抵抗器Ｒ３で設定された電位■８まで放
電し、出力信号Ｆに示した１２〜１３時間のディケイ期
間ＤＥを形成する。
ートＧ２の高レベル出力によって第２スイツチング素子
ＳＷ２がオンに変化することにより、上記コンテ゛ンサ
Ｘに充電されていた電荷は第２可変抵抗器Ｒ２を介して
、上記第３可変抵抗器Ｒ３で設定された電位■８まで放
電し、出力信号Ｆに示した１２〜１３時間のディケイ期
間ＤＥを形成する。
該テ゛イケイ期間ＤＥの所定の電位■８に達するまでの
立下り時間は、上記第２可変抵抗器Ｒ２の抵抗値を調節
することによって制御し得る。
立下り時間は、上記第２可変抵抗器Ｒ２の抵抗値を調節
することによって制御し得る。
第３可変抵抗器Ｒ３で設定された電位レベル■３はサス
ティン期間ＳＵとして、キー信号Ａが低レベルに変化す
る１４時間まで保持される。
ティン期間ＳＵとして、キー信号Ａが低レベルに変化す
る１４時間まで保持される。
上記サスティン期間ＳＵの電位レベルｖ５は第３可変抵
抗器Ｒ３の抵抗値を調節することによって制御し得る。
抗器Ｒ３の抵抗値を調節することによって制御し得る。
上記サスティン期間ＳＵの終端４４時間はキー信号Ａの
立下りに同期するが、該終端４４時間は第３スイツチン
グ素子ＳＷ３がオンに変化することによってもたらされ
る。
立下りに同期するが、該終端４４時間は第３スイツチン
グ素子ＳＷ３がオンに変化することによってもたらされ
る。
即ちコンテ゛ンサＸと出力端子ｆ間に第４可変抵抗器Ｒ
４を介して上記第３スイツチング素子ＳＷ３が接続され
、該第３スイツチング素子ＳＷ３には上記キー信号Ａを
インバータＬで反転した信号Ｅが入力されてなり、キー
信号Ａが低レベルに変化する立下りで高レベルに変化し
て第３スイツチング素子ＳＷ３をオンに変化させる。
４を介して上記第３スイツチング素子ＳＷ３が接続され
、該第３スイツチング素子ＳＷ３には上記キー信号Ａを
インバータＬで反転した信号Ｅが入力されてなり、キー
信号Ａが低レベルに変化する立下りで高レベルに変化し
て第３スイツチング素子ＳＷ３をオンに変化させる。
この時上記第１スイツチング素子ＳＷ１は既にオフに変
化しており、第２スイツチング素子ＳＷ２もまたキー信
号Ａのオフ動作に同期してオフに変化するため、コンテ
゛ンサＸに充電されていた電荷は第３スイツチング素子
ＳＷ３のオン動作に伴って第４可変抵抗器Ｒ４を介して
接地電位にまで放電され、１４〜１５時間のリリース期
間ＲＥを形成する。
化しており、第２スイツチング素子ＳＷ２もまたキー信
号Ａのオフ動作に同期してオフに変化するため、コンテ
゛ンサＸに充電されていた電荷は第３スイツチング素子
ＳＷ３のオン動作に伴って第４可変抵抗器Ｒ４を介して
接地電位にまで放電され、１４〜１５時間のリリース期
間ＲＥを形成する。
該リリース期間ＲＥの立下り時間は上記第４可変抵抗器
Ｒ４の抵抗値を設定することにより制御し得る。
Ｒ４の抵抗値を設定することにより制御し得る。
上記第１乃至第４可変抵抗器Ｒ１〜Ｒ４の各抵抗値を調
節することにより信号の立上り時間、減衰時間、定レベ
ル保持時間及立下り時間を容易に制御することができ、
演奏すべき楽器の音に対応させたエンベロープ信号を形
成することができる。
節することにより信号の立上り時間、減衰時間、定レベ
ル保持時間及立下り時間を容易に制御することができ、
演奏すべき楽器の音に対応させたエンベロープ信号を形
成することができる。
該エンベロープ信号を別途に形威された音階の周波信号
に組み合せ、更に適宜増幅処理を施こすことによって楽
器音を形威し得る。
に組み合せ、更に適宜増幅処理を施こすことによって楽
器音を形威し得る。
上記実施例は第１乃至第３スイツチング素子をいずれも
ＭＯＳ）ランジスタで構成し、該ＭＯ５）ランジスタの
ゲートにアンドゲート出力或いはインバータ出力を導入
してオン・オフ動作を制御したがＭＯＳ）ランジスタに
限られず、他のスイッチング素子でも実施し得る。
ＭＯＳ）ランジスタで構成し、該ＭＯ５）ランジスタの
ゲートにアンドゲート出力或いはインバータ出力を導入
してオン・オフ動作を制御したがＭＯＳ）ランジスタに
限られず、他のスイッチング素子でも実施し得る。
以上本考案によれば、抵抗、コンデンサ等の回路素子を
利用して簡単な回路で任意の波形をもつエンベロープ信
号を形成することができ、電子楽器の構成を簡単にして
装置を安価に提供することができる。
利用して簡単な回路で任意の波形をもつエンベロープ信
号を形成することができ、電子楽器の構成を簡単にして
装置を安価に提供することができる。
また回路の動作はディジタル信号で制御することができ
、電気回路の設計を容易にすることができる。
、電気回路の設計を容易にすることができる。
第１図は本考案による実施例の電気回路図、第２図は同
実施例の動作を説明するための信号波形図である。 ＳＷ１〜ＳＷ３・・・・・・スイッチング素子、Ｒ１−
Ｒ４・・・・・・可変抵抗器、Ｄ・・・・・・微分回路
、Ｆ、Ｆ・・・・・・フリップフロップ、Ｇ１．Ｇ２・
・・・・・アンドゲート、Ｘ・・・・・・コンテ゛ンサ
、ａ・・・・・・入力端、ｆ・・・・・・出力端、Ａ・
・・・・・キー信号、Ｆ・・・・・・エンベロープ信号
。
実施例の動作を説明するための信号波形図である。 ＳＷ１〜ＳＷ３・・・・・・スイッチング素子、Ｒ１−
Ｒ４・・・・・・可変抵抗器、Ｄ・・・・・・微分回路
、Ｆ、Ｆ・・・・・・フリップフロップ、Ｇ１．Ｇ２・
・・・・・アンドゲート、Ｘ・・・・・・コンテ゛ンサ
、ａ・・・・・・入力端、ｆ・・・・・・出力端、Ａ・
・・・・・キー信号、Ｆ・・・・・・エンベロープ信号
。
Claims (1)
- スイッチング素子ＳＷ１を介してアタック用の時定数を
設定するための可変抵抗器Ｒ１と充放電用のコンデンサ
Ｘを直列接続するとともに、上記コンデンサＸと並列に
、テ゛イケイ用の時定数を設定するための可変抵抗器Ｒ
２、スイッチング素子ＳＷ２及び基準電圧に対してサス
ティン用の所望の電圧レベルを設定する可変抵抗器Ｒ４
と、リリース用の時定数を設定するための可変抵抗器Ｒ
３及びスイッチング素子ＳＷ３をそれぞれ直列接続し、
（ａ）入力信号と同期してセットされ上記コンデンサＸ
の所定電圧レベルへの充電でリセットされるＲＳフリッ
プフロップＦＦと、（ｂ）双方の一方に上記入力信号、
他方に上記ＲＳフリップフロップＦＦの各Ｑ及び゛Ｑ出
力を入力するアンドゲートＧｌ、Ｇ２と、（Ｃ）前記入
力信号を反転するインバータＩｎとからなるディジタル
制御回路を備え、アンドゲートＧ１の出力により上記ス
イッチング素子ＳＷ１、アンドゲートＧ２の出力により
上記スイッチング素子ＳＷ２、インバータＩｎの出力に
より上記スイッチング素子ＳＷ３のオンオフ動作を制御
するようにしてなることを特徴とするエンベロープ信号
形成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1977177101U JPS5834478Y2 (ja) | 1977-12-29 | 1977-12-29 | エンベロ−プ信号形成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1977177101U JPS5834478Y2 (ja) | 1977-12-29 | 1977-12-29 | エンベロ−プ信号形成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54103827U JPS54103827U (ja) | 1979-07-21 |
| JPS5834478Y2 true JPS5834478Y2 (ja) | 1983-08-02 |
Family
ID=29186273
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1977177101U Expired JPS5834478Y2 (ja) | 1977-12-29 | 1977-12-29 | エンベロ−プ信号形成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5834478Y2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5126519A (ja) * | 1974-08-29 | 1976-03-04 | Matsushita Electric Ind Co Ltd |
-
1977
- 1977-12-29 JP JP1977177101U patent/JPS5834478Y2/ja not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5126519A (ja) * | 1974-08-29 | 1976-03-04 | Matsushita Electric Ind Co Ltd |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54103827U (ja) | 1979-07-21 |
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