JPS5828585B2 - 表示装置の文字拡大回路 - Google Patents
表示装置の文字拡大回路Info
- Publication number
- JPS5828585B2 JPS5828585B2 JP16198978A JP16198978A JPS5828585B2 JP S5828585 B2 JPS5828585 B2 JP S5828585B2 JP 16198978 A JP16198978 A JP 16198978A JP 16198978 A JP16198978 A JP 16198978A JP S5828585 B2 JPS5828585 B2 JP S5828585B2
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- JP
- Japan
- Prior art keywords
- character
- parallel
- circuit
- serial conversion
- clock
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【発明の詳細な説明】
本発明は文字の一部または特定の文字を拡大して表示す
る文字拡大回路に関するものである。
る文字拡大回路に関するものである。
最近、文字表示装置において、一部の文字を画面一杯に
拡大または特定文字を横方向に拡大して表示することが
行なわれている。
拡大または特定文字を横方向に拡大して表示することが
行なわれている。
ラスタ走査方式の文字表示装置は一般に第１図の構成を
有している。
有している。
文字パターンはたとえば８×８ドツトとし文字に対応す
る２伝信号で構成されている。
る２伝信号で構成されている。
同図において、１はクロック発振器であり、その周期は
ＣＲＴ（陰極線管）表示部のビーム速度と同期している
。
ＣＲＴ（陰極線管）表示部のビーム速度と同期している
。
２はドツトカウンタであり、１文字の横方向のビット数
が３２ビツトとすると３２進のカウンタである。
が３２ビツトとすると３２進のカウンタである。
３はキャラクタカウンタであり、表示画面における何文
字目かを表わしドツトカウンタ２が３２を計数しそれが
１にリセットされるときに＋１される。
字目かを表わしドツトカウンタ２が３２を計数しそれが
１にリセットされるときに＋１される。
４はラスタカウンタであり、１文字の縦方向の値を計数
する。
する。
たとえば、１文字の縦方向のビット数が３２ビツトであ
れば３２進のカウンタにより構成され、３２を計数する
と１にリセットされる。
れば３２進のカウンタにより構成され、３２を計数する
と１にリセットされる。
５は行カウンタであり、表示画面における何行目かを表
わす。
わす。
たとえば、１画面のＹ方向が２０行であれば２０進カウ
ンタにより構成される。
ンタにより構成される。
従って、ドツトカウンタ２は１文字ノ横方向ノビツトを
表わし、キャラクタカウンタ３はＸ方向の文字の第ｎ番
目の値を示し、ラスタカウンタ４は１文字の縦方向の位
置を表わし、行カウンタ５はＹ方向の行を示すものであ
る。
表わし、キャラクタカウンタ３はＸ方向の文字の第ｎ番
目の値を示し、ラスタカウンタ４は１文字の縦方向の位
置を表わし、行カウンタ５はＹ方向の行を示すものであ
る。
次に、６は画面メモリであり、■画面分の表示すべき文
字に対応する文字コードを記憶している。
字に対応する文字コードを記憶している。
この画面メモリ６にはキャラクタカウンタ３の出力およ
び行カウンタ５の出力が入力しており、これらの両者に
より１文字の文字コードが指定される。
び行カウンタ５の出力が入力しており、これらの両者に
より１文字の文字コードが指定される。
７は文字発生器（ＣＧ）であり、文字コードに対応した
文字パターンが記憶された固定メモリ（ＲＯＭ）より構
成されている。
文字パターンが記憶された固定メモリ（ＲＯＭ）より構
成されている。
この文字発生器７にはラスタカウンタ４の出力および画
面メモリ６０文字コードが入力し、それにより文字パタ
ーンの一部が並列出力で読み出され、並直列変換回路（
Ｐ／Ｓ）８に入力される。
面メモリ６０文字コードが入力し、それにより文字パタ
ーンの一部が並列出力で読み出され、並直列変換回路（
Ｐ／Ｓ）８に入力される。
並直列変換回路８はドツトクロックに同期して直列信号
に変換され、ビデオ信号がＣＲＴ表示部に送出される。
に変換され、ビデオ信号がＣＲＴ表示部に送出される。
この構成で所望の文字の横方向をたとえば２倍に拡大す
るにはＰ／Ｓ変換回路８に与えるクロックを所定の文字
領域に対応して２倍間隔ドツトすなわち１／２分周クロ
ックを与えるように切換えればよいが、１０ＭＨｚ以上
の高速切換では不安定な状態を生じ表示を悪化させ拡大
表示の効果を減殺するという欠点があった。
るにはＰ／Ｓ変換回路８に与えるクロックを所定の文字
領域に対応して２倍間隔ドツトすなわち１／２分周クロ
ックを与えるように切換えればよいが、１０ＭＨｚ以上
の高速切換では不安定な状態を生じ表示を悪化させ拡大
表示の効果を減殺するという欠点があった。
本発明の目的は並直列変換回路に与えるクロックを切換
えることなく拡大表示する表示装置の文字拡大回路を提
供することである。
えることなく拡大表示する表示装置の文字拡大回路を提
供することである。
前記目的を達成するため、本発明の表示装置の文字拡大
回路は文字コードが入力されそのコードに対応する複数
のビットより成る文字パターンを出力する文字発生回路
よりマルチプレクサを介して所定の並列出力を得て第１
の並直列変換回路に入れるとともに、前記文字パターン
の所定のビットを分岐して第２の並直列変換回路に入れ
、前記各並直列変換回路にドツトクロックの複数弁の一
〇分周クロックを与え、正常表示時には前記各並直列変
換回路の出力をタイミング制御手段により組合せてドツ
トクロックに合せ、文字の横方向拡大時には前記文字パ
ターンを構成する複数のビットを分割して第１の並直列
変換回路に与えその出力を前記分周クロックに合せビデ
オ信号として出力することを特徴とするものである。
回路は文字コードが入力されそのコードに対応する複数
のビットより成る文字パターンを出力する文字発生回路
よりマルチプレクサを介して所定の並列出力を得て第１
の並直列変換回路に入れるとともに、前記文字パターン
の所定のビットを分岐して第２の並直列変換回路に入れ
、前記各並直列変換回路にドツトクロックの複数弁の一
〇分周クロックを与え、正常表示時には前記各並直列変
換回路の出力をタイミング制御手段により組合せてドツ
トクロックに合せ、文字の横方向拡大時には前記文字パ
ターンを構成する複数のビットを分割して第１の並直列
変換回路に与えその出力を前記分周クロックに合せビデ
オ信号として出力することを特徴とするものである。
以下本発明を実施例につき詳述する。
第２図は本発明の実施例の構成を示す説明図であり、第
３図ａ−ｈはその動作を示すタイムチャートである。
３図ａ−ｈはその動作を示すタイムチャートである。
以下第２図に従い第３図ａ−ｈを参照しつつ説明する。
第２図において、文字発生器（ＣＧ）７は第１図に説明
したように、メモリ６に格納されたキャラクタコードと
ラスタカウンタ４からのラスクアドレスが入力され、そ
れにより、文字パターンの８ピツトのドツト信号＃１〜
＃８を読み出す。
したように、メモリ６に格納されたキャラクタコードと
ラスタカウンタ４からのラスクアドレスが入力され、そ
れにより、文字パターンの８ピツトのドツト信号＃１〜
＃８を読み出す。
この出力をマルチプレクサ（ＭＰＸ）１１に入力し、マ
ルチプレクサ（ＭＰＸ）１１は４ビット並列出力の時分
割多重化信号を制御信号■、■、■によりそれぞれの組
合せで出力する。
ルチプレクサ（ＭＰＸ）１１は４ビット並列出力の時分
割多重化信号を制御信号■、■、■によりそれぞれの組
合せで出力する。
すなわち、並列出力の４ビツトに対応しドツト信号＃１
〜＃４とドツト信号＃５〜＃８を並列入力するとともに
、２番目、３番目、４番目に対し＃３ 、＃５ 、＃７
が分岐入力される。
〜＃４とドツト信号＃５〜＃８を並列入力するとともに
、２番目、３番目、４番目に対し＃３ 、＃５ 、＃７
が分岐入力される。
制御信号のは正常表示信号Ａの場合であり、制御信号■
、■は拡大表示信号Ｂの場合であって、かつマルチプレ
クサ（ＭＰＸ）１１０時分割が第３図りのフリップフロ
ップＦＦ２のオンオフで制御されるものである。
、■は拡大表示信号Ｂの場合であって、かつマルチプレ
クサ（ＭＰＸ）１１０時分割が第３図りのフリップフロ
ップＦＦ２のオンオフで制御されるものである。
これらの制御信号により制御された４ビット並列出力は
Ｐ／Ｓ変換回路（Ｉ）１２に入力される。
Ｐ／Ｓ変換回路（Ｉ）１２に入力される。
一方、文字拡大回路ＣＧ）７０ドツト信号＃２ 、＃４
、＃６ 、＃８が分岐されＰ／Ｓ変換回路（ｎ）１３
に入力される。
、＃６ 、＃８が分岐されＰ／Ｓ変換回路（ｎ）１３
に入力される。
この両者に第３図Ｃに示す２倍間隔ドツ）２ＣＬ、すな
わちドツトクロックの１／２分周クロックが与えられ、
それぞれ直列出力が読み出されＮＡＮＤ回路１４゜１５
を通し、ＮＯＲ回路１６で合成され、ビデオ信号として
表示部に送出される。
わちドツトクロックの１／２分周クロックが与えられ、
それぞれ直列出力が読み出されＮＡＮＤ回路１４゜１５
を通し、ＮＯＲ回路１６で合成され、ビデオ信号として
表示部に送出される。
この場合、ＮＡＮＤ回路１４の他の入力信号■は第３図
すのドツトクロックにより動作するフリップフロップＦ
ＦＩのオン時に同期するかまたは拡大表示信号Ｂの場合
オンとなる。
すのドツトクロックにより動作するフリップフロップＦ
ＦＩのオン時に同期するかまたは拡大表示信号Ｂの場合
オンとなる。
またＮＡＮＤ回路１５の他の入力信号■は正常表示信号
Ａの場合であり第３図すのＦＦ１のオフ時に同期してオ
ンとなる。
Ａの場合であり第３図すのＦＦ１のオフ時に同期してオ
ンとなる。
この構成において、いたマルチプレクサ
（ＭＰＸ）１１に制御信号■すなわち正常表示信号Ａが
与えられると、その並列出力としてドツト信号＃１ 、
＃３ 、＃５ 、＃７がｐ／５（Ｉ）１２に入力し、ク
ロック２ＣＬで読み出され第３図ｄに示す＃１゜＃３．
＃５．＃７の直列出力が取出される。
与えられると、その並列出力としてドツト信号＃１ 、
＃３ 、＃５ 、＃７がｐ／５（Ｉ）１２に入力し、ク
ロック２ＣＬで読み出され第３図ｄに示す＃１゜＃３．
＃５．＃７の直列出力が取出される。
一方、ドツト信号＃２ 、＃４ 、＃６ 、＃＝８はＰ
／ ５（ＩＩ）１３に入力しクロック２ＣＬで読み出
され第３図ｅに示す＃２ 、＃＝４ 、＄６ 、＃８の
直列出力が取出される。
／ ５（ＩＩ）１３に入力しクロック２ＣＬで読み出
され第３図ｅに示す＃２ 、＃＝４ 、＄６ 、＃８の
直列出力が取出される。
前者はＮＡＮＤ回路１４により第３図すのＦＦ１０オン
時のみが、後者ではＦＦ１のオフ時のみがＮＯＲ回路１
６で合成されて取り出されるから、第３図ｆに示すよう
に、出力されるビデオ信号はクロック２ＣＬで読み出さ
れてはいるがドツトクロックＣＬでドツト信号＃１〜＃
８を順次読み出したものに等しくなり、正常表示が得ら
れる。
時のみが、後者ではＦＦ１のオフ時のみがＮＯＲ回路１
６で合成されて取り出されるから、第３図ｆに示すよう
に、出力されるビデオ信号はクロック２ＣＬで読み出さ
れてはいるがドツトクロックＣＬでドツト信号＃１〜＃
８を順次読み出したものに等しくなり、正常表示が得ら
れる。
次に、マルチプレクサ（ＭＰＸ）１１０制御信号■。
■に２倍の拡大表示信号Ｂが与えられ、かつＦＦ２のオ
ンオフによりタイミング制御され、Ｐ／５（Ｉ）１２に
与えられる並列出力の４ビツトは最初ドツト信号＃１〜
＃４、次に＃５〜＃８が与えられ、これがクロック２Ｃ
Ｌで読み出され、ＮＡＮＤ回路１４の他の入力■に拡大
表示信号Ｂが与えられてオン状態となる。
ンオフによりタイミング制御され、Ｐ／５（Ｉ）１２に
与えられる並列出力の４ビツトは最初ドツト信号＃１〜
＃４、次に＃５〜＃８が与えられ、これがクロック２Ｃ
Ｌで読み出され、ＮＡＮＤ回路１４の他の入力■に拡大
表示信号Ｂが与えられてオン状態となる。
これに反しＰ／５（ＩＩ）１３ではドツト信号＃２ 、
＄４．４４＝６ 。
＄４．４４＝６ 。
＃８が出力されるが、ＮＡＮＤ回路１５が他の入力■に
よりオフとなるから、結果としてＮＯＲ回路１６からの
ビデオ信号はＰ／５（Ｉ）１２からＮＡＮＤ回路１４を
介して読み出された信号のみとなり、第３図ｇに示すよ
うに、ドツト信号＃１〜＃８の順に１／２分周クロック
２ＣＬで読み出されたものが得られる。
よりオフとなるから、結果としてＮＯＲ回路１６からの
ビデオ信号はＰ／５（Ｉ）１２からＮＡＮＤ回路１４を
介して読み出された信号のみとなり、第３図ｇに示すよ
うに、ドツト信号＃１〜＃８の順に１／２分周クロック
２ＣＬで読み出されたものが得られる。
このようにして文字が横方向に２倍拡大された表示が得
られる。
られる。
実施例では文字の横方向を８ドツトとして２倍に拡大す
る例について述べたが文字の横方向のドツト数をさらに
増加させ３倍またはそれ以上に拡大する場合もＰ／５（
ＩＩ）１３と同様の並列回路を増加させることにより本
発明を適用することができる。
る例について述べたが文字の横方向のドツト数をさらに
増加させ３倍またはそれ以上に拡大する場合もＰ／５（
ＩＩ）１３と同様の並列回路を増加させることにより本
発明を適用することができる。
また文字の集合として画面の一部を拡大する場合にも適
用できることは明らかである。
用できることは明らかである。
以上説明したように、本発明によれば、文字発生回路よ
りマルチプレクサを介して第１の並直列変換回路とこれ
と並列入力する複数の並直列変換回路を設け、これらに
ドツトクロックの複数分の一〇分周クロックを与え、正
常表示時には前記各並直列変換回路の出力をタイミング
制御手段により組合せてドツトクロックに合せ、文字の
横方向拡大時には前記第１の並直列変換回路のみの出力
を前記分周クロックに合せビデオ信号を出力するように
したものである。
りマルチプレクサを介して第１の並直列変換回路とこれ
と並列入力する複数の並直列変換回路を設け、これらに
ドツトクロックの複数分の一〇分周クロックを与え、正
常表示時には前記各並直列変換回路の出力をタイミング
制御手段により組合せてドツトクロックに合せ、文字の
横方向拡大時には前記第１の並直列変換回路のみの出力
を前記分周クロックに合せビデオ信号を出力するように
したものである。
これにより、並直列変換回路に加えられる分周クロック
は一定であってこれを切換える必要がないから、従来の
ようにクロック切換に起因する不安定状態による拡大画
面への影響が皆無となり、品質の良い拡大表示が得られ
る。
は一定であってこれを切換える必要がないから、従来の
ようにクロック切換に起因する不安定状態による拡大画
面への影響が皆無となり、品質の良い拡大表示が得られ
る。
第１図は文字表示装置の一般説明図、第２図は本発明の
実施例の構成を示す説明図、第３図はその動作説明図で
あり、図中、７は文字発生回路、１１はマルチプレクサ
、１２，１３は並直列変換回路、１４，１５はＮＡＮＤ
回路、１６はＮＯＲ回路を示す。
実施例の構成を示す説明図、第３図はその動作説明図で
あり、図中、７は文字発生回路、１１はマルチプレクサ
、１２，１３は並直列変換回路、１４，１５はＮＡＮＤ
回路、１６はＮＯＲ回路を示す。
Claims (1)
- １ 文字コードが入力されそのコードに対応する複数の
ビットより成る文字パターンを出力する文字発生回路よ
りマルチプレクサを介して所定の並列出力を得て第１の
並直列変換回路に入れるとともに、前記文字パターンの
所定のビットを分岐して第２の並直列変換回路に入れ、
前記各並直列変換回路にドツトクロックの複数弁の一〇
分周クロックを与え、正常表示時には前記各並直列変換
回路の出力をタイミング制御手段により組合せてドツト
クロックに合せ、文字の横方向拡大時には前記文字パタ
ーンを構成する複数のビットを分割して第１の並直列変
換回路に与えその出力を前記分周クロックに合せビデオ
信号として出力することを特徴とする表示装置の文字拡
大回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16198978A JPS5828585B2 (ja) | 1978-12-29 | 1978-12-29 | 表示装置の文字拡大回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16198978A JPS5828585B2 (ja) | 1978-12-29 | 1978-12-29 | 表示装置の文字拡大回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5590994A JPS5590994A (en) | 1980-07-10 |
| JPS5828585B2 true JPS5828585B2 (ja) | 1983-06-16 |
Family
ID=15745911
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16198978A Expired JPS5828585B2 (ja) | 1978-12-29 | 1978-12-29 | 表示装置の文字拡大回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5828585B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6143783U (ja) * | 1984-08-24 | 1986-03-22 | 住友特殊金属株式会社 | ボイスコイル型モ−タ |
| JPS62185477U (ja) * | 1986-05-13 | 1987-11-25 |
-
1978
- 1978-12-29 JP JP16198978A patent/JPS5828585B2/ja not_active Expired
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6143783U (ja) * | 1984-08-24 | 1986-03-22 | 住友特殊金属株式会社 | ボイスコイル型モ−タ |
| JPS62185477U (ja) * | 1986-05-13 | 1987-11-25 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5590994A (en) | 1980-07-10 |
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