JPS5821211Y2 - リニアｉｃの耐ノイズ回路 - Google Patents
リニアｉｃの耐ノイズ回路Info
- Publication number
- JPS5821211Y2 JPS5821211Y2 JP1976108708U JP10870876U JPS5821211Y2 JP S5821211 Y2 JPS5821211 Y2 JP S5821211Y2 JP 1976108708 U JP1976108708 U JP 1976108708U JP 10870876 U JP10870876 U JP 10870876U JP S5821211 Y2 JPS5821211 Y2 JP S5821211Y2
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- Japan
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- linear
- frequency noise
- calculation
- resistor
- circuit
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Description
【考案の詳細な説明】
本考案は、高周波ノイズ対策を施したリニアＩＣの耐ノ
イズ回路に関し、特に周波数が数１００ＭＨｚの電波や
スパイク等の高周波ノイズに対して有効なリニアＩＣの
耐ノイズ回路に関する。
イズ回路に関し、特に周波数が数１００ＭＨｚの電波や
スパイク等の高周波ノイズに対して有効なリニアＩＣの
耐ノイズ回路に関する。
一般にリニアＩＣでは、入力に高周波ノイズが入るとＩ
Ｃ自体の検波作用や周波数弁別作用等により出力が変動
する場合がある。
Ｃ自体の検波作用や周波数弁別作用等により出力が変動
する場合がある。
例えば第１図に示すようなリニアＩＣと演算抵抗Ｒ１〜
Ｒ４を用いた比例演算増幅回路において、入力信号Ｅｉ
１゜Ｅｉ２が加わる差動入力端子■Ｎ１．ＩＮ２間に１
００ｍＶの正弦波電圧ｅＮをＯ〜５００ＭＨ２の周波数
範囲で加えたとき、リニアＩＣの出力Ｅｏの変動の一例
を示したのが第２図の実線である。
Ｒ４を用いた比例演算増幅回路において、入力信号Ｅｉ
１゜Ｅｉ２が加わる差動入力端子■Ｎ１．ＩＮ２間に１
００ｍＶの正弦波電圧ｅＮをＯ〜５００ＭＨ２の周波数
範囲で加えたとき、リニアＩＣの出力Ｅｏの変動の一例
を示したのが第２図の実線である。
なお、Ｅｉ１＝Ｅｉ２で、各抵抗Ｒ１〜Ｒ４の抵抗値は
５００ＫＪ７であり、フィルタ用コンデンサＣ１，Ｃ２
の容量は０．３３μＦである。
５００ＫＪ７であり、フィルタ用コンデンサＣ１，Ｃ２
の容量は０．３３μＦである。
またリニアＩＣは、抵抗Ｒ２とＲ４の結合点Ｐ２を演算
の基準点とし、入力電圧と帰還電圧の加算点である抵抗
Ｒ１とＲ２の結合点Ｐ、の電位がＰ２の電位と等しくな
るように動作する。
の基準点とし、入力電圧と帰還電圧の加算点である抵抗
Ｒ１とＲ２の結合点Ｐ、の電位がＰ２の電位と等しくな
るように動作する。
第２図から明らかなようにリニアＩＣは、周波数が１０
ＭＨｚ〜５００ ＭＨｚの正弦波電圧ｅＮすなわち高周
波ノイズが加わると、出力変動を生ずる。
ＭＨｚ〜５００ ＭＨｚの正弦波電圧ｅＮすなわち高周
波ノイズが加わると、出力変動を生ずる。
従来は高周波ノイズを除去するために、第１図に点線で
示すようにリニアＩＣの正、負の入力端子間にコンデン
サＣ３を接続しているが、しかしコンデンサＣ３として
１００９Ｆのものを用いても第２図の点線に示すように
２５０ ＭＨｚ以上の高周波ノイズに対してはほとんど
効果がないばかりでなく、悪影響がある。
示すようにリニアＩＣの正、負の入力端子間にコンデン
サＣ３を接続しているが、しかしコンデンサＣ３として
１００９Ｆのものを用いても第２図の点線に示すように
２５０ ＭＨｚ以上の高周波ノイズに対してはほとんど
効果がないばかりでなく、悪影響がある。
本考案は、上述のごとき高周波ノイズによる影響を有効
に除去できるリニアＩＣの耐ノイズ回路を提供するもの
である。
に除去できるリニアＩＣの耐ノイズ回路を提供するもの
である。
第３図は本考案の一実施例を示す接続図で、第１図の従
来例と異なるところは、リニアＩＣの入力側に抵抗Ｒ，
、Ｒ６とコンデンサＣ３を組合せた高周波ノイズ対策用
の回路を接続した点である。
来例と異なるところは、リニアＩＣの入力側に抵抗Ｒ，
、Ｒ６とコンデンサＣ３を組合せた高周波ノイズ対策用
の回路を接続した点である。
すなわち抵抗Ｒ６は演算抵抗Ｒ１，Ｒ３の結合点すなわ
ち演算の加算点Ｐ１とリニアＩＣの負の入力端子間に、
抵抗Ｒ６は演算抵抗Ｒ２，Ｒ４の結合点すなわち演算の
基準点Ｐ２とリニアＩＣの正の入力端子間に、コンデン
サＣ３はリニアＩＣの正、負の入力端子間にそれぞれ接
続されている。
ち演算の加算点Ｐ１とリニアＩＣの負の入力端子間に、
抵抗Ｒ６は演算抵抗Ｒ２，Ｒ４の結合点すなわち演算の
基準点Ｐ２とリニアＩＣの正の入力端子間に、コンデン
サＣ３はリニアＩＣの正、負の入力端子間にそれぞれ接
続されている。
このように構成すると差動入力端子ＩＮ、 、 ＩＮ２
間に１００ｍＶの正弦波の高周波ノイズｅ が加わって
も、リニアＩＣの出力Ｅｏは第４図の実線に示すように
ほとんど変動しなくなり、入力側に加わる高周波ノイズ
による影響を有効に除去でき、特にコンデンサＣ３のみ
の場合（第４図の点線）に比して２５０ ＭＨｚ以上の
高周波に対して効果大である。
間に１００ｍＶの正弦波の高周波ノイズｅ が加わって
も、リニアＩＣの出力Ｅｏは第４図の実線に示すように
ほとんど変動しなくなり、入力側に加わる高周波ノイズ
による影響を有効に除去でき、特にコンデンサＣ３のみ
の場合（第４図の点線）に比して２５０ ＭＨｚ以上の
高周波に対して効果大である。
また、電源ラインにスパイク状の高周波ノイズが重畳さ
れると、駆動電源が瞬間的に低下して入力端子側からリ
ニアＩＣの内部を経て電源側へ高周波ノイズによる電流
が流れ、出力変動を生ずることがあるが、抵抗Ｒ５？
Ｒ６により高周波ノイズによる型棒を制限できるため出
力変動は充分に小さくなる。
れると、駆動電源が瞬間的に低下して入力端子側からリ
ニアＩＣの内部を経て電源側へ高周波ノイズによる電流
が流れ、出力変動を生ずることがあるが、抵抗Ｒ５？
Ｒ６により高周波ノイズによる型棒を制限できるため出
力変動は充分に小さくなる。
さらに抵抗Ｒ，、Ｒ，の抵抗値を演算抵抗Ｒ１〜Ｒ４（
５０ｏＫＱ）に比して充分小さい値、例えば２に、Ｑ程
度にすればオフセット電流の影響も無視でき、またコン
デンサＣ３の容量も１００９Ｆ程度にすればリニアＩＣ
に影響を与えない。
５０ｏＫＱ）に比して充分小さい値、例えば２に、Ｑ程
度にすればオフセット電流の影響も無視でき、またコン
デンサＣ３の容量も１００９Ｆ程度にすればリニアＩＣ
に影響を与えない。
要するに高周波ノイズ対策用の抵抗Ｒ５ｖ Ｒ６とコン
デンサＣ３をリニアＩＣの入力側に接続してもリニアＩ
Ｃを用いた演算回路の定常的な特性には何ら影響を与え
ないようにできる。
デンサＣ３をリニアＩＣの入力側に接続してもリニアＩ
Ｃを用いた演算回路の定常的な特性には何ら影響を与え
ないようにできる。
なお上述では、高周波ノイズ対策用の回路としてコンデ
ンサＣ３をリニアＩＣの入力端子間に直接接続する場合
を例示したが、第５図に示すように抵抗Ｒ５＊ Ｒ６を
介して接続するようにしてもよく、第６図に示すように
コンデンサ０３′を追加してもよく、さらに第７図に示
すように抵抗Ｒ５ｔＲ６をそれぞれ分割してその中点間
にコンデンサＣ３を接続しても同様に高周波ノイズの影
響を除去できる。
ンサＣ３をリニアＩＣの入力端子間に直接接続する場合
を例示したが、第５図に示すように抵抗Ｒ５＊ Ｒ６を
介して接続するようにしてもよく、第６図に示すように
コンデンサ０３′を追加してもよく、さらに第７図に示
すように抵抗Ｒ５ｔＲ６をそれぞれ分割してその中点間
にコンデンサＣ３を接続しても同様に高周波ノイズの影
響を除去できる。
なお上述では、リニアＩＣを差動入力の比例演算増幅回
路に用いた場合を例示したが、その他の回路例えば反転
増幅回路（第８図）、ホールド回路（第９図）、積分回
路（第１０図）等においても、抵抗とコンデンサを組合
せた高周波ノイズ対策用の回路をリニアＩＣの入力端子
間に接続すれば高周波ノイズの影響を有効に除去できる
。
路に用いた場合を例示したが、その他の回路例えば反転
増幅回路（第８図）、ホールド回路（第９図）、積分回
路（第１０図）等においても、抵抗とコンデンサを組合
せた高周波ノイズ対策用の回路をリニアＩＣの入力端子
間に接続すれば高周波ノイズの影響を有効に除去できる
。
以上説明したように本考案によれば、演算の基準点およ
び加算点とリニアＩＣの入力端子間に抵抗とコンデンサ
の組合せからなる高周波ノイズ対策用の回路を挿入して
いるので、簡単な構成で高周波ノイズによる影響を有効
に除去できるリニアＩＣの耐ノイズ回路が得られる。
び加算点とリニアＩＣの入力端子間に抵抗とコンデンサ
の組合せからなる高周波ノイズ対策用の回路を挿入して
いるので、簡単な構成で高周波ノイズによる影響を有効
に除去できるリニアＩＣの耐ノイズ回路が得られる。
第１図は従来例を示す接続図、第２図はその説明図、第
３図は本考案の一実施例を示す接続図、第４図はその説
明図、第５図〜第１０図は本考案の他の実施例を示す接
続図である。 Ｂ１１ 、 Ｒ１２・・・・・・入力信号電圧、ＥＯ・
・・・・・出力電圧、ＩＣ・・・・・・リニアＩＣ，Ｒ
，〜Ｒ６・・・・・・抵抗、Ｃ０〜Ｃ３，Ｃ３′・・・
・・・コンデンサ、ｅＮ・・・・・・高周波ノイズ。
３図は本考案の一実施例を示す接続図、第４図はその説
明図、第５図〜第１０図は本考案の他の実施例を示す接
続図である。 Ｂ１１ 、 Ｒ１２・・・・・・入力信号電圧、ＥＯ・
・・・・・出力電圧、ＩＣ・・・・・・リニアＩＣ，Ｒ
，〜Ｒ６・・・・・・抵抗、Ｃ０〜Ｃ３，Ｃ３′・・・
・・・コンデンサ、ｅＮ・・・・・・高周波ノイズ。
Claims (1)
- リニアＩＣの正の入力端子に加えられる演算の基準点の
電位に、リニアＩＣの負の入力端子に加えられる演算の
加算点の電位が等しくなるように、リニアＩＣの出力端
子から前記演算の加算点に帰還が施された回路において
、前記リニアＩＣの正の入力端子と演算の基準点間に接
続される抵抗と、前記リニアＩＣの負の入力端子と演算
の加算点間に接続される抵抗および前記リニアＩＣの正
、負の入力端子間に直接または前記抵抗を介して接続さ
れるコンデンサを組合せた高周波ノイズ対策用の回路を
備えたことを特徴とするリニアＩＣの耐ノイズ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1976108708U JPS5821211Y2 (ja) | 1976-08-13 | 1976-08-13 | リニアｉｃの耐ノイズ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1976108708U JPS5821211Y2 (ja) | 1976-08-13 | 1976-08-13 | リニアｉｃの耐ノイズ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5326841U JPS5326841U (ja) | 1978-03-07 |
| JPS5821211Y2 true JPS5821211Y2 (ja) | 1983-05-06 |
Family
ID=28718672
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1976108708U Expired JPS5821211Y2 (ja) | 1976-08-13 | 1976-08-13 | リニアｉｃの耐ノイズ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5821211Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2016092570A (ja) * | 2014-11-04 | 2016-05-23 | 株式会社デンソー | 差動増幅器 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5443640Y2 (ja) * | 1974-12-16 | 1979-12-17 |
-
1976
- 1976-08-13 JP JP1976108708U patent/JPS5821211Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5326841U (ja) | 1978-03-07 |
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