JPS58203534A - 電子計算機システム - Google Patents
電子計算機システムInfo
- Publication number
- JPS58203534A JPS58203534A JP8502782A JP8502782A JPS58203534A JP S58203534 A JPS58203534 A JP S58203534A JP 8502782 A JP8502782 A JP 8502782A JP 8502782 A JP8502782 A JP 8502782A JP S58203534 A JPS58203534 A JP S58203534A
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- JP
- Japan
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- computer
- slave
- input
- output
- data
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
- G06F13/12—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
- G06F13/124—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware is a sequential transfer control unit, e.g. microprocessor, peripheral processor or state-machine
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- Engineering & Computer Science (AREA)
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- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Multi Processors (AREA)
- Information Transfer Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野の説明〕
本発明は周辺機器に対する入力又は出力処理を簡単にす
るためにインターフェイス部を改良した電子計算機シス
テムに関する。
るためにインターフェイス部を改良した電子計算機シス
テムに関する。
第１図はコンピュータおよび周辺機器とのインターフェ
イスを含む電子計算機システムの従来例を示す。例えば
監視制御装置を例にとると、計算機１には制御用押釦ス
イッチ２からの入力線が入カポ−）３に接続てれ、また
出力ポート５には監視用表示灯４への表示出力線、およ
び図示しないスイッチギヤやコントロールセンター等の
被制御機器への１１１＠出力線が接続される。制御用押
韻スイッチ２と監視用表示灯４は一般に操作机６に取付
けるっ操作机６にはこの他に計器、数字表示器。
イスを含む電子計算機システムの従来例を示す。例えば
監視制御装置を例にとると、計算機１には制御用押釦ス
イッチ２からの入力線が入カポ−）３に接続てれ、また
出力ポート５には監視用表示灯４への表示出力線、およ
び図示しないスイッチギヤやコントロールセンター等の
被制御機器への１１１＠出力線が接続される。制御用押
韻スイッチ２と監視用表示灯４は一般に操作机６に取付
けるっ操作机６にはこの他に計器、数字表示器。
文字に示器１画像表示器などを取付けており、これらは
計算機１０入出力ポート３．４に接続されるが、ここで
は図示を省略する。また、この他、制御対象の機器から
の信号（例えば過負荷故障信号など）も計算機の入力と
して必要であるが同様に１図示を省略するっ計算機１は
押釦スイッチ２からの入力によって所定の制御演算を行
い、その結果として被制御桟器に対する起動、停止等の
制御高力を行ない、同時に該当する監視用表示灯４に表
示出力全行なう。このような監視制御装置では制御しよ
うとする機器が多□、八と、それを監視制御するに必要
な押釦スイッチ２や表示灯４の数が多くなる。したがっ
て、計算機１に対するそれらの入出力点数が多く々つ、
計算機１と操作机６の間の配６９本数が多くなり、この
間が離れて設置される場合には工事費が高くなるっ又計
算機はこれらの入出力のための、演算処理の負担が大き
くなるっ例えば操作押釦入力が選択入力の場合は、多重
選択を防止するため、同時に２つ以上の入力があると誤
操作としてこれらの入力を防止する処理が必要となる。
計算機１０入出力ポート３．４に接続されるが、ここで
は図示を省略する。また、この他、制御対象の機器から
の信号（例えば過負荷故障信号など）も計算機の入力と
して必要であるが同様に１図示を省略するっ計算機１は
押釦スイッチ２からの入力によって所定の制御演算を行
い、その結果として被制御桟器に対する起動、停止等の
制御高力を行ない、同時に該当する監視用表示灯４に表
示出力全行なう。このような監視制御装置では制御しよ
うとする機器が多□、八と、それを監視制御するに必要
な押釦スイッチ２や表示灯４の数が多くなる。したがっ
て、計算機１に対するそれらの入出力点数が多く々つ、
計算機１と操作机６の間の配６９本数が多くなり、この
間が離れて設置される場合には工事費が高くなるっ又計
算機はこれらの入出力のための、演算処理の負担が大き
くなるっ例えば操作押釦入力が選択入力の場合は、多重
選択を防止するため、同時に２つ以上の入力があると誤
操作としてこれらの入力を防止する処理が必要となる。
また表示出力が異常時のフリッカ表示をさせるものの場
合にはその出力だけを周期的にＯＮ、 ＯＦＦさせる演
算処理が必要となるっこのように入出力点数が多くなる
と、これらの入出力処理プログラムが複雑になると同時
に、処理時間も多く必要となり、動作が遅れるなどの問
題点が生じる。
合にはその出力だけを周期的にＯＮ、 ＯＦＦさせる演
算処理が必要となるっこのように入出力点数が多くなる
と、これらの入出力処理プログラムが複雑になると同時
に、処理時間も多く必要となり、動作が遅れるなどの問
題点が生じる。
本発明の目的は、メインコンピュータの入出力処理を簡
単にし、操作机などの周辺機器との配線も少なくできる
ようにインターフェイス部を改良した電子計算機システ
ムを提供することにある。
単にし、操作机などの周辺機器との配線も少なくできる
ようにインターフェイス部を改良した電子計算機システ
ムを提供することにある。
本発明の電子計算機システムは、メインフンピユータと
、このメインコンピュータと内部バスを介して接続する
スレーブコンピュータと、こＤスレーブコンピュータと
シリアル伝送線を介して接ｆｆ１ｆるローカルコンピュ
ータと、このローカルコンピュータに接続さｎる入出力
装置とを備え、ローカルコンピュータは予定のプログラ
ムにより入出力装置からの入力を判別し所定の処理を行
った衾スレーブコンピュータにンリアル伝送すると共に
スレーブコンピュータから受信したデータに該当する表
示器に出力を与える中央演算素子を有し、スレーブコン
ピュータは予定のプログラムによりローカルトコ／ピユ
ータ刀＼ら／リアル伝送されチクるデータをメインコン
ピュータとの共有メモリにイサ込むと共ｌζζメンコン
ピュータによって共有メヒリＫＷき込まｎたデータ７仇
み出してこ扛をコーカルコンビ二−夕にンリアル伝送す
る中央演算素子を有し、メインコンピュータ；は予ｉの
プログラムによりスレーブコンピュータ（よつτ共有メ
モリ９て４き込丘れ之データを読み・出して演算処理し
このデータＶこ対応する１力を被制御・幾器に出力する
と共ンここの出力（・て対応するデータを共有メモリに
薔さ込む中央演算素子を頁ｔろことにより、メインコン
ビュータンて対する入出力配線およびその入出力処理プ
ログラムを簡素化したものである。
、このメインコンピュータと内部バスを介して接続する
スレーブコンピュータと、こＤスレーブコンピュータと
シリアル伝送線を介して接ｆｆ１ｆるローカルコンピュ
ータと、このローカルコンピュータに接続さｎる入出力
装置とを備え、ローカルコンピュータは予定のプログラ
ムにより入出力装置からの入力を判別し所定の処理を行
った衾スレーブコンピュータにンリアル伝送すると共に
スレーブコンピュータから受信したデータに該当する表
示器に出力を与える中央演算素子を有し、スレーブコン
ピュータは予定のプログラムによりローカルトコ／ピユ
ータ刀＼ら／リアル伝送されチクるデータをメインコン
ピュータとの共有メモリにイサ込むと共ｌζζメンコン
ピュータによって共有メヒリＫＷき込まｎたデータ７仇
み出してこ扛をコーカルコンビ二−夕にンリアル伝送す
る中央演算素子を有し、メインコンピュータ；は予ｉの
プログラムによりスレーブコンピュータ（よつτ共有メ
モリ９て４き込丘れ之データを読み・出して演算処理し
このデータＶこ対応する１力を被制御・幾器に出力する
と共ンここの出力（・て対応するデータを共有メモリに
薔さ込む中央演算素子を頁ｔろことにより、メインコン
ビュータンて対する入出力配線およびその入出力処理プ
ログラムを簡素化したものである。
以下本発明を図面に示す一実施例を参照して詳細に説明
する。
する。
第２図において、１はマスターコノピユータで、内部パ
スを介してスレーブコンピュータ７と接続する。このマ
スクコンピュータ１は出力ボート５と第３図で示す入力
ポートを待つっスレーブコンヒユータフば／リアル伝送
ポー トを有し ここからシリアル伝送線２ｏを介して
ローカルコンピュータ８と接続するっローカルコンピュ
ータ８は第３図で示す入出力ポート１３．１４を介して
入出力装置、例えば制御用押釦スイッチ２および監視用
表示灯４と接続する。ローカルマイクロコンピュータ８
と押釦スイッチ２９表示灯４は操作机６に設置するっ 次にｆ４３図により内部詳細構成を説明するっメインコ
ンピュータ１において、１１Ｍ＋は中央演算素子で、予
定のプログラムに従い後述する谷種演算処理を実行する
９１６Ｍはリードオンリメモリ（以下ＲＯＭと呼ぶ）で
、前記プログラムや演算処理に用いらＢる固定化てａた
各種データをメモリしており、アドレス、データおよび
コントロールバス（以下バスと呼ぶ）１２Ｍｋ弁してＣ
ＰＵ １１／Ｍと接続する、１５Ｍｒｉランダムアクセ
スメモリ（以下■と呼ぶ）で、演算結果の一時記憶等に
用いられ、同じくハス１２Ｍを介してＣＰＵ ＩＩＭと
接続する。
スを介してスレーブコンピュータ７と接続する。このマ
スクコンピュータ１は出力ボート５と第３図で示す入力
ポートを待つっスレーブコンヒユータフば／リアル伝送
ポー トを有し ここからシリアル伝送線２ｏを介して
ローカルコンピュータ８と接続するっローカルコンピュ
ータ８は第３図で示す入出力ポート１３．１４を介して
入出力装置、例えば制御用押釦スイッチ２および監視用
表示灯４と接続する。ローカルマイクロコンピュータ８
と押釦スイッチ２９表示灯４は操作机６に設置するっ 次にｆ４３図により内部詳細構成を説明するっメインコ
ンピュータ１において、１１Ｍ＋は中央演算素子で、予
定のプログラムに従い後述する谷種演算処理を実行する
９１６Ｍはリードオンリメモリ（以下ＲＯＭと呼ぶ）で
、前記プログラムや演算処理に用いらＢる固定化てａた
各種データをメモリしており、アドレス、データおよび
コントロールバス（以下バスと呼ぶ）１２Ｍｋ弁してＣ
ＰＵ １１／Ｍと接続する、１５Ｍｒｉランダムアクセ
スメモリ（以下■と呼ぶ）で、演算結果の一時記憶等に
用いられ、同じくハス１２Ｍを介してＣＰＵ ＩＩＭと
接続する。
こｎらＣＰＵ、バス、 ＲＩ：）Ｍ 、 ＲＡ！ｖｌは
スレーブコンピュータ７分よびローカルコンピュータ８
にも同様に収けてあり、これらには共・題の番号１１．
１２．１５゜１６に対応するサフィックスＳ、Ｌｔ−附
は説明は省略するつ メインコンピュータ１に戻って、３屯は人力ボート、４
（は出力ポートで、そｎぞれバス１２Ｍを介してＣＰＵ
１１八■と煮、読して分り、図示しない被制御機器か
うの・言号を入力したり、被１１］御機器への制御出力
を出力したりてる。 １：□（スレーブコノピユー
タ７は、メインコンピュータ１との共有メモ’） （Ｄ
ＰＭ ｌ １８を持っており、パス切Ｗ’Ｌ 器（Ｔ／
Ｒ） １７７（介してメインコンピュータ１側のバス１
２Ｍおよびスレーブコンピュータ７１１１１Ｉノバス１
２８の双方に接続する。１９８はデータ通信用送受信器
（以下ＵＳＡＲＴと呼ぶ）で、バス１２Ｓに接続すると
共に、シリアル伝送゛４２０を斤してｏ −カルコンピ
ユータ８のＵＳＡＲＴ １９Ｌと接続する。このＵＳＡ
ＲＴ Ｌ９Ｌの他端はローカルコンピュータ８のバス１
２Ｌ Ｌ！： 接ａ スる。またローカルコンピュータ
８は押釦スイッチ２からの指令を人力する入力ボート１
３および辰示灯４への出力を生じろ出力ポート１４を待
って２す、それぞれバスＬ２Ｔ、ｉ・こ接続する。
スレーブコンピュータ７分よびローカルコンピュータ８
にも同様に収けてあり、これらには共・題の番号１１．
１２．１５゜１６に対応するサフィックスＳ、Ｌｔ−附
は説明は省略するつ メインコンピュータ１に戻って、３屯は人力ボート、４
（は出力ポートで、そｎぞれバス１２Ｍを介してＣＰＵ
１１八■と煮、読して分り、図示しない被制御機器か
うの・言号を入力したり、被１１］御機器への制御出力
を出力したりてる。 １：□（スレーブコノピユー
タ７は、メインコンピュータ１との共有メモ’） （Ｄ
ＰＭ ｌ １８を持っており、パス切Ｗ’Ｌ 器（Ｔ／
Ｒ） １７７（介してメインコンピュータ１側のバス１
２Ｍおよびスレーブコンピュータ７１１１１Ｉノバス１
２８の双方に接続する。１９８はデータ通信用送受信器
（以下ＵＳＡＲＴと呼ぶ）で、バス１２Ｓに接続すると
共に、シリアル伝送゛４２０を斤してｏ −カルコンピ
ユータ８のＵＳＡＲＴ １９Ｌと接続する。このＵＳＡ
ＲＴ Ｌ９Ｌの他端はローカルコンピュータ８のバス１
２Ｌ Ｌ！： 接ａ スる。またローカルコンピュータ
８は押釦スイッチ２からの指令を人力する入力ボート１
３および辰示灯４への出力を生じろ出力ポート１４を待
って２す、それぞれバスＬ２Ｔ、ｉ・こ接続する。
以上の構成の概略の動作を説明−ｒる。６４２図で示す
操作机６に設置された押工日ス１ノチ２のｍｌｌ ・回
入力は、ローカルマイクロコンビ−１−夕８が受ケて、
多重選択防止等の演算処理をした・麦、その信号を符号
化する。すなわちローカルコンピュータ８の入力ポート
１３へ制御入力として、押釦スイッチ２の信号が入り、
バス１２Ｌを逍して、ＣＰＵ１１Ｌが読み取り、囮Ｍ１
６ＬとＲＩ３、ｆ１５Ｌと定エリ、あらかじめ決められ
たデータジム（ＲＯＭ １６Ｌに記憶さｎでいる）に従
って入力信号が何であるかを判別する。１す時忙多重選
択などの誤りがないかをチェックして該当の符号（例え
ばアスキーコードなど）に変換するう変換された符号け
ＵＳＡＲＴ １９Ｌで並列データを直列データに変換し
て、シリアル伝送線２０を経由してスレーブコンピュー
タ７へ伝送される。スレーブコンビニ−タフはその符号
をマスターコンピュータ１との共有メモリ１８に蓄き込
む。スレーブコンピュータ７は前記シリアル伝送で送ら
れた信号をＵＳＡＲＴ １９８で受信し、再び並列デー
タに変換する。スレーブコンピュータ７ ノＣＰＵ １
１８はＵＳＡＲＴ １９８がらの並列データをバス１２
Ｓを経由しバス切換器１７全通して共有メモＩＪ １８
に書き込む。バス切換器１７はマスクコンピュータｌの
側からＤＰＭ １８を読み書きするときと、スレーブコ
ノピユ−タフの側からＤＰＭ １８を読み書きするとき
とが、重ならないように切換動作の役割をしている。マ
スクコンピュータ１のＣＰＵ１１Ｍは共有メモリ１８に
書き込まれた前記のデータを読み取り、ＲＯＭ １６Ｍ
に格納されたグログラムに従って制御演算をする。そし
てその結果を共有メモリ１８に書き込む。もちろん、こ
の演算結果に該当する制御出力を出力ポート５から被制
御機器に出力するっ共有メモリ１８に書き込まれたデー
タは、スレーブコンピュータ７ ノＣＰＵ １１．！１
１・が読み取り、ＵＳＡＲＴ １９８を通してシリアル
伝送を行い、ローカルコンピュータ８に伝える。ローカ
ルコンピュータ８のＣＰＵ ＩＬＬはシリアル伝送され
てきたデータをＵＳＡＲＴ １９Ｌを通して受取り、該
当の表示出力を出力ポート１４を通して出力し、表示灯
４を点灯又は消灯させる。
操作机６に設置された押工日ス１ノチ２のｍｌｌ ・回
入力は、ローカルマイクロコンビ−１−夕８が受ケて、
多重選択防止等の演算処理をした・麦、その信号を符号
化する。すなわちローカルコンピュータ８の入力ポート
１３へ制御入力として、押釦スイッチ２の信号が入り、
バス１２Ｌを逍して、ＣＰＵ１１Ｌが読み取り、囮Ｍ１
６ＬとＲＩ３、ｆ１５Ｌと定エリ、あらかじめ決められ
たデータジム（ＲＯＭ １６Ｌに記憶さｎでいる）に従
って入力信号が何であるかを判別する。１す時忙多重選
択などの誤りがないかをチェックして該当の符号（例え
ばアスキーコードなど）に変換するう変換された符号け
ＵＳＡＲＴ １９Ｌで並列データを直列データに変換し
て、シリアル伝送線２０を経由してスレーブコンピュー
タ７へ伝送される。スレーブコンビニ−タフはその符号
をマスターコンピュータ１との共有メモリ１８に蓄き込
む。スレーブコンピュータ７は前記シリアル伝送で送ら
れた信号をＵＳＡＲＴ １９８で受信し、再び並列デー
タに変換する。スレーブコンピュータ７ ノＣＰＵ １
１８はＵＳＡＲＴ １９８がらの並列データをバス１２
Ｓを経由しバス切換器１７全通して共有メモＩＪ １８
に書き込む。バス切換器１７はマスクコンピュータｌの
側からＤＰＭ １８を読み書きするときと、スレーブコ
ノピユ−タフの側からＤＰＭ １８を読み書きするとき
とが、重ならないように切換動作の役割をしている。マ
スクコンピュータ１のＣＰＵ１１Ｍは共有メモリ１８に
書き込まれた前記のデータを読み取り、ＲＯＭ １６Ｍ
に格納されたグログラムに従って制御演算をする。そし
てその結果を共有メモリ１８に書き込む。もちろん、こ
の演算結果に該当する制御出力を出力ポート５から被制
御機器に出力するっ共有メモリ１８に書き込まれたデー
タは、スレーブコンピュータ７ ノＣＰＵ １１．！１
１・が読み取り、ＵＳＡＲＴ １９８を通してシリアル
伝送を行い、ローカルコンピュータ８に伝える。ローカ
ルコンピュータ８のＣＰＵ ＩＬＬはシリアル伝送され
てきたデータをＵＳＡＲＴ １９Ｌを通して受取り、該
当の表示出力を出力ポート１４を通して出力し、表示灯
４を点灯又は消灯させる。
このように１マスタコンピユータ１はスレーブコンヒユ
ータフに設置された共有メモリ１８のデータを読むだけ
で操作机６からの入力を受けることができる。又共有メ
モリ１８にデータを書き込むだけで操作机６の表示灯を
点滅することができる。
ータフに設置された共有メモリ１８のデータを読むだけ
で操作机６からの入力を受けることができる。又共有メ
モリ１８にデータを書き込むだけで操作机６の表示灯を
点滅することができる。
又スレーブコンピュータ７とローカルコンピュータ８の
間はシリアル伝送のため入力数なよび出力数が多くても
、伝送線２０は往復４本で済む。
間はシリアル伝送のため入力数なよび出力数が多くても
、伝送線２０は往復４本で済む。
従ってこの間の距離が長くても配線工事コストが少なく
て済む。
て済む。
尚スレーブコンピュータ７のプログラムは、共有メモ’
７１８のデータが変化したときまたは周期的なローカル
コンピュータ８との間のデータ送受信の機能があｎばよ
いためワンボードマイクロコンピュータで十分である。
７１８のデータが変化したときまたは周期的なローカル
コンピュータ８との間のデータ送受信の機能があｎばよ
いためワンボードマイクロコンピュータで十分である。
これはローカルコンピユーｐ８も同様である、
また上記実施例では、入出力装置として押釦スイッチ２
と表示灯４を用いた場合を説明したが、これらに代って
ローカルコンピュータ８の入出力装置にプラズマディス
プレイなどを用いてもよいさりに、共有メモリ１８のデ
ータを決められたコントロールコードやコマンドとして
使用すればローカルコンピュータ８ではランプチェック
や表示灯のフリッカ点灯などの指令として受は所定の出
力をすることも簡単〈できるのでマスクコンピュータＬ
は余分なプログラムを必要としない。
と表示灯４を用いた場合を説明したが、これらに代って
ローカルコンピュータ８の入出力装置にプラズマディス
プレイなどを用いてもよいさりに、共有メモリ１８のデ
ータを決められたコントロールコードやコマンドとして
使用すればローカルコンピュータ８ではランプチェック
や表示灯のフリッカ点灯などの指令として受は所定の出
力をすることも簡単〈できるのでマスクコンピュータＬ
は余分なプログラムを必要としない。
〔発明の効果〕
以上のように本発明によればマスタコンピュータの入出
力処理を簡単にするとともに周辺機器との間の配線コス
トも安くすることができるイノタフェイスを備えた電子
計算機システムを得ることができる。
力処理を簡単にするとともに周辺機器との間の配線コス
トも安くすることができるイノタフェイスを備えた電子
計算機システムを得ることができる。
第１図は従来装置を示すブロック図、第２図は本発明に
よる電子計算機システムの一実施例を示すブロック図、
第３図は第２図で示した各部の詳細構成を示すブロック
図である、 ｌ・・・マスタコンピュータ、２人・・・入出力装置、
７・・・スレーブコンピュータ、 ８…ローカルコンピユータ、 １１に１１８．ＩＩＬ・・・中央演算素子、１２Ｍ、
１２８．１２Ｌ・・・アドレス、データおよびコントロ
ールパス １８・・・共有メモリ、 １９・・・データ通信用送受信器、 ２０・・・シリアル伝送線。
よる電子計算機システムの一実施例を示すブロック図、
第３図は第２図で示した各部の詳細構成を示すブロック
図である、 ｌ・・・マスタコンピュータ、２人・・・入出力装置、
７・・・スレーブコンピュータ、 ８…ローカルコンピユータ、 １１に１１８．ＩＩＬ・・・中央演算素子、１２Ｍ、
１２８．１２Ｌ・・・アドレス、データおよびコントロ
ールパス １８・・・共有メモリ、 １９・・・データ通信用送受信器、 ２０・・・シリアル伝送線。
Claims (1)
- メインコンピュータと、このメインコンピュータと内部
バスを介して妥続するスレーブコンピュータと、このス
レーブコンピュータとシリアル伝送線を介して接続する
ローカルコンピュータと、このローカルコンピュータに
後続される入出力装置とを備え、ローカルコンピュータ
は予定のプログラムにより入出力装置からの入力を判別
し所定ノ処理を行った後スレーブコンビエータにシＩＪ
フル伝送すると共にスレーブコンピュータから受信し
たデータに該当する表示６に出力を与える中央演算素子
を有し、スレーブコンピュータは予定のプログラムによ
やローカルコンピュータからシリアル伝送さｎてくるデ
ータをメインコンピュータとの共呵メモリに書き込むと
共（Ｃメインコンビエータによって共有メモリに書き込
まれたデータを読み出してこれをローカルコンピュータ
にシＩＪ フル伝送する中央演算素子を有し、メインコ
ンピュータは予定のプログラムによりスレーブコンピュ
ータによって共有メモリに書き込まれたデータを読み出
して演算処理しこのデータに対応する出力を被制御機器
に出力すると共にこの出力に対応するデータを共有メモ
ＩＪ Ｋ書き込む中央演算素子を有する電子計算機シス
テム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8502782A JPS58203534A (ja) | 1982-05-21 | 1982-05-21 | 電子計算機システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8502782A JPS58203534A (ja) | 1982-05-21 | 1982-05-21 | 電子計算機システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58203534A true JPS58203534A (ja) | 1983-11-28 |
Family
ID=13847228
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8502782A Pending JPS58203534A (ja) | 1982-05-21 | 1982-05-21 | 電子計算機システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58203534A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61255461A (ja) * | 1985-05-07 | 1986-11-13 | Fuji Xerox Co Ltd | マルチｃｐｕ通信装置 |
| JPS61281691A (ja) * | 1985-04-08 | 1986-12-12 | デイタポイント、コ−パレイシヤン | テレビ会議ネツトワ−クに結合する方法及び作業ステ−シヨン |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50113148A (ja) * | 1974-02-15 | 1975-09-05 | ||
| JPS5317232A (en) * | 1976-07-31 | 1978-02-17 | Toshiba Corp | Device switching unit |
| JPS5324238A (en) * | 1976-08-18 | 1978-03-06 | Nec Corp | Data processing system for display system |
-
1982
- 1982-05-21 JP JP8502782A patent/JPS58203534A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50113148A (ja) * | 1974-02-15 | 1975-09-05 | ||
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| JPS61255461A (ja) * | 1985-05-07 | 1986-11-13 | Fuji Xerox Co Ltd | マルチｃｐｕ通信装置 |
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