JPS58201189A - 座標入力装置 - Google Patents
座標入力装置Info
- Publication number
- JPS58201189A JPS58201189A JP57085892A JP8589282A JPS58201189A JP S58201189 A JPS58201189 A JP S58201189A JP 57085892 A JP57085892 A JP 57085892A JP 8589282 A JP8589282 A JP 8589282A JP S58201189 A JPS58201189 A JP S58201189A
- Authority
- JP
- Japan
- Prior art keywords
- pressure
- input device
- point
- arithmetic processing
- coordinate input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/03—Arrangements for converting the position or the displacement of a member into a coded form
- G06F3/041—Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means
- G06F3/0414—Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means using force sensing means to determine a position
- G06F3/04142—Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means using force sensing means to determine a position the force sensing means being located peripherally, e.g. disposed at the corners or at the side of a touch sensing plate
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、コンピー−ターなどの電子機器に、２べく・
２次元座標値を入力する時に用いて有効な座標入力装置
に関するものである。
に関するものである。
以下、図面を用いて座標入力装置について具体的に説明
する。第１図は本発明に用いる圧力検出型の座標入力装
置の位置検出の原理を説明するだめの概略斜視図で、入
力面を３点支持した時の例である。第１図において、１
は入力面、２ａ、２ｂ。
する。第１図は本発明に用いる圧力検出型の座標入力装
置の位置検出の原理を説明するだめの概略斜視図で、入
力面を３点支持した時の例である。第１図において、１
は入力面、２ａ、２ｂ。
２Ｃは圧力検出器、３は支持体で入力面１上の支持点Ａ
、Ｂ、Ｃにおける分圧力を、圧力検出器２ａ、２ｂ、２
ｃへ伝達するためのものである。
、Ｂ、Ｃにおける分圧力を、圧力検出器２ａ、２ｂ、２
ｃへ伝達するためのものである。
入力面１上の１点Ｐに押圧力Ｆを印加した時、各支持点
Ａ、Ｂ、Ｃに、ｆａ、ｆｂ、ｆｏなる分圧力が印加され
たと仮定し、各支持点Ａ、Ｂ、Ｃの座標を第２図に示す
ように、Ａ（−り、ｏ）、Ｂ（Ｌ、ｏ）。
Ａ、Ｂ、Ｃに、ｆａ、ｆｂ、ｆｏなる分圧力が印加され
たと仮定し、各支持点Ａ、Ｂ、Ｃの座標を第２図に示す
ように、Ａ（−り、ｏ）、Ｂ（Ｌ、ｏ）。
Ｃ（○ｐ Ｈ）とし、押下力印加点Ｐの座標をＸ。
ｙとすれば、Ｘ、７は、
３ページ
なる式によシ求めることができる。
上記関係を実現するために、圧力検出器に印加圧力によ
って静電容量が変化する静電容量変化型の圧力検出器を
用い、第３図のブロック図に示されるように、上記圧力
検出器２ａ 、２ｂ 、２ｃの静電容量の変化を変換回
路４ａ 、４ｂ 、４ｃにより電気信号に変換し、減算
回路６、加算回路６、増幅回路７ｘ 、７ｙおよび、除
算回路８ｘ 、 ８ｙから成る演算処理回路９によシ演
算を行い、Ｘ。
って静電容量が変化する静電容量変化型の圧力検出器を
用い、第３図のブロック図に示されるように、上記圧力
検出器２ａ 、２ｂ 、２ｃの静電容量の変化を変換回
路４ａ 、４ｂ 、４ｃにより電気信号に変換し、減算
回路６、加算回路６、増幅回路７ｘ 、７ｙおよび、除
算回路８ｘ 、 ８ｙから成る演算処理回路９によシ演
算を行い、Ｘ。
ｙの座標値信号を取シ出す方法が採られている。
しかし、一般的に除算回路８ｘ 、８ｙは、動作入力電
圧範囲が制限されておシ、入力板１に印加できる圧力範
囲が制限される。また、変換回路４ａ、４ｂ、４ｃには
、時間遅れ要素が含まれるため、除算回路８ｘ 、８ｙ
の入力電圧が除算回路ＢＸ 、８７の動作範囲にはいる
まで一定の時間を必要とし、動作速度が遅くなるという
欠点がある。
圧範囲が制限されておシ、入力板１に印加できる圧力範
囲が制限される。また、変換回路４ａ、４ｂ、４ｃには
、時間遅れ要素が含まれるため、除算回路８ｘ 、８ｙ
の入力電圧が除算回路ＢＸ 、８７の動作範囲にはいる
まで一定の時間を必要とし、動作速度が遅くなるという
欠点がある。
本発明は、上記問題点を解決した簡単な構成の圧力検出
型の座標入力装置を提供するものであり、以下、図面に
基づき本発明を具体的に説明する。
型の座標入力装置を提供するものであり、以下、図面に
基づき本発明を具体的に説明する。
第４図は本発明の座標入力装置の信号処理回路の一実施
例を示すブロック図で、第３図と同一機能を有する部分
には同一番号を付す。同図において、加算回路６により
各圧力検出器からの出力信号の総和を求め出力する。１
０は電圧比較回路で、所定の閾値Ｅと加算回路６の出力
信号とを比較し、出力信号をサンプル・ホールド回路１
１ｘ、１１ｙに加える。サンプル・ホールド回路１１
ｘ 、 １１ ｙは、電圧比較回路１ｏの出力信号の変
化時点における増幅回路７ｘ 、７ｙの出力値を保持し
、それを出力する。上記のごとく構成することにより、
サンブリ・ホールド回路１１ｘ、１１ｙの出力信号は、
増幅回路７ｘ、７ｙの利得を所定の値に設定することで
、入力板１よの加圧印加点の座標値となる。
例を示すブロック図で、第３図と同一機能を有する部分
には同一番号を付す。同図において、加算回路６により
各圧力検出器からの出力信号の総和を求め出力する。１
０は電圧比較回路で、所定の閾値Ｅと加算回路６の出力
信号とを比較し、出力信号をサンプル・ホールド回路１
１ｘ、１１ｙに加える。サンプル・ホールド回路１１
ｘ 、 １１ ｙは、電圧比較回路１ｏの出力信号の変
化時点における増幅回路７ｘ 、７ｙの出力値を保持し
、それを出力する。上記のごとく構成することにより、
サンブリ・ホールド回路１１ｘ、１１ｙの出力信号は、
増幅回路７ｘ、７ｙの利得を所定の値に設定することで
、入力板１よの加圧印加点の座標値となる。
従って、演算処理回路１２を上記のごとく構成し、変換
回路４ａ、４ｂ、４ｃに含まれる時間遅れ要素の時定数
を同一に設定し、上記閾値Ｅを低く設定することで、上
記時間遅れ要素の時定数に関係なく動作速度を向上する
ことができる。
回路４ａ、４ｂ、４ｃに含まれる時間遅れ要素の時定数
を同一に設定し、上記閾値Ｅを低く設定することで、上
記時間遅れ要素の時定数に関係なく動作速度を向上する
ことができる。
５ページ
また、入力板１に動作限界を越える過大圧力が印加され
た場合でも、上記回路系が飽和するまでに座標値を出力
してしまうため、使用範囲が拡大される。
た場合でも、上記回路系が飽和するまでに座標値を出力
してしまうため、使用範囲が拡大される。
なお、第４図に示す信号処理回路のブロック図は一実施
例であってこれに限られるものではなく、例えば、１１
ｘ、１１７のサンプル・ホールド回路を用いず、増幅回
路７ｘ 、７ｙの出力信号をアナログ−ディジタル変換
回路でディジタル量に変換し、電圧比較回路１ｏの出力
信号により、ラッチなどの一時記憶レジスタに座標値を
保持、してもよい。
例であってこれに限られるものではなく、例えば、１１
ｘ、１１７のサンプル・ホールド回路を用いず、増幅回
路７ｘ 、７ｙの出力信号をアナログ−ディジタル変換
回路でディジタル量に変換し、電圧比較回路１ｏの出力
信号により、ラッチなどの一時記憶レジスタに座標値を
保持、してもよい。
以上の説明から明らかなように、本発明によれば従来の
問題点を解消した簡単な構成の座標入力装置が得られる
ため、その実用上の価値は多大である。
問題点を解消した簡単な構成の座標入力装置が得られる
ため、その実用上の価値は多大である。
第１図および第２図は本発明の座標入力装置の、ｍ、置
検出原理を説明するだめの概略斜視図と概略線図、第３
図は加圧検出型の座標入力装置の座標６ページ 算出回路の従来例を示すブロック図、第４図は本発明の
座標入力装置の座標算出回路の一実施例を示すブロック
図である。 １・・・・・・入力面、２ａ、２ｂ、２ａ・・・・・・
圧力検出器、３・・・・・・支持体、４ａ、４ｂ、４ｃ
・・・・・・変換回路、５・・・・・・減算回路、６・
・・・・・加算回路、７ｘ、７ｙ・・・・・・増幅回路
、ａｘ 、８ｙ・・・・・・除算回路、９・・・・・・
演算処理回路、１ｏ・・・・・・電圧比較回路、１１ｘ
。 １１ｙ・・・・・・サンプル・ホールド回路、１２・・
・・・・演算処理回路。
検出原理を説明するだめの概略斜視図と概略線図、第３
図は加圧検出型の座標入力装置の座標６ページ 算出回路の従来例を示すブロック図、第４図は本発明の
座標入力装置の座標算出回路の一実施例を示すブロック
図である。 １・・・・・・入力面、２ａ、２ｂ、２ａ・・・・・・
圧力検出器、３・・・・・・支持体、４ａ、４ｂ、４ｃ
・・・・・・変換回路、５・・・・・・減算回路、６・
・・・・・加算回路、７ｘ、７ｙ・・・・・・増幅回路
、ａｘ 、８ｙ・・・・・・除算回路、９・・・・・・
演算処理回路、１ｏ・・・・・・電圧比較回路、１１ｘ
。 １１ｙ・・・・・・サンプル・ホールド回路、１２・・
・・・・演算処理回路。
Claims (2)
- （１）少なくとも３点で支持された入力板上の１点に押
圧力を印加することができ、前記入力板の各支持点にお
ける分圧力を、前記各支持点部分に設けた圧力検出器に
よシ検出し、前記圧力検出器の出力信号に演算処理を施
すことにより、前記入力板に対する押圧力の印加点の座
標値を求めるごとく構成すると共に、前記圧力検出器の
各出力信号の総和が、所定の閾値に達した時に、前記演
算処理の結果が出力されるごとく構成したことを特徴と
する座標入力装置。 - （２）圧力検出器として、印加圧力の変化によって静電
容量が変化する静電容量変化型の圧力検出器を用いたこ
とを特徴とする特許請求の範囲第（１）項記載の座標入
力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57085892A JPS58201189A (ja) | 1982-05-20 | 1982-05-20 | 座標入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57085892A JPS58201189A (ja) | 1982-05-20 | 1982-05-20 | 座標入力装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58201189A true JPS58201189A (ja) | 1983-11-22 |
Family
ID=13871534
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57085892A Pending JPS58201189A (ja) | 1982-05-20 | 1982-05-20 | 座標入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58201189A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60254313A (ja) * | 1984-05-31 | 1985-12-16 | Nec Home Electronics Ltd | 座標入力装置 |
| KR100810455B1 (ko) | 2005-11-02 | 2008-03-07 | 이-리드 일렉트로닉 코포레이션, 리미티드 | 마이크로-키보드 시뮬레이터 |
-
1982
- 1982-05-20 JP JP57085892A patent/JPS58201189A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60254313A (ja) * | 1984-05-31 | 1985-12-16 | Nec Home Electronics Ltd | 座標入力装置 |
| KR100810455B1 (ko) | 2005-11-02 | 2008-03-07 | 이-리드 일렉트로닉 코포레이션, 리미티드 | 마이크로-키보드 시뮬레이터 |
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