JPS58177080A - 自動等化器 - Google Patents
自動等化器Info
- Publication number
- JPS58177080A JPS58177080A JP57059036A JP5903682A JPS58177080A JP S58177080 A JPS58177080 A JP S58177080A JP 57059036 A JP57059036 A JP 57059036A JP 5903682 A JP5903682 A JP 5903682A JP S58177080 A JPS58177080 A JP S58177080A
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- JP
- Japan
- Prior art keywords
- sample
- signal
- circuit
- sample circuit
- waveform
- Prior art date
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- Pending
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Picture Signal Circuits (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、テレビジョンビデオ信号用の自動波形等化
器に係り、特にテレビジョン侶号中の垂直ブランキング
期間のあらかじめ定められた部分を基準信号として伝送
系の線形歪を除去するトランスパーサルフィルタを用い
た自動鼓形等化器に関する。
器に係り、特にテレビジョン侶号中の垂直ブランキング
期間のあらかじめ定められた部分を基準信号として伝送
系の線形歪を除去するトランスパーサルフィルタを用い
た自動鼓形等化器に関する。
促来技術の間馳点を第１図の公知の自動波形等化器のブ
ロック図と第２図のサンプルホールダのブロック図と第
３図の信号波形図とを用いて説明する。基準信号として
、第３図（龜）に示される垂直同期信号の前縁（立ち下
がシ）の前抜幻１／２水平同期部分２２を例にとる。今
、線形歪として正の側方ゴースト、正の後方ゴースに貝
の後方ゴーストの各１個つつを例にとる。こｑ）ような
伝送歪を受けた基準信号２２の拡大図が第３図（ｂ）
ｘ（ｔ）でありさらに矢印で示すパルスの立ち下かり部
の形状がゆるやかなのは、伝送系が尚城敗分を通しにく
くなっていることを示している。
ロック図と第２図のサンプルホールダのブロック図と第
３図の信号波形図とを用いて説明する。基準信号として
、第３図（龜）に示される垂直同期信号の前縁（立ち下
がシ）の前抜幻１／２水平同期部分２２を例にとる。今
、線形歪として正の側方ゴースト、正の後方ゴースに貝
の後方ゴーストの各１個つつを例にとる。こｑ）ような
伝送歪を受けた基準信号２２の拡大図が第３図（ｂ）
ｘ（ｔ）でありさらに矢印で示すパルスの立ち下かり部
の形状がゆるやかなのは、伝送系が尚城敗分を通しにく
くなっていることを示している。
第１図において自動鼓形等化器の入力梃子１からの入力
信号Ｘ （ｔ） （第３図成形（ｂ））は、主伯−１！
ＩＢ２とトランスパーサルフィルタにより構成された打
消信号発生部３とタイミング発生部４とに入る。打消信
号発生部３に入った入力イ♂号ｘ （ｔ）は、（Ｎ＋Ｍ
＋１）個の差動掛算器２２に入る。この差動掛算器によ
って与えられるタッノダインは、後述するサンプルホー
ルドによって与えられるＣメモリの電圧によって決足さ
れ修正される。これら（Ｎ十Ｍ＋１）ｉ［ｉの差動掛算
器２１の中で時間的原点を与えるものが差動掛算器Ｍ６
２１ｍである。これら（Ｎ十Ｍ＋１）個の差動掛算器２
１の出力は、直列接続された（ Ｎ十Ｍ ）個の単位遅
延素子５にそれぞれ接続される。そしてこの打消信号発
生部３の出力信号が、打消信号ｘ１（ｔ）（第３し１汲
形（ｄ））となる。ここで、単位遅延素子５の単位遅延
索子Ｔ〔抄〕と入力信号ｘ （ｔ）の最高周波数成分／
ｗａｘ［Ｈｚ 〕とのｔ）ｊｉ ＶＣＩｎ、 なる関係がある。
信号Ｘ （ｔ） （第３図成形（ｂ））は、主伯−１！
ＩＢ２とトランスパーサルフィルタにより構成された打
消信号発生部３とタイミング発生部４とに入る。打消信
号発生部３に入った入力イ♂号ｘ （ｔ）は、（Ｎ＋Ｍ
＋１）個の差動掛算器２２に入る。この差動掛算器によ
って与えられるタッノダインは、後述するサンプルホー
ルドによって与えられるＣメモリの電圧によって決足さ
れ修正される。これら（Ｎ十Ｍ＋１）ｉ［ｉの差動掛算
器２１の中で時間的原点を与えるものが差動掛算器Ｍ６
２１ｍである。これら（Ｎ十Ｍ＋１）個の差動掛算器２
１の出力は、直列接続された（ Ｎ十Ｍ ）個の単位遅
延素子５にそれぞれ接続される。そしてこの打消信号発
生部３の出力信号が、打消信号ｘ１（ｔ）（第３し１汲
形（ｄ））となる。ここで、単位遅延素子５の単位遅延
索子Ｔ〔抄〕と入力信号ｘ （ｔ）の最高周波数成分／
ｗａｘ［Ｈｚ 〕とのｔ）ｊｉ ＶＣＩｎ、 なる関係がある。
一方、主侶号遅蝙部２は、打消信号発生部３内の単位）
！！畑累子５と同一の単位遅延素子６をＭ個直列接続し
たものである。そしてその出力１呂ち゛である遅嫉主信
号Ｘ！（ｔ）（第３図波形（Ｃ））は、ヂＪ消侶号１ｔ
（ｔ）の極性を反１ししたものと加算器７で加え合わさ
れ、その出力は出刃信号クランノ回路８を通って出力信
号ｙ （ｔ） （第３図波形（ｅ））として出力端子９
に導かれる。出力信号クランノ回路８は、出力信号のｉ
ｔｈ流１１ ｔｌ−める定ったー疋値ｋｃ保つ動きをす
る。タイミング発生部４からの制（ｌＩｌＩ伯号に信号
て参照信号発生部１０は、骸照侶号ｒ （ｔ） （第３
図波形（イ））を発生する。参照信号発生部１０は、前
記制御（Ｓ号によって奈照侶号を発生する参照信号発生
回路１１と、鯵照侶号のＩ！Ｌ＃ｃ値をある定まった一
定値に保つ径照＠号りラング回路１２とから構成されて
いる。
！！畑累子５と同一の単位遅延素子６をＭ個直列接続し
たものである。そしてその出力１呂ち゛である遅嫉主信
号Ｘ！（ｔ）（第３図波形（Ｃ））は、ヂＪ消侶号１ｔ
（ｔ）の極性を反１ししたものと加算器７で加え合わさ
れ、その出力は出刃信号クランノ回路８を通って出力信
号ｙ （ｔ） （第３図波形（ｅ））として出力端子９
に導かれる。出力信号クランノ回路８は、出力信号のｉ
ｔｈ流１１ ｔｌ−める定ったー疋値ｋｃ保つ動きをす
る。タイミング発生部４からの制（ｌＩｌＩ伯号に信号
て参照信号発生部１０は、骸照侶号ｒ （ｔ） （第３
図波形（イ））を発生する。参照信号発生部１０は、前
記制御（Ｓ号によって奈照侶号を発生する参照信号発生
回路１１と、鯵照侶号のＩ！Ｌ＃ｃ値をある定まった一
定値に保つ径照＠号りラング回路１２とから構成されて
いる。
この１照信号ｒ （ｔ）の極性を反転したものと前記出
力信号ｙ （ｔ）とが加算器１３で加え合わされ、胞差
匍号＠ （１） （第３図波形０））となシ、誤差項＠
Ｂ器１４によって、増＠廣息０倍されて第３図（ｈ）の
波形となる。この波形（ｈ）は、前記単位遅延索子５，
６と同一の（Ｎ＋Ｍ＋１）個の直列接続された単位遅延
索子１５と、これらの単位遅延素子からの（Ｎ十Ｍ＋２
）個の出力を父ける（Ｎ＋Ｍ＋２）個のサンプルホール
ド回路１６とから構成される制御部１７に導かれる。こ
れら（Ｎ十Ｍ＋２ ）個のサンプルホールド１６はタイ
ミング発生回路４からダートパルス信号メｔ１（第３図
波形（１））が導入される。
力信号ｙ （ｔ）とが加算器１３で加え合わされ、胞差
匍号＠ （１） （第３図波形０））となシ、誤差項＠
Ｂ器１４によって、増＠廣息０倍されて第３図（ｈ）の
波形となる。この波形（ｈ）は、前記単位遅延索子５，
６と同一の（Ｎ＋Ｍ＋１）個の直列接続された単位遅延
索子１５と、これらの単位遅延素子からの（Ｎ十Ｍ＋２
）個の出力を父ける（Ｎ＋Ｍ＋２）個のサンプルホール
ド回路１６とから構成される制御部１７に導かれる。こ
れら（Ｎ十Ｍ＋２ ）個のサンプルホールド１６はタイ
ミング発生回路４からダートパルス信号メｔ１（第３図
波形（１））が導入される。
サンプルホールダ１６の中の１つのより畦しいブロック
図が第２図である。サンプル回路ダ１６は、サンプルホ
ールダの入力を入力とするサンプル回路１８と、一端か
接地され他の一端か前記サンプル回路１８の出力に接続
されたコンデンサＣ２０（このコンデンサＨｅメモリと
も呼ばれる）と、入力が前記コンデンサＣ２０に接続さ
れ、出力かサンプルホールダの出力となるホールド回路
１９とからなる。サンダル回路１８の製作は、前記タイ
ミング発生部４からのダート・母ルス佃号ｐ （ｔ）
（第３図波形０））の電圧が為い時、つまシ波形伽）の
矢印を付した時間から（Ｍ十Ｎ＋’）Ｔ（秒〕後の時間
を中心とし、幅をＴｇとした期間のみ波形（ｈ）をコン
デンサＣ・、２０に電圧としてサンプルし、それ以外の
時間は、その入力と出力とが等倹約に開放されるもので
ある。コンデンサＣ２０の動作は、サンプルされた信号
′−１圧を次のサンダル時まで保持することであり、こ
の場合書き込み周期は、ｌ垂直Ｎ期周勘１／６０ ［秒
〕である。ホールド（ロ）路１９の動作は、コンデンサ
Ｃ２０に保持されている電圧を震えないで前記差動ｍ算
器２ノの差動入力に与えることでおる。前記差動掛算器
Ｍ＠２１ａ、よりｎＴ ［秒〕遅れた打消信号を作る差
動掛算器Ｍｎ２１ｂＦｉ、サンプルホールダ１６ａの出
力電圧とサンプルホールダ１６ｂの出力電圧との差と入
力、 （１）との槓に比例した信号を作るものである。
図が第２図である。サンプル回路ダ１６は、サンプルホ
ールダの入力を入力とするサンプル回路１８と、一端か
接地され他の一端か前記サンプル回路１８の出力に接続
されたコンデンサＣ２０（このコンデンサＨｅメモリと
も呼ばれる）と、入力が前記コンデンサＣ２０に接続さ
れ、出力かサンプルホールダの出力となるホールド回路
１９とからなる。サンダル回路１８の製作は、前記タイ
ミング発生部４からのダート・母ルス佃号ｐ （ｔ）
（第３図波形０））の電圧が為い時、つまシ波形伽）の
矢印を付した時間から（Ｍ十Ｎ＋’）Ｔ（秒〕後の時間
を中心とし、幅をＴｇとした期間のみ波形（ｈ）をコン
デンサＣ・、２０に電圧としてサンプルし、それ以外の
時間は、その入力と出力とが等倹約に開放されるもので
ある。コンデンサＣ２０の動作は、サンプルされた信号
′−１圧を次のサンダル時まで保持することであり、こ
の場合書き込み周期は、ｌ垂直Ｎ期周勘１／６０ ［秒
〕である。ホールド（ロ）路１９の動作は、コンデンサ
Ｃ２０に保持されている電圧を震えないで前記差動ｍ算
器２ノの差動入力に与えることでおる。前記差動掛算器
Ｍ＠２１ａ、よりｎＴ ［秒〕遅れた打消信号を作る差
動掛算器Ｍｎ２１ｂＦｉ、サンプルホールダ１６ａの出
力電圧とサンプルホールダ１６ｂの出力電圧との差と入
力、 （１）との槓に比例した信号を作るものである。
以下この権の自ｍｌ化益に要求されるサンプルホールド
の特徴を説明することによって、促米技術の問題点を明
らかにする。
の特徴を説明することによって、促米技術の問題点を明
らかにする。
このサンダルか−／ダのホールド時間は、すンプル周期
であるｌ垂直同期１／６０ （秒〕であり、サンプル時
間Ｔｇ＃′ｉはぼ単位遅延素子６０単位遅延時間Ｔ以内
である。等化の対象であるテレビジョンビデオ信号の最
高周波数成分子ｍ＊ｘ （ＨＸ３を５ＭＨｚとすると、
式（１）より Ｔｇ＜Ｔ≦１００ 〔ｎｅ＠ｔ） −（２１とな
る。従って、ホールド時間とサンプル時間の比が、はぼ
１．７Ｘ１０５と非常に大きな値になるので、ホールド
時間におけるＣメそりの１１荷の陶れによるボールド電
圧の変化を許容できる範囲にするためには、Ｃメモリの
容量を大きくせざるを得ない、Ｃメモリの容量のみ大き
くしてＣメモリへのサンプル回路の充放電々流の最大電
流が一定であると、−回のサングル動作にょるＣメモリ
の電圧変化が小さくなるので、自動等化に要する時間が
長くなる。なお自動等化を安定に行うためには、１回の
サンプル動作のみで波形（ｈ）をＣメモリにサンプルす
るのではなく、適当な核数回のサンプル動作で行うこと
は明らかである。従ってＣメモリのもれによるボールド
電圧の変化を許容できる範囲にし、かつ自動等化に要す
る時間を長くしないためＫは、サンノル回路の電流を大
きくしてＣメモリへの充放電々流の最大電流を大きくせ
ざるを得ない。これは、サンダル回路の消費電力の増大
による自動波形等化システムとしての信頼性の低下、放
熱処理のためのコストアップという問題に従来つながっ
ていた。特にシステム全体としてＩＣ化を行う際にこれ
らの゛間趙は大き′かった。
であるｌ垂直同期１／６０ （秒〕であり、サンプル時
間Ｔｇ＃′ｉはぼ単位遅延素子６０単位遅延時間Ｔ以内
である。等化の対象であるテレビジョンビデオ信号の最
高周波数成分子ｍ＊ｘ （ＨＸ３を５ＭＨｚとすると、
式（１）より Ｔｇ＜Ｔ≦１００ 〔ｎｅ＠ｔ） −（２１とな
る。従って、ホールド時間とサンプル時間の比が、はぼ
１．７Ｘ１０５と非常に大きな値になるので、ホールド
時間におけるＣメそりの１１荷の陶れによるボールド電
圧の変化を許容できる範囲にするためには、Ｃメモリの
容量を大きくせざるを得ない、Ｃメモリの容量のみ大き
くしてＣメモリへのサンプル回路の充放電々流の最大電
流が一定であると、−回のサングル動作にょるＣメモリ
の電圧変化が小さくなるので、自動等化に要する時間が
長くなる。なお自動等化を安定に行うためには、１回の
サンプル動作のみで波形（ｈ）をＣメモリにサンプルす
るのではなく、適当な核数回のサンプル動作で行うこと
は明らかである。従ってＣメモリのもれによるボールド
電圧の変化を許容できる範囲にし、かつ自動等化に要す
る時間を長くしないためＫは、サンノル回路の電流を大
きくしてＣメモリへの充放電々流の最大電流を大きくせ
ざるを得ない。これは、サンダル回路の消費電力の増大
による自動波形等化システムとしての信頼性の低下、放
熱処理のためのコストアップという問題に従来つながっ
ていた。特にシステム全体としてＩＣ化を行う際にこれ
らの゛間趙は大き′かった。
この発＃３はホールド期間中の消費電力を減じた自動波
形等化器を提供することを目的とするものである。
形等化器を提供することを目的とするものである。
この発明は、ホールド期間中においてサンプルホールド
のサンプル回路の動作を停止させることによって、平−
消費電力を減じて、自動等化システムとしての信頼性を
向上させるとともに、放熱処理のためのコストを減じ、
％にシステム全体のＩＣ化を容易にしたものである。
のサンプル回路の動作を停止させることによって、平−
消費電力を減じて、自動等化システムとしての信頼性を
向上させるとともに、放熱処理のためのコストを減じ、
％にシステム全体のＩＣ化を容易にしたものである。
第４図は本発明の一実施例を示す自動波形等化器のブロ
ック図である。第１図の公知の自動波形等化器のブロッ
ク図とは、サンプルホールド回路１６にタイミング発生
部４からのサンノラ動作ノＪ？ルス（１）が導かれてい
るところが異る。
ック図である。第１図の公知の自動波形等化器のブロッ
ク図とは、サンプルホールド回路１６にタイミング発生
部４からのサンノラ動作ノＪ？ルス（１）が導かれてい
るところが異る。
このサンノラ動作ノ臂ルスｑ（ｔ）は、ダートパルス信
号ｐ（ｔ） （第３図波形０）を包含する形でめシ、例
えは第３図波形（ｊ）のようなものである。
号ｐ（ｔ） （第３図波形０）を包含する形でめシ、例
えは第３図波形（ｊ）のようなものである。
第５図が本発明による自動波形等化器におけるサンプル
ホールド回路のブロック図であり、第２図のサンプルホ
ールド回路のプロ、り図とは、前記サングラ動作・母ル
スｑ（ｔ）がサンダル回路１８に導かれている点が異る
。つまり、ボールド期間の大部分はサンプル回路の動作
か停止している。よシ具体的に説明すれば、例えばサン
プル回路を構成する電流源の電流を流さなくして、Ｃメ
モリ２０とサンプル回路１８と＃′ｉＳ価的に開放状態
になっている。そして、ダートパルスｐ（ｔ） （第３
図波形０））によるサンプリングを正確に行うのに充分
なΔルス幅を持つサンプラ％＋１作・母ルスｑ（ｔ）
（第３図波形（ｊ））が加えられ、例えばサンプル回路
を構成する電流源の電流が流される。そしてサンプリン
グが完了した後に再びサンプル回路の動作を停止させる
。
ホールド回路のブロック図であり、第２図のサンプルホ
ールド回路のプロ、り図とは、前記サングラ動作・母ル
スｑ（ｔ）がサンダル回路１８に導かれている点が異る
。つまり、ボールド期間の大部分はサンプル回路の動作
か停止している。よシ具体的に説明すれば、例えばサン
プル回路を構成する電流源の電流を流さなくして、Ｃメ
モリ２０とサンプル回路１８と＃′ｉＳ価的に開放状態
になっている。そして、ダートパルスｐ（ｔ） （第３
図波形０））によるサンプリングを正確に行うのに充分
なΔルス幅を持つサンプラ％＋１作・母ルスｑ（ｔ）
（第３図波形（ｊ））が加えられ、例えばサンプル回路
を構成する電流源の電流が流される。そしてサンプリン
グが完了した後に再びサンプル回路の動作を停止させる
。
このようにして、この発明によればサンプル回路の平均
消費電力を効果的に減少させることができるので、自動
等化システムとしての信頼性の向上、放熱処理のための
コストの減少を町岨にし、特に自動等化器のＩＣ化を容
易にするとかできる。また上記実施例によりば、率１ｃ
Ｉ−” −）パルスが来た時のみサンプル回路を動作さ
せ同時にサンプリングする方式に比べて、ダート・９ル
スに先だつサングラ動作、４ルスによって、サンノル動
作の準備ができているので、より正確Ｖｔ、−ダート／
４’ルスによるサンプリングができるという効果がある
。
消費電力を効果的に減少させることができるので、自動
等化システムとしての信頼性の向上、放熱処理のための
コストの減少を町岨にし、特に自動等化器のＩＣ化を容
易にするとかできる。また上記実施例によりば、率１ｃ
Ｉ−” −）パルスが来た時のみサンプル回路を動作さ
せ同時にサンプリングする方式に比べて、ダート・９ル
スに先だつサングラ動作、４ルスによって、サンノル動
作の準備ができているので、より正確Ｖｔ、−ダート／
４’ルスによるサンプリングができるという効果がある
。
第１図は公知の自動波形等化器のプロ、り図、第２図は
第１図の自動波形等信器におけるサングルホールダのプ
ロ、り図、第３図は第１図および第４図の自動波形等化
器の各部の信号波形図、第４図はこの発明の一実施例の
自動波形等化器のブロック図、第５図は第４図の自動波
形％ 化Ｗにおけるサンプルホールダのプロ、り図であ
る。 １・・・入力端子、２・・・主信号遅蝙部、３・・・打
消信号発生部、４・・・タイミング発生部、５１６９１
５・・・単位遅純素子、７．１３・・・加算番、８・・
・出力信号クランノ回路、９・・・出力端子、１０・・
・参照信号発生部、１１・・・参照信号発生回路−１２
・・・参照信号クランプ回路、１４・・・誤差増幅器、
１６・・・サンプルホールド回路、１７・・・制御部、
１８・・・サンプル回路、１ゝ９・・・ホールド回路、
２０・・・コンデンサ（Ｃメモリ）、２１・・・差動掛
簀益。 出願人代理人 弁理士 鈴 江 武 彦第２図 第５図 （ｄ） ｘ＋（ｔ） （ｅ） Ｙ（ｔ） −一り一一一一； （ｆ） ｒ（ｔ） −一を一一一一一（ｇ） ｅ（
ｔ） ■ ■ う ＜ｊ）テ（１）
第１図の自動波形等信器におけるサングルホールダのプ
ロ、り図、第３図は第１図および第４図の自動波形等化
器の各部の信号波形図、第４図はこの発明の一実施例の
自動波形等化器のブロック図、第５図は第４図の自動波
形％ 化Ｗにおけるサンプルホールダのプロ、り図であ
る。 １・・・入力端子、２・・・主信号遅蝙部、３・・・打
消信号発生部、４・・・タイミング発生部、５１６９１
５・・・単位遅純素子、７．１３・・・加算番、８・・
・出力信号クランノ回路、９・・・出力端子、１０・・
・参照信号発生部、１１・・・参照信号発生回路−１２
・・・参照信号クランプ回路、１４・・・誤差増幅器、
１６・・・サンプルホールド回路、１７・・・制御部、
１８・・・サンプル回路、１ゝ９・・・ホールド回路、
２０・・・コンデンサ（Ｃメモリ）、２１・・・差動掛
簀益。 出願人代理人 弁理士 鈴 江 武 彦第２図 第５図 （ｄ） ｘ＋（ｔ） （ｅ） Ｙ（ｔ） −一り一一一一； （ｆ） ｒ（ｔ） −一を一一一一一（ｇ） ｅ（
ｔ） ■ ■ う ＜ｊ）テ（１）
Claims (1)
- テレビジ、ンビデオ信号をトランスパーサルフィルタに
導入し、前記テレビジ、ンビデオ信号中の垂直ブランキ
ング期間のあらかじめ定められた部分を基準信号として
この基準信号の参照信号に対する誤差信号を増幅した信
号をサングルホールドするサンプルホールダの出力にょ
シ前配トランスパーサルフィルタのメッググインを修正
することによって、前記テレビジョンビデオ信号の伝送
歪を除去する自動波形等化器において、前記サングルホ
ールドにおけるサンプル回路の動作をホールド期間中停
止させるように構成したことを％徴とする自動鼓形等化
器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57059036A JPS58177080A (ja) | 1982-04-09 | 1982-04-09 | 自動等化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57059036A JPS58177080A (ja) | 1982-04-09 | 1982-04-09 | 自動等化器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58177080A true JPS58177080A (ja) | 1983-10-17 |
Family
ID=13101660
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57059036A Pending JPS58177080A (ja) | 1982-04-09 | 1982-04-09 | 自動等化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58177080A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02186839A (ja) * | 1989-01-13 | 1990-07-23 | Mitsubishi Electric Corp | 適応形自動等化器 |
-
1982
- 1982-04-09 JP JP57059036A patent/JPS58177080A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02186839A (ja) * | 1989-01-13 | 1990-07-23 | Mitsubishi Electric Corp | 適応形自動等化器 |
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